avProjDoxygen
Loading...
Searching...
No Matches
Data Structures | Macros | Enumerations
stm32f303xe.h File Reference

CMSIS STM32F303xE Devices Peripheral Access Layer Header File. More...

#include "core_cm4.h"
#include "system_stm32f3xx.h"
#include <stdint.h>

Go to the source code of this file.

Data Structures

struct  ADC_TypeDef
 Analog to Digital Converter. More...
 
struct  ADC_Common_TypeDef
 
struct  CAN_TxMailBox_TypeDef
 Controller Area Network TxMailBox. More...
 
struct  CAN_FIFOMailBox_TypeDef
 Controller Area Network FIFOMailBox. More...
 
struct  CAN_FilterRegister_TypeDef
 Controller Area Network FilterRegister. More...
 
struct  CAN_TypeDef
 Controller Area Network. More...
 
struct  COMP_TypeDef
 Analog Comparators. More...
 
struct  COMP_Common_TypeDef
 
struct  CRC_TypeDef
 CRC calculation unit. More...
 
struct  DAC_TypeDef
 Digital to Analog Converter. More...
 
struct  DBGMCU_TypeDef
 Debug MCU. More...
 
struct  DMA_Channel_TypeDef
 DMA Controller. More...
 
struct  DMA_TypeDef
 
struct  EXTI_TypeDef
 External Interrupt/Event Controller. More...
 
struct  FLASH_TypeDef
 FLASH Registers. More...
 
struct  FMC_Bank1_TypeDef
 Flexible Memory Controller. More...
 
struct  FMC_Bank1E_TypeDef
 Flexible Memory Controller Bank1E. More...
 
struct  FMC_Bank2_3_TypeDef
 Flexible Memory Controller Bank2. More...
 
struct  FMC_Bank4_TypeDef
 Flexible Memory Controller Bank4. More...
 
struct  OB_TypeDef
 Option Bytes Registers. More...
 
struct  GPIO_TypeDef
 General Purpose I/O. More...
 
struct  OPAMP_TypeDef
 Operational Amplifier (OPAMP) More...
 
struct  SYSCFG_TypeDef
 System configuration controller. More...
 
struct  I2C_TypeDef
 Inter-integrated Circuit Interface. More...
 
struct  IWDG_TypeDef
 Independent WATCHDOG. More...
 
struct  PWR_TypeDef
 Power Control. More...
 
struct  RCC_TypeDef
 Reset and Clock Control. More...
 
struct  RTC_TypeDef
 Real-Time Clock. More...
 
struct  SPI_TypeDef
 Serial Peripheral Interface. More...
 
struct  TIM_TypeDef
 TIM. More...
 
struct  TSC_TypeDef
 Touch Sensing Controller (TSC) More...
 
struct  USART_TypeDef
 Universal Synchronous Asynchronous Receiver Transmitter. More...
 
struct  USB_TypeDef
 Universal Serial Bus Full Speed Device. More...
 
struct  WWDG_TypeDef
 Window WATCHDOG. More...
 

Macros

#define __CM4_REV   0x0001U
 Configuration of the Cortex-M4 Processor and Core Peripherals.
 
#define __MPU_PRESENT   1U
 
#define __NVIC_PRIO_BITS   4U
 
#define __Vendor_SysTickConfig   0U
 
#define __FPU_PRESENT   1U
 
#define FLASH_BASE   0x08000000UL
 
#define CCMDATARAM_BASE   0x10000000UL
 
#define SRAM_BASE   0x20000000UL
 
#define PERIPH_BASE   0x40000000UL
 
#define FMC_BASE   0x60000000UL
 
#define FMC_R_BASE   0xA0000000UL
 
#define SRAM_BB_BASE   0x22000000UL
 
#define PERIPH_BB_BASE   0x42000000UL
 
#define APB1PERIPH_BASE   PERIPH_BASE
 
#define APB2PERIPH_BASE   (PERIPH_BASE + 0x00010000UL)
 
#define AHB1PERIPH_BASE   (PERIPH_BASE + 0x00020000UL)
 
#define AHB2PERIPH_BASE   (PERIPH_BASE + 0x08000000UL)
 
#define AHB3PERIPH_BASE   (PERIPH_BASE + 0x10000000UL)
 
#define TIM2_BASE   (APB1PERIPH_BASE + 0x00000000UL)
 
#define TIM3_BASE   (APB1PERIPH_BASE + 0x00000400UL)
 
#define TIM4_BASE   (APB1PERIPH_BASE + 0x00000800UL)
 
#define TIM6_BASE   (APB1PERIPH_BASE + 0x00001000UL)
 
#define TIM7_BASE   (APB1PERIPH_BASE + 0x00001400UL)
 
#define RTC_BASE   (APB1PERIPH_BASE + 0x00002800UL)
 
#define WWDG_BASE   (APB1PERIPH_BASE + 0x00002C00UL)
 
#define IWDG_BASE   (APB1PERIPH_BASE + 0x00003000UL)
 
#define I2S2ext_BASE   (APB1PERIPH_BASE + 0x00003400UL)
 
#define SPI2_BASE   (APB1PERIPH_BASE + 0x00003800UL)
 
#define SPI3_BASE   (APB1PERIPH_BASE + 0x00003C00UL)
 
#define I2S3ext_BASE   (APB1PERIPH_BASE + 0x00004000UL)
 
#define USART2_BASE   (APB1PERIPH_BASE + 0x00004400UL)
 
#define USART3_BASE   (APB1PERIPH_BASE + 0x00004800UL)
 
#define UART4_BASE   (APB1PERIPH_BASE + 0x00004C00UL)
 
#define UART5_BASE   (APB1PERIPH_BASE + 0x00005000UL)
 
#define I2C1_BASE   (APB1PERIPH_BASE + 0x00005400UL)
 
#define I2C2_BASE   (APB1PERIPH_BASE + 0x00005800UL)
 
#define USB_BASE   (APB1PERIPH_BASE + 0x00005C00UL)
 
#define USB_PMAADDR   (APB1PERIPH_BASE + 0x00006000UL)
 
#define CAN_BASE   (APB1PERIPH_BASE + 0x00006400UL)
 
#define PWR_BASE   (APB1PERIPH_BASE + 0x00007000UL)
 
#define DAC1_BASE   (APB1PERIPH_BASE + 0x00007400UL)
 
#define DAC_BASE   DAC1_BASE
 
#define I2C3_BASE   (APB1PERIPH_BASE + 0x00007800UL)
 
#define SYSCFG_BASE   (APB2PERIPH_BASE + 0x00000000UL)
 
#define COMP1_BASE   (APB2PERIPH_BASE + 0x0000001CUL)
 
#define COMP2_BASE   (APB2PERIPH_BASE + 0x00000020UL)
 
#define COMP3_BASE   (APB2PERIPH_BASE + 0x00000024UL)
 
#define COMP4_BASE   (APB2PERIPH_BASE + 0x00000028UL)
 
#define COMP5_BASE   (APB2PERIPH_BASE + 0x0000002CUL)
 
#define COMP6_BASE   (APB2PERIPH_BASE + 0x00000030UL)
 
#define COMP7_BASE   (APB2PERIPH_BASE + 0x00000034UL)
 
#define COMP_BASE   COMP1_BASE
 
#define OPAMP1_BASE   (APB2PERIPH_BASE + 0x00000038UL)
 
#define OPAMP2_BASE   (APB2PERIPH_BASE + 0x0000003CUL)
 
#define OPAMP3_BASE   (APB2PERIPH_BASE + 0x00000040UL)
 
#define OPAMP4_BASE   (APB2PERIPH_BASE + 0x00000044UL)
 
#define OPAMP_BASE   OPAMP1_BASE
 
#define EXTI_BASE   (APB2PERIPH_BASE + 0x00000400UL)
 
#define TIM1_BASE   (APB2PERIPH_BASE + 0x00002C00UL)
 
#define SPI1_BASE   (APB2PERIPH_BASE + 0x00003000UL)
 
#define TIM8_BASE   (APB2PERIPH_BASE + 0x00003400UL)
 
#define USART1_BASE   (APB2PERIPH_BASE + 0x00003800UL)
 
#define SPI4_BASE   (APB2PERIPH_BASE + 0x00003C00UL)
 
#define TIM15_BASE   (APB2PERIPH_BASE + 0x00004000UL)
 
#define TIM16_BASE   (APB2PERIPH_BASE + 0x00004400UL)
 
#define TIM17_BASE   (APB2PERIPH_BASE + 0x00004800UL)
 
#define TIM20_BASE   (APB2PERIPH_BASE + 0x00005000UL)
 
#define DMA1_BASE   (AHB1PERIPH_BASE + 0x00000000UL)
 
#define DMA1_Channel1_BASE   (AHB1PERIPH_BASE + 0x00000008UL)
 
#define DMA1_Channel2_BASE   (AHB1PERIPH_BASE + 0x0000001CUL)
 
#define DMA1_Channel3_BASE   (AHB1PERIPH_BASE + 0x00000030UL)
 
#define DMA1_Channel4_BASE   (AHB1PERIPH_BASE + 0x00000044UL)
 
#define DMA1_Channel5_BASE   (AHB1PERIPH_BASE + 0x00000058UL)
 
#define DMA1_Channel6_BASE   (AHB1PERIPH_BASE + 0x0000006CUL)
 
#define DMA1_Channel7_BASE   (AHB1PERIPH_BASE + 0x00000080UL)
 
#define DMA2_BASE   (AHB1PERIPH_BASE + 0x00000400UL)
 
#define DMA2_Channel1_BASE   (AHB1PERIPH_BASE + 0x00000408UL)
 
#define DMA2_Channel2_BASE   (AHB1PERIPH_BASE + 0x0000041CUL)
 
#define DMA2_Channel3_BASE   (AHB1PERIPH_BASE + 0x00000430UL)
 
#define DMA2_Channel4_BASE   (AHB1PERIPH_BASE + 0x00000444UL)
 
#define DMA2_Channel5_BASE   (AHB1PERIPH_BASE + 0x00000458UL)
 
#define RCC_BASE   (AHB1PERIPH_BASE + 0x00001000UL)
 
#define FLASH_R_BASE   (AHB1PERIPH_BASE + 0x00002000UL)
 
#define OB_BASE   0x1FFFF800UL
 
#define FLASHSIZE_BASE   0x1FFFF7CCUL
 
#define UID_BASE   0x1FFFF7ACUL
 
#define CRC_BASE   (AHB1PERIPH_BASE + 0x00003000UL)
 
#define TSC_BASE   (AHB1PERIPH_BASE + 0x00004000UL)
 
#define GPIOA_BASE   (AHB2PERIPH_BASE + 0x00000000UL)
 
#define GPIOB_BASE   (AHB2PERIPH_BASE + 0x00000400UL)
 
#define GPIOC_BASE   (AHB2PERIPH_BASE + 0x00000800UL)
 
#define GPIOD_BASE   (AHB2PERIPH_BASE + 0x00000C00UL)
 
#define GPIOE_BASE   (AHB2PERIPH_BASE + 0x00001000UL)
 
#define GPIOF_BASE   (AHB2PERIPH_BASE + 0x00001400UL)
 
#define GPIOG_BASE   (AHB2PERIPH_BASE + 0x00001800UL)
 
#define GPIOH_BASE   (AHB2PERIPH_BASE + 0x00001C00UL)
 
#define ADC1_BASE   (AHB3PERIPH_BASE + 0x00000000UL)
 
#define ADC2_BASE   (AHB3PERIPH_BASE + 0x00000100UL)
 
#define ADC1_2_COMMON_BASE   (AHB3PERIPH_BASE + 0x00000300UL)
 
#define ADC3_BASE   (AHB3PERIPH_BASE + 0x00000400UL)
 
#define ADC4_BASE   (AHB3PERIPH_BASE + 0x00000500UL)
 
#define ADC3_4_COMMON_BASE   (AHB3PERIPH_BASE + 0x00000700UL)
 
#define FMC_BANK1   (FMC_BASE)
 
#define FMC_BANK1_1   (FMC_BANK1)
 
#define FMC_BANK1_2   (FMC_BANK1 + 0x04000000UL)
 
#define FMC_BANK1_3   (FMC_BANK1 + 0x08000000UL)
 
#define FMC_BANK1_4   (FMC_BANK1 + 0x0C000000UL)
 
#define FMC_BANK2   (FMC_BASE + 0x10000000UL)
 
#define FMC_BANK3   (FMC_BASE + 0x20000000UL)
 
#define FMC_BANK4   (FMC_BASE + 0x30000000UL)
 
#define FMC_Bank1_R_BASE   (FMC_R_BASE + 0x0000UL)
 
#define FMC_Bank1E_R_BASE   (FMC_R_BASE + 0x0104UL)
 
#define FMC_Bank2_3_R_BASE   (FMC_R_BASE + 0x0060UL)
 
#define FMC_Bank4_R_BASE   (FMC_R_BASE + 0x00A0UL)
 
#define DBGMCU_BASE   0xE0042000UL
 
#define TIM2   ((TIM_TypeDef *) TIM2_BASE)
 
#define TIM3   ((TIM_TypeDef *) TIM3_BASE)
 
#define TIM4   ((TIM_TypeDef *) TIM4_BASE)
 
#define TIM6   ((TIM_TypeDef *) TIM6_BASE)
 
#define TIM7   ((TIM_TypeDef *) TIM7_BASE)
 
#define RTC   ((RTC_TypeDef *) RTC_BASE)
 
#define WWDG   ((WWDG_TypeDef *) WWDG_BASE)
 
#define IWDG   ((IWDG_TypeDef *) IWDG_BASE)
 
#define I2S2ext   ((SPI_TypeDef *) I2S2ext_BASE)
 
#define SPI2   ((SPI_TypeDef *) SPI2_BASE)
 
#define SPI3   ((SPI_TypeDef *) SPI3_BASE)
 
#define I2S3ext   ((SPI_TypeDef *) I2S3ext_BASE)
 
#define USART2   ((USART_TypeDef *) USART2_BASE)
 
#define USART3   ((USART_TypeDef *) USART3_BASE)
 
#define UART4   ((USART_TypeDef *) UART4_BASE)
 
#define UART5   ((USART_TypeDef *) UART5_BASE)
 
#define I2C1   ((I2C_TypeDef *) I2C1_BASE)
 
#define I2C2   ((I2C_TypeDef *) I2C2_BASE)
 
#define I2C3   ((I2C_TypeDef *) I2C3_BASE)
 
#define CAN   ((CAN_TypeDef *) CAN_BASE)
 
#define PWR   ((PWR_TypeDef *) PWR_BASE)
 
#define DAC   ((DAC_TypeDef *) DAC_BASE)
 
#define DAC1   ((DAC_TypeDef *) DAC1_BASE)
 
#define COMP1   ((COMP_TypeDef *) COMP1_BASE)
 
#define COMP2   ((COMP_TypeDef *) COMP2_BASE)
 
#define COMP12_COMMON   ((COMP_Common_TypeDef *) COMP2_BASE)
 
#define COMP3   ((COMP_TypeDef *) COMP3_BASE)
 
#define COMP4   ((COMP_TypeDef *) COMP4_BASE)
 
#define COMP34_COMMON   ((COMP_Common_TypeDef *) COMP4_BASE)
 
#define COMP5   ((COMP_TypeDef *) COMP5_BASE)
 
#define COMP6   ((COMP_TypeDef *) COMP6_BASE)
 
#define COMP56_COMMON   ((COMP_Common_TypeDef *) COMP6_BASE)
 
#define COMP7   ((COMP_TypeDef *) COMP7_BASE)
 
#define COMP   ((COMP_TypeDef *) COMP_BASE)
 
#define OPAMP1   ((OPAMP_TypeDef *) OPAMP1_BASE)
 
#define OPAMP   ((OPAMP_TypeDef *) OPAMP_BASE)
 
#define OPAMP2   ((OPAMP_TypeDef *) OPAMP2_BASE)
 
#define OPAMP3   ((OPAMP_TypeDef *) OPAMP3_BASE)
 
#define OPAMP4   ((OPAMP_TypeDef *) OPAMP4_BASE)
 
#define SYSCFG   ((SYSCFG_TypeDef *) SYSCFG_BASE)
 
#define EXTI   ((EXTI_TypeDef *) EXTI_BASE)
 
#define TIM1   ((TIM_TypeDef *) TIM1_BASE)
 
#define SPI1   ((SPI_TypeDef *) SPI1_BASE)
 
#define TIM8   ((TIM_TypeDef *) TIM8_BASE)
 
#define USART1   ((USART_TypeDef *) USART1_BASE)
 
#define SPI4   ((SPI_TypeDef *) SPI4_BASE)
 
#define TIM15   ((TIM_TypeDef *) TIM15_BASE)
 
#define TIM16   ((TIM_TypeDef *) TIM16_BASE)
 
#define TIM17   ((TIM_TypeDef *) TIM17_BASE)
 
#define TIM20   ((TIM_TypeDef *) TIM20_BASE)
 
#define DBGMCU   ((DBGMCU_TypeDef *) DBGMCU_BASE)
 
#define DMA1   ((DMA_TypeDef *) DMA1_BASE)
 
#define DMA1_Channel1   ((DMA_Channel_TypeDef *) DMA1_Channel1_BASE)
 
#define DMA1_Channel2   ((DMA_Channel_TypeDef *) DMA1_Channel2_BASE)
 
#define DMA1_Channel3   ((DMA_Channel_TypeDef *) DMA1_Channel3_BASE)
 
#define DMA1_Channel4   ((DMA_Channel_TypeDef *) DMA1_Channel4_BASE)
 
#define DMA1_Channel5   ((DMA_Channel_TypeDef *) DMA1_Channel5_BASE)
 
#define DMA1_Channel6   ((DMA_Channel_TypeDef *) DMA1_Channel6_BASE)
 
#define DMA1_Channel7   ((DMA_Channel_TypeDef *) DMA1_Channel7_BASE)
 
#define DMA2   ((DMA_TypeDef *) DMA2_BASE)
 
#define DMA2_Channel1   ((DMA_Channel_TypeDef *) DMA2_Channel1_BASE)
 
#define DMA2_Channel2   ((DMA_Channel_TypeDef *) DMA2_Channel2_BASE)
 
#define DMA2_Channel3   ((DMA_Channel_TypeDef *) DMA2_Channel3_BASE)
 
#define DMA2_Channel4   ((DMA_Channel_TypeDef *) DMA2_Channel4_BASE)
 
#define DMA2_Channel5   ((DMA_Channel_TypeDef *) DMA2_Channel5_BASE)
 
#define RCC   ((RCC_TypeDef *) RCC_BASE)
 
#define FLASH   ((FLASH_TypeDef *) FLASH_R_BASE)
 
#define OB   ((OB_TypeDef *) OB_BASE)
 
#define CRC   ((CRC_TypeDef *) CRC_BASE)
 
#define TSC   ((TSC_TypeDef *) TSC_BASE)
 
#define GPIOA   ((GPIO_TypeDef *) GPIOA_BASE)
 
#define GPIOB   ((GPIO_TypeDef *) GPIOB_BASE)
 
#define GPIOC   ((GPIO_TypeDef *) GPIOC_BASE)
 
#define GPIOD   ((GPIO_TypeDef *) GPIOD_BASE)
 
#define GPIOE   ((GPIO_TypeDef *) GPIOE_BASE)
 
#define GPIOF   ((GPIO_TypeDef *) GPIOF_BASE)
 
#define GPIOG   ((GPIO_TypeDef *) GPIOG_BASE)
 
#define GPIOH   ((GPIO_TypeDef *) GPIOH_BASE)
 
#define ADC1   ((ADC_TypeDef *) ADC1_BASE)
 
#define ADC2   ((ADC_TypeDef *) ADC2_BASE)
 
#define ADC3   ((ADC_TypeDef *) ADC3_BASE)
 
#define ADC4   ((ADC_TypeDef *) ADC4_BASE)
 
#define ADC12_COMMON   ((ADC_Common_TypeDef *) ADC1_2_COMMON_BASE)
 
#define ADC34_COMMON   ((ADC_Common_TypeDef *) ADC3_4_COMMON_BASE)
 
#define ADC1_2_COMMON   ADC12_COMMON
 
#define ADC3_4_COMMON   ADC34_COMMON
 
#define USB   ((USB_TypeDef *) USB_BASE)
 
#define FMC_Bank1   ((FMC_Bank1_TypeDef *) FMC_Bank1_R_BASE)
 
#define FMC_Bank1E   ((FMC_Bank1E_TypeDef *) FMC_Bank1E_R_BASE)
 
#define FMC_Bank2_3   ((FMC_Bank2_3_TypeDef *) FMC_Bank2_3_R_BASE)
 
#define FMC_Bank4   ((FMC_Bank4_TypeDef *) FMC_Bank4_R_BASE)
 
#define LSI_STARTUP_TIME   85U
 
#define ADC5_V1_1
 
#define ADC_MULTIMODE_SUPPORT
 
#define ADC_ISR_ADRDY_Pos   (0U)
 
#define ADC_ISR_ADRDY_Msk   (0x1UL << ADC_ISR_ADRDY_Pos)
 
#define ADC_ISR_ADRDY   ADC_ISR_ADRDY_Msk
 
#define ADC_ISR_EOSMP_Pos   (1U)
 
#define ADC_ISR_EOSMP_Msk   (0x1UL << ADC_ISR_EOSMP_Pos)
 
#define ADC_ISR_EOSMP   ADC_ISR_EOSMP_Msk
 
#define ADC_ISR_EOC_Pos   (2U)
 
#define ADC_ISR_EOC_Msk   (0x1UL << ADC_ISR_EOC_Pos)
 
#define ADC_ISR_EOC   ADC_ISR_EOC_Msk
 
#define ADC_ISR_EOS_Pos   (3U)
 
#define ADC_ISR_EOS_Msk   (0x1UL << ADC_ISR_EOS_Pos)
 
#define ADC_ISR_EOS   ADC_ISR_EOS_Msk
 
#define ADC_ISR_OVR_Pos   (4U)
 
#define ADC_ISR_OVR_Msk   (0x1UL << ADC_ISR_OVR_Pos)
 
#define ADC_ISR_OVR   ADC_ISR_OVR_Msk
 
#define ADC_ISR_JEOC_Pos   (5U)
 
#define ADC_ISR_JEOC_Msk   (0x1UL << ADC_ISR_JEOC_Pos)
 
#define ADC_ISR_JEOC   ADC_ISR_JEOC_Msk
 
#define ADC_ISR_JEOS_Pos   (6U)
 
#define ADC_ISR_JEOS_Msk   (0x1UL << ADC_ISR_JEOS_Pos)
 
#define ADC_ISR_JEOS   ADC_ISR_JEOS_Msk
 
#define ADC_ISR_AWD1_Pos   (7U)
 
#define ADC_ISR_AWD1_Msk   (0x1UL << ADC_ISR_AWD1_Pos)
 
#define ADC_ISR_AWD1   ADC_ISR_AWD1_Msk
 
#define ADC_ISR_AWD2_Pos   (8U)
 
#define ADC_ISR_AWD2_Msk   (0x1UL << ADC_ISR_AWD2_Pos)
 
#define ADC_ISR_AWD2   ADC_ISR_AWD2_Msk
 
#define ADC_ISR_AWD3_Pos   (9U)
 
#define ADC_ISR_AWD3_Msk   (0x1UL << ADC_ISR_AWD3_Pos)
 
#define ADC_ISR_AWD3   ADC_ISR_AWD3_Msk
 
#define ADC_ISR_JQOVF_Pos   (10U)
 
#define ADC_ISR_JQOVF_Msk   (0x1UL << ADC_ISR_JQOVF_Pos)
 
#define ADC_ISR_JQOVF   ADC_ISR_JQOVF_Msk
 
#define ADC_ISR_ADRD   (ADC_ISR_ADRDY)
 
#define ADC_IER_ADRDYIE_Pos   (0U)
 
#define ADC_IER_ADRDYIE_Msk   (0x1UL << ADC_IER_ADRDYIE_Pos)
 
#define ADC_IER_ADRDYIE   ADC_IER_ADRDYIE_Msk
 
#define ADC_IER_EOSMPIE_Pos   (1U)
 
#define ADC_IER_EOSMPIE_Msk   (0x1UL << ADC_IER_EOSMPIE_Pos)
 
#define ADC_IER_EOSMPIE   ADC_IER_EOSMPIE_Msk
 
#define ADC_IER_EOCIE_Pos   (2U)
 
#define ADC_IER_EOCIE_Msk   (0x1UL << ADC_IER_EOCIE_Pos)
 
#define ADC_IER_EOCIE   ADC_IER_EOCIE_Msk
 
#define ADC_IER_EOSIE_Pos   (3U)
 
#define ADC_IER_EOSIE_Msk   (0x1UL << ADC_IER_EOSIE_Pos)
 
#define ADC_IER_EOSIE   ADC_IER_EOSIE_Msk
 
#define ADC_IER_OVRIE_Pos   (4U)
 
#define ADC_IER_OVRIE_Msk   (0x1UL << ADC_IER_OVRIE_Pos)
 
#define ADC_IER_OVRIE   ADC_IER_OVRIE_Msk
 
#define ADC_IER_JEOCIE_Pos   (5U)
 
#define ADC_IER_JEOCIE_Msk   (0x1UL << ADC_IER_JEOCIE_Pos)
 
#define ADC_IER_JEOCIE   ADC_IER_JEOCIE_Msk
 
#define ADC_IER_JEOSIE_Pos   (6U)
 
#define ADC_IER_JEOSIE_Msk   (0x1UL << ADC_IER_JEOSIE_Pos)
 
#define ADC_IER_JEOSIE   ADC_IER_JEOSIE_Msk
 
#define ADC_IER_AWD1IE_Pos   (7U)
 
#define ADC_IER_AWD1IE_Msk   (0x1UL << ADC_IER_AWD1IE_Pos)
 
#define ADC_IER_AWD1IE   ADC_IER_AWD1IE_Msk
 
#define ADC_IER_AWD2IE_Pos   (8U)
 
#define ADC_IER_AWD2IE_Msk   (0x1UL << ADC_IER_AWD2IE_Pos)
 
#define ADC_IER_AWD2IE   ADC_IER_AWD2IE_Msk
 
#define ADC_IER_AWD3IE_Pos   (9U)
 
#define ADC_IER_AWD3IE_Msk   (0x1UL << ADC_IER_AWD3IE_Pos)
 
#define ADC_IER_AWD3IE   ADC_IER_AWD3IE_Msk
 
#define ADC_IER_JQOVFIE_Pos   (10U)
 
#define ADC_IER_JQOVFIE_Msk   (0x1UL << ADC_IER_JQOVFIE_Pos)
 
#define ADC_IER_JQOVFIE   ADC_IER_JQOVFIE_Msk
 
#define ADC_IER_RDY   (ADC_IER_ADRDYIE)
 
#define ADC_IER_EOSMP   (ADC_IER_EOSMPIE)
 
#define ADC_IER_EOC   (ADC_IER_EOCIE)
 
#define ADC_IER_EOS   (ADC_IER_EOSIE)
 
#define ADC_IER_OVR   (ADC_IER_OVRIE)
 
#define ADC_IER_JEOC   (ADC_IER_JEOCIE)
 
#define ADC_IER_JEOS   (ADC_IER_JEOSIE)
 
#define ADC_IER_AWD1   (ADC_IER_AWD1IE)
 
#define ADC_IER_AWD2   (ADC_IER_AWD2IE)
 
#define ADC_IER_AWD3   (ADC_IER_AWD3IE)
 
#define ADC_IER_JQOVF   (ADC_IER_JQOVFIE)
 
#define ADC_CR_ADEN_Pos   (0U)
 
#define ADC_CR_ADEN_Msk   (0x1UL << ADC_CR_ADEN_Pos)
 
#define ADC_CR_ADEN   ADC_CR_ADEN_Msk
 
#define ADC_CR_ADDIS_Pos   (1U)
 
#define ADC_CR_ADDIS_Msk   (0x1UL << ADC_CR_ADDIS_Pos)
 
#define ADC_CR_ADDIS   ADC_CR_ADDIS_Msk
 
#define ADC_CR_ADSTART_Pos   (2U)
 
#define ADC_CR_ADSTART_Msk   (0x1UL << ADC_CR_ADSTART_Pos)
 
#define ADC_CR_ADSTART   ADC_CR_ADSTART_Msk
 
#define ADC_CR_JADSTART_Pos   (3U)
 
#define ADC_CR_JADSTART_Msk   (0x1UL << ADC_CR_JADSTART_Pos)
 
#define ADC_CR_JADSTART   ADC_CR_JADSTART_Msk
 
#define ADC_CR_ADSTP_Pos   (4U)
 
#define ADC_CR_ADSTP_Msk   (0x1UL << ADC_CR_ADSTP_Pos)
 
#define ADC_CR_ADSTP   ADC_CR_ADSTP_Msk
 
#define ADC_CR_JADSTP_Pos   (5U)
 
#define ADC_CR_JADSTP_Msk   (0x1UL << ADC_CR_JADSTP_Pos)
 
#define ADC_CR_JADSTP   ADC_CR_JADSTP_Msk
 
#define ADC_CR_ADVREGEN_Pos   (28U)
 
#define ADC_CR_ADVREGEN_Msk   (0x3UL << ADC_CR_ADVREGEN_Pos)
 
#define ADC_CR_ADVREGEN   ADC_CR_ADVREGEN_Msk
 
#define ADC_CR_ADVREGEN_0   (0x1UL << ADC_CR_ADVREGEN_Pos)
 
#define ADC_CR_ADVREGEN_1   (0x2UL << ADC_CR_ADVREGEN_Pos)
 
#define ADC_CR_ADCALDIF_Pos   (30U)
 
#define ADC_CR_ADCALDIF_Msk   (0x1UL << ADC_CR_ADCALDIF_Pos)
 
#define ADC_CR_ADCALDIF   ADC_CR_ADCALDIF_Msk
 
#define ADC_CR_ADCAL_Pos   (31U)
 
#define ADC_CR_ADCAL_Msk   (0x1UL << ADC_CR_ADCAL_Pos)
 
#define ADC_CR_ADCAL   ADC_CR_ADCAL_Msk
 
#define ADC_CFGR_DMAEN_Pos   (0U)
 
#define ADC_CFGR_DMAEN_Msk   (0x1UL << ADC_CFGR_DMAEN_Pos)
 
#define ADC_CFGR_DMAEN   ADC_CFGR_DMAEN_Msk
 
#define ADC_CFGR_DMACFG_Pos   (1U)
 
#define ADC_CFGR_DMACFG_Msk   (0x1UL << ADC_CFGR_DMACFG_Pos)
 
#define ADC_CFGR_DMACFG   ADC_CFGR_DMACFG_Msk
 
#define ADC_CFGR_RES_Pos   (3U)
 
#define ADC_CFGR_RES_Msk   (0x3UL << ADC_CFGR_RES_Pos)
 
#define ADC_CFGR_RES   ADC_CFGR_RES_Msk
 
#define ADC_CFGR_RES_0   (0x1UL << ADC_CFGR_RES_Pos)
 
#define ADC_CFGR_RES_1   (0x2UL << ADC_CFGR_RES_Pos)
 
#define ADC_CFGR_ALIGN_Pos   (5U)
 
#define ADC_CFGR_ALIGN_Msk   (0x1UL << ADC_CFGR_ALIGN_Pos)
 
#define ADC_CFGR_ALIGN   ADC_CFGR_ALIGN_Msk
 
#define ADC_CFGR_EXTSEL_Pos   (6U)
 
#define ADC_CFGR_EXTSEL_Msk   (0xFUL << ADC_CFGR_EXTSEL_Pos)
 
#define ADC_CFGR_EXTSEL   ADC_CFGR_EXTSEL_Msk
 
#define ADC_CFGR_EXTSEL_0   (0x1UL << ADC_CFGR_EXTSEL_Pos)
 
#define ADC_CFGR_EXTSEL_1   (0x2UL << ADC_CFGR_EXTSEL_Pos)
 
#define ADC_CFGR_EXTSEL_2   (0x4UL << ADC_CFGR_EXTSEL_Pos)
 
#define ADC_CFGR_EXTSEL_3   (0x8UL << ADC_CFGR_EXTSEL_Pos)
 
#define ADC_CFGR_EXTEN_Pos   (10U)
 
#define ADC_CFGR_EXTEN_Msk   (0x3UL << ADC_CFGR_EXTEN_Pos)
 
#define ADC_CFGR_EXTEN   ADC_CFGR_EXTEN_Msk
 
#define ADC_CFGR_EXTEN_0   (0x1UL << ADC_CFGR_EXTEN_Pos)
 
#define ADC_CFGR_EXTEN_1   (0x2UL << ADC_CFGR_EXTEN_Pos)
 
#define ADC_CFGR_OVRMOD_Pos   (12U)
 
#define ADC_CFGR_OVRMOD_Msk   (0x1UL << ADC_CFGR_OVRMOD_Pos)
 
#define ADC_CFGR_OVRMOD   ADC_CFGR_OVRMOD_Msk
 
#define ADC_CFGR_CONT_Pos   (13U)
 
#define ADC_CFGR_CONT_Msk   (0x1UL << ADC_CFGR_CONT_Pos)
 
#define ADC_CFGR_CONT   ADC_CFGR_CONT_Msk
 
#define ADC_CFGR_AUTDLY_Pos   (14U)
 
#define ADC_CFGR_AUTDLY_Msk   (0x1UL << ADC_CFGR_AUTDLY_Pos)
 
#define ADC_CFGR_AUTDLY   ADC_CFGR_AUTDLY_Msk
 
#define ADC_CFGR_DISCEN_Pos   (16U)
 
#define ADC_CFGR_DISCEN_Msk   (0x1UL << ADC_CFGR_DISCEN_Pos)
 
#define ADC_CFGR_DISCEN   ADC_CFGR_DISCEN_Msk
 
#define ADC_CFGR_DISCNUM_Pos   (17U)
 
#define ADC_CFGR_DISCNUM_Msk   (0x7UL << ADC_CFGR_DISCNUM_Pos)
 
#define ADC_CFGR_DISCNUM   ADC_CFGR_DISCNUM_Msk
 
#define ADC_CFGR_DISCNUM_0   (0x1UL << ADC_CFGR_DISCNUM_Pos)
 
#define ADC_CFGR_DISCNUM_1   (0x2UL << ADC_CFGR_DISCNUM_Pos)
 
#define ADC_CFGR_DISCNUM_2   (0x4UL << ADC_CFGR_DISCNUM_Pos)
 
#define ADC_CFGR_JDISCEN_Pos   (20U)
 
#define ADC_CFGR_JDISCEN_Msk   (0x1UL << ADC_CFGR_JDISCEN_Pos)
 
#define ADC_CFGR_JDISCEN   ADC_CFGR_JDISCEN_Msk
 
#define ADC_CFGR_JQM_Pos   (21U)
 
#define ADC_CFGR_JQM_Msk   (0x1UL << ADC_CFGR_JQM_Pos)
 
#define ADC_CFGR_JQM   ADC_CFGR_JQM_Msk
 
#define ADC_CFGR_AWD1SGL_Pos   (22U)
 
#define ADC_CFGR_AWD1SGL_Msk   (0x1UL << ADC_CFGR_AWD1SGL_Pos)
 
#define ADC_CFGR_AWD1SGL   ADC_CFGR_AWD1SGL_Msk
 
#define ADC_CFGR_AWD1EN_Pos   (23U)
 
#define ADC_CFGR_AWD1EN_Msk   (0x1UL << ADC_CFGR_AWD1EN_Pos)
 
#define ADC_CFGR_AWD1EN   ADC_CFGR_AWD1EN_Msk
 
#define ADC_CFGR_JAWD1EN_Pos   (24U)
 
#define ADC_CFGR_JAWD1EN_Msk   (0x1UL << ADC_CFGR_JAWD1EN_Pos)
 
#define ADC_CFGR_JAWD1EN   ADC_CFGR_JAWD1EN_Msk
 
#define ADC_CFGR_JAUTO_Pos   (25U)
 
#define ADC_CFGR_JAUTO_Msk   (0x1UL << ADC_CFGR_JAUTO_Pos)
 
#define ADC_CFGR_JAUTO   ADC_CFGR_JAUTO_Msk
 
#define ADC_CFGR_AWD1CH_Pos   (26U)
 
#define ADC_CFGR_AWD1CH_Msk   (0x1FUL << ADC_CFGR_AWD1CH_Pos)
 
#define ADC_CFGR_AWD1CH   ADC_CFGR_AWD1CH_Msk
 
#define ADC_CFGR_AWD1CH_0   (0x01UL << ADC_CFGR_AWD1CH_Pos)
 
#define ADC_CFGR_AWD1CH_1   (0x02UL << ADC_CFGR_AWD1CH_Pos)
 
#define ADC_CFGR_AWD1CH_2   (0x04UL << ADC_CFGR_AWD1CH_Pos)
 
#define ADC_CFGR_AWD1CH_3   (0x08UL << ADC_CFGR_AWD1CH_Pos)
 
#define ADC_CFGR_AWD1CH_4   (0x10UL << ADC_CFGR_AWD1CH_Pos)
 
#define ADC_CFGR_AUTOFF_Pos   (15U)
 
#define ADC_CFGR_AUTOFF_Msk   (0x1UL << ADC_CFGR_AUTOFF_Pos)
 
#define ADC_CFGR_AUTOFF   ADC_CFGR_AUTOFF_Msk
 
#define ADC_SMPR1_SMP0_Pos   (0U)
 
#define ADC_SMPR1_SMP0_Msk   (0x7UL << ADC_SMPR1_SMP0_Pos)
 
#define ADC_SMPR1_SMP0   ADC_SMPR1_SMP0_Msk
 
#define ADC_SMPR1_SMP0_0   (0x1UL << ADC_SMPR1_SMP0_Pos)
 
#define ADC_SMPR1_SMP0_1   (0x2UL << ADC_SMPR1_SMP0_Pos)
 
#define ADC_SMPR1_SMP0_2   (0x4UL << ADC_SMPR1_SMP0_Pos)
 
#define ADC_SMPR1_SMP1_Pos   (3U)
 
#define ADC_SMPR1_SMP1_Msk   (0x7UL << ADC_SMPR1_SMP1_Pos)
 
#define ADC_SMPR1_SMP1   ADC_SMPR1_SMP1_Msk
 
#define ADC_SMPR1_SMP1_0   (0x1UL << ADC_SMPR1_SMP1_Pos)
 
#define ADC_SMPR1_SMP1_1   (0x2UL << ADC_SMPR1_SMP1_Pos)
 
#define ADC_SMPR1_SMP1_2   (0x4UL << ADC_SMPR1_SMP1_Pos)
 
#define ADC_SMPR1_SMP2_Pos   (6U)
 
#define ADC_SMPR1_SMP2_Msk   (0x7UL << ADC_SMPR1_SMP2_Pos)
 
#define ADC_SMPR1_SMP2   ADC_SMPR1_SMP2_Msk
 
#define ADC_SMPR1_SMP2_0   (0x1UL << ADC_SMPR1_SMP2_Pos)
 
#define ADC_SMPR1_SMP2_1   (0x2UL << ADC_SMPR1_SMP2_Pos)
 
#define ADC_SMPR1_SMP2_2   (0x4UL << ADC_SMPR1_SMP2_Pos)
 
#define ADC_SMPR1_SMP3_Pos   (9U)
 
#define ADC_SMPR1_SMP3_Msk   (0x7UL << ADC_SMPR1_SMP3_Pos)
 
#define ADC_SMPR1_SMP3   ADC_SMPR1_SMP3_Msk
 
#define ADC_SMPR1_SMP3_0   (0x1UL << ADC_SMPR1_SMP3_Pos)
 
#define ADC_SMPR1_SMP3_1   (0x2UL << ADC_SMPR1_SMP3_Pos)
 
#define ADC_SMPR1_SMP3_2   (0x4UL << ADC_SMPR1_SMP3_Pos)
 
#define ADC_SMPR1_SMP4_Pos   (12U)
 
#define ADC_SMPR1_SMP4_Msk   (0x7UL << ADC_SMPR1_SMP4_Pos)
 
#define ADC_SMPR1_SMP4   ADC_SMPR1_SMP4_Msk
 
#define ADC_SMPR1_SMP4_0   (0x1UL << ADC_SMPR1_SMP4_Pos)
 
#define ADC_SMPR1_SMP4_1   (0x2UL << ADC_SMPR1_SMP4_Pos)
 
#define ADC_SMPR1_SMP4_2   (0x4UL << ADC_SMPR1_SMP4_Pos)
 
#define ADC_SMPR1_SMP5_Pos   (15U)
 
#define ADC_SMPR1_SMP5_Msk   (0x7UL << ADC_SMPR1_SMP5_Pos)
 
#define ADC_SMPR1_SMP5   ADC_SMPR1_SMP5_Msk
 
#define ADC_SMPR1_SMP5_0   (0x1UL << ADC_SMPR1_SMP5_Pos)
 
#define ADC_SMPR1_SMP5_1   (0x2UL << ADC_SMPR1_SMP5_Pos)
 
#define ADC_SMPR1_SMP5_2   (0x4UL << ADC_SMPR1_SMP5_Pos)
 
#define ADC_SMPR1_SMP6_Pos   (18U)
 
#define ADC_SMPR1_SMP6_Msk   (0x7UL << ADC_SMPR1_SMP6_Pos)
 
#define ADC_SMPR1_SMP6   ADC_SMPR1_SMP6_Msk
 
#define ADC_SMPR1_SMP6_0   (0x1UL << ADC_SMPR1_SMP6_Pos)
 
#define ADC_SMPR1_SMP6_1   (0x2UL << ADC_SMPR1_SMP6_Pos)
 
#define ADC_SMPR1_SMP6_2   (0x4UL << ADC_SMPR1_SMP6_Pos)
 
#define ADC_SMPR1_SMP7_Pos   (21U)
 
#define ADC_SMPR1_SMP7_Msk   (0x7UL << ADC_SMPR1_SMP7_Pos)
 
#define ADC_SMPR1_SMP7   ADC_SMPR1_SMP7_Msk
 
#define ADC_SMPR1_SMP7_0   (0x1UL << ADC_SMPR1_SMP7_Pos)
 
#define ADC_SMPR1_SMP7_1   (0x2UL << ADC_SMPR1_SMP7_Pos)
 
#define ADC_SMPR1_SMP7_2   (0x4UL << ADC_SMPR1_SMP7_Pos)
 
#define ADC_SMPR1_SMP8_Pos   (24U)
 
#define ADC_SMPR1_SMP8_Msk   (0x7UL << ADC_SMPR1_SMP8_Pos)
 
#define ADC_SMPR1_SMP8   ADC_SMPR1_SMP8_Msk
 
#define ADC_SMPR1_SMP8_0   (0x1UL << ADC_SMPR1_SMP8_Pos)
 
#define ADC_SMPR1_SMP8_1   (0x2UL << ADC_SMPR1_SMP8_Pos)
 
#define ADC_SMPR1_SMP8_2   (0x4UL << ADC_SMPR1_SMP8_Pos)
 
#define ADC_SMPR1_SMP9_Pos   (27U)
 
#define ADC_SMPR1_SMP9_Msk   (0x7UL << ADC_SMPR1_SMP9_Pos)
 
#define ADC_SMPR1_SMP9   ADC_SMPR1_SMP9_Msk
 
#define ADC_SMPR1_SMP9_0   (0x1UL << ADC_SMPR1_SMP9_Pos)
 
#define ADC_SMPR1_SMP9_1   (0x2UL << ADC_SMPR1_SMP9_Pos)
 
#define ADC_SMPR1_SMP9_2   (0x4UL << ADC_SMPR1_SMP9_Pos)
 
#define ADC_SMPR2_SMP10_Pos   (0U)
 
#define ADC_SMPR2_SMP10_Msk   (0x7UL << ADC_SMPR2_SMP10_Pos)
 
#define ADC_SMPR2_SMP10   ADC_SMPR2_SMP10_Msk
 
#define ADC_SMPR2_SMP10_0   (0x1UL << ADC_SMPR2_SMP10_Pos)
 
#define ADC_SMPR2_SMP10_1   (0x2UL << ADC_SMPR2_SMP10_Pos)
 
#define ADC_SMPR2_SMP10_2   (0x4UL << ADC_SMPR2_SMP10_Pos)
 
#define ADC_SMPR2_SMP11_Pos   (3U)
 
#define ADC_SMPR2_SMP11_Msk   (0x7UL << ADC_SMPR2_SMP11_Pos)
 
#define ADC_SMPR2_SMP11   ADC_SMPR2_SMP11_Msk
 
#define ADC_SMPR2_SMP11_0   (0x1UL << ADC_SMPR2_SMP11_Pos)
 
#define ADC_SMPR2_SMP11_1   (0x2UL << ADC_SMPR2_SMP11_Pos)
 
#define ADC_SMPR2_SMP11_2   (0x4UL << ADC_SMPR2_SMP11_Pos)
 
#define ADC_SMPR2_SMP12_Pos   (6U)
 
#define ADC_SMPR2_SMP12_Msk   (0x7UL << ADC_SMPR2_SMP12_Pos)
 
#define ADC_SMPR2_SMP12   ADC_SMPR2_SMP12_Msk
 
#define ADC_SMPR2_SMP12_0   (0x1UL << ADC_SMPR2_SMP12_Pos)
 
#define ADC_SMPR2_SMP12_1   (0x2UL << ADC_SMPR2_SMP12_Pos)
 
#define ADC_SMPR2_SMP12_2   (0x4UL << ADC_SMPR2_SMP12_Pos)
 
#define ADC_SMPR2_SMP13_Pos   (9U)
 
#define ADC_SMPR2_SMP13_Msk   (0x7UL << ADC_SMPR2_SMP13_Pos)
 
#define ADC_SMPR2_SMP13   ADC_SMPR2_SMP13_Msk
 
#define ADC_SMPR2_SMP13_0   (0x1UL << ADC_SMPR2_SMP13_Pos)
 
#define ADC_SMPR2_SMP13_1   (0x2UL << ADC_SMPR2_SMP13_Pos)
 
#define ADC_SMPR2_SMP13_2   (0x4UL << ADC_SMPR2_SMP13_Pos)
 
#define ADC_SMPR2_SMP14_Pos   (12U)
 
#define ADC_SMPR2_SMP14_Msk   (0x7UL << ADC_SMPR2_SMP14_Pos)
 
#define ADC_SMPR2_SMP14   ADC_SMPR2_SMP14_Msk
 
#define ADC_SMPR2_SMP14_0   (0x1UL << ADC_SMPR2_SMP14_Pos)
 
#define ADC_SMPR2_SMP14_1   (0x2UL << ADC_SMPR2_SMP14_Pos)
 
#define ADC_SMPR2_SMP14_2   (0x4UL << ADC_SMPR2_SMP14_Pos)
 
#define ADC_SMPR2_SMP15_Pos   (15U)
 
#define ADC_SMPR2_SMP15_Msk   (0x7UL << ADC_SMPR2_SMP15_Pos)
 
#define ADC_SMPR2_SMP15   ADC_SMPR2_SMP15_Msk
 
#define ADC_SMPR2_SMP15_0   (0x1UL << ADC_SMPR2_SMP15_Pos)
 
#define ADC_SMPR2_SMP15_1   (0x2UL << ADC_SMPR2_SMP15_Pos)
 
#define ADC_SMPR2_SMP15_2   (0x4UL << ADC_SMPR2_SMP15_Pos)
 
#define ADC_SMPR2_SMP16_Pos   (18U)
 
#define ADC_SMPR2_SMP16_Msk   (0x7UL << ADC_SMPR2_SMP16_Pos)
 
#define ADC_SMPR2_SMP16   ADC_SMPR2_SMP16_Msk
 
#define ADC_SMPR2_SMP16_0   (0x1UL << ADC_SMPR2_SMP16_Pos)
 
#define ADC_SMPR2_SMP16_1   (0x2UL << ADC_SMPR2_SMP16_Pos)
 
#define ADC_SMPR2_SMP16_2   (0x4UL << ADC_SMPR2_SMP16_Pos)
 
#define ADC_SMPR2_SMP17_Pos   (21U)
 
#define ADC_SMPR2_SMP17_Msk   (0x7UL << ADC_SMPR2_SMP17_Pos)
 
#define ADC_SMPR2_SMP17   ADC_SMPR2_SMP17_Msk
 
#define ADC_SMPR2_SMP17_0   (0x1UL << ADC_SMPR2_SMP17_Pos)
 
#define ADC_SMPR2_SMP17_1   (0x2UL << ADC_SMPR2_SMP17_Pos)
 
#define ADC_SMPR2_SMP17_2   (0x4UL << ADC_SMPR2_SMP17_Pos)
 
#define ADC_SMPR2_SMP18_Pos   (24U)
 
#define ADC_SMPR2_SMP18_Msk   (0x7UL << ADC_SMPR2_SMP18_Pos)
 
#define ADC_SMPR2_SMP18   ADC_SMPR2_SMP18_Msk
 
#define ADC_SMPR2_SMP18_0   (0x1UL << ADC_SMPR2_SMP18_Pos)
 
#define ADC_SMPR2_SMP18_1   (0x2UL << ADC_SMPR2_SMP18_Pos)
 
#define ADC_SMPR2_SMP18_2   (0x4UL << ADC_SMPR2_SMP18_Pos)
 
#define ADC_TR1_LT1_Pos   (0U)
 
#define ADC_TR1_LT1_Msk   (0xFFFUL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1   ADC_TR1_LT1_Msk
 
#define ADC_TR1_LT1_0   (0x001UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_1   (0x002UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_2   (0x004UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_3   (0x008UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_4   (0x010UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_5   (0x020UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_6   (0x040UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_7   (0x080UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_8   (0x100UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_9   (0x200UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_10   (0x400UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_LT1_11   (0x800UL << ADC_TR1_LT1_Pos)
 
#define ADC_TR1_HT1_Pos   (16U)
 
#define ADC_TR1_HT1_Msk   (0xFFFUL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1   ADC_TR1_HT1_Msk
 
#define ADC_TR1_HT1_0   (0x001UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_1   (0x002UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_2   (0x004UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_3   (0x008UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_4   (0x010UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_5   (0x020UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_6   (0x040UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_7   (0x080UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_8   (0x100UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_9   (0x200UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_10   (0x400UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR1_HT1_11   (0x800UL << ADC_TR1_HT1_Pos)
 
#define ADC_TR2_LT2_Pos   (0U)
 
#define ADC_TR2_LT2_Msk   (0xFFUL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_LT2   ADC_TR2_LT2_Msk
 
#define ADC_TR2_LT2_0   (0x01UL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_LT2_1   (0x02UL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_LT2_2   (0x04UL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_LT2_3   (0x08UL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_LT2_4   (0x10UL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_LT2_5   (0x20UL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_LT2_6   (0x40UL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_LT2_7   (0x80UL << ADC_TR2_LT2_Pos)
 
#define ADC_TR2_HT2_Pos   (16U)
 
#define ADC_TR2_HT2_Msk   (0xFFUL << ADC_TR2_HT2_Pos)
 
#define ADC_TR2_HT2   ADC_TR2_HT2_Msk
 
#define ADC_TR2_HT2_0   (0x01UL << ADC_TR2_HT2_Pos)
 
#define ADC_TR2_HT2_1   (0x02UL << ADC_TR2_HT2_Pos)
 
#define ADC_TR2_HT2_2   (0x04UL << ADC_TR2_HT2_Pos)
 
#define ADC_TR2_HT2_3   (0x08UL << ADC_TR2_HT2_Pos)
 
#define ADC_TR2_HT2_4   (0x10UL << ADC_TR2_HT2_Pos)
 
#define ADC_TR2_HT2_5   (0x20UL << ADC_TR2_HT2_Pos)
 
#define ADC_TR2_HT2_6   (0x40UL << ADC_TR2_HT2_Pos)
 
#define ADC_TR2_HT2_7   (0x80UL << ADC_TR2_HT2_Pos)
 
#define ADC_TR3_LT3_Pos   (0U)
 
#define ADC_TR3_LT3_Msk   (0xFFUL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_LT3   ADC_TR3_LT3_Msk
 
#define ADC_TR3_LT3_0   (0x01UL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_LT3_1   (0x02UL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_LT3_2   (0x04UL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_LT3_3   (0x08UL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_LT3_4   (0x10UL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_LT3_5   (0x20UL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_LT3_6   (0x40UL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_LT3_7   (0x80UL << ADC_TR3_LT3_Pos)
 
#define ADC_TR3_HT3_Pos   (16U)
 
#define ADC_TR3_HT3_Msk   (0xFFUL << ADC_TR3_HT3_Pos)
 
#define ADC_TR3_HT3   ADC_TR3_HT3_Msk
 
#define ADC_TR3_HT3_0   (0x01UL << ADC_TR3_HT3_Pos)
 
#define ADC_TR3_HT3_1   (0x02UL << ADC_TR3_HT3_Pos)
 
#define ADC_TR3_HT3_2   (0x04UL << ADC_TR3_HT3_Pos)
 
#define ADC_TR3_HT3_3   (0x08UL << ADC_TR3_HT3_Pos)
 
#define ADC_TR3_HT3_4   (0x10UL << ADC_TR3_HT3_Pos)
 
#define ADC_TR3_HT3_5   (0x20UL << ADC_TR3_HT3_Pos)
 
#define ADC_TR3_HT3_6   (0x40UL << ADC_TR3_HT3_Pos)
 
#define ADC_TR3_HT3_7   (0x80UL << ADC_TR3_HT3_Pos)
 
#define ADC_SQR1_L_Pos   (0U)
 
#define ADC_SQR1_L_Msk   (0xFUL << ADC_SQR1_L_Pos)
 
#define ADC_SQR1_L   ADC_SQR1_L_Msk
 
#define ADC_SQR1_L_0   (0x1UL << ADC_SQR1_L_Pos)
 
#define ADC_SQR1_L_1   (0x2UL << ADC_SQR1_L_Pos)
 
#define ADC_SQR1_L_2   (0x4UL << ADC_SQR1_L_Pos)
 
#define ADC_SQR1_L_3   (0x8UL << ADC_SQR1_L_Pos)
 
#define ADC_SQR1_SQ1_Pos   (6U)
 
#define ADC_SQR1_SQ1_Msk   (0x1FUL << ADC_SQR1_SQ1_Pos)
 
#define ADC_SQR1_SQ1   ADC_SQR1_SQ1_Msk
 
#define ADC_SQR1_SQ1_0   (0x01UL << ADC_SQR1_SQ1_Pos)
 
#define ADC_SQR1_SQ1_1   (0x02UL << ADC_SQR1_SQ1_Pos)
 
#define ADC_SQR1_SQ1_2   (0x04UL << ADC_SQR1_SQ1_Pos)
 
#define ADC_SQR1_SQ1_3   (0x08UL << ADC_SQR1_SQ1_Pos)
 
#define ADC_SQR1_SQ1_4   (0x10UL << ADC_SQR1_SQ1_Pos)
 
#define ADC_SQR1_SQ2_Pos   (12U)
 
#define ADC_SQR1_SQ2_Msk   (0x1FUL << ADC_SQR1_SQ2_Pos)
 
#define ADC_SQR1_SQ2   ADC_SQR1_SQ2_Msk
 
#define ADC_SQR1_SQ2_0   (0x01UL << ADC_SQR1_SQ2_Pos)
 
#define ADC_SQR1_SQ2_1   (0x02UL << ADC_SQR1_SQ2_Pos)
 
#define ADC_SQR1_SQ2_2   (0x04UL << ADC_SQR1_SQ2_Pos)
 
#define ADC_SQR1_SQ2_3   (0x08UL << ADC_SQR1_SQ2_Pos)
 
#define ADC_SQR1_SQ2_4   (0x10UL << ADC_SQR1_SQ2_Pos)
 
#define ADC_SQR1_SQ3_Pos   (18U)
 
#define ADC_SQR1_SQ3_Msk   (0x1FUL << ADC_SQR1_SQ3_Pos)
 
#define ADC_SQR1_SQ3   ADC_SQR1_SQ3_Msk
 
#define ADC_SQR1_SQ3_0   (0x01UL << ADC_SQR1_SQ3_Pos)
 
#define ADC_SQR1_SQ3_1   (0x02UL << ADC_SQR1_SQ3_Pos)
 
#define ADC_SQR1_SQ3_2   (0x04UL << ADC_SQR1_SQ3_Pos)
 
#define ADC_SQR1_SQ3_3   (0x08UL << ADC_SQR1_SQ3_Pos)
 
#define ADC_SQR1_SQ3_4   (0x10UL << ADC_SQR1_SQ3_Pos)
 
#define ADC_SQR1_SQ4_Pos   (24U)
 
#define ADC_SQR1_SQ4_Msk   (0x1FUL << ADC_SQR1_SQ4_Pos)
 
#define ADC_SQR1_SQ4   ADC_SQR1_SQ4_Msk
 
#define ADC_SQR1_SQ4_0   (0x01UL << ADC_SQR1_SQ4_Pos)
 
#define ADC_SQR1_SQ4_1   (0x02UL << ADC_SQR1_SQ4_Pos)
 
#define ADC_SQR1_SQ4_2   (0x04UL << ADC_SQR1_SQ4_Pos)
 
#define ADC_SQR1_SQ4_3   (0x08UL << ADC_SQR1_SQ4_Pos)
 
#define ADC_SQR1_SQ4_4   (0x10UL << ADC_SQR1_SQ4_Pos)
 
#define ADC_SQR2_SQ5_Pos   (0U)
 
#define ADC_SQR2_SQ5_Msk   (0x1FUL << ADC_SQR2_SQ5_Pos)
 
#define ADC_SQR2_SQ5   ADC_SQR2_SQ5_Msk
 
#define ADC_SQR2_SQ5_0   (0x01UL << ADC_SQR2_SQ5_Pos)
 
#define ADC_SQR2_SQ5_1   (0x02UL << ADC_SQR2_SQ5_Pos)
 
#define ADC_SQR2_SQ5_2   (0x04UL << ADC_SQR2_SQ5_Pos)
 
#define ADC_SQR2_SQ5_3   (0x08UL << ADC_SQR2_SQ5_Pos)
 
#define ADC_SQR2_SQ5_4   (0x10UL << ADC_SQR2_SQ5_Pos)
 
#define ADC_SQR2_SQ6_Pos   (6U)
 
#define ADC_SQR2_SQ6_Msk   (0x1FUL << ADC_SQR2_SQ6_Pos)
 
#define ADC_SQR2_SQ6   ADC_SQR2_SQ6_Msk
 
#define ADC_SQR2_SQ6_0   (0x01UL << ADC_SQR2_SQ6_Pos)
 
#define ADC_SQR2_SQ6_1   (0x02UL << ADC_SQR2_SQ6_Pos)
 
#define ADC_SQR2_SQ6_2   (0x04UL << ADC_SQR2_SQ6_Pos)
 
#define ADC_SQR2_SQ6_3   (0x08UL << ADC_SQR2_SQ6_Pos)
 
#define ADC_SQR2_SQ6_4   (0x10UL << ADC_SQR2_SQ6_Pos)
 
#define ADC_SQR2_SQ7_Pos   (12U)
 
#define ADC_SQR2_SQ7_Msk   (0x1FUL << ADC_SQR2_SQ7_Pos)
 
#define ADC_SQR2_SQ7   ADC_SQR2_SQ7_Msk
 
#define ADC_SQR2_SQ7_0   (0x01UL << ADC_SQR2_SQ7_Pos)
 
#define ADC_SQR2_SQ7_1   (0x02UL << ADC_SQR2_SQ7_Pos)
 
#define ADC_SQR2_SQ7_2   (0x04UL << ADC_SQR2_SQ7_Pos)
 
#define ADC_SQR2_SQ7_3   (0x08UL << ADC_SQR2_SQ7_Pos)
 
#define ADC_SQR2_SQ7_4   (0x10UL << ADC_SQR2_SQ7_Pos)
 
#define ADC_SQR2_SQ8_Pos   (18U)
 
#define ADC_SQR2_SQ8_Msk   (0x1FUL << ADC_SQR2_SQ8_Pos)
 
#define ADC_SQR2_SQ8   ADC_SQR2_SQ8_Msk
 
#define ADC_SQR2_SQ8_0   (0x01UL << ADC_SQR2_SQ8_Pos)
 
#define ADC_SQR2_SQ8_1   (0x02UL << ADC_SQR2_SQ8_Pos)
 
#define ADC_SQR2_SQ8_2   (0x04UL << ADC_SQR2_SQ8_Pos)
 
#define ADC_SQR2_SQ8_3   (0x08UL << ADC_SQR2_SQ8_Pos)
 
#define ADC_SQR2_SQ8_4   (0x10UL << ADC_SQR2_SQ8_Pos)
 
#define ADC_SQR2_SQ9_Pos   (24U)
 
#define ADC_SQR2_SQ9_Msk   (0x1FUL << ADC_SQR2_SQ9_Pos)
 
#define ADC_SQR2_SQ9   ADC_SQR2_SQ9_Msk
 
#define ADC_SQR2_SQ9_0   (0x01UL << ADC_SQR2_SQ9_Pos)
 
#define ADC_SQR2_SQ9_1   (0x02UL << ADC_SQR2_SQ9_Pos)
 
#define ADC_SQR2_SQ9_2   (0x04UL << ADC_SQR2_SQ9_Pos)
 
#define ADC_SQR2_SQ9_3   (0x08UL << ADC_SQR2_SQ9_Pos)
 
#define ADC_SQR2_SQ9_4   (0x10UL << ADC_SQR2_SQ9_Pos)
 
#define ADC_SQR3_SQ10_Pos   (0U)
 
#define ADC_SQR3_SQ10_Msk   (0x1FUL << ADC_SQR3_SQ10_Pos)
 
#define ADC_SQR3_SQ10   ADC_SQR3_SQ10_Msk
 
#define ADC_SQR3_SQ10_0   (0x01UL << ADC_SQR3_SQ10_Pos)
 
#define ADC_SQR3_SQ10_1   (0x02UL << ADC_SQR3_SQ10_Pos)
 
#define ADC_SQR3_SQ10_2   (0x04UL << ADC_SQR3_SQ10_Pos)
 
#define ADC_SQR3_SQ10_3   (0x08UL << ADC_SQR3_SQ10_Pos)
 
#define ADC_SQR3_SQ10_4   (0x10UL << ADC_SQR3_SQ10_Pos)
 
#define ADC_SQR3_SQ11_Pos   (6U)
 
#define ADC_SQR3_SQ11_Msk   (0x1FUL << ADC_SQR3_SQ11_Pos)
 
#define ADC_SQR3_SQ11   ADC_SQR3_SQ11_Msk
 
#define ADC_SQR3_SQ11_0   (0x01UL << ADC_SQR3_SQ11_Pos)
 
#define ADC_SQR3_SQ11_1   (0x02UL << ADC_SQR3_SQ11_Pos)
 
#define ADC_SQR3_SQ11_2   (0x04UL << ADC_SQR3_SQ11_Pos)
 
#define ADC_SQR3_SQ11_3   (0x08UL << ADC_SQR3_SQ11_Pos)
 
#define ADC_SQR3_SQ11_4   (0x10UL << ADC_SQR3_SQ11_Pos)
 
#define ADC_SQR3_SQ12_Pos   (12U)
 
#define ADC_SQR3_SQ12_Msk   (0x1FUL << ADC_SQR3_SQ12_Pos)
 
#define ADC_SQR3_SQ12   ADC_SQR3_SQ12_Msk
 
#define ADC_SQR3_SQ12_0   (0x01UL << ADC_SQR3_SQ12_Pos)
 
#define ADC_SQR3_SQ12_1   (0x02UL << ADC_SQR3_SQ12_Pos)
 
#define ADC_SQR3_SQ12_2   (0x04UL << ADC_SQR3_SQ12_Pos)
 
#define ADC_SQR3_SQ12_3   (0x08UL << ADC_SQR3_SQ12_Pos)
 
#define ADC_SQR3_SQ12_4   (0x10UL << ADC_SQR3_SQ12_Pos)
 
#define ADC_SQR3_SQ13_Pos   (18U)
 
#define ADC_SQR3_SQ13_Msk   (0x1FUL << ADC_SQR3_SQ13_Pos)
 
#define ADC_SQR3_SQ13   ADC_SQR3_SQ13_Msk
 
#define ADC_SQR3_SQ13_0   (0x01UL << ADC_SQR3_SQ13_Pos)
 
#define ADC_SQR3_SQ13_1   (0x02UL << ADC_SQR3_SQ13_Pos)
 
#define ADC_SQR3_SQ13_2   (0x04UL << ADC_SQR3_SQ13_Pos)
 
#define ADC_SQR3_SQ13_3   (0x08UL << ADC_SQR3_SQ13_Pos)
 
#define ADC_SQR3_SQ13_4   (0x10UL << ADC_SQR3_SQ13_Pos)
 
#define ADC_SQR3_SQ14_Pos   (24U)
 
#define ADC_SQR3_SQ14_Msk   (0x1FUL << ADC_SQR3_SQ14_Pos)
 
#define ADC_SQR3_SQ14   ADC_SQR3_SQ14_Msk
 
#define ADC_SQR3_SQ14_0   (0x01UL << ADC_SQR3_SQ14_Pos)
 
#define ADC_SQR3_SQ14_1   (0x02UL << ADC_SQR3_SQ14_Pos)
 
#define ADC_SQR3_SQ14_2   (0x04UL << ADC_SQR3_SQ14_Pos)
 
#define ADC_SQR3_SQ14_3   (0x08UL << ADC_SQR3_SQ14_Pos)
 
#define ADC_SQR3_SQ14_4   (0x10UL << ADC_SQR3_SQ14_Pos)
 
#define ADC_SQR4_SQ15_Pos   (0U)
 
#define ADC_SQR4_SQ15_Msk   (0x1FUL << ADC_SQR4_SQ15_Pos)
 
#define ADC_SQR4_SQ15   ADC_SQR4_SQ15_Msk
 
#define ADC_SQR4_SQ15_0   (0x01UL << ADC_SQR4_SQ15_Pos)
 
#define ADC_SQR4_SQ15_1   (0x02UL << ADC_SQR4_SQ15_Pos)
 
#define ADC_SQR4_SQ15_2   (0x04UL << ADC_SQR4_SQ15_Pos)
 
#define ADC_SQR4_SQ15_3   (0x08UL << ADC_SQR4_SQ15_Pos)
 
#define ADC_SQR4_SQ15_4   (0x10UL << ADC_SQR4_SQ15_Pos)
 
#define ADC_SQR4_SQ16_Pos   (6U)
 
#define ADC_SQR4_SQ16_Msk   (0x1FUL << ADC_SQR4_SQ16_Pos)
 
#define ADC_SQR4_SQ16   ADC_SQR4_SQ16_Msk
 
#define ADC_SQR4_SQ16_0   (0x01UL << ADC_SQR4_SQ16_Pos)
 
#define ADC_SQR4_SQ16_1   (0x02UL << ADC_SQR4_SQ16_Pos)
 
#define ADC_SQR4_SQ16_2   (0x04UL << ADC_SQR4_SQ16_Pos)
 
#define ADC_SQR4_SQ16_3   (0x08UL << ADC_SQR4_SQ16_Pos)
 
#define ADC_SQR4_SQ16_4   (0x10UL << ADC_SQR4_SQ16_Pos)
 
#define ADC_DR_RDATA_Pos   (0U)
 
#define ADC_DR_RDATA_Msk   (0xFFFFUL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA   ADC_DR_RDATA_Msk
 
#define ADC_DR_RDATA_0   (0x0001UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_1   (0x0002UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_2   (0x0004UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_3   (0x0008UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_4   (0x0010UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_5   (0x0020UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_6   (0x0040UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_7   (0x0080UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_8   (0x0100UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_9   (0x0200UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_10   (0x0400UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_11   (0x0800UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_12   (0x1000UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_13   (0x2000UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_14   (0x4000UL << ADC_DR_RDATA_Pos)
 
#define ADC_DR_RDATA_15   (0x8000UL << ADC_DR_RDATA_Pos)
 
#define ADC_JSQR_JL_Pos   (0U)
 
#define ADC_JSQR_JL_Msk   (0x3UL << ADC_JSQR_JL_Pos)
 
#define ADC_JSQR_JL   ADC_JSQR_JL_Msk
 
#define ADC_JSQR_JL_0   (0x1UL << ADC_JSQR_JL_Pos)
 
#define ADC_JSQR_JL_1   (0x2UL << ADC_JSQR_JL_Pos)
 
#define ADC_JSQR_JEXTSEL_Pos   (2U)
 
#define ADC_JSQR_JEXTSEL_Msk   (0xFUL << ADC_JSQR_JEXTSEL_Pos)
 
#define ADC_JSQR_JEXTSEL   ADC_JSQR_JEXTSEL_Msk
 
#define ADC_JSQR_JEXTSEL_0   (0x1UL << ADC_JSQR_JEXTSEL_Pos)
 
#define ADC_JSQR_JEXTSEL_1   (0x2UL << ADC_JSQR_JEXTSEL_Pos)
 
#define ADC_JSQR_JEXTSEL_2   (0x4UL << ADC_JSQR_JEXTSEL_Pos)
 
#define ADC_JSQR_JEXTSEL_3   (0x8UL << ADC_JSQR_JEXTSEL_Pos)
 
#define ADC_JSQR_JEXTEN_Pos   (6U)
 
#define ADC_JSQR_JEXTEN_Msk   (0x3UL << ADC_JSQR_JEXTEN_Pos)
 
#define ADC_JSQR_JEXTEN   ADC_JSQR_JEXTEN_Msk
 
#define ADC_JSQR_JEXTEN_0   (0x1UL << ADC_JSQR_JEXTEN_Pos)
 
#define ADC_JSQR_JEXTEN_1   (0x2UL << ADC_JSQR_JEXTEN_Pos)
 
#define ADC_JSQR_JSQ1_Pos   (8U)
 
#define ADC_JSQR_JSQ1_Msk   (0x1FUL << ADC_JSQR_JSQ1_Pos)
 
#define ADC_JSQR_JSQ1   ADC_JSQR_JSQ1_Msk
 
#define ADC_JSQR_JSQ1_0   (0x01UL << ADC_JSQR_JSQ1_Pos)
 
#define ADC_JSQR_JSQ1_1   (0x02UL << ADC_JSQR_JSQ1_Pos)
 
#define ADC_JSQR_JSQ1_2   (0x04UL << ADC_JSQR_JSQ1_Pos)
 
#define ADC_JSQR_JSQ1_3   (0x08UL << ADC_JSQR_JSQ1_Pos)
 
#define ADC_JSQR_JSQ1_4   (0x10UL << ADC_JSQR_JSQ1_Pos)
 
#define ADC_JSQR_JSQ2_Pos   (14U)
 
#define ADC_JSQR_JSQ2_Msk   (0x1FUL << ADC_JSQR_JSQ2_Pos)
 
#define ADC_JSQR_JSQ2   ADC_JSQR_JSQ2_Msk
 
#define ADC_JSQR_JSQ2_0   (0x01UL << ADC_JSQR_JSQ2_Pos)
 
#define ADC_JSQR_JSQ2_1   (0x02UL << ADC_JSQR_JSQ2_Pos)
 
#define ADC_JSQR_JSQ2_2   (0x04UL << ADC_JSQR_JSQ2_Pos)
 
#define ADC_JSQR_JSQ2_3   (0x08UL << ADC_JSQR_JSQ2_Pos)
 
#define ADC_JSQR_JSQ2_4   (0x10UL << ADC_JSQR_JSQ2_Pos)
 
#define ADC_JSQR_JSQ3_Pos   (20U)
 
#define ADC_JSQR_JSQ3_Msk   (0x1FUL << ADC_JSQR_JSQ3_Pos)
 
#define ADC_JSQR_JSQ3   ADC_JSQR_JSQ3_Msk
 
#define ADC_JSQR_JSQ3_0   (0x01UL << ADC_JSQR_JSQ3_Pos)
 
#define ADC_JSQR_JSQ3_1   (0x02UL << ADC_JSQR_JSQ3_Pos)
 
#define ADC_JSQR_JSQ3_2   (0x04UL << ADC_JSQR_JSQ3_Pos)
 
#define ADC_JSQR_JSQ3_3   (0x08UL << ADC_JSQR_JSQ3_Pos)
 
#define ADC_JSQR_JSQ3_4   (0x10UL << ADC_JSQR_JSQ3_Pos)
 
#define ADC_JSQR_JSQ4_Pos   (26U)
 
#define ADC_JSQR_JSQ4_Msk   (0x1FUL << ADC_JSQR_JSQ4_Pos)
 
#define ADC_JSQR_JSQ4   ADC_JSQR_JSQ4_Msk
 
#define ADC_JSQR_JSQ4_0   (0x01UL << ADC_JSQR_JSQ4_Pos)
 
#define ADC_JSQR_JSQ4_1   (0x02UL << ADC_JSQR_JSQ4_Pos)
 
#define ADC_JSQR_JSQ4_2   (0x04UL << ADC_JSQR_JSQ4_Pos)
 
#define ADC_JSQR_JSQ4_3   (0x08UL << ADC_JSQR_JSQ4_Pos)
 
#define ADC_JSQR_JSQ4_4   (0x10UL << ADC_JSQR_JSQ4_Pos)
 
#define ADC_OFR1_OFFSET1_Pos   (0U)
 
#define ADC_OFR1_OFFSET1_Msk   (0xFFFUL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1   ADC_OFR1_OFFSET1_Msk
 
#define ADC_OFR1_OFFSET1_0   (0x001UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_1   (0x002UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_2   (0x004UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_3   (0x008UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_4   (0x010UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_5   (0x020UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_6   (0x040UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_7   (0x080UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_8   (0x100UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_9   (0x200UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_10   (0x400UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_11   (0x800UL << ADC_OFR1_OFFSET1_Pos)
 
#define ADC_OFR1_OFFSET1_CH_Pos   (26U)
 
#define ADC_OFR1_OFFSET1_CH_Msk   (0x1FUL << ADC_OFR1_OFFSET1_CH_Pos)
 
#define ADC_OFR1_OFFSET1_CH   ADC_OFR1_OFFSET1_CH_Msk
 
#define ADC_OFR1_OFFSET1_CH_0   (0x01UL << ADC_OFR1_OFFSET1_CH_Pos)
 
#define ADC_OFR1_OFFSET1_CH_1   (0x02UL << ADC_OFR1_OFFSET1_CH_Pos)
 
#define ADC_OFR1_OFFSET1_CH_2   (0x04UL << ADC_OFR1_OFFSET1_CH_Pos)
 
#define ADC_OFR1_OFFSET1_CH_3   (0x08UL << ADC_OFR1_OFFSET1_CH_Pos)
 
#define ADC_OFR1_OFFSET1_CH_4   (0x10UL << ADC_OFR1_OFFSET1_CH_Pos)
 
#define ADC_OFR1_OFFSET1_EN_Pos   (31U)
 
#define ADC_OFR1_OFFSET1_EN_Msk   (0x1UL << ADC_OFR1_OFFSET1_EN_Pos)
 
#define ADC_OFR1_OFFSET1_EN   ADC_OFR1_OFFSET1_EN_Msk
 
#define ADC_OFR2_OFFSET2_Pos   (0U)
 
#define ADC_OFR2_OFFSET2_Msk   (0xFFFUL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2   ADC_OFR2_OFFSET2_Msk
 
#define ADC_OFR2_OFFSET2_0   (0x001UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_1   (0x002UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_2   (0x004UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_3   (0x008UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_4   (0x010UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_5   (0x020UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_6   (0x040UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_7   (0x080UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_8   (0x100UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_9   (0x200UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_10   (0x400UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_11   (0x800UL << ADC_OFR2_OFFSET2_Pos)
 
#define ADC_OFR2_OFFSET2_CH_Pos   (26U)
 
#define ADC_OFR2_OFFSET2_CH_Msk   (0x1FUL << ADC_OFR2_OFFSET2_CH_Pos)
 
#define ADC_OFR2_OFFSET2_CH   ADC_OFR2_OFFSET2_CH_Msk
 
#define ADC_OFR2_OFFSET2_CH_0   (0x01UL << ADC_OFR2_OFFSET2_CH_Pos)
 
#define ADC_OFR2_OFFSET2_CH_1   (0x02UL << ADC_OFR2_OFFSET2_CH_Pos)
 
#define ADC_OFR2_OFFSET2_CH_2   (0x04UL << ADC_OFR2_OFFSET2_CH_Pos)
 
#define ADC_OFR2_OFFSET2_CH_3   (0x08UL << ADC_OFR2_OFFSET2_CH_Pos)
 
#define ADC_OFR2_OFFSET2_CH_4   (0x10UL << ADC_OFR2_OFFSET2_CH_Pos)
 
#define ADC_OFR2_OFFSET2_EN_Pos   (31U)
 
#define ADC_OFR2_OFFSET2_EN_Msk   (0x1UL << ADC_OFR2_OFFSET2_EN_Pos)
 
#define ADC_OFR2_OFFSET2_EN   ADC_OFR2_OFFSET2_EN_Msk
 
#define ADC_OFR3_OFFSET3_Pos   (0U)
 
#define ADC_OFR3_OFFSET3_Msk   (0xFFFUL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3   ADC_OFR3_OFFSET3_Msk
 
#define ADC_OFR3_OFFSET3_0   (0x001UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_1   (0x002UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_2   (0x004UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_3   (0x008UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_4   (0x010UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_5   (0x020UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_6   (0x040UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_7   (0x080UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_8   (0x100UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_9   (0x200UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_10   (0x400UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_11   (0x800UL << ADC_OFR3_OFFSET3_Pos)
 
#define ADC_OFR3_OFFSET3_CH_Pos   (26U)
 
#define ADC_OFR3_OFFSET3_CH_Msk   (0x1FUL << ADC_OFR3_OFFSET3_CH_Pos)
 
#define ADC_OFR3_OFFSET3_CH   ADC_OFR3_OFFSET3_CH_Msk
 
#define ADC_OFR3_OFFSET3_CH_0   (0x01UL << ADC_OFR3_OFFSET3_CH_Pos)
 
#define ADC_OFR3_OFFSET3_CH_1   (0x02UL << ADC_OFR3_OFFSET3_CH_Pos)
 
#define ADC_OFR3_OFFSET3_CH_2   (0x04UL << ADC_OFR3_OFFSET3_CH_Pos)
 
#define ADC_OFR3_OFFSET3_CH_3   (0x08UL << ADC_OFR3_OFFSET3_CH_Pos)
 
#define ADC_OFR3_OFFSET3_CH_4   (0x10UL << ADC_OFR3_OFFSET3_CH_Pos)
 
#define ADC_OFR3_OFFSET3_EN_Pos   (31U)
 
#define ADC_OFR3_OFFSET3_EN_Msk   (0x1UL << ADC_OFR3_OFFSET3_EN_Pos)
 
#define ADC_OFR3_OFFSET3_EN   ADC_OFR3_OFFSET3_EN_Msk
 
#define ADC_OFR4_OFFSET4_Pos   (0U)
 
#define ADC_OFR4_OFFSET4_Msk   (0xFFFUL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4   ADC_OFR4_OFFSET4_Msk
 
#define ADC_OFR4_OFFSET4_0   (0x001UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_1   (0x002UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_2   (0x004UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_3   (0x008UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_4   (0x010UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_5   (0x020UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_6   (0x040UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_7   (0x080UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_8   (0x100UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_9   (0x200UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_10   (0x400UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_11   (0x800UL << ADC_OFR4_OFFSET4_Pos)
 
#define ADC_OFR4_OFFSET4_CH_Pos   (26U)
 
#define ADC_OFR4_OFFSET4_CH_Msk   (0x1FUL << ADC_OFR4_OFFSET4_CH_Pos)
 
#define ADC_OFR4_OFFSET4_CH   ADC_OFR4_OFFSET4_CH_Msk
 
#define ADC_OFR4_OFFSET4_CH_0   (0x01UL << ADC_OFR4_OFFSET4_CH_Pos)
 
#define ADC_OFR4_OFFSET4_CH_1   (0x02UL << ADC_OFR4_OFFSET4_CH_Pos)
 
#define ADC_OFR4_OFFSET4_CH_2   (0x04UL << ADC_OFR4_OFFSET4_CH_Pos)
 
#define ADC_OFR4_OFFSET4_CH_3   (0x08UL << ADC_OFR4_OFFSET4_CH_Pos)
 
#define ADC_OFR4_OFFSET4_CH_4   (0x10UL << ADC_OFR4_OFFSET4_CH_Pos)
 
#define ADC_OFR4_OFFSET4_EN_Pos   (31U)
 
#define ADC_OFR4_OFFSET4_EN_Msk   (0x1UL << ADC_OFR4_OFFSET4_EN_Pos)
 
#define ADC_OFR4_OFFSET4_EN   ADC_OFR4_OFFSET4_EN_Msk
 
#define ADC_JDR1_JDATA_Pos   (0U)
 
#define ADC_JDR1_JDATA_Msk   (0xFFFFUL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA   ADC_JDR1_JDATA_Msk
 
#define ADC_JDR1_JDATA_0   (0x0001UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_1   (0x0002UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_2   (0x0004UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_3   (0x0008UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_4   (0x0010UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_5   (0x0020UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_6   (0x0040UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_7   (0x0080UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_8   (0x0100UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_9   (0x0200UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_10   (0x0400UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_11   (0x0800UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_12   (0x1000UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_13   (0x2000UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_14   (0x4000UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR1_JDATA_15   (0x8000UL << ADC_JDR1_JDATA_Pos)
 
#define ADC_JDR2_JDATA_Pos   (0U)
 
#define ADC_JDR2_JDATA_Msk   (0xFFFFUL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA   ADC_JDR2_JDATA_Msk
 
#define ADC_JDR2_JDATA_0   (0x0001UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_1   (0x0002UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_2   (0x0004UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_3   (0x0008UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_4   (0x0010UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_5   (0x0020UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_6   (0x0040UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_7   (0x0080UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_8   (0x0100UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_9   (0x0200UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_10   (0x0400UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_11   (0x0800UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_12   (0x1000UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_13   (0x2000UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_14   (0x4000UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR2_JDATA_15   (0x8000UL << ADC_JDR2_JDATA_Pos)
 
#define ADC_JDR3_JDATA_Pos   (0U)
 
#define ADC_JDR3_JDATA_Msk   (0xFFFFUL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA   ADC_JDR3_JDATA_Msk
 
#define ADC_JDR3_JDATA_0   (0x0001UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_1   (0x0002UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_2   (0x0004UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_3   (0x0008UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_4   (0x0010UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_5   (0x0020UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_6   (0x0040UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_7   (0x0080UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_8   (0x0100UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_9   (0x0200UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_10   (0x0400UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_11   (0x0800UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_12   (0x1000UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_13   (0x2000UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_14   (0x4000UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR3_JDATA_15   (0x8000UL << ADC_JDR3_JDATA_Pos)
 
#define ADC_JDR4_JDATA_Pos   (0U)
 
#define ADC_JDR4_JDATA_Msk   (0xFFFFUL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA   ADC_JDR4_JDATA_Msk
 
#define ADC_JDR4_JDATA_0   (0x0001UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_1   (0x0002UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_2   (0x0004UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_3   (0x0008UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_4   (0x0010UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_5   (0x0020UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_6   (0x0040UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_7   (0x0080UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_8   (0x0100UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_9   (0x0200UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_10   (0x0400UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_11   (0x0800UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_12   (0x1000UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_13   (0x2000UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_14   (0x4000UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_JDR4_JDATA_15   (0x8000UL << ADC_JDR4_JDATA_Pos)
 
#define ADC_AWD2CR_AWD2CH_Pos   (1U)
 
#define ADC_AWD2CR_AWD2CH_Msk   (0x3FFFFUL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH   ADC_AWD2CR_AWD2CH_Msk
 
#define ADC_AWD2CR_AWD2CH_0   (0x00001UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_1   (0x00002UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_2   (0x00004UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_3   (0x00008UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_4   (0x00010UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_5   (0x00020UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_6   (0x00040UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_7   (0x00080UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_8   (0x00100UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_9   (0x00200UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_10   (0x00400UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_11   (0x00800UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_12   (0x01000UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_13   (0x02000UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_14   (0x04000UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_15   (0x08000UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_16   (0x10000UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD2CR_AWD2CH_17   (0x20000UL << ADC_AWD2CR_AWD2CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_Pos   (1U)
 
#define ADC_AWD3CR_AWD3CH_Msk   (0x3FFFFUL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH   ADC_AWD3CR_AWD3CH_Msk
 
#define ADC_AWD3CR_AWD3CH_0   (0x00001UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_1   (0x00002UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_2   (0x00004UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_3   (0x00008UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_4   (0x00010UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_5   (0x00020UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_6   (0x00040UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_7   (0x00080UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_8   (0x00100UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_9   (0x00200UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_10   (0x00400UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_11   (0x00800UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_12   (0x01000UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_13   (0x02000UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_14   (0x04000UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_15   (0x08000UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_16   (0x10000UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_AWD3CR_AWD3CH_17   (0x20000UL << ADC_AWD3CR_AWD3CH_Pos)
 
#define ADC_DIFSEL_DIFSEL_Pos   (1U)
 
#define ADC_DIFSEL_DIFSEL_Msk   (0x3FFFFUL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL   ADC_DIFSEL_DIFSEL_Msk
 
#define ADC_DIFSEL_DIFSEL_0   (0x00001UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_1   (0x00002UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_2   (0x00004UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_3   (0x00008UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_4   (0x00010UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_5   (0x00020UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_6   (0x00040UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_7   (0x00080UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_8   (0x00100UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_9   (0x00200UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_10   (0x00400UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_11   (0x00800UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_12   (0x01000UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_13   (0x02000UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_14   (0x04000UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_15   (0x08000UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_16   (0x10000UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_DIFSEL_DIFSEL_17   (0x20000UL << ADC_DIFSEL_DIFSEL_Pos)
 
#define ADC_CALFACT_CALFACT_S_Pos   (0U)
 
#define ADC_CALFACT_CALFACT_S_Msk   (0x7FUL << ADC_CALFACT_CALFACT_S_Pos)
 
#define ADC_CALFACT_CALFACT_S   ADC_CALFACT_CALFACT_S_Msk
 
#define ADC_CALFACT_CALFACT_S_0   (0x01UL << ADC_CALFACT_CALFACT_S_Pos)
 
#define ADC_CALFACT_CALFACT_S_1   (0x02UL << ADC_CALFACT_CALFACT_S_Pos)
 
#define ADC_CALFACT_CALFACT_S_2   (0x04UL << ADC_CALFACT_CALFACT_S_Pos)
 
#define ADC_CALFACT_CALFACT_S_3   (0x08UL << ADC_CALFACT_CALFACT_S_Pos)
 
#define ADC_CALFACT_CALFACT_S_4   (0x10UL << ADC_CALFACT_CALFACT_S_Pos)
 
#define ADC_CALFACT_CALFACT_S_5   (0x20UL << ADC_CALFACT_CALFACT_S_Pos)
 
#define ADC_CALFACT_CALFACT_S_6   (0x40UL << ADC_CALFACT_CALFACT_S_Pos)
 
#define ADC_CALFACT_CALFACT_D_Pos   (16U)
 
#define ADC_CALFACT_CALFACT_D_Msk   (0x7FUL << ADC_CALFACT_CALFACT_D_Pos)
 
#define ADC_CALFACT_CALFACT_D   ADC_CALFACT_CALFACT_D_Msk
 
#define ADC_CALFACT_CALFACT_D_0   (0x01UL << ADC_CALFACT_CALFACT_D_Pos)
 
#define ADC_CALFACT_CALFACT_D_1   (0x02UL << ADC_CALFACT_CALFACT_D_Pos)
 
#define ADC_CALFACT_CALFACT_D_2   (0x04UL << ADC_CALFACT_CALFACT_D_Pos)
 
#define ADC_CALFACT_CALFACT_D_3   (0x08UL << ADC_CALFACT_CALFACT_D_Pos)
 
#define ADC_CALFACT_CALFACT_D_4   (0x10UL << ADC_CALFACT_CALFACT_D_Pos)
 
#define ADC_CALFACT_CALFACT_D_5   (0x20UL << ADC_CALFACT_CALFACT_D_Pos)
 
#define ADC_CALFACT_CALFACT_D_6   (0x40UL << ADC_CALFACT_CALFACT_D_Pos)
 
#define ADC12_CSR_ADRDY_MST_Pos   (0U)
 
#define ADC12_CSR_ADRDY_MST_Msk   (0x1UL << ADC12_CSR_ADRDY_MST_Pos)
 
#define ADC12_CSR_ADRDY_MST   ADC12_CSR_ADRDY_MST_Msk
 
#define ADC12_CSR_ADRDY_EOSMP_MST_Pos   (1U)
 
#define ADC12_CSR_ADRDY_EOSMP_MST_Msk   (0x1UL << ADC12_CSR_ADRDY_EOSMP_MST_Pos)
 
#define ADC12_CSR_ADRDY_EOSMP_MST   ADC12_CSR_ADRDY_EOSMP_MST_Msk
 
#define ADC12_CSR_ADRDY_EOC_MST_Pos   (2U)
 
#define ADC12_CSR_ADRDY_EOC_MST_Msk   (0x1UL << ADC12_CSR_ADRDY_EOC_MST_Pos)
 
#define ADC12_CSR_ADRDY_EOC_MST   ADC12_CSR_ADRDY_EOC_MST_Msk
 
#define ADC12_CSR_ADRDY_EOS_MST_Pos   (3U)
 
#define ADC12_CSR_ADRDY_EOS_MST_Msk   (0x1UL << ADC12_CSR_ADRDY_EOS_MST_Pos)
 
#define ADC12_CSR_ADRDY_EOS_MST   ADC12_CSR_ADRDY_EOS_MST_Msk
 
#define ADC12_CSR_ADRDY_OVR_MST_Pos   (4U)
 
#define ADC12_CSR_ADRDY_OVR_MST_Msk   (0x1UL << ADC12_CSR_ADRDY_OVR_MST_Pos)
 
#define ADC12_CSR_ADRDY_OVR_MST   ADC12_CSR_ADRDY_OVR_MST_Msk
 
#define ADC12_CSR_ADRDY_JEOC_MST_Pos   (5U)
 
#define ADC12_CSR_ADRDY_JEOC_MST_Msk   (0x1UL << ADC12_CSR_ADRDY_JEOC_MST_Pos)
 
#define ADC12_CSR_ADRDY_JEOC_MST   ADC12_CSR_ADRDY_JEOC_MST_Msk
 
#define ADC12_CSR_ADRDY_JEOS_MST_Pos   (6U)
 
#define ADC12_CSR_ADRDY_JEOS_MST_Msk   (0x1UL << ADC12_CSR_ADRDY_JEOS_MST_Pos)
 
#define ADC12_CSR_ADRDY_JEOS_MST   ADC12_CSR_ADRDY_JEOS_MST_Msk
 
#define ADC12_CSR_AWD1_MST_Pos   (7U)
 
#define ADC12_CSR_AWD1_MST_Msk   (0x1UL << ADC12_CSR_AWD1_MST_Pos)
 
#define ADC12_CSR_AWD1_MST   ADC12_CSR_AWD1_MST_Msk
 
#define ADC12_CSR_AWD2_MST_Pos   (8U)
 
#define ADC12_CSR_AWD2_MST_Msk   (0x1UL << ADC12_CSR_AWD2_MST_Pos)
 
#define ADC12_CSR_AWD2_MST   ADC12_CSR_AWD2_MST_Msk
 
#define ADC12_CSR_AWD3_MST_Pos   (9U)
 
#define ADC12_CSR_AWD3_MST_Msk   (0x1UL << ADC12_CSR_AWD3_MST_Pos)
 
#define ADC12_CSR_AWD3_MST   ADC12_CSR_AWD3_MST_Msk
 
#define ADC12_CSR_JQOVF_MST_Pos   (10U)
 
#define ADC12_CSR_JQOVF_MST_Msk   (0x1UL << ADC12_CSR_JQOVF_MST_Pos)
 
#define ADC12_CSR_JQOVF_MST   ADC12_CSR_JQOVF_MST_Msk
 
#define ADC12_CSR_ADRDY_SLV_Pos   (16U)
 
#define ADC12_CSR_ADRDY_SLV_Msk   (0x1UL << ADC12_CSR_ADRDY_SLV_Pos)
 
#define ADC12_CSR_ADRDY_SLV   ADC12_CSR_ADRDY_SLV_Msk
 
#define ADC12_CSR_ADRDY_EOSMP_SLV_Pos   (17U)
 
#define ADC12_CSR_ADRDY_EOSMP_SLV_Msk   (0x1UL << ADC12_CSR_ADRDY_EOSMP_SLV_Pos)
 
#define ADC12_CSR_ADRDY_EOSMP_SLV   ADC12_CSR_ADRDY_EOSMP_SLV_Msk
 
#define ADC12_CSR_ADRDY_EOC_SLV_Pos   (18U)
 
#define ADC12_CSR_ADRDY_EOC_SLV_Msk   (0x1UL << ADC12_CSR_ADRDY_EOC_SLV_Pos)
 
#define ADC12_CSR_ADRDY_EOC_SLV   ADC12_CSR_ADRDY_EOC_SLV_Msk
 
#define ADC12_CSR_ADRDY_EOS_SLV_Pos   (19U)
 
#define ADC12_CSR_ADRDY_EOS_SLV_Msk   (0x1UL << ADC12_CSR_ADRDY_EOS_SLV_Pos)
 
#define ADC12_CSR_ADRDY_EOS_SLV   ADC12_CSR_ADRDY_EOS_SLV_Msk
 
#define ADC12_CSR_ADRDY_OVR_SLV_Pos   (20U)
 
#define ADC12_CSR_ADRDY_OVR_SLV_Msk   (0x1UL << ADC12_CSR_ADRDY_OVR_SLV_Pos)
 
#define ADC12_CSR_ADRDY_OVR_SLV   ADC12_CSR_ADRDY_OVR_SLV_Msk
 
#define ADC12_CSR_ADRDY_JEOC_SLV_Pos   (21U)
 
#define ADC12_CSR_ADRDY_JEOC_SLV_Msk   (0x1UL << ADC12_CSR_ADRDY_JEOC_SLV_Pos)
 
#define ADC12_CSR_ADRDY_JEOC_SLV   ADC12_CSR_ADRDY_JEOC_SLV_Msk
 
#define ADC12_CSR_ADRDY_JEOS_SLV_Pos   (22U)
 
#define ADC12_CSR_ADRDY_JEOS_SLV_Msk   (0x1UL << ADC12_CSR_ADRDY_JEOS_SLV_Pos)
 
#define ADC12_CSR_ADRDY_JEOS_SLV   ADC12_CSR_ADRDY_JEOS_SLV_Msk
 
#define ADC12_CSR_AWD1_SLV_Pos   (23U)
 
#define ADC12_CSR_AWD1_SLV_Msk   (0x1UL << ADC12_CSR_AWD1_SLV_Pos)
 
#define ADC12_CSR_AWD1_SLV   ADC12_CSR_AWD1_SLV_Msk
 
#define ADC12_CSR_AWD2_SLV_Pos   (24U)
 
#define ADC12_CSR_AWD2_SLV_Msk   (0x1UL << ADC12_CSR_AWD2_SLV_Pos)
 
#define ADC12_CSR_AWD2_SLV   ADC12_CSR_AWD2_SLV_Msk
 
#define ADC12_CSR_AWD3_SLV_Pos   (25U)
 
#define ADC12_CSR_AWD3_SLV_Msk   (0x1UL << ADC12_CSR_AWD3_SLV_Pos)
 
#define ADC12_CSR_AWD3_SLV   ADC12_CSR_AWD3_SLV_Msk
 
#define ADC12_CSR_JQOVF_SLV_Pos   (26U)
 
#define ADC12_CSR_JQOVF_SLV_Msk   (0x1UL << ADC12_CSR_JQOVF_SLV_Pos)
 
#define ADC12_CSR_JQOVF_SLV   ADC12_CSR_JQOVF_SLV_Msk
 
#define ADC34_CSR_ADRDY_MST_Pos   (0U)
 
#define ADC34_CSR_ADRDY_MST_Msk   (0x1UL << ADC34_CSR_ADRDY_MST_Pos)
 
#define ADC34_CSR_ADRDY_MST   ADC34_CSR_ADRDY_MST_Msk
 
#define ADC34_CSR_ADRDY_EOSMP_MST_Pos   (1U)
 
#define ADC34_CSR_ADRDY_EOSMP_MST_Msk   (0x1UL << ADC34_CSR_ADRDY_EOSMP_MST_Pos)
 
#define ADC34_CSR_ADRDY_EOSMP_MST   ADC34_CSR_ADRDY_EOSMP_MST_Msk
 
#define ADC34_CSR_ADRDY_EOC_MST_Pos   (2U)
 
#define ADC34_CSR_ADRDY_EOC_MST_Msk   (0x1UL << ADC34_CSR_ADRDY_EOC_MST_Pos)
 
#define ADC34_CSR_ADRDY_EOC_MST   ADC34_CSR_ADRDY_EOC_MST_Msk
 
#define ADC34_CSR_ADRDY_EOS_MST_Pos   (3U)
 
#define ADC34_CSR_ADRDY_EOS_MST_Msk   (0x1UL << ADC34_CSR_ADRDY_EOS_MST_Pos)
 
#define ADC34_CSR_ADRDY_EOS_MST   ADC34_CSR_ADRDY_EOS_MST_Msk
 
#define ADC34_CSR_ADRDY_OVR_MST_Pos   (4U)
 
#define ADC34_CSR_ADRDY_OVR_MST_Msk   (0x1UL << ADC34_CSR_ADRDY_OVR_MST_Pos)
 
#define ADC34_CSR_ADRDY_OVR_MST   ADC34_CSR_ADRDY_OVR_MST_Msk
 
#define ADC34_CSR_ADRDY_JEOC_MST_Pos   (5U)
 
#define ADC34_CSR_ADRDY_JEOC_MST_Msk   (0x1UL << ADC34_CSR_ADRDY_JEOC_MST_Pos)
 
#define ADC34_CSR_ADRDY_JEOC_MST   ADC34_CSR_ADRDY_JEOC_MST_Msk
 
#define ADC34_CSR_ADRDY_JEOS_MST_Pos   (6U)
 
#define ADC34_CSR_ADRDY_JEOS_MST_Msk   (0x1UL << ADC34_CSR_ADRDY_JEOS_MST_Pos)
 
#define ADC34_CSR_ADRDY_JEOS_MST   ADC34_CSR_ADRDY_JEOS_MST_Msk
 
#define ADC34_CSR_AWD1_MST_Pos   (7U)
 
#define ADC34_CSR_AWD1_MST_Msk   (0x1UL << ADC34_CSR_AWD1_MST_Pos)
 
#define ADC34_CSR_AWD1_MST   ADC34_CSR_AWD1_MST_Msk
 
#define ADC34_CSR_AWD2_MST_Pos   (8U)
 
#define ADC34_CSR_AWD2_MST_Msk   (0x1UL << ADC34_CSR_AWD2_MST_Pos)
 
#define ADC34_CSR_AWD2_MST   ADC34_CSR_AWD2_MST_Msk
 
#define ADC34_CSR_AWD3_MST_Pos   (9U)
 
#define ADC34_CSR_AWD3_MST_Msk   (0x1UL << ADC34_CSR_AWD3_MST_Pos)
 
#define ADC34_CSR_AWD3_MST   ADC34_CSR_AWD3_MST_Msk
 
#define ADC34_CSR_JQOVF_MST_Pos   (10U)
 
#define ADC34_CSR_JQOVF_MST_Msk   (0x1UL << ADC34_CSR_JQOVF_MST_Pos)
 
#define ADC34_CSR_JQOVF_MST   ADC34_CSR_JQOVF_MST_Msk
 
#define ADC34_CSR_ADRDY_SLV_Pos   (16U)
 
#define ADC34_CSR_ADRDY_SLV_Msk   (0x1UL << ADC34_CSR_ADRDY_SLV_Pos)
 
#define ADC34_CSR_ADRDY_SLV   ADC34_CSR_ADRDY_SLV_Msk
 
#define ADC34_CSR_ADRDY_EOSMP_SLV_Pos   (17U)
 
#define ADC34_CSR_ADRDY_EOSMP_SLV_Msk   (0x1UL << ADC34_CSR_ADRDY_EOSMP_SLV_Pos)
 
#define ADC34_CSR_ADRDY_EOSMP_SLV   ADC34_CSR_ADRDY_EOSMP_SLV_Msk
 
#define ADC34_CSR_ADRDY_EOC_SLV_Pos   (18U)
 
#define ADC34_CSR_ADRDY_EOC_SLV_Msk   (0x1UL << ADC34_CSR_ADRDY_EOC_SLV_Pos)
 
#define ADC34_CSR_ADRDY_EOC_SLV   ADC34_CSR_ADRDY_EOC_SLV_Msk
 
#define ADC34_CSR_ADRDY_EOS_SLV_Pos   (19U)
 
#define ADC34_CSR_ADRDY_EOS_SLV_Msk   (0x1UL << ADC34_CSR_ADRDY_EOS_SLV_Pos)
 
#define ADC34_CSR_ADRDY_EOS_SLV   ADC34_CSR_ADRDY_EOS_SLV_Msk
 
#define ADC12_CSR_ADRDY_OVR_SLV_Pos   (20U)
 
#define ADC12_CSR_ADRDY_OVR_SLV_Msk   (0x1UL << ADC12_CSR_ADRDY_OVR_SLV_Pos)
 
#define ADC12_CSR_ADRDY_OVR_SLV   ADC12_CSR_ADRDY_OVR_SLV_Msk
 
#define ADC34_CSR_ADRDY_JEOC_SLV_Pos   (21U)
 
#define ADC34_CSR_ADRDY_JEOC_SLV_Msk   (0x1UL << ADC34_CSR_ADRDY_JEOC_SLV_Pos)
 
#define ADC34_CSR_ADRDY_JEOC_SLV   ADC34_CSR_ADRDY_JEOC_SLV_Msk
 
#define ADC34_CSR_ADRDY_JEOS_SLV_Pos   (22U)
 
#define ADC34_CSR_ADRDY_JEOS_SLV_Msk   (0x1UL << ADC34_CSR_ADRDY_JEOS_SLV_Pos)
 
#define ADC34_CSR_ADRDY_JEOS_SLV   ADC34_CSR_ADRDY_JEOS_SLV_Msk
 
#define ADC34_CSR_AWD1_SLV_Pos   (23U)
 
#define ADC34_CSR_AWD1_SLV_Msk   (0x1UL << ADC34_CSR_AWD1_SLV_Pos)
 
#define ADC34_CSR_AWD1_SLV   ADC34_CSR_AWD1_SLV_Msk
 
#define ADC34_CSR_AWD2_SLV_Pos   (24U)
 
#define ADC34_CSR_AWD2_SLV_Msk   (0x1UL << ADC34_CSR_AWD2_SLV_Pos)
 
#define ADC34_CSR_AWD2_SLV   ADC34_CSR_AWD2_SLV_Msk
 
#define ADC34_CSR_AWD3_SLV_Pos   (25U)
 
#define ADC34_CSR_AWD3_SLV_Msk   (0x1UL << ADC34_CSR_AWD3_SLV_Pos)
 
#define ADC34_CSR_AWD3_SLV   ADC34_CSR_AWD3_SLV_Msk
 
#define ADC34_CSR_JQOVF_SLV_Pos   (26U)
 
#define ADC34_CSR_JQOVF_SLV_Msk   (0x1UL << ADC34_CSR_JQOVF_SLV_Pos)
 
#define ADC34_CSR_JQOVF_SLV   ADC34_CSR_JQOVF_SLV_Msk
 
#define ADC12_CCR_MULTI_Pos   (0U)
 
#define ADC12_CCR_MULTI_Msk   (0x1FUL << ADC12_CCR_MULTI_Pos)
 
#define ADC12_CCR_MULTI   ADC12_CCR_MULTI_Msk
 
#define ADC12_CCR_MULTI_0   (0x01UL << ADC12_CCR_MULTI_Pos)
 
#define ADC12_CCR_MULTI_1   (0x02UL << ADC12_CCR_MULTI_Pos)
 
#define ADC12_CCR_MULTI_2   (0x04UL << ADC12_CCR_MULTI_Pos)
 
#define ADC12_CCR_MULTI_3   (0x08UL << ADC12_CCR_MULTI_Pos)
 
#define ADC12_CCR_MULTI_4   (0x10UL << ADC12_CCR_MULTI_Pos)
 
#define ADC12_CCR_DELAY_Pos   (8U)
 
#define ADC12_CCR_DELAY_Msk   (0xFUL << ADC12_CCR_DELAY_Pos)
 
#define ADC12_CCR_DELAY   ADC12_CCR_DELAY_Msk
 
#define ADC12_CCR_DELAY_0   (0x1UL << ADC12_CCR_DELAY_Pos)
 
#define ADC12_CCR_DELAY_1   (0x2UL << ADC12_CCR_DELAY_Pos)
 
#define ADC12_CCR_DELAY_2   (0x4UL << ADC12_CCR_DELAY_Pos)
 
#define ADC12_CCR_DELAY_3   (0x8UL << ADC12_CCR_DELAY_Pos)
 
#define ADC12_CCR_DMACFG_Pos   (13U)
 
#define ADC12_CCR_DMACFG_Msk   (0x1UL << ADC12_CCR_DMACFG_Pos)
 
#define ADC12_CCR_DMACFG   ADC12_CCR_DMACFG_Msk
 
#define ADC12_CCR_MDMA_Pos   (14U)
 
#define ADC12_CCR_MDMA_Msk   (0x3UL << ADC12_CCR_MDMA_Pos)
 
#define ADC12_CCR_MDMA   ADC12_CCR_MDMA_Msk
 
#define ADC12_CCR_MDMA_0   (0x1UL << ADC12_CCR_MDMA_Pos)
 
#define ADC12_CCR_MDMA_1   (0x2UL << ADC12_CCR_MDMA_Pos)
 
#define ADC12_CCR_CKMODE_Pos   (16U)
 
#define ADC12_CCR_CKMODE_Msk   (0x3UL << ADC12_CCR_CKMODE_Pos)
 
#define ADC12_CCR_CKMODE   ADC12_CCR_CKMODE_Msk
 
#define ADC12_CCR_CKMODE_0   (0x1UL << ADC12_CCR_CKMODE_Pos)
 
#define ADC12_CCR_CKMODE_1   (0x2UL << ADC12_CCR_CKMODE_Pos)
 
#define ADC12_CCR_VREFEN_Pos   (22U)
 
#define ADC12_CCR_VREFEN_Msk   (0x1UL << ADC12_CCR_VREFEN_Pos)
 
#define ADC12_CCR_VREFEN   ADC12_CCR_VREFEN_Msk
 
#define ADC12_CCR_TSEN_Pos   (23U)
 
#define ADC12_CCR_TSEN_Msk   (0x1UL << ADC12_CCR_TSEN_Pos)
 
#define ADC12_CCR_TSEN   ADC12_CCR_TSEN_Msk
 
#define ADC12_CCR_VBATEN_Pos   (24U)
 
#define ADC12_CCR_VBATEN_Msk   (0x1UL << ADC12_CCR_VBATEN_Pos)
 
#define ADC12_CCR_VBATEN   ADC12_CCR_VBATEN_Msk
 
#define ADC34_CCR_MULTI_Pos   (0U)
 
#define ADC34_CCR_MULTI_Msk   (0x1FUL << ADC34_CCR_MULTI_Pos)
 
#define ADC34_CCR_MULTI   ADC34_CCR_MULTI_Msk
 
#define ADC34_CCR_MULTI_0   (0x01UL << ADC34_CCR_MULTI_Pos)
 
#define ADC34_CCR_MULTI_1   (0x02UL << ADC34_CCR_MULTI_Pos)
 
#define ADC34_CCR_MULTI_2   (0x04UL << ADC34_CCR_MULTI_Pos)
 
#define ADC34_CCR_MULTI_3   (0x08UL << ADC34_CCR_MULTI_Pos)
 
#define ADC34_CCR_MULTI_4   (0x10UL << ADC34_CCR_MULTI_Pos)
 
#define ADC34_CCR_DELAY_Pos   (8U)
 
#define ADC34_CCR_DELAY_Msk   (0xFUL << ADC34_CCR_DELAY_Pos)
 
#define ADC34_CCR_DELAY   ADC34_CCR_DELAY_Msk
 
#define ADC34_CCR_DELAY_0   (0x1UL << ADC34_CCR_DELAY_Pos)
 
#define ADC34_CCR_DELAY_1   (0x2UL << ADC34_CCR_DELAY_Pos)
 
#define ADC34_CCR_DELAY_2   (0x4UL << ADC34_CCR_DELAY_Pos)
 
#define ADC34_CCR_DELAY_3   (0x8UL << ADC34_CCR_DELAY_Pos)
 
#define ADC34_CCR_DMACFG_Pos   (13U)
 
#define ADC34_CCR_DMACFG_Msk   (0x1UL << ADC34_CCR_DMACFG_Pos)
 
#define ADC34_CCR_DMACFG   ADC34_CCR_DMACFG_Msk
 
#define ADC34_CCR_MDMA_Pos   (14U)
 
#define ADC34_CCR_MDMA_Msk   (0x3UL << ADC34_CCR_MDMA_Pos)
 
#define ADC34_CCR_MDMA   ADC34_CCR_MDMA_Msk
 
#define ADC34_CCR_MDMA_0   (0x1UL << ADC34_CCR_MDMA_Pos)
 
#define ADC34_CCR_MDMA_1   (0x2UL << ADC34_CCR_MDMA_Pos)
 
#define ADC34_CCR_CKMODE_Pos   (16U)
 
#define ADC34_CCR_CKMODE_Msk   (0x3UL << ADC34_CCR_CKMODE_Pos)
 
#define ADC34_CCR_CKMODE   ADC34_CCR_CKMODE_Msk
 
#define ADC34_CCR_CKMODE_0   (0x1UL << ADC34_CCR_CKMODE_Pos)
 
#define ADC34_CCR_CKMODE_1   (0x2UL << ADC34_CCR_CKMODE_Pos)
 
#define ADC34_CCR_VREFEN_Pos   (22U)
 
#define ADC34_CCR_VREFEN_Msk   (0x1UL << ADC34_CCR_VREFEN_Pos)
 
#define ADC34_CCR_VREFEN   ADC34_CCR_VREFEN_Msk
 
#define ADC34_CCR_TSEN_Pos   (23U)
 
#define ADC34_CCR_TSEN_Msk   (0x1UL << ADC34_CCR_TSEN_Pos)
 
#define ADC34_CCR_TSEN   ADC34_CCR_TSEN_Msk
 
#define ADC34_CCR_VBATEN_Pos   (24U)
 
#define ADC34_CCR_VBATEN_Msk   (0x1UL << ADC34_CCR_VBATEN_Pos)
 
#define ADC34_CCR_VBATEN   ADC34_CCR_VBATEN_Msk
 
#define ADC12_CDR_RDATA_MST_Pos   (0U)
 
#define ADC12_CDR_RDATA_MST_Msk   (0xFFFFUL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST   ADC12_CDR_RDATA_MST_Msk
 
#define ADC12_CDR_RDATA_MST_0   (0x0001UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_1   (0x0002UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_2   (0x0004UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_3   (0x0008UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_4   (0x0010UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_5   (0x0020UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_6   (0x0040UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_7   (0x0080UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_8   (0x0100UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_9   (0x0200UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_10   (0x0400UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_11   (0x0800UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_12   (0x1000UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_13   (0x2000UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_14   (0x4000UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_MST_15   (0x8000UL << ADC12_CDR_RDATA_MST_Pos)
 
#define ADC12_CDR_RDATA_SLV_Pos   (16U)
 
#define ADC12_CDR_RDATA_SLV_Msk   (0xFFFFUL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV   ADC12_CDR_RDATA_SLV_Msk
 
#define ADC12_CDR_RDATA_SLV_0   (0x0001UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_1   (0x0002UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_2   (0x0004UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_3   (0x0008UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_4   (0x0010UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_5   (0x0020UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_6   (0x0040UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_7   (0x0080UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_8   (0x0100UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_9   (0x0200UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_10   (0x0400UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_11   (0x0800UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_12   (0x1000UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_13   (0x2000UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_14   (0x4000UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC12_CDR_RDATA_SLV_15   (0x8000UL << ADC12_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_MST_Pos   (0U)
 
#define ADC34_CDR_RDATA_MST_Msk   (0xFFFFUL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST   ADC34_CDR_RDATA_MST_Msk
 
#define ADC34_CDR_RDATA_MST_0   (0x0001UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_1   (0x0002UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_2   (0x0004UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_3   (0x0008UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_4   (0x0010UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_5   (0x0020UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_6   (0x0040UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_7   (0x0080UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_8   (0x0100UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_9   (0x0200UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_10   (0x0400UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_11   (0x0800UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_12   (0x1000UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_13   (0x2000UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_14   (0x4000UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_MST_15   (0x8000UL << ADC34_CDR_RDATA_MST_Pos)
 
#define ADC34_CDR_RDATA_SLV_Pos   (16U)
 
#define ADC34_CDR_RDATA_SLV_Msk   (0xFFFFUL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV   ADC34_CDR_RDATA_SLV_Msk
 
#define ADC34_CDR_RDATA_SLV_0   (0x0001UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_1   (0x0002UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_2   (0x0004UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_3   (0x0008UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_4   (0x0010UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_5   (0x0020UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_6   (0x0040UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_7   (0x0080UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_8   (0x0100UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_9   (0x0200UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_10   (0x0400UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_11   (0x0800UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_12   (0x1000UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_13   (0x2000UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_14   (0x4000UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC34_CDR_RDATA_SLV_15   (0x8000UL << ADC34_CDR_RDATA_SLV_Pos)
 
#define ADC_CSR_ADRDY_MST_Pos   (0U)
 
#define ADC_CSR_ADRDY_MST_Msk   (0x1UL << ADC_CSR_ADRDY_MST_Pos)
 
#define ADC_CSR_ADRDY_MST   ADC_CSR_ADRDY_MST_Msk
 
#define ADC_CSR_EOSMP_MST_Pos   (1U)
 
#define ADC_CSR_EOSMP_MST_Msk   (0x1UL << ADC_CSR_EOSMP_MST_Pos)
 
#define ADC_CSR_EOSMP_MST   ADC_CSR_EOSMP_MST_Msk
 
#define ADC_CSR_EOC_MST_Pos   (2U)
 
#define ADC_CSR_EOC_MST_Msk   (0x1UL << ADC_CSR_EOC_MST_Pos)
 
#define ADC_CSR_EOC_MST   ADC_CSR_EOC_MST_Msk
 
#define ADC_CSR_EOS_MST_Pos   (3U)
 
#define ADC_CSR_EOS_MST_Msk   (0x1UL << ADC_CSR_EOS_MST_Pos)
 
#define ADC_CSR_EOS_MST   ADC_CSR_EOS_MST_Msk
 
#define ADC_CSR_OVR_MST_Pos   (4U)
 
#define ADC_CSR_OVR_MST_Msk   (0x1UL << ADC_CSR_OVR_MST_Pos)
 
#define ADC_CSR_OVR_MST   ADC_CSR_OVR_MST_Msk
 
#define ADC_CSR_JEOC_MST_Pos   (5U)
 
#define ADC_CSR_JEOC_MST_Msk   (0x1UL << ADC_CSR_JEOC_MST_Pos)
 
#define ADC_CSR_JEOC_MST   ADC_CSR_JEOC_MST_Msk
 
#define ADC_CSR_JEOS_MST_Pos   (6U)
 
#define ADC_CSR_JEOS_MST_Msk   (0x1UL << ADC_CSR_JEOS_MST_Pos)
 
#define ADC_CSR_JEOS_MST   ADC_CSR_JEOS_MST_Msk
 
#define ADC_CSR_AWD1_MST_Pos   (7U)
 
#define ADC_CSR_AWD1_MST_Msk   (0x1UL << ADC_CSR_AWD1_MST_Pos)
 
#define ADC_CSR_AWD1_MST   ADC_CSR_AWD1_MST_Msk
 
#define ADC_CSR_AWD2_MST_Pos   (8U)
 
#define ADC_CSR_AWD2_MST_Msk   (0x1UL << ADC_CSR_AWD2_MST_Pos)
 
#define ADC_CSR_AWD2_MST   ADC_CSR_AWD2_MST_Msk
 
#define ADC_CSR_AWD3_MST_Pos   (9U)
 
#define ADC_CSR_AWD3_MST_Msk   (0x1UL << ADC_CSR_AWD3_MST_Pos)
 
#define ADC_CSR_AWD3_MST   ADC_CSR_AWD3_MST_Msk
 
#define ADC_CSR_JQOVF_MST_Pos   (10U)
 
#define ADC_CSR_JQOVF_MST_Msk   (0x1UL << ADC_CSR_JQOVF_MST_Pos)
 
#define ADC_CSR_JQOVF_MST   ADC_CSR_JQOVF_MST_Msk
 
#define ADC_CSR_ADRDY_SLV_Pos   (16U)
 
#define ADC_CSR_ADRDY_SLV_Msk   (0x1UL << ADC_CSR_ADRDY_SLV_Pos)
 
#define ADC_CSR_ADRDY_SLV   ADC_CSR_ADRDY_SLV_Msk
 
#define ADC_CSR_EOSMP_SLV_Pos   (17U)
 
#define ADC_CSR_EOSMP_SLV_Msk   (0x1UL << ADC_CSR_EOSMP_SLV_Pos)
 
#define ADC_CSR_EOSMP_SLV   ADC_CSR_EOSMP_SLV_Msk
 
#define ADC_CSR_EOC_SLV_Pos   (18U)
 
#define ADC_CSR_EOC_SLV_Msk   (0x1UL << ADC_CSR_EOC_SLV_Pos)
 
#define ADC_CSR_EOC_SLV   ADC_CSR_EOC_SLV_Msk
 
#define ADC_CSR_EOS_SLV_Pos   (19U)
 
#define ADC_CSR_EOS_SLV_Msk   (0x1UL << ADC_CSR_EOS_SLV_Pos)
 
#define ADC_CSR_EOS_SLV   ADC_CSR_EOS_SLV_Msk
 
#define ADC_CSR_OVR_SLV_Pos   (20U)
 
#define ADC_CSR_OVR_SLV_Msk   (0x1UL << ADC_CSR_OVR_SLV_Pos)
 
#define ADC_CSR_OVR_SLV   ADC_CSR_OVR_SLV_Msk
 
#define ADC_CSR_JEOC_SLV_Pos   (21U)
 
#define ADC_CSR_JEOC_SLV_Msk   (0x1UL << ADC_CSR_JEOC_SLV_Pos)
 
#define ADC_CSR_JEOC_SLV   ADC_CSR_JEOC_SLV_Msk
 
#define ADC_CSR_JEOS_SLV_Pos   (22U)
 
#define ADC_CSR_JEOS_SLV_Msk   (0x1UL << ADC_CSR_JEOS_SLV_Pos)
 
#define ADC_CSR_JEOS_SLV   ADC_CSR_JEOS_SLV_Msk
 
#define ADC_CSR_AWD1_SLV_Pos   (23U)
 
#define ADC_CSR_AWD1_SLV_Msk   (0x1UL << ADC_CSR_AWD1_SLV_Pos)
 
#define ADC_CSR_AWD1_SLV   ADC_CSR_AWD1_SLV_Msk
 
#define ADC_CSR_AWD2_SLV_Pos   (24U)
 
#define ADC_CSR_AWD2_SLV_Msk   (0x1UL << ADC_CSR_AWD2_SLV_Pos)
 
#define ADC_CSR_AWD2_SLV   ADC_CSR_AWD2_SLV_Msk
 
#define ADC_CSR_AWD3_SLV_Pos   (25U)
 
#define ADC_CSR_AWD3_SLV_Msk   (0x1UL << ADC_CSR_AWD3_SLV_Pos)
 
#define ADC_CSR_AWD3_SLV   ADC_CSR_AWD3_SLV_Msk
 
#define ADC_CSR_JQOVF_SLV_Pos   (26U)
 
#define ADC_CSR_JQOVF_SLV_Msk   (0x1UL << ADC_CSR_JQOVF_SLV_Pos)
 
#define ADC_CSR_JQOVF_SLV   ADC_CSR_JQOVF_SLV_Msk
 
#define ADC_CSR_ADRDY_EOSMP_MST   ADC_CSR_EOSMP_MST
 
#define ADC_CSR_ADRDY_EOC_MST   ADC_CSR_EOC_MST
 
#define ADC_CSR_ADRDY_EOS_MST   ADC_CSR_EOS_MST
 
#define ADC_CSR_ADRDY_OVR_MST   ADC_CSR_OVR_MST
 
#define ADC_CSR_ADRDY_JEOC_MST   ADC_CSR_JEOC_MST
 
#define ADC_CSR_ADRDY_JEOS_MST   ADC_CSR_JEOS_MST
 
#define ADC_CSR_ADRDY_EOSMP_SLV   ADC_CSR_EOSMP_SLV
 
#define ADC_CSR_ADRDY_EOC_SLV   ADC_CSR_EOC_SLV
 
#define ADC_CSR_ADRDY_EOS_SLV   ADC_CSR_EOS_SLV
 
#define ADC_CSR_ADRDY_OVR_SLV   ADC_CSR_OVR_SLV
 
#define ADC_CSR_ADRDY_JEOC_SLV   ADC_CSR_JEOC_SLV
 
#define ADC_CSR_ADRDY_JEOS_SLV   ADC_CSR_JEOS_SLV
 
#define ADC_CCR_DUAL_Pos   (0U)
 
#define ADC_CCR_DUAL_Msk   (0x1FUL << ADC_CCR_DUAL_Pos)
 
#define ADC_CCR_DUAL   ADC_CCR_DUAL_Msk
 
#define ADC_CCR_DUAL_0   (0x01UL << ADC_CCR_DUAL_Pos)
 
#define ADC_CCR_DUAL_1   (0x02UL << ADC_CCR_DUAL_Pos)
 
#define ADC_CCR_DUAL_2   (0x04UL << ADC_CCR_DUAL_Pos)
 
#define ADC_CCR_DUAL_3   (0x08UL << ADC_CCR_DUAL_Pos)
 
#define ADC_CCR_DUAL_4   (0x10UL << ADC_CCR_DUAL_Pos)
 
#define ADC_CCR_DELAY_Pos   (8U)
 
#define ADC_CCR_DELAY_Msk   (0xFUL << ADC_CCR_DELAY_Pos)
 
#define ADC_CCR_DELAY   ADC_CCR_DELAY_Msk
 
#define ADC_CCR_DELAY_0   (0x1UL << ADC_CCR_DELAY_Pos)
 
#define ADC_CCR_DELAY_1   (0x2UL << ADC_CCR_DELAY_Pos)
 
#define ADC_CCR_DELAY_2   (0x4UL << ADC_CCR_DELAY_Pos)
 
#define ADC_CCR_DELAY_3   (0x8UL << ADC_CCR_DELAY_Pos)
 
#define ADC_CCR_DMACFG_Pos   (13U)
 
#define ADC_CCR_DMACFG_Msk   (0x1UL << ADC_CCR_DMACFG_Pos)
 
#define ADC_CCR_DMACFG   ADC_CCR_DMACFG_Msk
 
#define ADC_CCR_MDMA_Pos   (14U)
 
#define ADC_CCR_MDMA_Msk   (0x3UL << ADC_CCR_MDMA_Pos)
 
#define ADC_CCR_MDMA   ADC_CCR_MDMA_Msk
 
#define ADC_CCR_MDMA_0   (0x1UL << ADC_CCR_MDMA_Pos)
 
#define ADC_CCR_MDMA_1   (0x2UL << ADC_CCR_MDMA_Pos)
 
#define ADC_CCR_CKMODE_Pos   (16U)
 
#define ADC_CCR_CKMODE_Msk   (0x3UL << ADC_CCR_CKMODE_Pos)
 
#define ADC_CCR_CKMODE   ADC_CCR_CKMODE_Msk
 
#define ADC_CCR_CKMODE_0   (0x1UL << ADC_CCR_CKMODE_Pos)
 
#define ADC_CCR_CKMODE_1   (0x2UL << ADC_CCR_CKMODE_Pos)
 
#define ADC_CCR_VREFEN_Pos   (22U)
 
#define ADC_CCR_VREFEN_Msk   (0x1UL << ADC_CCR_VREFEN_Pos)
 
#define ADC_CCR_VREFEN   ADC_CCR_VREFEN_Msk
 
#define ADC_CCR_TSEN_Pos   (23U)
 
#define ADC_CCR_TSEN_Msk   (0x1UL << ADC_CCR_TSEN_Pos)
 
#define ADC_CCR_TSEN   ADC_CCR_TSEN_Msk
 
#define ADC_CCR_VBATEN_Pos   (24U)
 
#define ADC_CCR_VBATEN_Msk   (0x1UL << ADC_CCR_VBATEN_Pos)
 
#define ADC_CCR_VBATEN   ADC_CCR_VBATEN_Msk
 
#define ADC_CCR_MULTI   (ADC_CCR_DUAL)
 
#define ADC_CCR_MULTI_0   (ADC_CCR_DUAL_0)
 
#define ADC_CCR_MULTI_1   (ADC_CCR_DUAL_1)
 
#define ADC_CCR_MULTI_2   (ADC_CCR_DUAL_2)
 
#define ADC_CCR_MULTI_3   (ADC_CCR_DUAL_3)
 
#define ADC_CCR_MULTI_4   (ADC_CCR_DUAL_4)
 
#define ADC_CDR_RDATA_MST_Pos   (0U)
 
#define ADC_CDR_RDATA_MST_Msk   (0xFFFFUL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST   ADC_CDR_RDATA_MST_Msk
 
#define ADC_CDR_RDATA_MST_0   (0x0001UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_1   (0x0002UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_2   (0x0004UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_3   (0x0008UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_4   (0x0010UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_5   (0x0020UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_6   (0x0040UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_7   (0x0080UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_8   (0x0100UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_9   (0x0200UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_10   (0x0400UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_11   (0x0800UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_12   (0x1000UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_13   (0x2000UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_14   (0x4000UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_MST_15   (0x8000UL << ADC_CDR_RDATA_MST_Pos)
 
#define ADC_CDR_RDATA_SLV_Pos   (16U)
 
#define ADC_CDR_RDATA_SLV_Msk   (0xFFFFUL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV   ADC_CDR_RDATA_SLV_Msk
 
#define ADC_CDR_RDATA_SLV_0   (0x0001UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_1   (0x0002UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_2   (0x0004UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_3   (0x0008UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_4   (0x0010UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_5   (0x0020UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_6   (0x0040UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_7   (0x0080UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_8   (0x0100UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_9   (0x0200UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_10   (0x0400UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_11   (0x0800UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_12   (0x1000UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_13   (0x2000UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_14   (0x4000UL << ADC_CDR_RDATA_SLV_Pos)
 
#define ADC_CDR_RDATA_SLV_15   (0x8000UL << ADC_CDR_RDATA_SLV_Pos)
 
#define COMP_V1_3_0_0
 
#define COMP1_CSR_COMP1EN_Pos   (0U)
 
#define COMP1_CSR_COMP1EN_Msk   (0x1UL << COMP1_CSR_COMP1EN_Pos)
 
#define COMP1_CSR_COMP1EN   COMP1_CSR_COMP1EN_Msk
 
#define COMP1_CSR_COMP1SW1_Pos   (1U)
 
#define COMP1_CSR_COMP1SW1_Msk   (0x1UL << COMP1_CSR_COMP1SW1_Pos)
 
#define COMP1_CSR_COMP1SW1   COMP1_CSR_COMP1SW1_Msk
 
#define COMP_CSR_COMP1SW1   COMP1_CSR_COMP1SW1
 
#define COMP1_CSR_COMP1INSEL_Pos   (4U)
 
#define COMP1_CSR_COMP1INSEL_Msk   (0x7UL << COMP1_CSR_COMP1INSEL_Pos)
 
#define COMP1_CSR_COMP1INSEL   COMP1_CSR_COMP1INSEL_Msk
 
#define COMP1_CSR_COMP1INSEL_0   (0x1UL << COMP1_CSR_COMP1INSEL_Pos)
 
#define COMP1_CSR_COMP1INSEL_1   (0x2UL << COMP1_CSR_COMP1INSEL_Pos)
 
#define COMP1_CSR_COMP1INSEL_2   (0x4UL << COMP1_CSR_COMP1INSEL_Pos)
 
#define COMP1_CSR_COMP1OUTSEL_Pos   (10U)
 
#define COMP1_CSR_COMP1OUTSEL_Msk   (0xFUL << COMP1_CSR_COMP1OUTSEL_Pos)
 
#define COMP1_CSR_COMP1OUTSEL   COMP1_CSR_COMP1OUTSEL_Msk
 
#define COMP1_CSR_COMP1OUTSEL_0   (0x1UL << COMP1_CSR_COMP1OUTSEL_Pos)
 
#define COMP1_CSR_COMP1OUTSEL_1   (0x2UL << COMP1_CSR_COMP1OUTSEL_Pos)
 
#define COMP1_CSR_COMP1OUTSEL_2   (0x4UL << COMP1_CSR_COMP1OUTSEL_Pos)
 
#define COMP1_CSR_COMP1OUTSEL_3   (0x8UL << COMP1_CSR_COMP1OUTSEL_Pos)
 
#define COMP1_CSR_COMP1POL_Pos   (15U)
 
#define COMP1_CSR_COMP1POL_Msk   (0x1UL << COMP1_CSR_COMP1POL_Pos)
 
#define COMP1_CSR_COMP1POL   COMP1_CSR_COMP1POL_Msk
 
#define COMP1_CSR_COMP1BLANKING_Pos   (18U)
 
#define COMP1_CSR_COMP1BLANKING_Msk   (0x3UL << COMP1_CSR_COMP1BLANKING_Pos)
 
#define COMP1_CSR_COMP1BLANKING   COMP1_CSR_COMP1BLANKING_Msk
 
#define COMP1_CSR_COMP1BLANKING_0   (0x1UL << COMP1_CSR_COMP1BLANKING_Pos)
 
#define COMP1_CSR_COMP1BLANKING_1   (0x2UL << COMP1_CSR_COMP1BLANKING_Pos)
 
#define COMP1_CSR_COMP1BLANKING_2   (0x4UL << COMP1_CSR_COMP1BLANKING_Pos)
 
#define COMP1_CSR_COMP1OUT_Pos   (30U)
 
#define COMP1_CSR_COMP1OUT_Msk   (0x1UL << COMP1_CSR_COMP1OUT_Pos)
 
#define COMP1_CSR_COMP1OUT   COMP1_CSR_COMP1OUT_Msk
 
#define COMP1_CSR_COMP1LOCK_Pos   (31U)
 
#define COMP1_CSR_COMP1LOCK_Msk   (0x1UL << COMP1_CSR_COMP1LOCK_Pos)
 
#define COMP1_CSR_COMP1LOCK   COMP1_CSR_COMP1LOCK_Msk
 
#define COMP2_CSR_COMP2EN_Pos   (0U)
 
#define COMP2_CSR_COMP2EN_Msk   (0x1UL << COMP2_CSR_COMP2EN_Pos)
 
#define COMP2_CSR_COMP2EN   COMP2_CSR_COMP2EN_Msk
 
#define COMP2_CSR_COMP2INSEL_Pos   (4U)
 
#define COMP2_CSR_COMP2INSEL_Msk   (0x7UL << COMP2_CSR_COMP2INSEL_Pos)
 
#define COMP2_CSR_COMP2INSEL   COMP2_CSR_COMP2INSEL_Msk
 
#define COMP2_CSR_COMP2INSEL_0   (0x00000010U)
 
#define COMP2_CSR_COMP2INSEL_1   (0x00000020U)
 
#define COMP2_CSR_COMP2INSEL_2   (0x00000040U)
 
#define COMP2_CSR_COMP2OUTSEL_Pos   (10U)
 
#define COMP2_CSR_COMP2OUTSEL_Msk   (0xFUL << COMP2_CSR_COMP2OUTSEL_Pos)
 
#define COMP2_CSR_COMP2OUTSEL   COMP2_CSR_COMP2OUTSEL_Msk
 
#define COMP2_CSR_COMP2OUTSEL_0   (0x1UL << COMP2_CSR_COMP2OUTSEL_Pos)
 
#define COMP2_CSR_COMP2OUTSEL_1   (0x2UL << COMP2_CSR_COMP2OUTSEL_Pos)
 
#define COMP2_CSR_COMP2OUTSEL_2   (0x4UL << COMP2_CSR_COMP2OUTSEL_Pos)
 
#define COMP2_CSR_COMP2OUTSEL_3   (0x8UL << COMP2_CSR_COMP2OUTSEL_Pos)
 
#define COMP2_CSR_COMP2POL_Pos   (15U)
 
#define COMP2_CSR_COMP2POL_Msk   (0x1UL << COMP2_CSR_COMP2POL_Pos)
 
#define COMP2_CSR_COMP2POL   COMP2_CSR_COMP2POL_Msk
 
#define COMP2_CSR_COMP2BLANKING_Pos   (18U)
 
#define COMP2_CSR_COMP2BLANKING_Msk   (0x3UL << COMP2_CSR_COMP2BLANKING_Pos)
 
#define COMP2_CSR_COMP2BLANKING   COMP2_CSR_COMP2BLANKING_Msk
 
#define COMP2_CSR_COMP2BLANKING_0   (0x1UL << COMP2_CSR_COMP2BLANKING_Pos)
 
#define COMP2_CSR_COMP2BLANKING_1   (0x2UL << COMP2_CSR_COMP2BLANKING_Pos)
 
#define COMP2_CSR_COMP2BLANKING_2   (0x4UL << COMP2_CSR_COMP2BLANKING_Pos)
 
#define COMP2_CSR_COMP2OUT_Pos   (30U)
 
#define COMP2_CSR_COMP2OUT_Msk   (0x1UL << COMP2_CSR_COMP2OUT_Pos)
 
#define COMP2_CSR_COMP2OUT   COMP2_CSR_COMP2OUT_Msk
 
#define COMP2_CSR_COMP2LOCK_Pos   (31U)
 
#define COMP2_CSR_COMP2LOCK_Msk   (0x1UL << COMP2_CSR_COMP2LOCK_Pos)
 
#define COMP2_CSR_COMP2LOCK   COMP2_CSR_COMP2LOCK_Msk
 
#define COMP3_CSR_COMP3EN_Pos   (0U)
 
#define COMP3_CSR_COMP3EN_Msk   (0x1UL << COMP3_CSR_COMP3EN_Pos)
 
#define COMP3_CSR_COMP3EN   COMP3_CSR_COMP3EN_Msk
 
#define COMP3_CSR_COMP3INSEL_Pos   (4U)
 
#define COMP3_CSR_COMP3INSEL_Msk   (0x7UL << COMP3_CSR_COMP3INSEL_Pos)
 
#define COMP3_CSR_COMP3INSEL   COMP3_CSR_COMP3INSEL_Msk
 
#define COMP3_CSR_COMP3INSEL_0   (0x1UL << COMP3_CSR_COMP3INSEL_Pos)
 
#define COMP3_CSR_COMP3INSEL_1   (0x2UL << COMP3_CSR_COMP3INSEL_Pos)
 
#define COMP3_CSR_COMP3INSEL_2   (0x4UL << COMP3_CSR_COMP3INSEL_Pos)
 
#define COMP3_CSR_COMP3OUTSEL_Pos   (10U)
 
#define COMP3_CSR_COMP3OUTSEL_Msk   (0xFUL << COMP3_CSR_COMP3OUTSEL_Pos)
 
#define COMP3_CSR_COMP3OUTSEL   COMP3_CSR_COMP3OUTSEL_Msk
 
#define COMP3_CSR_COMP3OUTSEL_0   (0x1UL << COMP3_CSR_COMP3OUTSEL_Pos)
 
#define COMP3_CSR_COMP3OUTSEL_1   (0x2UL << COMP3_CSR_COMP3OUTSEL_Pos)
 
#define COMP3_CSR_COMP3OUTSEL_2   (0x4UL << COMP3_CSR_COMP3OUTSEL_Pos)
 
#define COMP3_CSR_COMP3OUTSEL_3   (0x8UL << COMP3_CSR_COMP3OUTSEL_Pos)
 
#define COMP3_CSR_COMP3POL_Pos   (15U)
 
#define COMP3_CSR_COMP3POL_Msk   (0x1UL << COMP3_CSR_COMP3POL_Pos)
 
#define COMP3_CSR_COMP3POL   COMP3_CSR_COMP3POL_Msk
 
#define COMP3_CSR_COMP3BLANKING_Pos   (18U)
 
#define COMP3_CSR_COMP3BLANKING_Msk   (0x3UL << COMP3_CSR_COMP3BLANKING_Pos)
 
#define COMP3_CSR_COMP3BLANKING   COMP3_CSR_COMP3BLANKING_Msk
 
#define COMP3_CSR_COMP3BLANKING_0   (0x1UL << COMP3_CSR_COMP3BLANKING_Pos)
 
#define COMP3_CSR_COMP3BLANKING_1   (0x2UL << COMP3_CSR_COMP3BLANKING_Pos)
 
#define COMP3_CSR_COMP3BLANKING_2   (0x4UL << COMP3_CSR_COMP3BLANKING_Pos)
 
#define COMP3_CSR_COMP3OUT_Pos   (30U)
 
#define COMP3_CSR_COMP3OUT_Msk   (0x1UL << COMP3_CSR_COMP3OUT_Pos)
 
#define COMP3_CSR_COMP3OUT   COMP3_CSR_COMP3OUT_Msk
 
#define COMP3_CSR_COMP3LOCK_Pos   (31U)
 
#define COMP3_CSR_COMP3LOCK_Msk   (0x1UL << COMP3_CSR_COMP3LOCK_Pos)
 
#define COMP3_CSR_COMP3LOCK   COMP3_CSR_COMP3LOCK_Msk
 
#define COMP4_CSR_COMP4EN_Pos   (0U)
 
#define COMP4_CSR_COMP4EN_Msk   (0x1UL << COMP4_CSR_COMP4EN_Pos)
 
#define COMP4_CSR_COMP4EN   COMP4_CSR_COMP4EN_Msk
 
#define COMP4_CSR_COMP4INSEL_Pos   (4U)
 
#define COMP4_CSR_COMP4INSEL_Msk   (0x7UL << COMP4_CSR_COMP4INSEL_Pos)
 
#define COMP4_CSR_COMP4INSEL   COMP4_CSR_COMP4INSEL_Msk
 
#define COMP4_CSR_COMP4INSEL_0   (0x00000010U)
 
#define COMP4_CSR_COMP4INSEL_1   (0x00000020U)
 
#define COMP4_CSR_COMP4INSEL_2   (0x00000040U)
 
#define COMP4_CSR_COMP4OUTSEL_Pos   (10U)
 
#define COMP4_CSR_COMP4OUTSEL_Msk   (0xFUL << COMP4_CSR_COMP4OUTSEL_Pos)
 
#define COMP4_CSR_COMP4OUTSEL   COMP4_CSR_COMP4OUTSEL_Msk
 
#define COMP4_CSR_COMP4OUTSEL_0   (0x1UL << COMP4_CSR_COMP4OUTSEL_Pos)
 
#define COMP4_CSR_COMP4OUTSEL_1   (0x2UL << COMP4_CSR_COMP4OUTSEL_Pos)
 
#define COMP4_CSR_COMP4OUTSEL_2   (0x4UL << COMP4_CSR_COMP4OUTSEL_Pos)
 
#define COMP4_CSR_COMP4OUTSEL_3   (0x8UL << COMP4_CSR_COMP4OUTSEL_Pos)
 
#define COMP4_CSR_COMP4POL_Pos   (15U)
 
#define COMP4_CSR_COMP4POL_Msk   (0x1UL << COMP4_CSR_COMP4POL_Pos)
 
#define COMP4_CSR_COMP4POL   COMP4_CSR_COMP4POL_Msk
 
#define COMP4_CSR_COMP4BLANKING_Pos   (18U)
 
#define COMP4_CSR_COMP4BLANKING_Msk   (0x3UL << COMP4_CSR_COMP4BLANKING_Pos)
 
#define COMP4_CSR_COMP4BLANKING   COMP4_CSR_COMP4BLANKING_Msk
 
#define COMP4_CSR_COMP4BLANKING_0   (0x1UL << COMP4_CSR_COMP4BLANKING_Pos)
 
#define COMP4_CSR_COMP4BLANKING_1   (0x2UL << COMP4_CSR_COMP4BLANKING_Pos)
 
#define COMP4_CSR_COMP4BLANKING_2   (0x4UL << COMP4_CSR_COMP4BLANKING_Pos)
 
#define COMP4_CSR_COMP4OUT_Pos   (30U)
 
#define COMP4_CSR_COMP4OUT_Msk   (0x1UL << COMP4_CSR_COMP4OUT_Pos)
 
#define COMP4_CSR_COMP4OUT   COMP4_CSR_COMP4OUT_Msk
 
#define COMP4_CSR_COMP4LOCK_Pos   (31U)
 
#define COMP4_CSR_COMP4LOCK_Msk   (0x1UL << COMP4_CSR_COMP4LOCK_Pos)
 
#define COMP4_CSR_COMP4LOCK   COMP4_CSR_COMP4LOCK_Msk
 
#define COMP5_CSR_COMP5EN_Pos   (0U)
 
#define COMP5_CSR_COMP5EN_Msk   (0x1UL << COMP5_CSR_COMP5EN_Pos)
 
#define COMP5_CSR_COMP5EN   COMP5_CSR_COMP5EN_Msk
 
#define COMP5_CSR_COMP5INSEL_Pos   (4U)
 
#define COMP5_CSR_COMP5INSEL_Msk   (0x7UL << COMP5_CSR_COMP5INSEL_Pos)
 
#define COMP5_CSR_COMP5INSEL   COMP5_CSR_COMP5INSEL_Msk
 
#define COMP5_CSR_COMP5INSEL_0   (0x1UL << COMP5_CSR_COMP5INSEL_Pos)
 
#define COMP5_CSR_COMP5INSEL_1   (0x2UL << COMP5_CSR_COMP5INSEL_Pos)
 
#define COMP5_CSR_COMP5INSEL_2   (0x4UL << COMP5_CSR_COMP5INSEL_Pos)
 
#define COMP5_CSR_COMP5OUTSEL_Pos   (10U)
 
#define COMP5_CSR_COMP5OUTSEL_Msk   (0xFUL << COMP5_CSR_COMP5OUTSEL_Pos)
 
#define COMP5_CSR_COMP5OUTSEL   COMP5_CSR_COMP5OUTSEL_Msk
 
#define COMP5_CSR_COMP5OUTSEL_0   (0x1UL << COMP5_CSR_COMP5OUTSEL_Pos)
 
#define COMP5_CSR_COMP5OUTSEL_1   (0x2UL << COMP5_CSR_COMP5OUTSEL_Pos)
 
#define COMP5_CSR_COMP5OUTSEL_2   (0x4UL << COMP5_CSR_COMP5OUTSEL_Pos)
 
#define COMP5_CSR_COMP5OUTSEL_3   (0x8UL << COMP5_CSR_COMP5OUTSEL_Pos)
 
#define COMP5_CSR_COMP5POL_Pos   (15U)
 
#define COMP5_CSR_COMP5POL_Msk   (0x1UL << COMP5_CSR_COMP5POL_Pos)
 
#define COMP5_CSR_COMP5POL   COMP5_CSR_COMP5POL_Msk
 
#define COMP5_CSR_COMP5BLANKING_Pos   (18U)
 
#define COMP5_CSR_COMP5BLANKING_Msk   (0x3UL << COMP5_CSR_COMP5BLANKING_Pos)
 
#define COMP5_CSR_COMP5BLANKING   COMP5_CSR_COMP5BLANKING_Msk
 
#define COMP5_CSR_COMP5BLANKING_0   (0x1UL << COMP5_CSR_COMP5BLANKING_Pos)
 
#define COMP5_CSR_COMP5BLANKING_1   (0x2UL << COMP5_CSR_COMP5BLANKING_Pos)
 
#define COMP5_CSR_COMP5BLANKING_2   (0x4UL << COMP5_CSR_COMP5BLANKING_Pos)
 
#define COMP5_CSR_COMP5OUT_Pos   (30U)
 
#define COMP5_CSR_COMP5OUT_Msk   (0x1UL << COMP5_CSR_COMP5OUT_Pos)
 
#define COMP5_CSR_COMP5OUT   COMP5_CSR_COMP5OUT_Msk
 
#define COMP5_CSR_COMP5LOCK_Pos   (31U)
 
#define COMP5_CSR_COMP5LOCK_Msk   (0x1UL << COMP5_CSR_COMP5LOCK_Pos)
 
#define COMP5_CSR_COMP5LOCK   COMP5_CSR_COMP5LOCK_Msk
 
#define COMP6_CSR_COMP6EN_Pos   (0U)
 
#define COMP6_CSR_COMP6EN_Msk   (0x1UL << COMP6_CSR_COMP6EN_Pos)
 
#define COMP6_CSR_COMP6EN   COMP6_CSR_COMP6EN_Msk
 
#define COMP6_CSR_COMP6INSEL_Pos   (4U)
 
#define COMP6_CSR_COMP6INSEL_Msk   (0x7UL << COMP6_CSR_COMP6INSEL_Pos)
 
#define COMP6_CSR_COMP6INSEL   COMP6_CSR_COMP6INSEL_Msk
 
#define COMP6_CSR_COMP6INSEL_0   (0x00000010U)
 
#define COMP6_CSR_COMP6INSEL_1   (0x00000020U)
 
#define COMP6_CSR_COMP6INSEL_2   (0x00000040U)
 
#define COMP6_CSR_COMP6OUTSEL_Pos   (10U)
 
#define COMP6_CSR_COMP6OUTSEL_Msk   (0xFUL << COMP6_CSR_COMP6OUTSEL_Pos)
 
#define COMP6_CSR_COMP6OUTSEL   COMP6_CSR_COMP6OUTSEL_Msk
 
#define COMP6_CSR_COMP6OUTSEL_0   (0x1UL << COMP6_CSR_COMP6OUTSEL_Pos)
 
#define COMP6_CSR_COMP6OUTSEL_1   (0x2UL << COMP6_CSR_COMP6OUTSEL_Pos)
 
#define COMP6_CSR_COMP6OUTSEL_2   (0x4UL << COMP6_CSR_COMP6OUTSEL_Pos)
 
#define COMP6_CSR_COMP6OUTSEL_3   (0x8UL << COMP6_CSR_COMP6OUTSEL_Pos)
 
#define COMP6_CSR_COMP6POL_Pos   (15U)
 
#define COMP6_CSR_COMP6POL_Msk   (0x1UL << COMP6_CSR_COMP6POL_Pos)
 
#define COMP6_CSR_COMP6POL   COMP6_CSR_COMP6POL_Msk
 
#define COMP6_CSR_COMP6BLANKING_Pos   (18U)
 
#define COMP6_CSR_COMP6BLANKING_Msk   (0x3UL << COMP6_CSR_COMP6BLANKING_Pos)
 
#define COMP6_CSR_COMP6BLANKING   COMP6_CSR_COMP6BLANKING_Msk
 
#define COMP6_CSR_COMP6BLANKING_0   (0x1UL << COMP6_CSR_COMP6BLANKING_Pos)
 
#define COMP6_CSR_COMP6BLANKING_1   (0x2UL << COMP6_CSR_COMP6BLANKING_Pos)
 
#define COMP6_CSR_COMP6BLANKING_2   (0x4UL << COMP6_CSR_COMP6BLANKING_Pos)
 
#define COMP6_CSR_COMP6OUT_Pos   (30U)
 
#define COMP6_CSR_COMP6OUT_Msk   (0x1UL << COMP6_CSR_COMP6OUT_Pos)
 
#define COMP6_CSR_COMP6OUT   COMP6_CSR_COMP6OUT_Msk
 
#define COMP6_CSR_COMP6LOCK_Pos   (31U)
 
#define COMP6_CSR_COMP6LOCK_Msk   (0x1UL << COMP6_CSR_COMP6LOCK_Pos)
 
#define COMP6_CSR_COMP6LOCK   COMP6_CSR_COMP6LOCK_Msk
 
#define COMP7_CSR_COMP7EN_Pos   (0U)
 
#define COMP7_CSR_COMP7EN_Msk   (0x1UL << COMP7_CSR_COMP7EN_Pos)
 
#define COMP7_CSR_COMP7EN   COMP7_CSR_COMP7EN_Msk
 
#define COMP7_CSR_COMP7INSEL_Pos   (4U)
 
#define COMP7_CSR_COMP7INSEL_Msk   (0x7UL << COMP7_CSR_COMP7INSEL_Pos)
 
#define COMP7_CSR_COMP7INSEL   COMP7_CSR_COMP7INSEL_Msk
 
#define COMP7_CSR_COMP7INSEL_0   (0x1UL << COMP7_CSR_COMP7INSEL_Pos)
 
#define COMP7_CSR_COMP7INSEL_1   (0x2UL << COMP7_CSR_COMP7INSEL_Pos)
 
#define COMP7_CSR_COMP7INSEL_2   (0x4UL << COMP7_CSR_COMP7INSEL_Pos)
 
#define COMP7_CSR_COMP7OUTSEL_Pos   (10U)
 
#define COMP7_CSR_COMP7OUTSEL_Msk   (0xFUL << COMP7_CSR_COMP7OUTSEL_Pos)
 
#define COMP7_CSR_COMP7OUTSEL   COMP7_CSR_COMP7OUTSEL_Msk
 
#define COMP7_CSR_COMP7OUTSEL_0   (0x1UL << COMP7_CSR_COMP7OUTSEL_Pos)
 
#define COMP7_CSR_COMP7OUTSEL_1   (0x2UL << COMP7_CSR_COMP7OUTSEL_Pos)
 
#define COMP7_CSR_COMP7OUTSEL_2   (0x4UL << COMP7_CSR_COMP7OUTSEL_Pos)
 
#define COMP7_CSR_COMP7OUTSEL_3   (0x8UL << COMP7_CSR_COMP7OUTSEL_Pos)
 
#define COMP7_CSR_COMP7POL_Pos   (15U)
 
#define COMP7_CSR_COMP7POL_Msk   (0x1UL << COMP7_CSR_COMP7POL_Pos)
 
#define COMP7_CSR_COMP7POL   COMP7_CSR_COMP7POL_Msk
 
#define COMP7_CSR_COMP7BLANKING_Pos   (18U)
 
#define COMP7_CSR_COMP7BLANKING_Msk   (0x3UL << COMP7_CSR_COMP7BLANKING_Pos)
 
#define COMP7_CSR_COMP7BLANKING   COMP7_CSR_COMP7BLANKING_Msk
 
#define COMP7_CSR_COMP7BLANKING_0   (0x1UL << COMP7_CSR_COMP7BLANKING_Pos)
 
#define COMP7_CSR_COMP7BLANKING_1   (0x2UL << COMP7_CSR_COMP7BLANKING_Pos)
 
#define COMP7_CSR_COMP7BLANKING_2   (0x4UL << COMP7_CSR_COMP7BLANKING_Pos)
 
#define COMP7_CSR_COMP7OUT_Pos   (30U)
 
#define COMP7_CSR_COMP7OUT_Msk   (0x1UL << COMP7_CSR_COMP7OUT_Pos)
 
#define COMP7_CSR_COMP7OUT   COMP7_CSR_COMP7OUT_Msk
 
#define COMP7_CSR_COMP7LOCK_Pos   (31U)
 
#define COMP7_CSR_COMP7LOCK_Msk   (0x1UL << COMP7_CSR_COMP7LOCK_Pos)
 
#define COMP7_CSR_COMP7LOCK   COMP7_CSR_COMP7LOCK_Msk
 
#define COMP_CSR_COMPxEN_Pos   (0U)
 
#define COMP_CSR_COMPxEN_Msk   (0x1UL << COMP_CSR_COMPxEN_Pos)
 
#define COMP_CSR_COMPxEN   COMP_CSR_COMPxEN_Msk
 
#define COMP_CSR_COMPxSW1_Pos   (1U)
 
#define COMP_CSR_COMPxSW1_Msk   (0x1UL << COMP_CSR_COMPxSW1_Pos)
 
#define COMP_CSR_COMPxSW1   COMP_CSR_COMPxSW1_Msk
 
#define COMP_CSR_COMPxINSEL_Pos   (4U)
 
#define COMP_CSR_COMPxINSEL_Msk   (0x7UL << COMP_CSR_COMPxINSEL_Pos)
 
#define COMP_CSR_COMPxINSEL   COMP_CSR_COMPxINSEL_Msk
 
#define COMP_CSR_COMPxINSEL_0   (0x00000010U)
 
#define COMP_CSR_COMPxINSEL_1   (0x00000020U)
 
#define COMP_CSR_COMPxINSEL_2   (0x00000040U)
 
#define COMP_CSR_COMPxOUTSEL_Pos   (10U)
 
#define COMP_CSR_COMPxOUTSEL_Msk   (0xFUL << COMP_CSR_COMPxOUTSEL_Pos)
 
#define COMP_CSR_COMPxOUTSEL   COMP_CSR_COMPxOUTSEL_Msk
 
#define COMP_CSR_COMPxOUTSEL_0   (0x1UL << COMP_CSR_COMPxOUTSEL_Pos)
 
#define COMP_CSR_COMPxOUTSEL_1   (0x2UL << COMP_CSR_COMPxOUTSEL_Pos)
 
#define COMP_CSR_COMPxOUTSEL_2   (0x4UL << COMP_CSR_COMPxOUTSEL_Pos)
 
#define COMP_CSR_COMPxOUTSEL_3   (0x8UL << COMP_CSR_COMPxOUTSEL_Pos)
 
#define COMP_CSR_COMPxPOL_Pos   (15U)
 
#define COMP_CSR_COMPxPOL_Msk   (0x1UL << COMP_CSR_COMPxPOL_Pos)
 
#define COMP_CSR_COMPxPOL   COMP_CSR_COMPxPOL_Msk
 
#define COMP_CSR_COMPxBLANKING_Pos   (18U)
 
#define COMP_CSR_COMPxBLANKING_Msk   (0x3UL << COMP_CSR_COMPxBLANKING_Pos)
 
#define COMP_CSR_COMPxBLANKING   COMP_CSR_COMPxBLANKING_Msk
 
#define COMP_CSR_COMPxBLANKING_0   (0x1UL << COMP_CSR_COMPxBLANKING_Pos)
 
#define COMP_CSR_COMPxBLANKING_1   (0x2UL << COMP_CSR_COMPxBLANKING_Pos)
 
#define COMP_CSR_COMPxBLANKING_2   (0x4UL << COMP_CSR_COMPxBLANKING_Pos)
 
#define COMP_CSR_COMPxOUT_Pos   (30U)
 
#define COMP_CSR_COMPxOUT_Msk   (0x1UL << COMP_CSR_COMPxOUT_Pos)
 
#define COMP_CSR_COMPxOUT   COMP_CSR_COMPxOUT_Msk
 
#define COMP_CSR_COMPxLOCK_Pos   (31U)
 
#define COMP_CSR_COMPxLOCK_Msk   (0x1UL << COMP_CSR_COMPxLOCK_Pos)
 
#define COMP_CSR_COMPxLOCK   COMP_CSR_COMPxLOCK_Msk
 
#define OPAMP1_CSR_OPAMP1EN_Pos   (0U)
 
#define OPAMP1_CSR_OPAMP1EN_Msk   (0x1UL << OPAMP1_CSR_OPAMP1EN_Pos)
 
#define OPAMP1_CSR_OPAMP1EN   OPAMP1_CSR_OPAMP1EN_Msk
 
#define OPAMP1_CSR_FORCEVP_Pos   (1U)
 
#define OPAMP1_CSR_FORCEVP_Msk   (0x1UL << OPAMP1_CSR_FORCEVP_Pos)
 
#define OPAMP1_CSR_FORCEVP   OPAMP1_CSR_FORCEVP_Msk
 
#define OPAMP1_CSR_VPSEL_Pos   (2U)
 
#define OPAMP1_CSR_VPSEL_Msk   (0x3UL << OPAMP1_CSR_VPSEL_Pos)
 
#define OPAMP1_CSR_VPSEL   OPAMP1_CSR_VPSEL_Msk
 
#define OPAMP1_CSR_VPSEL_0   (0x1UL << OPAMP1_CSR_VPSEL_Pos)
 
#define OPAMP1_CSR_VPSEL_1   (0x2UL << OPAMP1_CSR_VPSEL_Pos)
 
#define OPAMP1_CSR_VMSEL_Pos   (5U)
 
#define OPAMP1_CSR_VMSEL_Msk   (0x3UL << OPAMP1_CSR_VMSEL_Pos)
 
#define OPAMP1_CSR_VMSEL   OPAMP1_CSR_VMSEL_Msk
 
#define OPAMP1_CSR_VMSEL_0   (0x1UL << OPAMP1_CSR_VMSEL_Pos)
 
#define OPAMP1_CSR_VMSEL_1   (0x2UL << OPAMP1_CSR_VMSEL_Pos)
 
#define OPAMP1_CSR_TCMEN_Pos   (7U)
 
#define OPAMP1_CSR_TCMEN_Msk   (0x1UL << OPAMP1_CSR_TCMEN_Pos)
 
#define OPAMP1_CSR_TCMEN   OPAMP1_CSR_TCMEN_Msk
 
#define OPAMP1_CSR_VMSSEL_Pos   (8U)
 
#define OPAMP1_CSR_VMSSEL_Msk   (0x1UL << OPAMP1_CSR_VMSSEL_Pos)
 
#define OPAMP1_CSR_VMSSEL   OPAMP1_CSR_VMSSEL_Msk
 
#define OPAMP1_CSR_VPSSEL_Pos   (9U)
 
#define OPAMP1_CSR_VPSSEL_Msk   (0x3UL << OPAMP1_CSR_VPSSEL_Pos)
 
#define OPAMP1_CSR_VPSSEL   OPAMP1_CSR_VPSSEL_Msk
 
#define OPAMP1_CSR_VPSSEL_0   (0x1UL << OPAMP1_CSR_VPSSEL_Pos)
 
#define OPAMP1_CSR_VPSSEL_1   (0x2UL << OPAMP1_CSR_VPSSEL_Pos)
 
#define OPAMP1_CSR_CALON_Pos   (11U)
 
#define OPAMP1_CSR_CALON_Msk   (0x1UL << OPAMP1_CSR_CALON_Pos)
 
#define OPAMP1_CSR_CALON   OPAMP1_CSR_CALON_Msk
 
#define OPAMP1_CSR_CALSEL_Pos   (12U)
 
#define OPAMP1_CSR_CALSEL_Msk   (0x3UL << OPAMP1_CSR_CALSEL_Pos)
 
#define OPAMP1_CSR_CALSEL   OPAMP1_CSR_CALSEL_Msk
 
#define OPAMP1_CSR_CALSEL_0   (0x1UL << OPAMP1_CSR_CALSEL_Pos)
 
#define OPAMP1_CSR_CALSEL_1   (0x2UL << OPAMP1_CSR_CALSEL_Pos)
 
#define OPAMP1_CSR_PGGAIN_Pos   (14U)
 
#define OPAMP1_CSR_PGGAIN_Msk   (0xFUL << OPAMP1_CSR_PGGAIN_Pos)
 
#define OPAMP1_CSR_PGGAIN   OPAMP1_CSR_PGGAIN_Msk
 
#define OPAMP1_CSR_PGGAIN_0   (0x1UL << OPAMP1_CSR_PGGAIN_Pos)
 
#define OPAMP1_CSR_PGGAIN_1   (0x2UL << OPAMP1_CSR_PGGAIN_Pos)
 
#define OPAMP1_CSR_PGGAIN_2   (0x4UL << OPAMP1_CSR_PGGAIN_Pos)
 
#define OPAMP1_CSR_PGGAIN_3   (0x8UL << OPAMP1_CSR_PGGAIN_Pos)
 
#define OPAMP1_CSR_USERTRIM_Pos   (18U)
 
#define OPAMP1_CSR_USERTRIM_Msk   (0x1UL << OPAMP1_CSR_USERTRIM_Pos)
 
#define OPAMP1_CSR_USERTRIM   OPAMP1_CSR_USERTRIM_Msk
 
#define OPAMP1_CSR_TRIMOFFSETP_Pos   (19U)
 
#define OPAMP1_CSR_TRIMOFFSETP_Msk   (0x1FUL << OPAMP1_CSR_TRIMOFFSETP_Pos)
 
#define OPAMP1_CSR_TRIMOFFSETP   OPAMP1_CSR_TRIMOFFSETP_Msk
 
#define OPAMP1_CSR_TRIMOFFSETN_Pos   (24U)
 
#define OPAMP1_CSR_TRIMOFFSETN_Msk   (0x1FUL << OPAMP1_CSR_TRIMOFFSETN_Pos)
 
#define OPAMP1_CSR_TRIMOFFSETN   OPAMP1_CSR_TRIMOFFSETN_Msk
 
#define OPAMP1_CSR_TSTREF_Pos   (29U)
 
#define OPAMP1_CSR_TSTREF_Msk   (0x1UL << OPAMP1_CSR_TSTREF_Pos)
 
#define OPAMP1_CSR_TSTREF   OPAMP1_CSR_TSTREF_Msk
 
#define OPAMP1_CSR_OUTCAL_Pos   (30U)
 
#define OPAMP1_CSR_OUTCAL_Msk   (0x1UL << OPAMP1_CSR_OUTCAL_Pos)
 
#define OPAMP1_CSR_OUTCAL   OPAMP1_CSR_OUTCAL_Msk
 
#define OPAMP1_CSR_LOCK_Pos   (31U)
 
#define OPAMP1_CSR_LOCK_Msk   (0x1UL << OPAMP1_CSR_LOCK_Pos)
 
#define OPAMP1_CSR_LOCK   OPAMP1_CSR_LOCK_Msk
 
#define OPAMP2_CSR_OPAMP2EN_Pos   (0U)
 
#define OPAMP2_CSR_OPAMP2EN_Msk   (0x1UL << OPAMP2_CSR_OPAMP2EN_Pos)
 
#define OPAMP2_CSR_OPAMP2EN   OPAMP2_CSR_OPAMP2EN_Msk
 
#define OPAMP2_CSR_FORCEVP_Pos   (1U)
 
#define OPAMP2_CSR_FORCEVP_Msk   (0x1UL << OPAMP2_CSR_FORCEVP_Pos)
 
#define OPAMP2_CSR_FORCEVP   OPAMP2_CSR_FORCEVP_Msk
 
#define OPAMP2_CSR_VPSEL_Pos   (2U)
 
#define OPAMP2_CSR_VPSEL_Msk   (0x3UL << OPAMP2_CSR_VPSEL_Pos)
 
#define OPAMP2_CSR_VPSEL   OPAMP2_CSR_VPSEL_Msk
 
#define OPAMP2_CSR_VPSEL_0   (0x1UL << OPAMP2_CSR_VPSEL_Pos)
 
#define OPAMP2_CSR_VPSEL_1   (0x2UL << OPAMP2_CSR_VPSEL_Pos)
 
#define OPAMP2_CSR_VMSEL_Pos   (5U)
 
#define OPAMP2_CSR_VMSEL_Msk   (0x3UL << OPAMP2_CSR_VMSEL_Pos)
 
#define OPAMP2_CSR_VMSEL   OPAMP2_CSR_VMSEL_Msk
 
#define OPAMP2_CSR_VMSEL_0   (0x1UL << OPAMP2_CSR_VMSEL_Pos)
 
#define OPAMP2_CSR_VMSEL_1   (0x2UL << OPAMP2_CSR_VMSEL_Pos)
 
#define OPAMP2_CSR_TCMEN_Pos   (7U)
 
#define OPAMP2_CSR_TCMEN_Msk   (0x1UL << OPAMP2_CSR_TCMEN_Pos)
 
#define OPAMP2_CSR_TCMEN   OPAMP2_CSR_TCMEN_Msk
 
#define OPAMP2_CSR_VMSSEL_Pos   (8U)
 
#define OPAMP2_CSR_VMSSEL_Msk   (0x1UL << OPAMP2_CSR_VMSSEL_Pos)
 
#define OPAMP2_CSR_VMSSEL   OPAMP2_CSR_VMSSEL_Msk
 
#define OPAMP2_CSR_VPSSEL_Pos   (9U)
 
#define OPAMP2_CSR_VPSSEL_Msk   (0x3UL << OPAMP2_CSR_VPSSEL_Pos)
 
#define OPAMP2_CSR_VPSSEL   OPAMP2_CSR_VPSSEL_Msk
 
#define OPAMP2_CSR_VPSSEL_0   (0x1UL << OPAMP2_CSR_VPSSEL_Pos)
 
#define OPAMP2_CSR_VPSSEL_1   (0x2UL << OPAMP2_CSR_VPSSEL_Pos)
 
#define OPAMP2_CSR_CALON_Pos   (11U)
 
#define OPAMP2_CSR_CALON_Msk   (0x1UL << OPAMP2_CSR_CALON_Pos)
 
#define OPAMP2_CSR_CALON   OPAMP2_CSR_CALON_Msk
 
#define OPAMP2_CSR_CALSEL_Pos   (12U)
 
#define OPAMP2_CSR_CALSEL_Msk   (0x3UL << OPAMP2_CSR_CALSEL_Pos)
 
#define OPAMP2_CSR_CALSEL   OPAMP2_CSR_CALSEL_Msk
 
#define OPAMP2_CSR_CALSEL_0   (0x1UL << OPAMP2_CSR_CALSEL_Pos)
 
#define OPAMP2_CSR_CALSEL_1   (0x2UL << OPAMP2_CSR_CALSEL_Pos)
 
#define OPAMP2_CSR_PGGAIN_Pos   (14U)
 
#define OPAMP2_CSR_PGGAIN_Msk   (0xFUL << OPAMP2_CSR_PGGAIN_Pos)
 
#define OPAMP2_CSR_PGGAIN   OPAMP2_CSR_PGGAIN_Msk
 
#define OPAMP2_CSR_PGGAIN_0   (0x1UL << OPAMP2_CSR_PGGAIN_Pos)
 
#define OPAMP2_CSR_PGGAIN_1   (0x2UL << OPAMP2_CSR_PGGAIN_Pos)
 
#define OPAMP2_CSR_PGGAIN_2   (0x4UL << OPAMP2_CSR_PGGAIN_Pos)
 
#define OPAMP2_CSR_PGGAIN_3   (0x8UL << OPAMP2_CSR_PGGAIN_Pos)
 
#define OPAMP2_CSR_USERTRIM_Pos   (18U)
 
#define OPAMP2_CSR_USERTRIM_Msk   (0x1UL << OPAMP2_CSR_USERTRIM_Pos)
 
#define OPAMP2_CSR_USERTRIM   OPAMP2_CSR_USERTRIM_Msk
 
#define OPAMP2_CSR_TRIMOFFSETP_Pos   (19U)
 
#define OPAMP2_CSR_TRIMOFFSETP_Msk   (0x1FUL << OPAMP2_CSR_TRIMOFFSETP_Pos)
 
#define OPAMP2_CSR_TRIMOFFSETP   OPAMP2_CSR_TRIMOFFSETP_Msk
 
#define OPAMP2_CSR_TRIMOFFSETN_Pos   (24U)
 
#define OPAMP2_CSR_TRIMOFFSETN_Msk   (0x1FUL << OPAMP2_CSR_TRIMOFFSETN_Pos)
 
#define OPAMP2_CSR_TRIMOFFSETN   OPAMP2_CSR_TRIMOFFSETN_Msk
 
#define OPAMP2_CSR_TSTREF_Pos   (29U)
 
#define OPAMP2_CSR_TSTREF_Msk   (0x1UL << OPAMP2_CSR_TSTREF_Pos)
 
#define OPAMP2_CSR_TSTREF   OPAMP2_CSR_TSTREF_Msk
 
#define OPAMP2_CSR_OUTCAL_Pos   (30U)
 
#define OPAMP2_CSR_OUTCAL_Msk   (0x1UL << OPAMP2_CSR_OUTCAL_Pos)
 
#define OPAMP2_CSR_OUTCAL   OPAMP2_CSR_OUTCAL_Msk
 
#define OPAMP2_CSR_LOCK_Pos   (31U)
 
#define OPAMP2_CSR_LOCK_Msk   (0x1UL << OPAMP2_CSR_LOCK_Pos)
 
#define OPAMP2_CSR_LOCK   OPAMP2_CSR_LOCK_Msk
 
#define OPAMP3_CSR_OPAMP3EN_Pos   (0U)
 
#define OPAMP3_CSR_OPAMP3EN_Msk   (0x1UL << OPAMP3_CSR_OPAMP3EN_Pos)
 
#define OPAMP3_CSR_OPAMP3EN   OPAMP3_CSR_OPAMP3EN_Msk
 
#define OPAMP3_CSR_FORCEVP_Pos   (1U)
 
#define OPAMP3_CSR_FORCEVP_Msk   (0x1UL << OPAMP3_CSR_FORCEVP_Pos)
 
#define OPAMP3_CSR_FORCEVP   OPAMP3_CSR_FORCEVP_Msk
 
#define OPAMP3_CSR_VPSEL_Pos   (2U)
 
#define OPAMP3_CSR_VPSEL_Msk   (0x3UL << OPAMP3_CSR_VPSEL_Pos)
 
#define OPAMP3_CSR_VPSEL   OPAMP3_CSR_VPSEL_Msk
 
#define OPAMP3_CSR_VPSEL_0   (0x1UL << OPAMP3_CSR_VPSEL_Pos)
 
#define OPAMP3_CSR_VPSEL_1   (0x2UL << OPAMP3_CSR_VPSEL_Pos)
 
#define OPAMP3_CSR_VMSEL_Pos   (5U)
 
#define OPAMP3_CSR_VMSEL_Msk   (0x3UL << OPAMP3_CSR_VMSEL_Pos)
 
#define OPAMP3_CSR_VMSEL   OPAMP3_CSR_VMSEL_Msk
 
#define OPAMP3_CSR_VMSEL_0   (0x1UL << OPAMP3_CSR_VMSEL_Pos)
 
#define OPAMP3_CSR_VMSEL_1   (0x2UL << OPAMP3_CSR_VMSEL_Pos)
 
#define OPAMP3_CSR_TCMEN_Pos   (7U)
 
#define OPAMP3_CSR_TCMEN_Msk   (0x1UL << OPAMP3_CSR_TCMEN_Pos)
 
#define OPAMP3_CSR_TCMEN   OPAMP3_CSR_TCMEN_Msk
 
#define OPAMP3_CSR_VMSSEL_Pos   (8U)
 
#define OPAMP3_CSR_VMSSEL_Msk   (0x1UL << OPAMP3_CSR_VMSSEL_Pos)
 
#define OPAMP3_CSR_VMSSEL   OPAMP3_CSR_VMSSEL_Msk
 
#define OPAMP3_CSR_VPSSEL_Pos   (9U)
 
#define OPAMP3_CSR_VPSSEL_Msk   (0x3UL << OPAMP3_CSR_VPSSEL_Pos)
 
#define OPAMP3_CSR_VPSSEL   OPAMP3_CSR_VPSSEL_Msk
 
#define OPAMP3_CSR_VPSSEL_0   (0x1UL << OPAMP3_CSR_VPSSEL_Pos)
 
#define OPAMP3_CSR_VPSSEL_1   (0x2UL << OPAMP3_CSR_VPSSEL_Pos)
 
#define OPAMP3_CSR_CALON_Pos   (11U)
 
#define OPAMP3_CSR_CALON_Msk   (0x1UL << OPAMP3_CSR_CALON_Pos)
 
#define OPAMP3_CSR_CALON   OPAMP3_CSR_CALON_Msk
 
#define OPAMP3_CSR_CALSEL_Pos   (12U)
 
#define OPAMP3_CSR_CALSEL_Msk   (0x3UL << OPAMP3_CSR_CALSEL_Pos)
 
#define OPAMP3_CSR_CALSEL   OPAMP3_CSR_CALSEL_Msk
 
#define OPAMP3_CSR_CALSEL_0   (0x1UL << OPAMP3_CSR_CALSEL_Pos)
 
#define OPAMP3_CSR_CALSEL_1   (0x2UL << OPAMP3_CSR_CALSEL_Pos)
 
#define OPAMP3_CSR_PGGAIN_Pos   (14U)
 
#define OPAMP3_CSR_PGGAIN_Msk   (0xFUL << OPAMP3_CSR_PGGAIN_Pos)
 
#define OPAMP3_CSR_PGGAIN   OPAMP3_CSR_PGGAIN_Msk
 
#define OPAMP3_CSR_PGGAIN_0   (0x1UL << OPAMP3_CSR_PGGAIN_Pos)
 
#define OPAMP3_CSR_PGGAIN_1   (0x2UL << OPAMP3_CSR_PGGAIN_Pos)
 
#define OPAMP3_CSR_PGGAIN_2   (0x4UL << OPAMP3_CSR_PGGAIN_Pos)
 
#define OPAMP3_CSR_PGGAIN_3   (0x8UL << OPAMP3_CSR_PGGAIN_Pos)
 
#define OPAMP3_CSR_USERTRIM_Pos   (18U)
 
#define OPAMP3_CSR_USERTRIM_Msk   (0x1UL << OPAMP3_CSR_USERTRIM_Pos)
 
#define OPAMP3_CSR_USERTRIM   OPAMP3_CSR_USERTRIM_Msk
 
#define OPAMP3_CSR_TRIMOFFSETP_Pos   (19U)
 
#define OPAMP3_CSR_TRIMOFFSETP_Msk   (0x1FUL << OPAMP3_CSR_TRIMOFFSETP_Pos)
 
#define OPAMP3_CSR_TRIMOFFSETP   OPAMP3_CSR_TRIMOFFSETP_Msk
 
#define OPAMP3_CSR_TRIMOFFSETN_Pos   (24U)
 
#define OPAMP3_CSR_TRIMOFFSETN_Msk   (0x1FUL << OPAMP3_CSR_TRIMOFFSETN_Pos)
 
#define OPAMP3_CSR_TRIMOFFSETN   OPAMP3_CSR_TRIMOFFSETN_Msk
 
#define OPAMP3_CSR_TSTREF_Pos   (29U)
 
#define OPAMP3_CSR_TSTREF_Msk   (0x1UL << OPAMP3_CSR_TSTREF_Pos)
 
#define OPAMP3_CSR_TSTREF   OPAMP3_CSR_TSTREF_Msk
 
#define OPAMP3_CSR_OUTCAL_Pos   (30U)
 
#define OPAMP3_CSR_OUTCAL_Msk   (0x1UL << OPAMP3_CSR_OUTCAL_Pos)
 
#define OPAMP3_CSR_OUTCAL   OPAMP3_CSR_OUTCAL_Msk
 
#define OPAMP3_CSR_LOCK_Pos   (31U)
 
#define OPAMP3_CSR_LOCK_Msk   (0x1UL << OPAMP3_CSR_LOCK_Pos)
 
#define OPAMP3_CSR_LOCK   OPAMP3_CSR_LOCK_Msk
 
#define OPAMP4_CSR_OPAMP4EN_Pos   (0U)
 
#define OPAMP4_CSR_OPAMP4EN_Msk   (0x1UL << OPAMP4_CSR_OPAMP4EN_Pos)
 
#define OPAMP4_CSR_OPAMP4EN   OPAMP4_CSR_OPAMP4EN_Msk
 
#define OPAMP4_CSR_FORCEVP_Pos   (1U)
 
#define OPAMP4_CSR_FORCEVP_Msk   (0x1UL << OPAMP4_CSR_FORCEVP_Pos)
 
#define OPAMP4_CSR_FORCEVP   OPAMP4_CSR_FORCEVP_Msk
 
#define OPAMP4_CSR_VPSEL_Pos   (2U)
 
#define OPAMP4_CSR_VPSEL_Msk   (0x3UL << OPAMP4_CSR_VPSEL_Pos)
 
#define OPAMP4_CSR_VPSEL   OPAMP4_CSR_VPSEL_Msk
 
#define OPAMP4_CSR_VPSEL_0   (0x1UL << OPAMP4_CSR_VPSEL_Pos)
 
#define OPAMP4_CSR_VPSEL_1   (0x2UL << OPAMP4_CSR_VPSEL_Pos)
 
#define OPAMP4_CSR_VMSEL_Pos   (5U)
 
#define OPAMP4_CSR_VMSEL_Msk   (0x3UL << OPAMP4_CSR_VMSEL_Pos)
 
#define OPAMP4_CSR_VMSEL   OPAMP4_CSR_VMSEL_Msk
 
#define OPAMP4_CSR_VMSEL_0   (0x1UL << OPAMP4_CSR_VMSEL_Pos)
 
#define OPAMP4_CSR_VMSEL_1   (0x2UL << OPAMP4_CSR_VMSEL_Pos)
 
#define OPAMP4_CSR_TCMEN_Pos   (7U)
 
#define OPAMP4_CSR_TCMEN_Msk   (0x1UL << OPAMP4_CSR_TCMEN_Pos)
 
#define OPAMP4_CSR_TCMEN   OPAMP4_CSR_TCMEN_Msk
 
#define OPAMP4_CSR_VMSSEL_Pos   (8U)
 
#define OPAMP4_CSR_VMSSEL_Msk   (0x1UL << OPAMP4_CSR_VMSSEL_Pos)
 
#define OPAMP4_CSR_VMSSEL   OPAMP4_CSR_VMSSEL_Msk
 
#define OPAMP4_CSR_VPSSEL_Pos   (9U)
 
#define OPAMP4_CSR_VPSSEL_Msk   (0x3UL << OPAMP4_CSR_VPSSEL_Pos)
 
#define OPAMP4_CSR_VPSSEL   OPAMP4_CSR_VPSSEL_Msk
 
#define OPAMP4_CSR_VPSSEL_0   (0x1UL << OPAMP4_CSR_VPSSEL_Pos)
 
#define OPAMP4_CSR_VPSSEL_1   (0x2UL << OPAMP4_CSR_VPSSEL_Pos)
 
#define OPAMP4_CSR_CALON_Pos   (11U)
 
#define OPAMP4_CSR_CALON_Msk   (0x1UL << OPAMP4_CSR_CALON_Pos)
 
#define OPAMP4_CSR_CALON   OPAMP4_CSR_CALON_Msk
 
#define OPAMP4_CSR_CALSEL_Pos   (12U)
 
#define OPAMP4_CSR_CALSEL_Msk   (0x3UL << OPAMP4_CSR_CALSEL_Pos)
 
#define OPAMP4_CSR_CALSEL   OPAMP4_CSR_CALSEL_Msk
 
#define OPAMP4_CSR_CALSEL_0   (0x1UL << OPAMP4_CSR_CALSEL_Pos)
 
#define OPAMP4_CSR_CALSEL_1   (0x2UL << OPAMP4_CSR_CALSEL_Pos)
 
#define OPAMP4_CSR_PGGAIN_Pos   (14U)
 
#define OPAMP4_CSR_PGGAIN_Msk   (0xFUL << OPAMP4_CSR_PGGAIN_Pos)
 
#define OPAMP4_CSR_PGGAIN   OPAMP4_CSR_PGGAIN_Msk
 
#define OPAMP4_CSR_PGGAIN_0   (0x1UL << OPAMP4_CSR_PGGAIN_Pos)
 
#define OPAMP4_CSR_PGGAIN_1   (0x2UL << OPAMP4_CSR_PGGAIN_Pos)
 
#define OPAMP4_CSR_PGGAIN_2   (0x4UL << OPAMP4_CSR_PGGAIN_Pos)
 
#define OPAMP4_CSR_PGGAIN_3   (0x8UL << OPAMP4_CSR_PGGAIN_Pos)
 
#define OPAMP4_CSR_USERTRIM_Pos   (18U)
 
#define OPAMP4_CSR_USERTRIM_Msk   (0x1UL << OPAMP4_CSR_USERTRIM_Pos)
 
#define OPAMP4_CSR_USERTRIM   OPAMP4_CSR_USERTRIM_Msk
 
#define OPAMP4_CSR_TRIMOFFSETP_Pos   (19U)
 
#define OPAMP4_CSR_TRIMOFFSETP_Msk   (0x1FUL << OPAMP4_CSR_TRIMOFFSETP_Pos)
 
#define OPAMP4_CSR_TRIMOFFSETP   OPAMP4_CSR_TRIMOFFSETP_Msk
 
#define OPAMP4_CSR_TRIMOFFSETN_Pos   (24U)
 
#define OPAMP4_CSR_TRIMOFFSETN_Msk   (0x1FUL << OPAMP4_CSR_TRIMOFFSETN_Pos)
 
#define OPAMP4_CSR_TRIMOFFSETN   OPAMP4_CSR_TRIMOFFSETN_Msk
 
#define OPAMP4_CSR_TSTREF_Pos   (29U)
 
#define OPAMP4_CSR_TSTREF_Msk   (0x1UL << OPAMP4_CSR_TSTREF_Pos)
 
#define OPAMP4_CSR_TSTREF   OPAMP4_CSR_TSTREF_Msk
 
#define OPAMP4_CSR_OUTCAL_Pos   (30U)
 
#define OPAMP4_CSR_OUTCAL_Msk   (0x1UL << OPAMP4_CSR_OUTCAL_Pos)
 
#define OPAMP4_CSR_OUTCAL   OPAMP4_CSR_OUTCAL_Msk
 
#define OPAMP4_CSR_LOCK_Pos   (31U)
 
#define OPAMP4_CSR_LOCK_Msk   (0x1UL << OPAMP4_CSR_LOCK_Pos)
 
#define OPAMP4_CSR_LOCK   OPAMP4_CSR_LOCK_Msk
 
#define OPAMP_CSR_OPAMPxEN_Pos   (0U)
 
#define OPAMP_CSR_OPAMPxEN_Msk   (0x1UL << OPAMP_CSR_OPAMPxEN_Pos)
 
#define OPAMP_CSR_OPAMPxEN   OPAMP_CSR_OPAMPxEN_Msk
 
#define OPAMP_CSR_FORCEVP_Pos   (1U)
 
#define OPAMP_CSR_FORCEVP_Msk   (0x1UL << OPAMP_CSR_FORCEVP_Pos)
 
#define OPAMP_CSR_FORCEVP   OPAMP_CSR_FORCEVP_Msk
 
#define OPAMP_CSR_VPSEL_Pos   (2U)
 
#define OPAMP_CSR_VPSEL_Msk   (0x3UL << OPAMP_CSR_VPSEL_Pos)
 
#define OPAMP_CSR_VPSEL   OPAMP_CSR_VPSEL_Msk
 
#define OPAMP_CSR_VPSEL_0   (0x1UL << OPAMP_CSR_VPSEL_Pos)
 
#define OPAMP_CSR_VPSEL_1   (0x2UL << OPAMP_CSR_VPSEL_Pos)
 
#define OPAMP_CSR_VMSEL_Pos   (5U)
 
#define OPAMP_CSR_VMSEL_Msk   (0x3UL << OPAMP_CSR_VMSEL_Pos)
 
#define OPAMP_CSR_VMSEL   OPAMP_CSR_VMSEL_Msk
 
#define OPAMP_CSR_VMSEL_0   (0x1UL << OPAMP_CSR_VMSEL_Pos)
 
#define OPAMP_CSR_VMSEL_1   (0x2UL << OPAMP_CSR_VMSEL_Pos)
 
#define OPAMP_CSR_TCMEN_Pos   (7U)
 
#define OPAMP_CSR_TCMEN_Msk   (0x1UL << OPAMP_CSR_TCMEN_Pos)
 
#define OPAMP_CSR_TCMEN   OPAMP_CSR_TCMEN_Msk
 
#define OPAMP_CSR_VMSSEL_Pos   (8U)
 
#define OPAMP_CSR_VMSSEL_Msk   (0x1UL << OPAMP_CSR_VMSSEL_Pos)
 
#define OPAMP_CSR_VMSSEL   OPAMP_CSR_VMSSEL_Msk
 
#define OPAMP_CSR_VPSSEL_Pos   (9U)
 
#define OPAMP_CSR_VPSSEL_Msk   (0x3UL << OPAMP_CSR_VPSSEL_Pos)
 
#define OPAMP_CSR_VPSSEL   OPAMP_CSR_VPSSEL_Msk
 
#define OPAMP_CSR_VPSSEL_0   (0x1UL << OPAMP_CSR_VPSSEL_Pos)
 
#define OPAMP_CSR_VPSSEL_1   (0x2UL << OPAMP_CSR_VPSSEL_Pos)
 
#define OPAMP_CSR_CALON_Pos   (11U)
 
#define OPAMP_CSR_CALON_Msk   (0x1UL << OPAMP_CSR_CALON_Pos)
 
#define OPAMP_CSR_CALON   OPAMP_CSR_CALON_Msk
 
#define OPAMP_CSR_CALSEL_Pos   (12U)
 
#define OPAMP_CSR_CALSEL_Msk   (0x3UL << OPAMP_CSR_CALSEL_Pos)
 
#define OPAMP_CSR_CALSEL   OPAMP_CSR_CALSEL_Msk
 
#define OPAMP_CSR_CALSEL_0   (0x1UL << OPAMP_CSR_CALSEL_Pos)
 
#define OPAMP_CSR_CALSEL_1   (0x2UL << OPAMP_CSR_CALSEL_Pos)
 
#define OPAMP_CSR_PGGAIN_Pos   (14U)
 
#define OPAMP_CSR_PGGAIN_Msk   (0xFUL << OPAMP_CSR_PGGAIN_Pos)
 
#define OPAMP_CSR_PGGAIN   OPAMP_CSR_PGGAIN_Msk
 
#define OPAMP_CSR_PGGAIN_0   (0x1UL << OPAMP_CSR_PGGAIN_Pos)
 
#define OPAMP_CSR_PGGAIN_1   (0x2UL << OPAMP_CSR_PGGAIN_Pos)
 
#define OPAMP_CSR_PGGAIN_2   (0x4UL << OPAMP_CSR_PGGAIN_Pos)
 
#define OPAMP_CSR_PGGAIN_3   (0x8UL << OPAMP_CSR_PGGAIN_Pos)
 
#define OPAMP_CSR_USERTRIM_Pos   (18U)
 
#define OPAMP_CSR_USERTRIM_Msk   (0x1UL << OPAMP_CSR_USERTRIM_Pos)
 
#define OPAMP_CSR_USERTRIM   OPAMP_CSR_USERTRIM_Msk
 
#define OPAMP_CSR_TRIMOFFSETP_Pos   (19U)
 
#define OPAMP_CSR_TRIMOFFSETP_Msk   (0x1FUL << OPAMP_CSR_TRIMOFFSETP_Pos)
 
#define OPAMP_CSR_TRIMOFFSETP   OPAMP_CSR_TRIMOFFSETP_Msk
 
#define OPAMP_CSR_TRIMOFFSETN_Pos   (24U)
 
#define OPAMP_CSR_TRIMOFFSETN_Msk   (0x1FUL << OPAMP_CSR_TRIMOFFSETN_Pos)
 
#define OPAMP_CSR_TRIMOFFSETN   OPAMP_CSR_TRIMOFFSETN_Msk
 
#define OPAMP_CSR_TSTREF_Pos   (29U)
 
#define OPAMP_CSR_TSTREF_Msk   (0x1UL << OPAMP_CSR_TSTREF_Pos)
 
#define OPAMP_CSR_TSTREF   OPAMP_CSR_TSTREF_Msk
 
#define OPAMP_CSR_OUTCAL_Pos   (30U)
 
#define OPAMP_CSR_OUTCAL_Msk   (0x1UL << OPAMP_CSR_OUTCAL_Pos)
 
#define OPAMP_CSR_OUTCAL   OPAMP_CSR_OUTCAL_Msk
 
#define OPAMP_CSR_LOCK_Pos   (31U)
 
#define OPAMP_CSR_LOCK_Msk   (0x1UL << OPAMP_CSR_LOCK_Pos)
 
#define OPAMP_CSR_LOCK   OPAMP_CSR_LOCK_Msk
 
#define CAN_MCR_INRQ_Pos   (0U)
 
#define CAN_MCR_INRQ_Msk   (0x1UL << CAN_MCR_INRQ_Pos)
 
#define CAN_MCR_INRQ   CAN_MCR_INRQ_Msk
 
#define CAN_MCR_SLEEP_Pos   (1U)
 
#define CAN_MCR_SLEEP_Msk   (0x1UL << CAN_MCR_SLEEP_Pos)
 
#define CAN_MCR_SLEEP   CAN_MCR_SLEEP_Msk
 
#define CAN_MCR_TXFP_Pos   (2U)
 
#define CAN_MCR_TXFP_Msk   (0x1UL << CAN_MCR_TXFP_Pos)
 
#define CAN_MCR_TXFP   CAN_MCR_TXFP_Msk
 
#define CAN_MCR_RFLM_Pos   (3U)
 
#define CAN_MCR_RFLM_Msk   (0x1UL << CAN_MCR_RFLM_Pos)
 
#define CAN_MCR_RFLM   CAN_MCR_RFLM_Msk
 
#define CAN_MCR_NART_Pos   (4U)
 
#define CAN_MCR_NART_Msk   (0x1UL << CAN_MCR_NART_Pos)
 
#define CAN_MCR_NART   CAN_MCR_NART_Msk
 
#define CAN_MCR_AWUM_Pos   (5U)
 
#define CAN_MCR_AWUM_Msk   (0x1UL << CAN_MCR_AWUM_Pos)
 
#define CAN_MCR_AWUM   CAN_MCR_AWUM_Msk
 
#define CAN_MCR_ABOM_Pos   (6U)
 
#define CAN_MCR_ABOM_Msk   (0x1UL << CAN_MCR_ABOM_Pos)
 
#define CAN_MCR_ABOM   CAN_MCR_ABOM_Msk
 
#define CAN_MCR_TTCM_Pos   (7U)
 
#define CAN_MCR_TTCM_Msk   (0x1UL << CAN_MCR_TTCM_Pos)
 
#define CAN_MCR_TTCM   CAN_MCR_TTCM_Msk
 
#define CAN_MCR_RESET_Pos   (15U)
 
#define CAN_MCR_RESET_Msk   (0x1UL << CAN_MCR_RESET_Pos)
 
#define CAN_MCR_RESET   CAN_MCR_RESET_Msk
 
#define CAN_MSR_INAK_Pos   (0U)
 
#define CAN_MSR_INAK_Msk   (0x1UL << CAN_MSR_INAK_Pos)
 
#define CAN_MSR_INAK   CAN_MSR_INAK_Msk
 
#define CAN_MSR_SLAK_Pos   (1U)
 
#define CAN_MSR_SLAK_Msk   (0x1UL << CAN_MSR_SLAK_Pos)
 
#define CAN_MSR_SLAK   CAN_MSR_SLAK_Msk
 
#define CAN_MSR_ERRI_Pos   (2U)
 
#define CAN_MSR_ERRI_Msk   (0x1UL << CAN_MSR_ERRI_Pos)
 
#define CAN_MSR_ERRI   CAN_MSR_ERRI_Msk
 
#define CAN_MSR_WKUI_Pos   (3U)
 
#define CAN_MSR_WKUI_Msk   (0x1UL << CAN_MSR_WKUI_Pos)
 
#define CAN_MSR_WKUI   CAN_MSR_WKUI_Msk
 
#define CAN_MSR_SLAKI_Pos   (4U)
 
#define CAN_MSR_SLAKI_Msk   (0x1UL << CAN_MSR_SLAKI_Pos)
 
#define CAN_MSR_SLAKI   CAN_MSR_SLAKI_Msk
 
#define CAN_MSR_TXM_Pos   (8U)
 
#define CAN_MSR_TXM_Msk   (0x1UL << CAN_MSR_TXM_Pos)
 
#define CAN_MSR_TXM   CAN_MSR_TXM_Msk
 
#define CAN_MSR_RXM_Pos   (9U)
 
#define CAN_MSR_RXM_Msk   (0x1UL << CAN_MSR_RXM_Pos)
 
#define CAN_MSR_RXM   CAN_MSR_RXM_Msk
 
#define CAN_MSR_SAMP_Pos   (10U)
 
#define CAN_MSR_SAMP_Msk   (0x1UL << CAN_MSR_SAMP_Pos)
 
#define CAN_MSR_SAMP   CAN_MSR_SAMP_Msk
 
#define CAN_MSR_RX_Pos   (11U)
 
#define CAN_MSR_RX_Msk   (0x1UL << CAN_MSR_RX_Pos)
 
#define CAN_MSR_RX   CAN_MSR_RX_Msk
 
#define CAN_TSR_RQCP0_Pos   (0U)
 
#define CAN_TSR_RQCP0_Msk   (0x1UL << CAN_TSR_RQCP0_Pos)
 
#define CAN_TSR_RQCP0   CAN_TSR_RQCP0_Msk
 
#define CAN_TSR_TXOK0_Pos   (1U)
 
#define CAN_TSR_TXOK0_Msk   (0x1UL << CAN_TSR_TXOK0_Pos)
 
#define CAN_TSR_TXOK0   CAN_TSR_TXOK0_Msk
 
#define CAN_TSR_ALST0_Pos   (2U)
 
#define CAN_TSR_ALST0_Msk   (0x1UL << CAN_TSR_ALST0_Pos)
 
#define CAN_TSR_ALST0   CAN_TSR_ALST0_Msk
 
#define CAN_TSR_TERR0_Pos   (3U)
 
#define CAN_TSR_TERR0_Msk   (0x1UL << CAN_TSR_TERR0_Pos)
 
#define CAN_TSR_TERR0   CAN_TSR_TERR0_Msk
 
#define CAN_TSR_ABRQ0_Pos   (7U)
 
#define CAN_TSR_ABRQ0_Msk   (0x1UL << CAN_TSR_ABRQ0_Pos)
 
#define CAN_TSR_ABRQ0   CAN_TSR_ABRQ0_Msk
 
#define CAN_TSR_RQCP1_Pos   (8U)
 
#define CAN_TSR_RQCP1_Msk   (0x1UL << CAN_TSR_RQCP1_Pos)
 
#define CAN_TSR_RQCP1   CAN_TSR_RQCP1_Msk
 
#define CAN_TSR_TXOK1_Pos   (9U)
 
#define CAN_TSR_TXOK1_Msk   (0x1UL << CAN_TSR_TXOK1_Pos)
 
#define CAN_TSR_TXOK1   CAN_TSR_TXOK1_Msk
 
#define CAN_TSR_ALST1_Pos   (10U)
 
#define CAN_TSR_ALST1_Msk   (0x1UL << CAN_TSR_ALST1_Pos)
 
#define CAN_TSR_ALST1   CAN_TSR_ALST1_Msk
 
#define CAN_TSR_TERR1_Pos   (11U)
 
#define CAN_TSR_TERR1_Msk   (0x1UL << CAN_TSR_TERR1_Pos)
 
#define CAN_TSR_TERR1   CAN_TSR_TERR1_Msk
 
#define CAN_TSR_ABRQ1_Pos   (15U)
 
#define CAN_TSR_ABRQ1_Msk   (0x1UL << CAN_TSR_ABRQ1_Pos)
 
#define CAN_TSR_ABRQ1   CAN_TSR_ABRQ1_Msk
 
#define CAN_TSR_RQCP2_Pos   (16U)
 
#define CAN_TSR_RQCP2_Msk   (0x1UL << CAN_TSR_RQCP2_Pos)
 
#define CAN_TSR_RQCP2   CAN_TSR_RQCP2_Msk
 
#define CAN_TSR_TXOK2_Pos   (17U)
 
#define CAN_TSR_TXOK2_Msk   (0x1UL << CAN_TSR_TXOK2_Pos)
 
#define CAN_TSR_TXOK2   CAN_TSR_TXOK2_Msk
 
#define CAN_TSR_ALST2_Pos   (18U)
 
#define CAN_TSR_ALST2_Msk   (0x1UL << CAN_TSR_ALST2_Pos)
 
#define CAN_TSR_ALST2   CAN_TSR_ALST2_Msk
 
#define CAN_TSR_TERR2_Pos   (19U)
 
#define CAN_TSR_TERR2_Msk   (0x1UL << CAN_TSR_TERR2_Pos)
 
#define CAN_TSR_TERR2   CAN_TSR_TERR2_Msk
 
#define CAN_TSR_ABRQ2_Pos   (23U)
 
#define CAN_TSR_ABRQ2_Msk   (0x1UL << CAN_TSR_ABRQ2_Pos)
 
#define CAN_TSR_ABRQ2   CAN_TSR_ABRQ2_Msk
 
#define CAN_TSR_CODE_Pos   (24U)
 
#define CAN_TSR_CODE_Msk   (0x3UL << CAN_TSR_CODE_Pos)
 
#define CAN_TSR_CODE   CAN_TSR_CODE_Msk
 
#define CAN_TSR_TME_Pos   (26U)
 
#define CAN_TSR_TME_Msk   (0x7UL << CAN_TSR_TME_Pos)
 
#define CAN_TSR_TME   CAN_TSR_TME_Msk
 
#define CAN_TSR_TME0_Pos   (26U)
 
#define CAN_TSR_TME0_Msk   (0x1UL << CAN_TSR_TME0_Pos)
 
#define CAN_TSR_TME0   CAN_TSR_TME0_Msk
 
#define CAN_TSR_TME1_Pos   (27U)
 
#define CAN_TSR_TME1_Msk   (0x1UL << CAN_TSR_TME1_Pos)
 
#define CAN_TSR_TME1   CAN_TSR_TME1_Msk
 
#define CAN_TSR_TME2_Pos   (28U)
 
#define CAN_TSR_TME2_Msk   (0x1UL << CAN_TSR_TME2_Pos)
 
#define CAN_TSR_TME2   CAN_TSR_TME2_Msk
 
#define CAN_TSR_LOW_Pos   (29U)
 
#define CAN_TSR_LOW_Msk   (0x7UL << CAN_TSR_LOW_Pos)
 
#define CAN_TSR_LOW   CAN_TSR_LOW_Msk
 
#define CAN_TSR_LOW0_Pos   (29U)
 
#define CAN_TSR_LOW0_Msk   (0x1UL << CAN_TSR_LOW0_Pos)
 
#define CAN_TSR_LOW0   CAN_TSR_LOW0_Msk
 
#define CAN_TSR_LOW1_Pos   (30U)
 
#define CAN_TSR_LOW1_Msk   (0x1UL << CAN_TSR_LOW1_Pos)
 
#define CAN_TSR_LOW1   CAN_TSR_LOW1_Msk
 
#define CAN_TSR_LOW2_Pos   (31U)
 
#define CAN_TSR_LOW2_Msk   (0x1UL << CAN_TSR_LOW2_Pos)
 
#define CAN_TSR_LOW2   CAN_TSR_LOW2_Msk
 
#define CAN_RF0R_FMP0_Pos   (0U)
 
#define CAN_RF0R_FMP0_Msk   (0x3UL << CAN_RF0R_FMP0_Pos)
 
#define CAN_RF0R_FMP0   CAN_RF0R_FMP0_Msk
 
#define CAN_RF0R_FULL0_Pos   (3U)
 
#define CAN_RF0R_FULL0_Msk   (0x1UL << CAN_RF0R_FULL0_Pos)
 
#define CAN_RF0R_FULL0   CAN_RF0R_FULL0_Msk
 
#define CAN_RF0R_FOVR0_Pos   (4U)
 
#define CAN_RF0R_FOVR0_Msk   (0x1UL << CAN_RF0R_FOVR0_Pos)
 
#define CAN_RF0R_FOVR0   CAN_RF0R_FOVR0_Msk
 
#define CAN_RF0R_RFOM0_Pos   (5U)
 
#define CAN_RF0R_RFOM0_Msk   (0x1UL << CAN_RF0R_RFOM0_Pos)
 
#define CAN_RF0R_RFOM0   CAN_RF0R_RFOM0_Msk
 
#define CAN_RF1R_FMP1_Pos   (0U)
 
#define CAN_RF1R_FMP1_Msk   (0x3UL << CAN_RF1R_FMP1_Pos)
 
#define CAN_RF1R_FMP1   CAN_RF1R_FMP1_Msk
 
#define CAN_RF1R_FULL1_Pos   (3U)
 
#define CAN_RF1R_FULL1_Msk   (0x1UL << CAN_RF1R_FULL1_Pos)
 
#define CAN_RF1R_FULL1   CAN_RF1R_FULL1_Msk
 
#define CAN_RF1R_FOVR1_Pos   (4U)
 
#define CAN_RF1R_FOVR1_Msk   (0x1UL << CAN_RF1R_FOVR1_Pos)
 
#define CAN_RF1R_FOVR1   CAN_RF1R_FOVR1_Msk
 
#define CAN_RF1R_RFOM1_Pos   (5U)
 
#define CAN_RF1R_RFOM1_Msk   (0x1UL << CAN_RF1R_RFOM1_Pos)
 
#define CAN_RF1R_RFOM1   CAN_RF1R_RFOM1_Msk
 
#define CAN_IER_TMEIE_Pos   (0U)
 
#define CAN_IER_TMEIE_Msk   (0x1UL << CAN_IER_TMEIE_Pos)
 
#define CAN_IER_TMEIE   CAN_IER_TMEIE_Msk
 
#define CAN_IER_FMPIE0_Pos   (1U)
 
#define CAN_IER_FMPIE0_Msk   (0x1UL << CAN_IER_FMPIE0_Pos)
 
#define CAN_IER_FMPIE0   CAN_IER_FMPIE0_Msk
 
#define CAN_IER_FFIE0_Pos   (2U)
 
#define CAN_IER_FFIE0_Msk   (0x1UL << CAN_IER_FFIE0_Pos)
 
#define CAN_IER_FFIE0   CAN_IER_FFIE0_Msk
 
#define CAN_IER_FOVIE0_Pos   (3U)
 
#define CAN_IER_FOVIE0_Msk   (0x1UL << CAN_IER_FOVIE0_Pos)
 
#define CAN_IER_FOVIE0   CAN_IER_FOVIE0_Msk
 
#define CAN_IER_FMPIE1_Pos   (4U)
 
#define CAN_IER_FMPIE1_Msk   (0x1UL << CAN_IER_FMPIE1_Pos)
 
#define CAN_IER_FMPIE1   CAN_IER_FMPIE1_Msk
 
#define CAN_IER_FFIE1_Pos   (5U)
 
#define CAN_IER_FFIE1_Msk   (0x1UL << CAN_IER_FFIE1_Pos)
 
#define CAN_IER_FFIE1   CAN_IER_FFIE1_Msk
 
#define CAN_IER_FOVIE1_Pos   (6U)
 
#define CAN_IER_FOVIE1_Msk   (0x1UL << CAN_IER_FOVIE1_Pos)
 
#define CAN_IER_FOVIE1   CAN_IER_FOVIE1_Msk
 
#define CAN_IER_EWGIE_Pos   (8U)
 
#define CAN_IER_EWGIE_Msk   (0x1UL << CAN_IER_EWGIE_Pos)
 
#define CAN_IER_EWGIE   CAN_IER_EWGIE_Msk
 
#define CAN_IER_EPVIE_Pos   (9U)
 
#define CAN_IER_EPVIE_Msk   (0x1UL << CAN_IER_EPVIE_Pos)
 
#define CAN_IER_EPVIE   CAN_IER_EPVIE_Msk
 
#define CAN_IER_BOFIE_Pos   (10U)
 
#define CAN_IER_BOFIE_Msk   (0x1UL << CAN_IER_BOFIE_Pos)
 
#define CAN_IER_BOFIE   CAN_IER_BOFIE_Msk
 
#define CAN_IER_LECIE_Pos   (11U)
 
#define CAN_IER_LECIE_Msk   (0x1UL << CAN_IER_LECIE_Pos)
 
#define CAN_IER_LECIE   CAN_IER_LECIE_Msk
 
#define CAN_IER_ERRIE_Pos   (15U)
 
#define CAN_IER_ERRIE_Msk   (0x1UL << CAN_IER_ERRIE_Pos)
 
#define CAN_IER_ERRIE   CAN_IER_ERRIE_Msk
 
#define CAN_IER_WKUIE_Pos   (16U)
 
#define CAN_IER_WKUIE_Msk   (0x1UL << CAN_IER_WKUIE_Pos)
 
#define CAN_IER_WKUIE   CAN_IER_WKUIE_Msk
 
#define CAN_IER_SLKIE_Pos   (17U)
 
#define CAN_IER_SLKIE_Msk   (0x1UL << CAN_IER_SLKIE_Pos)
 
#define CAN_IER_SLKIE   CAN_IER_SLKIE_Msk
 
#define CAN_ESR_EWGF_Pos   (0U)
 
#define CAN_ESR_EWGF_Msk   (0x1UL << CAN_ESR_EWGF_Pos)
 
#define CAN_ESR_EWGF   CAN_ESR_EWGF_Msk
 
#define CAN_ESR_EPVF_Pos   (1U)
 
#define CAN_ESR_EPVF_Msk   (0x1UL << CAN_ESR_EPVF_Pos)
 
#define CAN_ESR_EPVF   CAN_ESR_EPVF_Msk
 
#define CAN_ESR_BOFF_Pos   (2U)
 
#define CAN_ESR_BOFF_Msk   (0x1UL << CAN_ESR_BOFF_Pos)
 
#define CAN_ESR_BOFF   CAN_ESR_BOFF_Msk
 
#define CAN_ESR_LEC_Pos   (4U)
 
#define CAN_ESR_LEC_Msk   (0x7UL << CAN_ESR_LEC_Pos)
 
#define CAN_ESR_LEC   CAN_ESR_LEC_Msk
 
#define CAN_ESR_LEC_0   (0x1UL << CAN_ESR_LEC_Pos)
 
#define CAN_ESR_LEC_1   (0x2UL << CAN_ESR_LEC_Pos)
 
#define CAN_ESR_LEC_2   (0x4UL << CAN_ESR_LEC_Pos)
 
#define CAN_ESR_TEC_Pos   (16U)
 
#define CAN_ESR_TEC_Msk   (0xFFUL << CAN_ESR_TEC_Pos)
 
#define CAN_ESR_TEC   CAN_ESR_TEC_Msk
 
#define CAN_ESR_REC_Pos   (24U)
 
#define CAN_ESR_REC_Msk   (0xFFUL << CAN_ESR_REC_Pos)
 
#define CAN_ESR_REC   CAN_ESR_REC_Msk
 
#define CAN_BTR_BRP_Pos   (0U)
 
#define CAN_BTR_BRP_Msk   (0x3FFUL << CAN_BTR_BRP_Pos)
 
#define CAN_BTR_BRP   CAN_BTR_BRP_Msk
 
#define CAN_BTR_TS1_Pos   (16U)
 
#define CAN_BTR_TS1_Msk   (0xFUL << CAN_BTR_TS1_Pos)
 
#define CAN_BTR_TS1   CAN_BTR_TS1_Msk
 
#define CAN_BTR_TS1_0   (0x1UL << CAN_BTR_TS1_Pos)
 
#define CAN_BTR_TS1_1   (0x2UL << CAN_BTR_TS1_Pos)
 
#define CAN_BTR_TS1_2   (0x4UL << CAN_BTR_TS1_Pos)
 
#define CAN_BTR_TS1_3   (0x8UL << CAN_BTR_TS1_Pos)
 
#define CAN_BTR_TS2_Pos   (20U)
 
#define CAN_BTR_TS2_Msk   (0x7UL << CAN_BTR_TS2_Pos)
 
#define CAN_BTR_TS2   CAN_BTR_TS2_Msk
 
#define CAN_BTR_TS2_0   (0x1UL << CAN_BTR_TS2_Pos)
 
#define CAN_BTR_TS2_1   (0x2UL << CAN_BTR_TS2_Pos)
 
#define CAN_BTR_TS2_2   (0x4UL << CAN_BTR_TS2_Pos)
 
#define CAN_BTR_SJW_Pos   (24U)
 
#define CAN_BTR_SJW_Msk   (0x3UL << CAN_BTR_SJW_Pos)
 
#define CAN_BTR_SJW   CAN_BTR_SJW_Msk
 
#define CAN_BTR_SJW_0   (0x1UL << CAN_BTR_SJW_Pos)
 
#define CAN_BTR_SJW_1   (0x2UL << CAN_BTR_SJW_Pos)
 
#define CAN_BTR_LBKM_Pos   (30U)
 
#define CAN_BTR_LBKM_Msk   (0x1UL << CAN_BTR_LBKM_Pos)
 
#define CAN_BTR_LBKM   CAN_BTR_LBKM_Msk
 
#define CAN_BTR_SILM_Pos   (31U)
 
#define CAN_BTR_SILM_Msk   (0x1UL << CAN_BTR_SILM_Pos)
 
#define CAN_BTR_SILM   CAN_BTR_SILM_Msk
 
#define CAN_TI0R_TXRQ_Pos   (0U)
 
#define CAN_TI0R_TXRQ_Msk   (0x1UL << CAN_TI0R_TXRQ_Pos)
 
#define CAN_TI0R_TXRQ   CAN_TI0R_TXRQ_Msk
 
#define CAN_TI0R_RTR_Pos   (1U)
 
#define CAN_TI0R_RTR_Msk   (0x1UL << CAN_TI0R_RTR_Pos)
 
#define CAN_TI0R_RTR   CAN_TI0R_RTR_Msk
 
#define CAN_TI0R_IDE_Pos   (2U)
 
#define CAN_TI0R_IDE_Msk   (0x1UL << CAN_TI0R_IDE_Pos)
 
#define CAN_TI0R_IDE   CAN_TI0R_IDE_Msk
 
#define CAN_TI0R_EXID_Pos   (3U)
 
#define CAN_TI0R_EXID_Msk   (0x3FFFFUL << CAN_TI0R_EXID_Pos)
 
#define CAN_TI0R_EXID   CAN_TI0R_EXID_Msk
 
#define CAN_TI0R_STID_Pos   (21U)
 
#define CAN_TI0R_STID_Msk   (0x7FFUL << CAN_TI0R_STID_Pos)
 
#define CAN_TI0R_STID   CAN_TI0R_STID_Msk
 
#define CAN_TDT0R_DLC_Pos   (0U)
 
#define CAN_TDT0R_DLC_Msk   (0xFUL << CAN_TDT0R_DLC_Pos)
 
#define CAN_TDT0R_DLC   CAN_TDT0R_DLC_Msk
 
#define CAN_TDT0R_TGT_Pos   (8U)
 
#define CAN_TDT0R_TGT_Msk   (0x1UL << CAN_TDT0R_TGT_Pos)
 
#define CAN_TDT0R_TGT   CAN_TDT0R_TGT_Msk
 
#define CAN_TDT0R_TIME_Pos   (16U)
 
#define CAN_TDT0R_TIME_Msk   (0xFFFFUL << CAN_TDT0R_TIME_Pos)
 
#define CAN_TDT0R_TIME   CAN_TDT0R_TIME_Msk
 
#define CAN_TDL0R_DATA0_Pos   (0U)
 
#define CAN_TDL0R_DATA0_Msk   (0xFFUL << CAN_TDL0R_DATA0_Pos)
 
#define CAN_TDL0R_DATA0   CAN_TDL0R_DATA0_Msk
 
#define CAN_TDL0R_DATA1_Pos   (8U)
 
#define CAN_TDL0R_DATA1_Msk   (0xFFUL << CAN_TDL0R_DATA1_Pos)
 
#define CAN_TDL0R_DATA1   CAN_TDL0R_DATA1_Msk
 
#define CAN_TDL0R_DATA2_Pos   (16U)
 
#define CAN_TDL0R_DATA2_Msk   (0xFFUL << CAN_TDL0R_DATA2_Pos)
 
#define CAN_TDL0R_DATA2   CAN_TDL0R_DATA2_Msk
 
#define CAN_TDL0R_DATA3_Pos   (24U)
 
#define CAN_TDL0R_DATA3_Msk   (0xFFUL << CAN_TDL0R_DATA3_Pos)
 
#define CAN_TDL0R_DATA3   CAN_TDL0R_DATA3_Msk
 
#define CAN_TDH0R_DATA4_Pos   (0U)
 
#define CAN_TDH0R_DATA4_Msk   (0xFFUL << CAN_TDH0R_DATA4_Pos)
 
#define CAN_TDH0R_DATA4   CAN_TDH0R_DATA4_Msk
 
#define CAN_TDH0R_DATA5_Pos   (8U)
 
#define CAN_TDH0R_DATA5_Msk   (0xFFUL << CAN_TDH0R_DATA5_Pos)
 
#define CAN_TDH0R_DATA5   CAN_TDH0R_DATA5_Msk
 
#define CAN_TDH0R_DATA6_Pos   (16U)
 
#define CAN_TDH0R_DATA6_Msk   (0xFFUL << CAN_TDH0R_DATA6_Pos)
 
#define CAN_TDH0R_DATA6   CAN_TDH0R_DATA6_Msk
 
#define CAN_TDH0R_DATA7_Pos   (24U)
 
#define CAN_TDH0R_DATA7_Msk   (0xFFUL << CAN_TDH0R_DATA7_Pos)
 
#define CAN_TDH0R_DATA7   CAN_TDH0R_DATA7_Msk
 
#define CAN_TI1R_TXRQ_Pos   (0U)
 
#define CAN_TI1R_TXRQ_Msk   (0x1UL << CAN_TI1R_TXRQ_Pos)
 
#define CAN_TI1R_TXRQ   CAN_TI1R_TXRQ_Msk
 
#define CAN_TI1R_RTR_Pos   (1U)
 
#define CAN_TI1R_RTR_Msk   (0x1UL << CAN_TI1R_RTR_Pos)
 
#define CAN_TI1R_RTR   CAN_TI1R_RTR_Msk
 
#define CAN_TI1R_IDE_Pos   (2U)
 
#define CAN_TI1R_IDE_Msk   (0x1UL << CAN_TI1R_IDE_Pos)
 
#define CAN_TI1R_IDE   CAN_TI1R_IDE_Msk
 
#define CAN_TI1R_EXID_Pos   (3U)
 
#define CAN_TI1R_EXID_Msk   (0x3FFFFUL << CAN_TI1R_EXID_Pos)
 
#define CAN_TI1R_EXID   CAN_TI1R_EXID_Msk
 
#define CAN_TI1R_STID_Pos   (21U)
 
#define CAN_TI1R_STID_Msk   (0x7FFUL << CAN_TI1R_STID_Pos)
 
#define CAN_TI1R_STID   CAN_TI1R_STID_Msk
 
#define CAN_TDT1R_DLC_Pos   (0U)
 
#define CAN_TDT1R_DLC_Msk   (0xFUL << CAN_TDT1R_DLC_Pos)
 
#define CAN_TDT1R_DLC   CAN_TDT1R_DLC_Msk
 
#define CAN_TDT1R_TGT_Pos   (8U)
 
#define CAN_TDT1R_TGT_Msk   (0x1UL << CAN_TDT1R_TGT_Pos)
 
#define CAN_TDT1R_TGT   CAN_TDT1R_TGT_Msk
 
#define CAN_TDT1R_TIME_Pos   (16U)
 
#define CAN_TDT1R_TIME_Msk   (0xFFFFUL << CAN_TDT1R_TIME_Pos)
 
#define CAN_TDT1R_TIME   CAN_TDT1R_TIME_Msk
 
#define CAN_TDL1R_DATA0_Pos   (0U)
 
#define CAN_TDL1R_DATA0_Msk   (0xFFUL << CAN_TDL1R_DATA0_Pos)
 
#define CAN_TDL1R_DATA0   CAN_TDL1R_DATA0_Msk
 
#define CAN_TDL1R_DATA1_Pos   (8U)
 
#define CAN_TDL1R_DATA1_Msk   (0xFFUL << CAN_TDL1R_DATA1_Pos)
 
#define CAN_TDL1R_DATA1   CAN_TDL1R_DATA1_Msk
 
#define CAN_TDL1R_DATA2_Pos   (16U)
 
#define CAN_TDL1R_DATA2_Msk   (0xFFUL << CAN_TDL1R_DATA2_Pos)
 
#define CAN_TDL1R_DATA2   CAN_TDL1R_DATA2_Msk
 
#define CAN_TDL1R_DATA3_Pos   (24U)
 
#define CAN_TDL1R_DATA3_Msk   (0xFFUL << CAN_TDL1R_DATA3_Pos)
 
#define CAN_TDL1R_DATA3   CAN_TDL1R_DATA3_Msk
 
#define CAN_TDH1R_DATA4_Pos   (0U)
 
#define CAN_TDH1R_DATA4_Msk   (0xFFUL << CAN_TDH1R_DATA4_Pos)
 
#define CAN_TDH1R_DATA4   CAN_TDH1R_DATA4_Msk
 
#define CAN_TDH1R_DATA5_Pos   (8U)
 
#define CAN_TDH1R_DATA5_Msk   (0xFFUL << CAN_TDH1R_DATA5_Pos)
 
#define CAN_TDH1R_DATA5   CAN_TDH1R_DATA5_Msk
 
#define CAN_TDH1R_DATA6_Pos   (16U)
 
#define CAN_TDH1R_DATA6_Msk   (0xFFUL << CAN_TDH1R_DATA6_Pos)
 
#define CAN_TDH1R_DATA6   CAN_TDH1R_DATA6_Msk
 
#define CAN_TDH1R_DATA7_Pos   (24U)
 
#define CAN_TDH1R_DATA7_Msk   (0xFFUL << CAN_TDH1R_DATA7_Pos)
 
#define CAN_TDH1R_DATA7   CAN_TDH1R_DATA7_Msk
 
#define CAN_TI2R_TXRQ_Pos   (0U)
 
#define CAN_TI2R_TXRQ_Msk   (0x1UL << CAN_TI2R_TXRQ_Pos)
 
#define CAN_TI2R_TXRQ   CAN_TI2R_TXRQ_Msk
 
#define CAN_TI2R_RTR_Pos   (1U)
 
#define CAN_TI2R_RTR_Msk   (0x1UL << CAN_TI2R_RTR_Pos)
 
#define CAN_TI2R_RTR   CAN_TI2R_RTR_Msk
 
#define CAN_TI2R_IDE_Pos   (2U)
 
#define CAN_TI2R_IDE_Msk   (0x1UL << CAN_TI2R_IDE_Pos)
 
#define CAN_TI2R_IDE   CAN_TI2R_IDE_Msk
 
#define CAN_TI2R_EXID_Pos   (3U)
 
#define CAN_TI2R_EXID_Msk   (0x3FFFFUL << CAN_TI2R_EXID_Pos)
 
#define CAN_TI2R_EXID   CAN_TI2R_EXID_Msk
 
#define CAN_TI2R_STID_Pos   (21U)
 
#define CAN_TI2R_STID_Msk   (0x7FFUL << CAN_TI2R_STID_Pos)
 
#define CAN_TI2R_STID   CAN_TI2R_STID_Msk
 
#define CAN_TDT2R_DLC_Pos   (0U)
 
#define CAN_TDT2R_DLC_Msk   (0xFUL << CAN_TDT2R_DLC_Pos)
 
#define CAN_TDT2R_DLC   CAN_TDT2R_DLC_Msk
 
#define CAN_TDT2R_TGT_Pos   (8U)
 
#define CAN_TDT2R_TGT_Msk   (0x1UL << CAN_TDT2R_TGT_Pos)
 
#define CAN_TDT2R_TGT   CAN_TDT2R_TGT_Msk
 
#define CAN_TDT2R_TIME_Pos   (16U)
 
#define CAN_TDT2R_TIME_Msk   (0xFFFFUL << CAN_TDT2R_TIME_Pos)
 
#define CAN_TDT2R_TIME   CAN_TDT2R_TIME_Msk
 
#define CAN_TDL2R_DATA0_Pos   (0U)
 
#define CAN_TDL2R_DATA0_Msk   (0xFFUL << CAN_TDL2R_DATA0_Pos)
 
#define CAN_TDL2R_DATA0   CAN_TDL2R_DATA0_Msk
 
#define CAN_TDL2R_DATA1_Pos   (8U)
 
#define CAN_TDL2R_DATA1_Msk   (0xFFUL << CAN_TDL2R_DATA1_Pos)
 
#define CAN_TDL2R_DATA1   CAN_TDL2R_DATA1_Msk
 
#define CAN_TDL2R_DATA2_Pos   (16U)
 
#define CAN_TDL2R_DATA2_Msk   (0xFFUL << CAN_TDL2R_DATA2_Pos)
 
#define CAN_TDL2R_DATA2   CAN_TDL2R_DATA2_Msk
 
#define CAN_TDL2R_DATA3_Pos   (24U)
 
#define CAN_TDL2R_DATA3_Msk   (0xFFUL << CAN_TDL2R_DATA3_Pos)
 
#define CAN_TDL2R_DATA3   CAN_TDL2R_DATA3_Msk
 
#define CAN_TDH2R_DATA4_Pos   (0U)
 
#define CAN_TDH2R_DATA4_Msk   (0xFFUL << CAN_TDH2R_DATA4_Pos)
 
#define CAN_TDH2R_DATA4   CAN_TDH2R_DATA4_Msk
 
#define CAN_TDH2R_DATA5_Pos   (8U)
 
#define CAN_TDH2R_DATA5_Msk   (0xFFUL << CAN_TDH2R_DATA5_Pos)
 
#define CAN_TDH2R_DATA5   CAN_TDH2R_DATA5_Msk
 
#define CAN_TDH2R_DATA6_Pos   (16U)
 
#define CAN_TDH2R_DATA6_Msk   (0xFFUL << CAN_TDH2R_DATA6_Pos)
 
#define CAN_TDH2R_DATA6   CAN_TDH2R_DATA6_Msk
 
#define CAN_TDH2R_DATA7_Pos   (24U)
 
#define CAN_TDH2R_DATA7_Msk   (0xFFUL << CAN_TDH2R_DATA7_Pos)
 
#define CAN_TDH2R_DATA7   CAN_TDH2R_DATA7_Msk
 
#define CAN_RI0R_RTR_Pos   (1U)
 
#define CAN_RI0R_RTR_Msk   (0x1UL << CAN_RI0R_RTR_Pos)
 
#define CAN_RI0R_RTR   CAN_RI0R_RTR_Msk
 
#define CAN_RI0R_IDE_Pos   (2U)
 
#define CAN_RI0R_IDE_Msk   (0x1UL << CAN_RI0R_IDE_Pos)
 
#define CAN_RI0R_IDE   CAN_RI0R_IDE_Msk
 
#define CAN_RI0R_EXID_Pos   (3U)
 
#define CAN_RI0R_EXID_Msk   (0x3FFFFUL << CAN_RI0R_EXID_Pos)
 
#define CAN_RI0R_EXID   CAN_RI0R_EXID_Msk
 
#define CAN_RI0R_STID_Pos   (21U)
 
#define CAN_RI0R_STID_Msk   (0x7FFUL << CAN_RI0R_STID_Pos)
 
#define CAN_RI0R_STID   CAN_RI0R_STID_Msk
 
#define CAN_RDT0R_DLC_Pos   (0U)
 
#define CAN_RDT0R_DLC_Msk   (0xFUL << CAN_RDT0R_DLC_Pos)
 
#define CAN_RDT0R_DLC   CAN_RDT0R_DLC_Msk
 
#define CAN_RDT0R_FMI_Pos   (8U)
 
#define CAN_RDT0R_FMI_Msk   (0xFFUL << CAN_RDT0R_FMI_Pos)
 
#define CAN_RDT0R_FMI   CAN_RDT0R_FMI_Msk
 
#define CAN_RDT0R_TIME_Pos   (16U)
 
#define CAN_RDT0R_TIME_Msk   (0xFFFFUL << CAN_RDT0R_TIME_Pos)
 
#define CAN_RDT0R_TIME   CAN_RDT0R_TIME_Msk
 
#define CAN_RDL0R_DATA0_Pos   (0U)
 
#define CAN_RDL0R_DATA0_Msk   (0xFFUL << CAN_RDL0R_DATA0_Pos)
 
#define CAN_RDL0R_DATA0   CAN_RDL0R_DATA0_Msk
 
#define CAN_RDL0R_DATA1_Pos   (8U)
 
#define CAN_RDL0R_DATA1_Msk   (0xFFUL << CAN_RDL0R_DATA1_Pos)
 
#define CAN_RDL0R_DATA1   CAN_RDL0R_DATA1_Msk
 
#define CAN_RDL0R_DATA2_Pos   (16U)
 
#define CAN_RDL0R_DATA2_Msk   (0xFFUL << CAN_RDL0R_DATA2_Pos)
 
#define CAN_RDL0R_DATA2   CAN_RDL0R_DATA2_Msk
 
#define CAN_RDL0R_DATA3_Pos   (24U)
 
#define CAN_RDL0R_DATA3_Msk   (0xFFUL << CAN_RDL0R_DATA3_Pos)
 
#define CAN_RDL0R_DATA3   CAN_RDL0R_DATA3_Msk
 
#define CAN_RDH0R_DATA4_Pos   (0U)
 
#define CAN_RDH0R_DATA4_Msk   (0xFFUL << CAN_RDH0R_DATA4_Pos)
 
#define CAN_RDH0R_DATA4   CAN_RDH0R_DATA4_Msk
 
#define CAN_RDH0R_DATA5_Pos   (8U)
 
#define CAN_RDH0R_DATA5_Msk   (0xFFUL << CAN_RDH0R_DATA5_Pos)
 
#define CAN_RDH0R_DATA5   CAN_RDH0R_DATA5_Msk
 
#define CAN_RDH0R_DATA6_Pos   (16U)
 
#define CAN_RDH0R_DATA6_Msk   (0xFFUL << CAN_RDH0R_DATA6_Pos)
 
#define CAN_RDH0R_DATA6   CAN_RDH0R_DATA6_Msk
 
#define CAN_RDH0R_DATA7_Pos   (24U)
 
#define CAN_RDH0R_DATA7_Msk   (0xFFUL << CAN_RDH0R_DATA7_Pos)
 
#define CAN_RDH0R_DATA7   CAN_RDH0R_DATA7_Msk
 
#define CAN_RI1R_RTR_Pos   (1U)
 
#define CAN_RI1R_RTR_Msk   (0x1UL << CAN_RI1R_RTR_Pos)
 
#define CAN_RI1R_RTR   CAN_RI1R_RTR_Msk
 
#define CAN_RI1R_IDE_Pos   (2U)
 
#define CAN_RI1R_IDE_Msk   (0x1UL << CAN_RI1R_IDE_Pos)
 
#define CAN_RI1R_IDE   CAN_RI1R_IDE_Msk
 
#define CAN_RI1R_EXID_Pos   (3U)
 
#define CAN_RI1R_EXID_Msk   (0x3FFFFUL << CAN_RI1R_EXID_Pos)
 
#define CAN_RI1R_EXID   CAN_RI1R_EXID_Msk
 
#define CAN_RI1R_STID_Pos   (21U)
 
#define CAN_RI1R_STID_Msk   (0x7FFUL << CAN_RI1R_STID_Pos)
 
#define CAN_RI1R_STID   CAN_RI1R_STID_Msk
 
#define CAN_RDT1R_DLC_Pos   (0U)
 
#define CAN_RDT1R_DLC_Msk   (0xFUL << CAN_RDT1R_DLC_Pos)
 
#define CAN_RDT1R_DLC   CAN_RDT1R_DLC_Msk
 
#define CAN_RDT1R_FMI_Pos   (8U)
 
#define CAN_RDT1R_FMI_Msk   (0xFFUL << CAN_RDT1R_FMI_Pos)
 
#define CAN_RDT1R_FMI   CAN_RDT1R_FMI_Msk
 
#define CAN_RDT1R_TIME_Pos   (16U)
 
#define CAN_RDT1R_TIME_Msk   (0xFFFFUL << CAN_RDT1R_TIME_Pos)
 
#define CAN_RDT1R_TIME   CAN_RDT1R_TIME_Msk
 
#define CAN_RDL1R_DATA0_Pos   (0U)
 
#define CAN_RDL1R_DATA0_Msk   (0xFFUL << CAN_RDL1R_DATA0_Pos)
 
#define CAN_RDL1R_DATA0   CAN_RDL1R_DATA0_Msk
 
#define CAN_RDL1R_DATA1_Pos   (8U)
 
#define CAN_RDL1R_DATA1_Msk   (0xFFUL << CAN_RDL1R_DATA1_Pos)
 
#define CAN_RDL1R_DATA1   CAN_RDL1R_DATA1_Msk
 
#define CAN_RDL1R_DATA2_Pos   (16U)
 
#define CAN_RDL1R_DATA2_Msk   (0xFFUL << CAN_RDL1R_DATA2_Pos)
 
#define CAN_RDL1R_DATA2   CAN_RDL1R_DATA2_Msk
 
#define CAN_RDL1R_DATA3_Pos   (24U)
 
#define CAN_RDL1R_DATA3_Msk   (0xFFUL << CAN_RDL1R_DATA3_Pos)
 
#define CAN_RDL1R_DATA3   CAN_RDL1R_DATA3_Msk
 
#define CAN_RDH1R_DATA4_Pos   (0U)
 
#define CAN_RDH1R_DATA4_Msk   (0xFFUL << CAN_RDH1R_DATA4_Pos)
 
#define CAN_RDH1R_DATA4   CAN_RDH1R_DATA4_Msk
 
#define CAN_RDH1R_DATA5_Pos   (8U)
 
#define CAN_RDH1R_DATA5_Msk   (0xFFUL << CAN_RDH1R_DATA5_Pos)
 
#define CAN_RDH1R_DATA5   CAN_RDH1R_DATA5_Msk
 
#define CAN_RDH1R_DATA6_Pos   (16U)
 
#define CAN_RDH1R_DATA6_Msk   (0xFFUL << CAN_RDH1R_DATA6_Pos)
 
#define CAN_RDH1R_DATA6   CAN_RDH1R_DATA6_Msk
 
#define CAN_RDH1R_DATA7_Pos   (24U)
 
#define CAN_RDH1R_DATA7_Msk   (0xFFUL << CAN_RDH1R_DATA7_Pos)
 
#define CAN_RDH1R_DATA7   CAN_RDH1R_DATA7_Msk
 
#define CAN_FMR_FINIT_Pos   (0U)
 
#define CAN_FMR_FINIT_Msk   (0x1UL << CAN_FMR_FINIT_Pos)
 
#define CAN_FMR_FINIT   CAN_FMR_FINIT_Msk
 
#define CAN_FM1R_FBM_Pos   (0U)
 
#define CAN_FM1R_FBM_Msk   (0x3FFFUL << CAN_FM1R_FBM_Pos)
 
#define CAN_FM1R_FBM   CAN_FM1R_FBM_Msk
 
#define CAN_FM1R_FBM0_Pos   (0U)
 
#define CAN_FM1R_FBM0_Msk   (0x1UL << CAN_FM1R_FBM0_Pos)
 
#define CAN_FM1R_FBM0   CAN_FM1R_FBM0_Msk
 
#define CAN_FM1R_FBM1_Pos   (1U)
 
#define CAN_FM1R_FBM1_Msk   (0x1UL << CAN_FM1R_FBM1_Pos)
 
#define CAN_FM1R_FBM1   CAN_FM1R_FBM1_Msk
 
#define CAN_FM1R_FBM2_Pos   (2U)
 
#define CAN_FM1R_FBM2_Msk   (0x1UL << CAN_FM1R_FBM2_Pos)
 
#define CAN_FM1R_FBM2   CAN_FM1R_FBM2_Msk
 
#define CAN_FM1R_FBM3_Pos   (3U)
 
#define CAN_FM1R_FBM3_Msk   (0x1UL << CAN_FM1R_FBM3_Pos)
 
#define CAN_FM1R_FBM3   CAN_FM1R_FBM3_Msk
 
#define CAN_FM1R_FBM4_Pos   (4U)
 
#define CAN_FM1R_FBM4_Msk   (0x1UL << CAN_FM1R_FBM4_Pos)
 
#define CAN_FM1R_FBM4   CAN_FM1R_FBM4_Msk
 
#define CAN_FM1R_FBM5_Pos   (5U)
 
#define CAN_FM1R_FBM5_Msk   (0x1UL << CAN_FM1R_FBM5_Pos)
 
#define CAN_FM1R_FBM5   CAN_FM1R_FBM5_Msk
 
#define CAN_FM1R_FBM6_Pos   (6U)
 
#define CAN_FM1R_FBM6_Msk   (0x1UL << CAN_FM1R_FBM6_Pos)
 
#define CAN_FM1R_FBM6   CAN_FM1R_FBM6_Msk
 
#define CAN_FM1R_FBM7_Pos   (7U)
 
#define CAN_FM1R_FBM7_Msk   (0x1UL << CAN_FM1R_FBM7_Pos)
 
#define CAN_FM1R_FBM7   CAN_FM1R_FBM7_Msk
 
#define CAN_FM1R_FBM8_Pos   (8U)
 
#define CAN_FM1R_FBM8_Msk   (0x1UL << CAN_FM1R_FBM8_Pos)
 
#define CAN_FM1R_FBM8   CAN_FM1R_FBM8_Msk
 
#define CAN_FM1R_FBM9_Pos   (9U)
 
#define CAN_FM1R_FBM9_Msk   (0x1UL << CAN_FM1R_FBM9_Pos)
 
#define CAN_FM1R_FBM9   CAN_FM1R_FBM9_Msk
 
#define CAN_FM1R_FBM10_Pos   (10U)
 
#define CAN_FM1R_FBM10_Msk   (0x1UL << CAN_FM1R_FBM10_Pos)
 
#define CAN_FM1R_FBM10   CAN_FM1R_FBM10_Msk
 
#define CAN_FM1R_FBM11_Pos   (11U)
 
#define CAN_FM1R_FBM11_Msk   (0x1UL << CAN_FM1R_FBM11_Pos)
 
#define CAN_FM1R_FBM11   CAN_FM1R_FBM11_Msk
 
#define CAN_FM1R_FBM12_Pos   (12U)
 
#define CAN_FM1R_FBM12_Msk   (0x1UL << CAN_FM1R_FBM12_Pos)
 
#define CAN_FM1R_FBM12   CAN_FM1R_FBM12_Msk
 
#define CAN_FM1R_FBM13_Pos   (13U)
 
#define CAN_FM1R_FBM13_Msk   (0x1UL << CAN_FM1R_FBM13_Pos)
 
#define CAN_FM1R_FBM13   CAN_FM1R_FBM13_Msk
 
#define CAN_FS1R_FSC_Pos   (0U)
 
#define CAN_FS1R_FSC_Msk   (0x3FFFUL << CAN_FS1R_FSC_Pos)
 
#define CAN_FS1R_FSC   CAN_FS1R_FSC_Msk
 
#define CAN_FS1R_FSC0_Pos   (0U)
 
#define CAN_FS1R_FSC0_Msk   (0x1UL << CAN_FS1R_FSC0_Pos)
 
#define CAN_FS1R_FSC0   CAN_FS1R_FSC0_Msk
 
#define CAN_FS1R_FSC1_Pos   (1U)
 
#define CAN_FS1R_FSC1_Msk   (0x1UL << CAN_FS1R_FSC1_Pos)
 
#define CAN_FS1R_FSC1   CAN_FS1R_FSC1_Msk
 
#define CAN_FS1R_FSC2_Pos   (2U)
 
#define CAN_FS1R_FSC2_Msk   (0x1UL << CAN_FS1R_FSC2_Pos)
 
#define CAN_FS1R_FSC2   CAN_FS1R_FSC2_Msk
 
#define CAN_FS1R_FSC3_Pos   (3U)
 
#define CAN_FS1R_FSC3_Msk   (0x1UL << CAN_FS1R_FSC3_Pos)
 
#define CAN_FS1R_FSC3   CAN_FS1R_FSC3_Msk
 
#define CAN_FS1R_FSC4_Pos   (4U)
 
#define CAN_FS1R_FSC4_Msk   (0x1UL << CAN_FS1R_FSC4_Pos)
 
#define CAN_FS1R_FSC4   CAN_FS1R_FSC4_Msk
 
#define CAN_FS1R_FSC5_Pos   (5U)
 
#define CAN_FS1R_FSC5_Msk   (0x1UL << CAN_FS1R_FSC5_Pos)
 
#define CAN_FS1R_FSC5   CAN_FS1R_FSC5_Msk
 
#define CAN_FS1R_FSC6_Pos   (6U)
 
#define CAN_FS1R_FSC6_Msk   (0x1UL << CAN_FS1R_FSC6_Pos)
 
#define CAN_FS1R_FSC6   CAN_FS1R_FSC6_Msk
 
#define CAN_FS1R_FSC7_Pos   (7U)
 
#define CAN_FS1R_FSC7_Msk   (0x1UL << CAN_FS1R_FSC7_Pos)
 
#define CAN_FS1R_FSC7   CAN_FS1R_FSC7_Msk
 
#define CAN_FS1R_FSC8_Pos   (8U)
 
#define CAN_FS1R_FSC8_Msk   (0x1UL << CAN_FS1R_FSC8_Pos)
 
#define CAN_FS1R_FSC8   CAN_FS1R_FSC8_Msk
 
#define CAN_FS1R_FSC9_Pos   (9U)
 
#define CAN_FS1R_FSC9_Msk   (0x1UL << CAN_FS1R_FSC9_Pos)
 
#define CAN_FS1R_FSC9   CAN_FS1R_FSC9_Msk
 
#define CAN_FS1R_FSC10_Pos   (10U)
 
#define CAN_FS1R_FSC10_Msk   (0x1UL << CAN_FS1R_FSC10_Pos)
 
#define CAN_FS1R_FSC10   CAN_FS1R_FSC10_Msk
 
#define CAN_FS1R_FSC11_Pos   (11U)
 
#define CAN_FS1R_FSC11_Msk   (0x1UL << CAN_FS1R_FSC11_Pos)
 
#define CAN_FS1R_FSC11   CAN_FS1R_FSC11_Msk
 
#define CAN_FS1R_FSC12_Pos   (12U)
 
#define CAN_FS1R_FSC12_Msk   (0x1UL << CAN_FS1R_FSC12_Pos)
 
#define CAN_FS1R_FSC12   CAN_FS1R_FSC12_Msk
 
#define CAN_FS1R_FSC13_Pos   (13U)
 
#define CAN_FS1R_FSC13_Msk   (0x1UL << CAN_FS1R_FSC13_Pos)
 
#define CAN_FS1R_FSC13   CAN_FS1R_FSC13_Msk
 
#define CAN_FFA1R_FFA_Pos   (0U)
 
#define CAN_FFA1R_FFA_Msk   (0x3FFFUL << CAN_FFA1R_FFA_Pos)
 
#define CAN_FFA1R_FFA   CAN_FFA1R_FFA_Msk
 
#define CAN_FFA1R_FFA0_Pos   (0U)
 
#define CAN_FFA1R_FFA0_Msk   (0x1UL << CAN_FFA1R_FFA0_Pos)
 
#define CAN_FFA1R_FFA0   CAN_FFA1R_FFA0_Msk
 
#define CAN_FFA1R_FFA1_Pos   (1U)
 
#define CAN_FFA1R_FFA1_Msk   (0x1UL << CAN_FFA1R_FFA1_Pos)
 
#define CAN_FFA1R_FFA1   CAN_FFA1R_FFA1_Msk
 
#define CAN_FFA1R_FFA2_Pos   (2U)
 
#define CAN_FFA1R_FFA2_Msk   (0x1UL << CAN_FFA1R_FFA2_Pos)
 
#define CAN_FFA1R_FFA2   CAN_FFA1R_FFA2_Msk
 
#define CAN_FFA1R_FFA3_Pos   (3U)
 
#define CAN_FFA1R_FFA3_Msk   (0x1UL << CAN_FFA1R_FFA3_Pos)
 
#define CAN_FFA1R_FFA3   CAN_FFA1R_FFA3_Msk
 
#define CAN_FFA1R_FFA4_Pos   (4U)
 
#define CAN_FFA1R_FFA4_Msk   (0x1UL << CAN_FFA1R_FFA4_Pos)
 
#define CAN_FFA1R_FFA4   CAN_FFA1R_FFA4_Msk
 
#define CAN_FFA1R_FFA5_Pos   (5U)
 
#define CAN_FFA1R_FFA5_Msk   (0x1UL << CAN_FFA1R_FFA5_Pos)
 
#define CAN_FFA1R_FFA5   CAN_FFA1R_FFA5_Msk
 
#define CAN_FFA1R_FFA6_Pos   (6U)
 
#define CAN_FFA1R_FFA6_Msk   (0x1UL << CAN_FFA1R_FFA6_Pos)
 
#define CAN_FFA1R_FFA6   CAN_FFA1R_FFA6_Msk
 
#define CAN_FFA1R_FFA7_Pos   (7U)
 
#define CAN_FFA1R_FFA7_Msk   (0x1UL << CAN_FFA1R_FFA7_Pos)
 
#define CAN_FFA1R_FFA7   CAN_FFA1R_FFA7_Msk
 
#define CAN_FFA1R_FFA8_Pos   (8U)
 
#define CAN_FFA1R_FFA8_Msk   (0x1UL << CAN_FFA1R_FFA8_Pos)
 
#define CAN_FFA1R_FFA8   CAN_FFA1R_FFA8_Msk
 
#define CAN_FFA1R_FFA9_Pos   (9U)
 
#define CAN_FFA1R_FFA9_Msk   (0x1UL << CAN_FFA1R_FFA9_Pos)
 
#define CAN_FFA1R_FFA9   CAN_FFA1R_FFA9_Msk
 
#define CAN_FFA1R_FFA10_Pos   (10U)
 
#define CAN_FFA1R_FFA10_Msk   (0x1UL << CAN_FFA1R_FFA10_Pos)
 
#define CAN_FFA1R_FFA10   CAN_FFA1R_FFA10_Msk
 
#define CAN_FFA1R_FFA11_Pos   (11U)
 
#define CAN_FFA1R_FFA11_Msk   (0x1UL << CAN_FFA1R_FFA11_Pos)
 
#define CAN_FFA1R_FFA11   CAN_FFA1R_FFA11_Msk
 
#define CAN_FFA1R_FFA12_Pos   (12U)
 
#define CAN_FFA1R_FFA12_Msk   (0x1UL << CAN_FFA1R_FFA12_Pos)
 
#define CAN_FFA1R_FFA12   CAN_FFA1R_FFA12_Msk
 
#define CAN_FFA1R_FFA13_Pos   (13U)
 
#define CAN_FFA1R_FFA13_Msk   (0x1UL << CAN_FFA1R_FFA13_Pos)
 
#define CAN_FFA1R_FFA13   CAN_FFA1R_FFA13_Msk
 
#define CAN_FA1R_FACT_Pos   (0U)
 
#define CAN_FA1R_FACT_Msk   (0x3FFFUL << CAN_FA1R_FACT_Pos)
 
#define CAN_FA1R_FACT   CAN_FA1R_FACT_Msk
 
#define CAN_FA1R_FACT0_Pos   (0U)
 
#define CAN_FA1R_FACT0_Msk   (0x1UL << CAN_FA1R_FACT0_Pos)
 
#define CAN_FA1R_FACT0   CAN_FA1R_FACT0_Msk
 
#define CAN_FA1R_FACT1_Pos   (1U)
 
#define CAN_FA1R_FACT1_Msk   (0x1UL << CAN_FA1R_FACT1_Pos)
 
#define CAN_FA1R_FACT1   CAN_FA1R_FACT1_Msk
 
#define CAN_FA1R_FACT2_Pos   (2U)
 
#define CAN_FA1R_FACT2_Msk   (0x1UL << CAN_FA1R_FACT2_Pos)
 
#define CAN_FA1R_FACT2   CAN_FA1R_FACT2_Msk
 
#define CAN_FA1R_FACT3_Pos   (3U)
 
#define CAN_FA1R_FACT3_Msk   (0x1UL << CAN_FA1R_FACT3_Pos)
 
#define CAN_FA1R_FACT3   CAN_FA1R_FACT3_Msk
 
#define CAN_FA1R_FACT4_Pos   (4U)
 
#define CAN_FA1R_FACT4_Msk   (0x1UL << CAN_FA1R_FACT4_Pos)
 
#define CAN_FA1R_FACT4   CAN_FA1R_FACT4_Msk
 
#define CAN_FA1R_FACT5_Pos   (5U)
 
#define CAN_FA1R_FACT5_Msk   (0x1UL << CAN_FA1R_FACT5_Pos)
 
#define CAN_FA1R_FACT5   CAN_FA1R_FACT5_Msk
 
#define CAN_FA1R_FACT6_Pos   (6U)
 
#define CAN_FA1R_FACT6_Msk   (0x1UL << CAN_FA1R_FACT6_Pos)
 
#define CAN_FA1R_FACT6   CAN_FA1R_FACT6_Msk
 
#define CAN_FA1R_FACT7_Pos   (7U)
 
#define CAN_FA1R_FACT7_Msk   (0x1UL << CAN_FA1R_FACT7_Pos)
 
#define CAN_FA1R_FACT7   CAN_FA1R_FACT7_Msk
 
#define CAN_FA1R_FACT8_Pos   (8U)
 
#define CAN_FA1R_FACT8_Msk   (0x1UL << CAN_FA1R_FACT8_Pos)
 
#define CAN_FA1R_FACT8   CAN_FA1R_FACT8_Msk
 
#define CAN_FA1R_FACT9_Pos   (9U)
 
#define CAN_FA1R_FACT9_Msk   (0x1UL << CAN_FA1R_FACT9_Pos)
 
#define CAN_FA1R_FACT9   CAN_FA1R_FACT9_Msk
 
#define CAN_FA1R_FACT10_Pos   (10U)
 
#define CAN_FA1R_FACT10_Msk   (0x1UL << CAN_FA1R_FACT10_Pos)
 
#define CAN_FA1R_FACT10   CAN_FA1R_FACT10_Msk
 
#define CAN_FA1R_FACT11_Pos   (11U)
 
#define CAN_FA1R_FACT11_Msk   (0x1UL << CAN_FA1R_FACT11_Pos)
 
#define CAN_FA1R_FACT11   CAN_FA1R_FACT11_Msk
 
#define CAN_FA1R_FACT12_Pos   (12U)
 
#define CAN_FA1R_FACT12_Msk   (0x1UL << CAN_FA1R_FACT12_Pos)
 
#define CAN_FA1R_FACT12   CAN_FA1R_FACT12_Msk
 
#define CAN_FA1R_FACT13_Pos   (13U)
 
#define CAN_FA1R_FACT13_Msk   (0x1UL << CAN_FA1R_FACT13_Pos)
 
#define CAN_FA1R_FACT13   CAN_FA1R_FACT13_Msk
 
#define CAN_F0R1_FB0_Pos   (0U)
 
#define CAN_F0R1_FB0_Msk   (0x1UL << CAN_F0R1_FB0_Pos)
 
#define CAN_F0R1_FB0   CAN_F0R1_FB0_Msk
 
#define CAN_F0R1_FB1_Pos   (1U)
 
#define CAN_F0R1_FB1_Msk   (0x1UL << CAN_F0R1_FB1_Pos)
 
#define CAN_F0R1_FB1   CAN_F0R1_FB1_Msk
 
#define CAN_F0R1_FB2_Pos   (2U)
 
#define CAN_F0R1_FB2_Msk   (0x1UL << CAN_F0R1_FB2_Pos)
 
#define CAN_F0R1_FB2   CAN_F0R1_FB2_Msk
 
#define CAN_F0R1_FB3_Pos   (3U)
 
#define CAN_F0R1_FB3_Msk   (0x1UL << CAN_F0R1_FB3_Pos)
 
#define CAN_F0R1_FB3   CAN_F0R1_FB3_Msk
 
#define CAN_F0R1_FB4_Pos   (4U)
 
#define CAN_F0R1_FB4_Msk   (0x1UL << CAN_F0R1_FB4_Pos)
 
#define CAN_F0R1_FB4   CAN_F0R1_FB4_Msk
 
#define CAN_F0R1_FB5_Pos   (5U)
 
#define CAN_F0R1_FB5_Msk   (0x1UL << CAN_F0R1_FB5_Pos)
 
#define CAN_F0R1_FB5   CAN_F0R1_FB5_Msk
 
#define CAN_F0R1_FB6_Pos   (6U)
 
#define CAN_F0R1_FB6_Msk   (0x1UL << CAN_F0R1_FB6_Pos)
 
#define CAN_F0R1_FB6   CAN_F0R1_FB6_Msk
 
#define CAN_F0R1_FB7_Pos   (7U)
 
#define CAN_F0R1_FB7_Msk   (0x1UL << CAN_F0R1_FB7_Pos)
 
#define CAN_F0R1_FB7   CAN_F0R1_FB7_Msk
 
#define CAN_F0R1_FB8_Pos   (8U)
 
#define CAN_F0R1_FB8_Msk   (0x1UL << CAN_F0R1_FB8_Pos)
 
#define CAN_F0R1_FB8   CAN_F0R1_FB8_Msk
 
#define CAN_F0R1_FB9_Pos   (9U)
 
#define CAN_F0R1_FB9_Msk   (0x1UL << CAN_F0R1_FB9_Pos)
 
#define CAN_F0R1_FB9   CAN_F0R1_FB9_Msk
 
#define CAN_F0R1_FB10_Pos   (10U)
 
#define CAN_F0R1_FB10_Msk   (0x1UL << CAN_F0R1_FB10_Pos)
 
#define CAN_F0R1_FB10   CAN_F0R1_FB10_Msk
 
#define CAN_F0R1_FB11_Pos   (11U)
 
#define CAN_F0R1_FB11_Msk   (0x1UL << CAN_F0R1_FB11_Pos)
 
#define CAN_F0R1_FB11   CAN_F0R1_FB11_Msk
 
#define CAN_F0R1_FB12_Pos   (12U)
 
#define CAN_F0R1_FB12_Msk   (0x1UL << CAN_F0R1_FB12_Pos)
 
#define CAN_F0R1_FB12   CAN_F0R1_FB12_Msk
 
#define CAN_F0R1_FB13_Pos   (13U)
 
#define CAN_F0R1_FB13_Msk   (0x1UL << CAN_F0R1_FB13_Pos)
 
#define CAN_F0R1_FB13   CAN_F0R1_FB13_Msk
 
#define CAN_F0R1_FB14_Pos   (14U)
 
#define CAN_F0R1_FB14_Msk   (0x1UL << CAN_F0R1_FB14_Pos)
 
#define CAN_F0R1_FB14   CAN_F0R1_FB14_Msk
 
#define CAN_F0R1_FB15_Pos   (15U)
 
#define CAN_F0R1_FB15_Msk   (0x1UL << CAN_F0R1_FB15_Pos)
 
#define CAN_F0R1_FB15   CAN_F0R1_FB15_Msk
 
#define CAN_F0R1_FB16_Pos   (16U)
 
#define CAN_F0R1_FB16_Msk   (0x1UL << CAN_F0R1_FB16_Pos)
 
#define CAN_F0R1_FB16   CAN_F0R1_FB16_Msk
 
#define CAN_F0R1_FB17_Pos   (17U)
 
#define CAN_F0R1_FB17_Msk   (0x1UL << CAN_F0R1_FB17_Pos)
 
#define CAN_F0R1_FB17   CAN_F0R1_FB17_Msk
 
#define CAN_F0R1_FB18_Pos   (18U)
 
#define CAN_F0R1_FB18_Msk   (0x1UL << CAN_F0R1_FB18_Pos)
 
#define CAN_F0R1_FB18   CAN_F0R1_FB18_Msk
 
#define CAN_F0R1_FB19_Pos   (19U)
 
#define CAN_F0R1_FB19_Msk   (0x1UL << CAN_F0R1_FB19_Pos)
 
#define CAN_F0R1_FB19   CAN_F0R1_FB19_Msk
 
#define CAN_F0R1_FB20_Pos   (20U)
 
#define CAN_F0R1_FB20_Msk   (0x1UL << CAN_F0R1_FB20_Pos)
 
#define CAN_F0R1_FB20   CAN_F0R1_FB20_Msk
 
#define CAN_F0R1_FB21_Pos   (21U)
 
#define CAN_F0R1_FB21_Msk   (0x1UL << CAN_F0R1_FB21_Pos)
 
#define CAN_F0R1_FB21   CAN_F0R1_FB21_Msk
 
#define CAN_F0R1_FB22_Pos   (22U)
 
#define CAN_F0R1_FB22_Msk   (0x1UL << CAN_F0R1_FB22_Pos)
 
#define CAN_F0R1_FB22   CAN_F0R1_FB22_Msk
 
#define CAN_F0R1_FB23_Pos   (23U)
 
#define CAN_F0R1_FB23_Msk   (0x1UL << CAN_F0R1_FB23_Pos)
 
#define CAN_F0R1_FB23   CAN_F0R1_FB23_Msk
 
#define CAN_F0R1_FB24_Pos   (24U)
 
#define CAN_F0R1_FB24_Msk   (0x1UL << CAN_F0R1_FB24_Pos)
 
#define CAN_F0R1_FB24   CAN_F0R1_FB24_Msk
 
#define CAN_F0R1_FB25_Pos   (25U)
 
#define CAN_F0R1_FB25_Msk   (0x1UL << CAN_F0R1_FB25_Pos)
 
#define CAN_F0R1_FB25   CAN_F0R1_FB25_Msk
 
#define CAN_F0R1_FB26_Pos   (26U)
 
#define CAN_F0R1_FB26_Msk   (0x1UL << CAN_F0R1_FB26_Pos)
 
#define CAN_F0R1_FB26   CAN_F0R1_FB26_Msk
 
#define CAN_F0R1_FB27_Pos   (27U)
 
#define CAN_F0R1_FB27_Msk   (0x1UL << CAN_F0R1_FB27_Pos)
 
#define CAN_F0R1_FB27   CAN_F0R1_FB27_Msk
 
#define CAN_F0R1_FB28_Pos   (28U)
 
#define CAN_F0R1_FB28_Msk   (0x1UL << CAN_F0R1_FB28_Pos)
 
#define CAN_F0R1_FB28   CAN_F0R1_FB28_Msk
 
#define CAN_F0R1_FB29_Pos   (29U)
 
#define CAN_F0R1_FB29_Msk   (0x1UL << CAN_F0R1_FB29_Pos)
 
#define CAN_F0R1_FB29   CAN_F0R1_FB29_Msk
 
#define CAN_F0R1_FB30_Pos   (30U)
 
#define CAN_F0R1_FB30_Msk   (0x1UL << CAN_F0R1_FB30_Pos)
 
#define CAN_F0R1_FB30   CAN_F0R1_FB30_Msk
 
#define CAN_F0R1_FB31_Pos   (31U)
 
#define CAN_F0R1_FB31_Msk   (0x1UL << CAN_F0R1_FB31_Pos)
 
#define CAN_F0R1_FB31   CAN_F0R1_FB31_Msk
 
#define CAN_F1R1_FB0_Pos   (0U)
 
#define CAN_F1R1_FB0_Msk   (0x1UL << CAN_F1R1_FB0_Pos)
 
#define CAN_F1R1_FB0   CAN_F1R1_FB0_Msk
 
#define CAN_F1R1_FB1_Pos   (1U)
 
#define CAN_F1R1_FB1_Msk   (0x1UL << CAN_F1R1_FB1_Pos)
 
#define CAN_F1R1_FB1   CAN_F1R1_FB1_Msk
 
#define CAN_F1R1_FB2_Pos   (2U)
 
#define CAN_F1R1_FB2_Msk   (0x1UL << CAN_F1R1_FB2_Pos)
 
#define CAN_F1R1_FB2   CAN_F1R1_FB2_Msk
 
#define CAN_F1R1_FB3_Pos   (3U)
 
#define CAN_F1R1_FB3_Msk   (0x1UL << CAN_F1R1_FB3_Pos)
 
#define CAN_F1R1_FB3   CAN_F1R1_FB3_Msk
 
#define CAN_F1R1_FB4_Pos   (4U)
 
#define CAN_F1R1_FB4_Msk   (0x1UL << CAN_F1R1_FB4_Pos)
 
#define CAN_F1R1_FB4   CAN_F1R1_FB4_Msk
 
#define CAN_F1R1_FB5_Pos   (5U)
 
#define CAN_F1R1_FB5_Msk   (0x1UL << CAN_F1R1_FB5_Pos)
 
#define CAN_F1R1_FB5   CAN_F1R1_FB5_Msk
 
#define CAN_F1R1_FB6_Pos   (6U)
 
#define CAN_F1R1_FB6_Msk   (0x1UL << CAN_F1R1_FB6_Pos)
 
#define CAN_F1R1_FB6   CAN_F1R1_FB6_Msk
 
#define CAN_F1R1_FB7_Pos   (7U)
 
#define CAN_F1R1_FB7_Msk   (0x1UL << CAN_F1R1_FB7_Pos)
 
#define CAN_F1R1_FB7   CAN_F1R1_FB7_Msk
 
#define CAN_F1R1_FB8_Pos   (8U)
 
#define CAN_F1R1_FB8_Msk   (0x1UL << CAN_F1R1_FB8_Pos)
 
#define CAN_F1R1_FB8   CAN_F1R1_FB8_Msk
 
#define CAN_F1R1_FB9_Pos   (9U)
 
#define CAN_F1R1_FB9_Msk   (0x1UL << CAN_F1R1_FB9_Pos)
 
#define CAN_F1R1_FB9   CAN_F1R1_FB9_Msk
 
#define CAN_F1R1_FB10_Pos   (10U)
 
#define CAN_F1R1_FB10_Msk   (0x1UL << CAN_F1R1_FB10_Pos)
 
#define CAN_F1R1_FB10   CAN_F1R1_FB10_Msk
 
#define CAN_F1R1_FB11_Pos   (11U)
 
#define CAN_F1R1_FB11_Msk   (0x1UL << CAN_F1R1_FB11_Pos)
 
#define CAN_F1R1_FB11   CAN_F1R1_FB11_Msk
 
#define CAN_F1R1_FB12_Pos   (12U)
 
#define CAN_F1R1_FB12_Msk   (0x1UL << CAN_F1R1_FB12_Pos)
 
#define CAN_F1R1_FB12   CAN_F1R1_FB12_Msk
 
#define CAN_F1R1_FB13_Pos   (13U)
 
#define CAN_F1R1_FB13_Msk   (0x1UL << CAN_F1R1_FB13_Pos)
 
#define CAN_F1R1_FB13   CAN_F1R1_FB13_Msk
 
#define CAN_F1R1_FB14_Pos   (14U)
 
#define CAN_F1R1_FB14_Msk   (0x1UL << CAN_F1R1_FB14_Pos)
 
#define CAN_F1R1_FB14   CAN_F1R1_FB14_Msk
 
#define CAN_F1R1_FB15_Pos   (15U)
 
#define CAN_F1R1_FB15_Msk   (0x1UL << CAN_F1R1_FB15_Pos)
 
#define CAN_F1R1_FB15   CAN_F1R1_FB15_Msk
 
#define CAN_F1R1_FB16_Pos   (16U)
 
#define CAN_F1R1_FB16_Msk   (0x1UL << CAN_F1R1_FB16_Pos)
 
#define CAN_F1R1_FB16   CAN_F1R1_FB16_Msk
 
#define CAN_F1R1_FB17_Pos   (17U)
 
#define CAN_F1R1_FB17_Msk   (0x1UL << CAN_F1R1_FB17_Pos)
 
#define CAN_F1R1_FB17   CAN_F1R1_FB17_Msk
 
#define CAN_F1R1_FB18_Pos   (18U)
 
#define CAN_F1R1_FB18_Msk   (0x1UL << CAN_F1R1_FB18_Pos)
 
#define CAN_F1R1_FB18   CAN_F1R1_FB18_Msk
 
#define CAN_F1R1_FB19_Pos   (19U)
 
#define CAN_F1R1_FB19_Msk   (0x1UL << CAN_F1R1_FB19_Pos)
 
#define CAN_F1R1_FB19   CAN_F1R1_FB19_Msk
 
#define CAN_F1R1_FB20_Pos   (20U)
 
#define CAN_F1R1_FB20_Msk   (0x1UL << CAN_F1R1_FB20_Pos)
 
#define CAN_F1R1_FB20   CAN_F1R1_FB20_Msk
 
#define CAN_F1R1_FB21_Pos   (21U)
 
#define CAN_F1R1_FB21_Msk   (0x1UL << CAN_F1R1_FB21_Pos)
 
#define CAN_F1R1_FB21   CAN_F1R1_FB21_Msk
 
#define CAN_F1R1_FB22_Pos   (22U)
 
#define CAN_F1R1_FB22_Msk   (0x1UL << CAN_F1R1_FB22_Pos)
 
#define CAN_F1R1_FB22   CAN_F1R1_FB22_Msk
 
#define CAN_F1R1_FB23_Pos   (23U)
 
#define CAN_F1R1_FB23_Msk   (0x1UL << CAN_F1R1_FB23_Pos)
 
#define CAN_F1R1_FB23   CAN_F1R1_FB23_Msk
 
#define CAN_F1R1_FB24_Pos   (24U)
 
#define CAN_F1R1_FB24_Msk   (0x1UL << CAN_F1R1_FB24_Pos)
 
#define CAN_F1R1_FB24   CAN_F1R1_FB24_Msk
 
#define CAN_F1R1_FB25_Pos   (25U)
 
#define CAN_F1R1_FB25_Msk   (0x1UL << CAN_F1R1_FB25_Pos)
 
#define CAN_F1R1_FB25   CAN_F1R1_FB25_Msk
 
#define CAN_F1R1_FB26_Pos   (26U)
 
#define CAN_F1R1_FB26_Msk   (0x1UL << CAN_F1R1_FB26_Pos)
 
#define CAN_F1R1_FB26   CAN_F1R1_FB26_Msk
 
#define CAN_F1R1_FB27_Pos   (27U)
 
#define CAN_F1R1_FB27_Msk   (0x1UL << CAN_F1R1_FB27_Pos)
 
#define CAN_F1R1_FB27   CAN_F1R1_FB27_Msk
 
#define CAN_F1R1_FB28_Pos   (28U)
 
#define CAN_F1R1_FB28_Msk   (0x1UL << CAN_F1R1_FB28_Pos)
 
#define CAN_F1R1_FB28   CAN_F1R1_FB28_Msk
 
#define CAN_F1R1_FB29_Pos   (29U)
 
#define CAN_F1R1_FB29_Msk   (0x1UL << CAN_F1R1_FB29_Pos)
 
#define CAN_F1R1_FB29   CAN_F1R1_FB29_Msk
 
#define CAN_F1R1_FB30_Pos   (30U)
 
#define CAN_F1R1_FB30_Msk   (0x1UL << CAN_F1R1_FB30_Pos)
 
#define CAN_F1R1_FB30   CAN_F1R1_FB30_Msk
 
#define CAN_F1R1_FB31_Pos   (31U)
 
#define CAN_F1R1_FB31_Msk   (0x1UL << CAN_F1R1_FB31_Pos)
 
#define CAN_F1R1_FB31   CAN_F1R1_FB31_Msk
 
#define CAN_F2R1_FB0_Pos   (0U)
 
#define CAN_F2R1_FB0_Msk   (0x1UL << CAN_F2R1_FB0_Pos)
 
#define CAN_F2R1_FB0   CAN_F2R1_FB0_Msk
 
#define CAN_F2R1_FB1_Pos   (1U)
 
#define CAN_F2R1_FB1_Msk   (0x1UL << CAN_F2R1_FB1_Pos)
 
#define CAN_F2R1_FB1   CAN_F2R1_FB1_Msk
 
#define CAN_F2R1_FB2_Pos   (2U)
 
#define CAN_F2R1_FB2_Msk   (0x1UL << CAN_F2R1_FB2_Pos)
 
#define CAN_F2R1_FB2   CAN_F2R1_FB2_Msk
 
#define CAN_F2R1_FB3_Pos   (3U)
 
#define CAN_F2R1_FB3_Msk   (0x1UL << CAN_F2R1_FB3_Pos)
 
#define CAN_F2R1_FB3   CAN_F2R1_FB3_Msk
 
#define CAN_F2R1_FB4_Pos   (4U)
 
#define CAN_F2R1_FB4_Msk   (0x1UL << CAN_F2R1_FB4_Pos)
 
#define CAN_F2R1_FB4   CAN_F2R1_FB4_Msk
 
#define CAN_F2R1_FB5_Pos   (5U)
 
#define CAN_F2R1_FB5_Msk   (0x1UL << CAN_F2R1_FB5_Pos)
 
#define CAN_F2R1_FB5   CAN_F2R1_FB5_Msk
 
#define CAN_F2R1_FB6_Pos   (6U)
 
#define CAN_F2R1_FB6_Msk   (0x1UL << CAN_F2R1_FB6_Pos)
 
#define CAN_F2R1_FB6   CAN_F2R1_FB6_Msk
 
#define CAN_F2R1_FB7_Pos   (7U)
 
#define CAN_F2R1_FB7_Msk   (0x1UL << CAN_F2R1_FB7_Pos)
 
#define CAN_F2R1_FB7   CAN_F2R1_FB7_Msk
 
#define CAN_F2R1_FB8_Pos   (8U)
 
#define CAN_F2R1_FB8_Msk   (0x1UL << CAN_F2R1_FB8_Pos)
 
#define CAN_F2R1_FB8   CAN_F2R1_FB8_Msk
 
#define CAN_F2R1_FB9_Pos   (9U)
 
#define CAN_F2R1_FB9_Msk   (0x1UL << CAN_F2R1_FB9_Pos)
 
#define CAN_F2R1_FB9   CAN_F2R1_FB9_Msk
 
#define CAN_F2R1_FB10_Pos   (10U)
 
#define CAN_F2R1_FB10_Msk   (0x1UL << CAN_F2R1_FB10_Pos)
 
#define CAN_F2R1_FB10   CAN_F2R1_FB10_Msk
 
#define CAN_F2R1_FB11_Pos   (11U)
 
#define CAN_F2R1_FB11_Msk   (0x1UL << CAN_F2R1_FB11_Pos)
 
#define CAN_F2R1_FB11   CAN_F2R1_FB11_Msk
 
#define CAN_F2R1_FB12_Pos   (12U)
 
#define CAN_F2R1_FB12_Msk   (0x1UL << CAN_F2R1_FB12_Pos)
 
#define CAN_F2R1_FB12   CAN_F2R1_FB12_Msk
 
#define CAN_F2R1_FB13_Pos   (13U)
 
#define CAN_F2R1_FB13_Msk   (0x1UL << CAN_F2R1_FB13_Pos)
 
#define CAN_F2R1_FB13   CAN_F2R1_FB13_Msk
 
#define CAN_F2R1_FB14_Pos   (14U)
 
#define CAN_F2R1_FB14_Msk   (0x1UL << CAN_F2R1_FB14_Pos)
 
#define CAN_F2R1_FB14   CAN_F2R1_FB14_Msk
 
#define CAN_F2R1_FB15_Pos   (15U)
 
#define CAN_F2R1_FB15_Msk   (0x1UL << CAN_F2R1_FB15_Pos)
 
#define CAN_F2R1_FB15   CAN_F2R1_FB15_Msk
 
#define CAN_F2R1_FB16_Pos   (16U)
 
#define CAN_F2R1_FB16_Msk   (0x1UL << CAN_F2R1_FB16_Pos)
 
#define CAN_F2R1_FB16   CAN_F2R1_FB16_Msk
 
#define CAN_F2R1_FB17_Pos   (17U)
 
#define CAN_F2R1_FB17_Msk   (0x1UL << CAN_F2R1_FB17_Pos)
 
#define CAN_F2R1_FB17   CAN_F2R1_FB17_Msk
 
#define CAN_F2R1_FB18_Pos   (18U)
 
#define CAN_F2R1_FB18_Msk   (0x1UL << CAN_F2R1_FB18_Pos)
 
#define CAN_F2R1_FB18   CAN_F2R1_FB18_Msk
 
#define CAN_F2R1_FB19_Pos   (19U)
 
#define CAN_F2R1_FB19_Msk   (0x1UL << CAN_F2R1_FB19_Pos)
 
#define CAN_F2R1_FB19   CAN_F2R1_FB19_Msk
 
#define CAN_F2R1_FB20_Pos   (20U)
 
#define CAN_F2R1_FB20_Msk   (0x1UL << CAN_F2R1_FB20_Pos)
 
#define CAN_F2R1_FB20   CAN_F2R1_FB20_Msk
 
#define CAN_F2R1_FB21_Pos   (21U)
 
#define CAN_F2R1_FB21_Msk   (0x1UL << CAN_F2R1_FB21_Pos)
 
#define CAN_F2R1_FB21   CAN_F2R1_FB21_Msk
 
#define CAN_F2R1_FB22_Pos   (22U)
 
#define CAN_F2R1_FB22_Msk   (0x1UL << CAN_F2R1_FB22_Pos)
 
#define CAN_F2R1_FB22   CAN_F2R1_FB22_Msk
 
#define CAN_F2R1_FB23_Pos   (23U)
 
#define CAN_F2R1_FB23_Msk   (0x1UL << CAN_F2R1_FB23_Pos)
 
#define CAN_F2R1_FB23   CAN_F2R1_FB23_Msk
 
#define CAN_F2R1_FB24_Pos   (24U)
 
#define CAN_F2R1_FB24_Msk   (0x1UL << CAN_F2R1_FB24_Pos)
 
#define CAN_F2R1_FB24   CAN_F2R1_FB24_Msk
 
#define CAN_F2R1_FB25_Pos   (25U)
 
#define CAN_F2R1_FB25_Msk   (0x1UL << CAN_F2R1_FB25_Pos)
 
#define CAN_F2R1_FB25   CAN_F2R1_FB25_Msk
 
#define CAN_F2R1_FB26_Pos   (26U)
 
#define CAN_F2R1_FB26_Msk   (0x1UL << CAN_F2R1_FB26_Pos)
 
#define CAN_F2R1_FB26   CAN_F2R1_FB26_Msk
 
#define CAN_F2R1_FB27_Pos   (27U)
 
#define CAN_F2R1_FB27_Msk   (0x1UL << CAN_F2R1_FB27_Pos)
 
#define CAN_F2R1_FB27   CAN_F2R1_FB27_Msk
 
#define CAN_F2R1_FB28_Pos   (28U)
 
#define CAN_F2R1_FB28_Msk   (0x1UL << CAN_F2R1_FB28_Pos)
 
#define CAN_F2R1_FB28   CAN_F2R1_FB28_Msk
 
#define CAN_F2R1_FB29_Pos   (29U)
 
#define CAN_F2R1_FB29_Msk   (0x1UL << CAN_F2R1_FB29_Pos)
 
#define CAN_F2R1_FB29   CAN_F2R1_FB29_Msk
 
#define CAN_F2R1_FB30_Pos   (30U)
 
#define CAN_F2R1_FB30_Msk   (0x1UL << CAN_F2R1_FB30_Pos)
 
#define CAN_F2R1_FB30   CAN_F2R1_FB30_Msk
 
#define CAN_F2R1_FB31_Pos   (31U)
 
#define CAN_F2R1_FB31_Msk   (0x1UL << CAN_F2R1_FB31_Pos)
 
#define CAN_F2R1_FB31   CAN_F2R1_FB31_Msk
 
#define CAN_F3R1_FB0_Pos   (0U)
 
#define CAN_F3R1_FB0_Msk   (0x1UL << CAN_F3R1_FB0_Pos)
 
#define CAN_F3R1_FB0   CAN_F3R1_FB0_Msk
 
#define CAN_F3R1_FB1_Pos   (1U)
 
#define CAN_F3R1_FB1_Msk   (0x1UL << CAN_F3R1_FB1_Pos)
 
#define CAN_F3R1_FB1   CAN_F3R1_FB1_Msk
 
#define CAN_F3R1_FB2_Pos   (2U)
 
#define CAN_F3R1_FB2_Msk   (0x1UL << CAN_F3R1_FB2_Pos)
 
#define CAN_F3R1_FB2   CAN_F3R1_FB2_Msk
 
#define CAN_F3R1_FB3_Pos   (3U)
 
#define CAN_F3R1_FB3_Msk   (0x1UL << CAN_F3R1_FB3_Pos)
 
#define CAN_F3R1_FB3   CAN_F3R1_FB3_Msk
 
#define CAN_F3R1_FB4_Pos   (4U)
 
#define CAN_F3R1_FB4_Msk   (0x1UL << CAN_F3R1_FB4_Pos)
 
#define CAN_F3R1_FB4   CAN_F3R1_FB4_Msk
 
#define CAN_F3R1_FB5_Pos   (5U)
 
#define CAN_F3R1_FB5_Msk   (0x1UL << CAN_F3R1_FB5_Pos)
 
#define CAN_F3R1_FB5   CAN_F3R1_FB5_Msk
 
#define CAN_F3R1_FB6_Pos   (6U)
 
#define CAN_F3R1_FB6_Msk   (0x1UL << CAN_F3R1_FB6_Pos)
 
#define CAN_F3R1_FB6   CAN_F3R1_FB6_Msk
 
#define CAN_F3R1_FB7_Pos   (7U)
 
#define CAN_F3R1_FB7_Msk   (0x1UL << CAN_F3R1_FB7_Pos)
 
#define CAN_F3R1_FB7   CAN_F3R1_FB7_Msk
 
#define CAN_F3R1_FB8_Pos   (8U)
 
#define CAN_F3R1_FB8_Msk   (0x1UL << CAN_F3R1_FB8_Pos)
 
#define CAN_F3R1_FB8   CAN_F3R1_FB8_Msk
 
#define CAN_F3R1_FB9_Pos   (9U)
 
#define CAN_F3R1_FB9_Msk   (0x1UL << CAN_F3R1_FB9_Pos)
 
#define CAN_F3R1_FB9   CAN_F3R1_FB9_Msk
 
#define CAN_F3R1_FB10_Pos   (10U)
 
#define CAN_F3R1_FB10_Msk   (0x1UL << CAN_F3R1_FB10_Pos)
 
#define CAN_F3R1_FB10   CAN_F3R1_FB10_Msk
 
#define CAN_F3R1_FB11_Pos   (11U)
 
#define CAN_F3R1_FB11_Msk   (0x1UL << CAN_F3R1_FB11_Pos)
 
#define CAN_F3R1_FB11   CAN_F3R1_FB11_Msk
 
#define CAN_F3R1_FB12_Pos   (12U)
 
#define CAN_F3R1_FB12_Msk   (0x1UL << CAN_F3R1_FB12_Pos)
 
#define CAN_F3R1_FB12   CAN_F3R1_FB12_Msk
 
#define CAN_F3R1_FB13_Pos   (13U)
 
#define CAN_F3R1_FB13_Msk   (0x1UL << CAN_F3R1_FB13_Pos)
 
#define CAN_F3R1_FB13   CAN_F3R1_FB13_Msk
 
#define CAN_F3R1_FB14_Pos   (14U)
 
#define CAN_F3R1_FB14_Msk   (0x1UL << CAN_F3R1_FB14_Pos)
 
#define CAN_F3R1_FB14   CAN_F3R1_FB14_Msk
 
#define CAN_F3R1_FB15_Pos   (15U)
 
#define CAN_F3R1_FB15_Msk   (0x1UL << CAN_F3R1_FB15_Pos)
 
#define CAN_F3R1_FB15   CAN_F3R1_FB15_Msk
 
#define CAN_F3R1_FB16_Pos   (16U)
 
#define CAN_F3R1_FB16_Msk   (0x1UL << CAN_F3R1_FB16_Pos)
 
#define CAN_F3R1_FB16   CAN_F3R1_FB16_Msk
 
#define CAN_F3R1_FB17_Pos   (17U)
 
#define CAN_F3R1_FB17_Msk   (0x1UL << CAN_F3R1_FB17_Pos)
 
#define CAN_F3R1_FB17   CAN_F3R1_FB17_Msk
 
#define CAN_F3R1_FB18_Pos   (18U)
 
#define CAN_F3R1_FB18_Msk   (0x1UL << CAN_F3R1_FB18_Pos)
 
#define CAN_F3R1_FB18   CAN_F3R1_FB18_Msk
 
#define CAN_F3R1_FB19_Pos   (19U)
 
#define CAN_F3R1_FB19_Msk   (0x1UL << CAN_F3R1_FB19_Pos)
 
#define CAN_F3R1_FB19   CAN_F3R1_FB19_Msk
 
#define CAN_F3R1_FB20_Pos   (20U)
 
#define CAN_F3R1_FB20_Msk   (0x1UL << CAN_F3R1_FB20_Pos)
 
#define CAN_F3R1_FB20   CAN_F3R1_FB20_Msk
 
#define CAN_F3R1_FB21_Pos   (21U)
 
#define CAN_F3R1_FB21_Msk   (0x1UL << CAN_F3R1_FB21_Pos)
 
#define CAN_F3R1_FB21   CAN_F3R1_FB21_Msk
 
#define CAN_F3R1_FB22_Pos   (22U)
 
#define CAN_F3R1_FB22_Msk   (0x1UL << CAN_F3R1_FB22_Pos)
 
#define CAN_F3R1_FB22   CAN_F3R1_FB22_Msk
 
#define CAN_F3R1_FB23_Pos   (23U)
 
#define CAN_F3R1_FB23_Msk   (0x1UL << CAN_F3R1_FB23_Pos)
 
#define CAN_F3R1_FB23   CAN_F3R1_FB23_Msk
 
#define CAN_F3R1_FB24_Pos   (24U)
 
#define CAN_F3R1_FB24_Msk   (0x1UL << CAN_F3R1_FB24_Pos)
 
#define CAN_F3R1_FB24   CAN_F3R1_FB24_Msk
 
#define CAN_F3R1_FB25_Pos   (25U)
 
#define CAN_F3R1_FB25_Msk   (0x1UL << CAN_F3R1_FB25_Pos)
 
#define CAN_F3R1_FB25   CAN_F3R1_FB25_Msk
 
#define CAN_F3R1_FB26_Pos   (26U)
 
#define CAN_F3R1_FB26_Msk   (0x1UL << CAN_F3R1_FB26_Pos)
 
#define CAN_F3R1_FB26   CAN_F3R1_FB26_Msk
 
#define CAN_F3R1_FB27_Pos   (27U)
 
#define CAN_F3R1_FB27_Msk   (0x1UL << CAN_F3R1_FB27_Pos)
 
#define CAN_F3R1_FB27   CAN_F3R1_FB27_Msk
 
#define CAN_F3R1_FB28_Pos   (28U)
 
#define CAN_F3R1_FB28_Msk   (0x1UL << CAN_F3R1_FB28_Pos)
 
#define CAN_F3R1_FB28   CAN_F3R1_FB28_Msk
 
#define CAN_F3R1_FB29_Pos   (29U)
 
#define CAN_F3R1_FB29_Msk   (0x1UL << CAN_F3R1_FB29_Pos)
 
#define CAN_F3R1_FB29   CAN_F3R1_FB29_Msk
 
#define CAN_F3R1_FB30_Pos   (30U)
 
#define CAN_F3R1_FB30_Msk   (0x1UL << CAN_F3R1_FB30_Pos)
 
#define CAN_F3R1_FB30   CAN_F3R1_FB30_Msk
 
#define CAN_F3R1_FB31_Pos   (31U)
 
#define CAN_F3R1_FB31_Msk   (0x1UL << CAN_F3R1_FB31_Pos)
 
#define CAN_F3R1_FB31   CAN_F3R1_FB31_Msk
 
#define CAN_F4R1_FB0_Pos   (0U)
 
#define CAN_F4R1_FB0_Msk   (0x1UL << CAN_F4R1_FB0_Pos)
 
#define CAN_F4R1_FB0   CAN_F4R1_FB0_Msk
 
#define CAN_F4R1_FB1_Pos   (1U)
 
#define CAN_F4R1_FB1_Msk   (0x1UL << CAN_F4R1_FB1_Pos)
 
#define CAN_F4R1_FB1   CAN_F4R1_FB1_Msk
 
#define CAN_F4R1_FB2_Pos   (2U)
 
#define CAN_F4R1_FB2_Msk   (0x1UL << CAN_F4R1_FB2_Pos)
 
#define CAN_F4R1_FB2   CAN_F4R1_FB2_Msk
 
#define CAN_F4R1_FB3_Pos   (3U)
 
#define CAN_F4R1_FB3_Msk   (0x1UL << CAN_F4R1_FB3_Pos)
 
#define CAN_F4R1_FB3   CAN_F4R1_FB3_Msk
 
#define CAN_F4R1_FB4_Pos   (4U)
 
#define CAN_F4R1_FB4_Msk   (0x1UL << CAN_F4R1_FB4_Pos)
 
#define CAN_F4R1_FB4   CAN_F4R1_FB4_Msk
 
#define CAN_F4R1_FB5_Pos   (5U)
 
#define CAN_F4R1_FB5_Msk   (0x1UL << CAN_F4R1_FB5_Pos)
 
#define CAN_F4R1_FB5   CAN_F4R1_FB5_Msk
 
#define CAN_F4R1_FB6_Pos   (6U)
 
#define CAN_F4R1_FB6_Msk   (0x1UL << CAN_F4R1_FB6_Pos)
 
#define CAN_F4R1_FB6   CAN_F4R1_FB6_Msk
 
#define CAN_F4R1_FB7_Pos   (7U)
 
#define CAN_F4R1_FB7_Msk   (0x1UL << CAN_F4R1_FB7_Pos)
 
#define CAN_F4R1_FB7   CAN_F4R1_FB7_Msk
 
#define CAN_F4R1_FB8_Pos   (8U)
 
#define CAN_F4R1_FB8_Msk   (0x1UL << CAN_F4R1_FB8_Pos)
 
#define CAN_F4R1_FB8   CAN_F4R1_FB8_Msk
 
#define CAN_F4R1_FB9_Pos   (9U)
 
#define CAN_F4R1_FB9_Msk   (0x1UL << CAN_F4R1_FB9_Pos)
 
#define CAN_F4R1_FB9   CAN_F4R1_FB9_Msk
 
#define CAN_F4R1_FB10_Pos   (10U)
 
#define CAN_F4R1_FB10_Msk   (0x1UL << CAN_F4R1_FB10_Pos)
 
#define CAN_F4R1_FB10   CAN_F4R1_FB10_Msk
 
#define CAN_F4R1_FB11_Pos   (11U)
 
#define CAN_F4R1_FB11_Msk   (0x1UL << CAN_F4R1_FB11_Pos)
 
#define CAN_F4R1_FB11   CAN_F4R1_FB11_Msk
 
#define CAN_F4R1_FB12_Pos   (12U)
 
#define CAN_F4R1_FB12_Msk   (0x1UL << CAN_F4R1_FB12_Pos)
 
#define CAN_F4R1_FB12   CAN_F4R1_FB12_Msk
 
#define CAN_F4R1_FB13_Pos   (13U)
 
#define CAN_F4R1_FB13_Msk   (0x1UL << CAN_F4R1_FB13_Pos)
 
#define CAN_F4R1_FB13   CAN_F4R1_FB13_Msk
 
#define CAN_F4R1_FB14_Pos   (14U)
 
#define CAN_F4R1_FB14_Msk   (0x1UL << CAN_F4R1_FB14_Pos)
 
#define CAN_F4R1_FB14   CAN_F4R1_FB14_Msk
 
#define CAN_F4R1_FB15_Pos   (15U)
 
#define CAN_F4R1_FB15_Msk   (0x1UL << CAN_F4R1_FB15_Pos)
 
#define CAN_F4R1_FB15   CAN_F4R1_FB15_Msk
 
#define CAN_F4R1_FB16_Pos   (16U)
 
#define CAN_F4R1_FB16_Msk   (0x1UL << CAN_F4R1_FB16_Pos)
 
#define CAN_F4R1_FB16   CAN_F4R1_FB16_Msk
 
#define CAN_F4R1_FB17_Pos   (17U)
 
#define CAN_F4R1_FB17_Msk   (0x1UL << CAN_F4R1_FB17_Pos)
 
#define CAN_F4R1_FB17   CAN_F4R1_FB17_Msk
 
#define CAN_F4R1_FB18_Pos   (18U)
 
#define CAN_F4R1_FB18_Msk   (0x1UL << CAN_F4R1_FB18_Pos)
 
#define CAN_F4R1_FB18   CAN_F4R1_FB18_Msk
 
#define CAN_F4R1_FB19_Pos   (19U)
 
#define CAN_F4R1_FB19_Msk   (0x1UL << CAN_F4R1_FB19_Pos)
 
#define CAN_F4R1_FB19   CAN_F4R1_FB19_Msk
 
#define CAN_F4R1_FB20_Pos   (20U)
 
#define CAN_F4R1_FB20_Msk   (0x1UL << CAN_F4R1_FB20_Pos)
 
#define CAN_F4R1_FB20   CAN_F4R1_FB20_Msk
 
#define CAN_F4R1_FB21_Pos   (21U)
 
#define CAN_F4R1_FB21_Msk   (0x1UL << CAN_F4R1_FB21_Pos)
 
#define CAN_F4R1_FB21   CAN_F4R1_FB21_Msk
 
#define CAN_F4R1_FB22_Pos   (22U)
 
#define CAN_F4R1_FB22_Msk   (0x1UL << CAN_F4R1_FB22_Pos)
 
#define CAN_F4R1_FB22   CAN_F4R1_FB22_Msk
 
#define CAN_F4R1_FB23_Pos   (23U)
 
#define CAN_F4R1_FB23_Msk   (0x1UL << CAN_F4R1_FB23_Pos)
 
#define CAN_F4R1_FB23   CAN_F4R1_FB23_Msk
 
#define CAN_F4R1_FB24_Pos   (24U)
 
#define CAN_F4R1_FB24_Msk   (0x1UL << CAN_F4R1_FB24_Pos)
 
#define CAN_F4R1_FB24   CAN_F4R1_FB24_Msk
 
#define CAN_F4R1_FB25_Pos   (25U)
 
#define CAN_F4R1_FB25_Msk   (0x1UL << CAN_F4R1_FB25_Pos)
 
#define CAN_F4R1_FB25   CAN_F4R1_FB25_Msk
 
#define CAN_F4R1_FB26_Pos   (26U)
 
#define CAN_F4R1_FB26_Msk   (0x1UL << CAN_F4R1_FB26_Pos)
 
#define CAN_F4R1_FB26   CAN_F4R1_FB26_Msk
 
#define CAN_F4R1_FB27_Pos   (27U)
 
#define CAN_F4R1_FB27_Msk   (0x1UL << CAN_F4R1_FB27_Pos)
 
#define CAN_F4R1_FB27   CAN_F4R1_FB27_Msk
 
#define CAN_F4R1_FB28_Pos   (28U)
 
#define CAN_F4R1_FB28_Msk   (0x1UL << CAN_F4R1_FB28_Pos)
 
#define CAN_F4R1_FB28   CAN_F4R1_FB28_Msk
 
#define CAN_F4R1_FB29_Pos   (29U)
 
#define CAN_F4R1_FB29_Msk   (0x1UL << CAN_F4R1_FB29_Pos)
 
#define CAN_F4R1_FB29   CAN_F4R1_FB29_Msk
 
#define CAN_F4R1_FB30_Pos   (30U)
 
#define CAN_F4R1_FB30_Msk   (0x1UL << CAN_F4R1_FB30_Pos)
 
#define CAN_F4R1_FB30   CAN_F4R1_FB30_Msk
 
#define CAN_F4R1_FB31_Pos   (31U)
 
#define CAN_F4R1_FB31_Msk   (0x1UL << CAN_F4R1_FB31_Pos)
 
#define CAN_F4R1_FB31   CAN_F4R1_FB31_Msk
 
#define CAN_F5R1_FB0_Pos   (0U)
 
#define CAN_F5R1_FB0_Msk   (0x1UL << CAN_F5R1_FB0_Pos)
 
#define CAN_F5R1_FB0   CAN_F5R1_FB0_Msk
 
#define CAN_F5R1_FB1_Pos   (1U)
 
#define CAN_F5R1_FB1_Msk   (0x1UL << CAN_F5R1_FB1_Pos)
 
#define CAN_F5R1_FB1   CAN_F5R1_FB1_Msk
 
#define CAN_F5R1_FB2_Pos   (2U)
 
#define CAN_F5R1_FB2_Msk   (0x1UL << CAN_F5R1_FB2_Pos)
 
#define CAN_F5R1_FB2   CAN_F5R1_FB2_Msk
 
#define CAN_F5R1_FB3_Pos   (3U)
 
#define CAN_F5R1_FB3_Msk   (0x1UL << CAN_F5R1_FB3_Pos)
 
#define CAN_F5R1_FB3   CAN_F5R1_FB3_Msk
 
#define CAN_F5R1_FB4_Pos   (4U)
 
#define CAN_F5R1_FB4_Msk   (0x1UL << CAN_F5R1_FB4_Pos)
 
#define CAN_F5R1_FB4   CAN_F5R1_FB4_Msk
 
#define CAN_F5R1_FB5_Pos   (5U)
 
#define CAN_F5R1_FB5_Msk   (0x1UL << CAN_F5R1_FB5_Pos)
 
#define CAN_F5R1_FB5   CAN_F5R1_FB5_Msk
 
#define CAN_F5R1_FB6_Pos   (6U)
 
#define CAN_F5R1_FB6_Msk   (0x1UL << CAN_F5R1_FB6_Pos)
 
#define CAN_F5R1_FB6   CAN_F5R1_FB6_Msk
 
#define CAN_F5R1_FB7_Pos   (7U)
 
#define CAN_F5R1_FB7_Msk   (0x1UL << CAN_F5R1_FB7_Pos)
 
#define CAN_F5R1_FB7   CAN_F5R1_FB7_Msk
 
#define CAN_F5R1_FB8_Pos   (8U)
 
#define CAN_F5R1_FB8_Msk   (0x1UL << CAN_F5R1_FB8_Pos)
 
#define CAN_F5R1_FB8   CAN_F5R1_FB8_Msk
 
#define CAN_F5R1_FB9_Pos   (9U)
 
#define CAN_F5R1_FB9_Msk   (0x1UL << CAN_F5R1_FB9_Pos)
 
#define CAN_F5R1_FB9   CAN_F5R1_FB9_Msk
 
#define CAN_F5R1_FB10_Pos   (10U)
 
#define CAN_F5R1_FB10_Msk   (0x1UL << CAN_F5R1_FB10_Pos)
 
#define CAN_F5R1_FB10   CAN_F5R1_FB10_Msk
 
#define CAN_F5R1_FB11_Pos   (11U)
 
#define CAN_F5R1_FB11_Msk   (0x1UL << CAN_F5R1_FB11_Pos)
 
#define CAN_F5R1_FB11   CAN_F5R1_FB11_Msk
 
#define CAN_F5R1_FB12_Pos   (12U)
 
#define CAN_F5R1_FB12_Msk   (0x1UL << CAN_F5R1_FB12_Pos)
 
#define CAN_F5R1_FB12   CAN_F5R1_FB12_Msk
 
#define CAN_F5R1_FB13_Pos   (13U)
 
#define CAN_F5R1_FB13_Msk   (0x1UL << CAN_F5R1_FB13_Pos)
 
#define CAN_F5R1_FB13   CAN_F5R1_FB13_Msk
 
#define CAN_F5R1_FB14_Pos   (14U)
 
#define CAN_F5R1_FB14_Msk   (0x1UL << CAN_F5R1_FB14_Pos)
 
#define CAN_F5R1_FB14   CAN_F5R1_FB14_Msk
 
#define CAN_F5R1_FB15_Pos   (15U)
 
#define CAN_F5R1_FB15_Msk   (0x1UL << CAN_F5R1_FB15_Pos)
 
#define CAN_F5R1_FB15   CAN_F5R1_FB15_Msk
 
#define CAN_F5R1_FB16_Pos   (16U)
 
#define CAN_F5R1_FB16_Msk   (0x1UL << CAN_F5R1_FB16_Pos)
 
#define CAN_F5R1_FB16   CAN_F5R1_FB16_Msk
 
#define CAN_F5R1_FB17_Pos   (17U)
 
#define CAN_F5R1_FB17_Msk   (0x1UL << CAN_F5R1_FB17_Pos)
 
#define CAN_F5R1_FB17   CAN_F5R1_FB17_Msk
 
#define CAN_F5R1_FB18_Pos   (18U)
 
#define CAN_F5R1_FB18_Msk   (0x1UL << CAN_F5R1_FB18_Pos)
 
#define CAN_F5R1_FB18   CAN_F5R1_FB18_Msk
 
#define CAN_F5R1_FB19_Pos   (19U)
 
#define CAN_F5R1_FB19_Msk   (0x1UL << CAN_F5R1_FB19_Pos)
 
#define CAN_F5R1_FB19   CAN_F5R1_FB19_Msk
 
#define CAN_F5R1_FB20_Pos   (20U)
 
#define CAN_F5R1_FB20_Msk   (0x1UL << CAN_F5R1_FB20_Pos)
 
#define CAN_F5R1_FB20   CAN_F5R1_FB20_Msk
 
#define CAN_F5R1_FB21_Pos   (21U)
 
#define CAN_F5R1_FB21_Msk   (0x1UL << CAN_F5R1_FB21_Pos)
 
#define CAN_F5R1_FB21   CAN_F5R1_FB21_Msk
 
#define CAN_F5R1_FB22_Pos   (22U)
 
#define CAN_F5R1_FB22_Msk   (0x1UL << CAN_F5R1_FB22_Pos)
 
#define CAN_F5R1_FB22   CAN_F5R1_FB22_Msk
 
#define CAN_F5R1_FB23_Pos   (23U)
 
#define CAN_F5R1_FB23_Msk   (0x1UL << CAN_F5R1_FB23_Pos)
 
#define CAN_F5R1_FB23   CAN_F5R1_FB23_Msk
 
#define CAN_F5R1_FB24_Pos   (24U)
 
#define CAN_F5R1_FB24_Msk   (0x1UL << CAN_F5R1_FB24_Pos)
 
#define CAN_F5R1_FB24   CAN_F5R1_FB24_Msk
 
#define CAN_F5R1_FB25_Pos   (25U)
 
#define CAN_F5R1_FB25_Msk   (0x1UL << CAN_F5R1_FB25_Pos)
 
#define CAN_F5R1_FB25   CAN_F5R1_FB25_Msk
 
#define CAN_F5R1_FB26_Pos   (26U)
 
#define CAN_F5R1_FB26_Msk   (0x1UL << CAN_F5R1_FB26_Pos)
 
#define CAN_F5R1_FB26   CAN_F5R1_FB26_Msk
 
#define CAN_F5R1_FB27_Pos   (27U)
 
#define CAN_F5R1_FB27_Msk   (0x1UL << CAN_F5R1_FB27_Pos)
 
#define CAN_F5R1_FB27   CAN_F5R1_FB27_Msk
 
#define CAN_F5R1_FB28_Pos   (28U)
 
#define CAN_F5R1_FB28_Msk   (0x1UL << CAN_F5R1_FB28_Pos)
 
#define CAN_F5R1_FB28   CAN_F5R1_FB28_Msk
 
#define CAN_F5R1_FB29_Pos   (29U)
 
#define CAN_F5R1_FB29_Msk   (0x1UL << CAN_F5R1_FB29_Pos)
 
#define CAN_F5R1_FB29   CAN_F5R1_FB29_Msk
 
#define CAN_F5R1_FB30_Pos   (30U)
 
#define CAN_F5R1_FB30_Msk   (0x1UL << CAN_F5R1_FB30_Pos)
 
#define CAN_F5R1_FB30   CAN_F5R1_FB30_Msk
 
#define CAN_F5R1_FB31_Pos   (31U)
 
#define CAN_F5R1_FB31_Msk   (0x1UL << CAN_F5R1_FB31_Pos)
 
#define CAN_F5R1_FB31   CAN_F5R1_FB31_Msk
 
#define CAN_F6R1_FB0_Pos   (0U)
 
#define CAN_F6R1_FB0_Msk   (0x1UL << CAN_F6R1_FB0_Pos)
 
#define CAN_F6R1_FB0   CAN_F6R1_FB0_Msk
 
#define CAN_F6R1_FB1_Pos   (1U)
 
#define CAN_F6R1_FB1_Msk   (0x1UL << CAN_F6R1_FB1_Pos)
 
#define CAN_F6R1_FB1   CAN_F6R1_FB1_Msk
 
#define CAN_F6R1_FB2_Pos   (2U)
 
#define CAN_F6R1_FB2_Msk   (0x1UL << CAN_F6R1_FB2_Pos)
 
#define CAN_F6R1_FB2   CAN_F6R1_FB2_Msk
 
#define CAN_F6R1_FB3_Pos   (3U)
 
#define CAN_F6R1_FB3_Msk   (0x1UL << CAN_F6R1_FB3_Pos)
 
#define CAN_F6R1_FB3   CAN_F6R1_FB3_Msk
 
#define CAN_F6R1_FB4_Pos   (4U)
 
#define CAN_F6R1_FB4_Msk   (0x1UL << CAN_F6R1_FB4_Pos)
 
#define CAN_F6R1_FB4   CAN_F6R1_FB4_Msk
 
#define CAN_F6R1_FB5_Pos   (5U)
 
#define CAN_F6R1_FB5_Msk   (0x1UL << CAN_F6R1_FB5_Pos)
 
#define CAN_F6R1_FB5   CAN_F6R1_FB5_Msk
 
#define CAN_F6R1_FB6_Pos   (6U)
 
#define CAN_F6R1_FB6_Msk   (0x1UL << CAN_F6R1_FB6_Pos)
 
#define CAN_F6R1_FB6   CAN_F6R1_FB6_Msk
 
#define CAN_F6R1_FB7_Pos   (7U)
 
#define CAN_F6R1_FB7_Msk   (0x1UL << CAN_F6R1_FB7_Pos)
 
#define CAN_F6R1_FB7   CAN_F6R1_FB7_Msk
 
#define CAN_F6R1_FB8_Pos   (8U)
 
#define CAN_F6R1_FB8_Msk   (0x1UL << CAN_F6R1_FB8_Pos)
 
#define CAN_F6R1_FB8   CAN_F6R1_FB8_Msk
 
#define CAN_F6R1_FB9_Pos   (9U)
 
#define CAN_F6R1_FB9_Msk   (0x1UL << CAN_F6R1_FB9_Pos)
 
#define CAN_F6R1_FB9   CAN_F6R1_FB9_Msk
 
#define CAN_F6R1_FB10_Pos   (10U)
 
#define CAN_F6R1_FB10_Msk   (0x1UL << CAN_F6R1_FB10_Pos)
 
#define CAN_F6R1_FB10   CAN_F6R1_FB10_Msk
 
#define CAN_F6R1_FB11_Pos   (11U)
 
#define CAN_F6R1_FB11_Msk   (0x1UL << CAN_F6R1_FB11_Pos)
 
#define CAN_F6R1_FB11   CAN_F6R1_FB11_Msk
 
#define CAN_F6R1_FB12_Pos   (12U)
 
#define CAN_F6R1_FB12_Msk   (0x1UL << CAN_F6R1_FB12_Pos)
 
#define CAN_F6R1_FB12   CAN_F6R1_FB12_Msk
 
#define CAN_F6R1_FB13_Pos   (13U)
 
#define CAN_F6R1_FB13_Msk   (0x1UL << CAN_F6R1_FB13_Pos)
 
#define CAN_F6R1_FB13   CAN_F6R1_FB13_Msk
 
#define CAN_F6R1_FB14_Pos   (14U)
 
#define CAN_F6R1_FB14_Msk   (0x1UL << CAN_F6R1_FB14_Pos)
 
#define CAN_F6R1_FB14   CAN_F6R1_FB14_Msk
 
#define CAN_F6R1_FB15_Pos   (15U)
 
#define CAN_F6R1_FB15_Msk   (0x1UL << CAN_F6R1_FB15_Pos)
 
#define CAN_F6R1_FB15   CAN_F6R1_FB15_Msk
 
#define CAN_F6R1_FB16_Pos   (16U)
 
#define CAN_F6R1_FB16_Msk   (0x1UL << CAN_F6R1_FB16_Pos)
 
#define CAN_F6R1_FB16   CAN_F6R1_FB16_Msk
 
#define CAN_F6R1_FB17_Pos   (17U)
 
#define CAN_F6R1_FB17_Msk   (0x1UL << CAN_F6R1_FB17_Pos)
 
#define CAN_F6R1_FB17   CAN_F6R1_FB17_Msk
 
#define CAN_F6R1_FB18_Pos   (18U)
 
#define CAN_F6R1_FB18_Msk   (0x1UL << CAN_F6R1_FB18_Pos)
 
#define CAN_F6R1_FB18   CAN_F6R1_FB18_Msk
 
#define CAN_F6R1_FB19_Pos   (19U)
 
#define CAN_F6R1_FB19_Msk   (0x1UL << CAN_F6R1_FB19_Pos)
 
#define CAN_F6R1_FB19   CAN_F6R1_FB19_Msk
 
#define CAN_F6R1_FB20_Pos   (20U)
 
#define CAN_F6R1_FB20_Msk   (0x1UL << CAN_F6R1_FB20_Pos)
 
#define CAN_F6R1_FB20   CAN_F6R1_FB20_Msk
 
#define CAN_F6R1_FB21_Pos   (21U)
 
#define CAN_F6R1_FB21_Msk   (0x1UL << CAN_F6R1_FB21_Pos)
 
#define CAN_F6R1_FB21   CAN_F6R1_FB21_Msk
 
#define CAN_F6R1_FB22_Pos   (22U)
 
#define CAN_F6R1_FB22_Msk   (0x1UL << CAN_F6R1_FB22_Pos)
 
#define CAN_F6R1_FB22   CAN_F6R1_FB22_Msk
 
#define CAN_F6R1_FB23_Pos   (23U)
 
#define CAN_F6R1_FB23_Msk   (0x1UL << CAN_F6R1_FB23_Pos)
 
#define CAN_F6R1_FB23   CAN_F6R1_FB23_Msk
 
#define CAN_F6R1_FB24_Pos   (24U)
 
#define CAN_F6R1_FB24_Msk   (0x1UL << CAN_F6R1_FB24_Pos)
 
#define CAN_F6R1_FB24   CAN_F6R1_FB24_Msk
 
#define CAN_F6R1_FB25_Pos   (25U)
 
#define CAN_F6R1_FB25_Msk   (0x1UL << CAN_F6R1_FB25_Pos)
 
#define CAN_F6R1_FB25   CAN_F6R1_FB25_Msk
 
#define CAN_F6R1_FB26_Pos   (26U)
 
#define CAN_F6R1_FB26_Msk   (0x1UL << CAN_F6R1_FB26_Pos)
 
#define CAN_F6R1_FB26   CAN_F6R1_FB26_Msk
 
#define CAN_F6R1_FB27_Pos   (27U)
 
#define CAN_F6R1_FB27_Msk   (0x1UL << CAN_F6R1_FB27_Pos)
 
#define CAN_F6R1_FB27   CAN_F6R1_FB27_Msk
 
#define CAN_F6R1_FB28_Pos   (28U)
 
#define CAN_F6R1_FB28_Msk   (0x1UL << CAN_F6R1_FB28_Pos)
 
#define CAN_F6R1_FB28   CAN_F6R1_FB28_Msk
 
#define CAN_F6R1_FB29_Pos   (29U)
 
#define CAN_F6R1_FB29_Msk   (0x1UL << CAN_F6R1_FB29_Pos)
 
#define CAN_F6R1_FB29   CAN_F6R1_FB29_Msk
 
#define CAN_F6R1_FB30_Pos   (30U)
 
#define CAN_F6R1_FB30_Msk   (0x1UL << CAN_F6R1_FB30_Pos)
 
#define CAN_F6R1_FB30   CAN_F6R1_FB30_Msk
 
#define CAN_F6R1_FB31_Pos   (31U)
 
#define CAN_F6R1_FB31_Msk   (0x1UL << CAN_F6R1_FB31_Pos)
 
#define CAN_F6R1_FB31   CAN_F6R1_FB31_Msk
 
#define CAN_F7R1_FB0_Pos   (0U)
 
#define CAN_F7R1_FB0_Msk   (0x1UL << CAN_F7R1_FB0_Pos)
 
#define CAN_F7R1_FB0   CAN_F7R1_FB0_Msk
 
#define CAN_F7R1_FB1_Pos   (1U)
 
#define CAN_F7R1_FB1_Msk   (0x1UL << CAN_F7R1_FB1_Pos)
 
#define CAN_F7R1_FB1   CAN_F7R1_FB1_Msk
 
#define CAN_F7R1_FB2_Pos   (2U)
 
#define CAN_F7R1_FB2_Msk   (0x1UL << CAN_F7R1_FB2_Pos)
 
#define CAN_F7R1_FB2   CAN_F7R1_FB2_Msk
 
#define CAN_F7R1_FB3_Pos   (3U)
 
#define CAN_F7R1_FB3_Msk   (0x1UL << CAN_F7R1_FB3_Pos)
 
#define CAN_F7R1_FB3   CAN_F7R1_FB3_Msk
 
#define CAN_F7R1_FB4_Pos   (4U)
 
#define CAN_F7R1_FB4_Msk   (0x1UL << CAN_F7R1_FB4_Pos)
 
#define CAN_F7R1_FB4   CAN_F7R1_FB4_Msk
 
#define CAN_F7R1_FB5_Pos   (5U)
 
#define CAN_F7R1_FB5_Msk   (0x1UL << CAN_F7R1_FB5_Pos)
 
#define CAN_F7R1_FB5   CAN_F7R1_FB5_Msk
 
#define CAN_F7R1_FB6_Pos   (6U)
 
#define CAN_F7R1_FB6_Msk   (0x1UL << CAN_F7R1_FB6_Pos)
 
#define CAN_F7R1_FB6   CAN_F7R1_FB6_Msk
 
#define CAN_F7R1_FB7_Pos   (7U)
 
#define CAN_F7R1_FB7_Msk   (0x1UL << CAN_F7R1_FB7_Pos)
 
#define CAN_F7R1_FB7   CAN_F7R1_FB7_Msk
 
#define CAN_F7R1_FB8_Pos   (8U)
 
#define CAN_F7R1_FB8_Msk   (0x1UL << CAN_F7R1_FB8_Pos)
 
#define CAN_F7R1_FB8   CAN_F7R1_FB8_Msk
 
#define CAN_F7R1_FB9_Pos   (9U)
 
#define CAN_F7R1_FB9_Msk   (0x1UL << CAN_F7R1_FB9_Pos)
 
#define CAN_F7R1_FB9   CAN_F7R1_FB9_Msk
 
#define CAN_F7R1_FB10_Pos   (10U)
 
#define CAN_F7R1_FB10_Msk   (0x1UL << CAN_F7R1_FB10_Pos)
 
#define CAN_F7R1_FB10   CAN_F7R1_FB10_Msk
 
#define CAN_F7R1_FB11_Pos   (11U)
 
#define CAN_F7R1_FB11_Msk   (0x1UL << CAN_F7R1_FB11_Pos)
 
#define CAN_F7R1_FB11   CAN_F7R1_FB11_Msk
 
#define CAN_F7R1_FB12_Pos   (12U)
 
#define CAN_F7R1_FB12_Msk   (0x1UL << CAN_F7R1_FB12_Pos)
 
#define CAN_F7R1_FB12   CAN_F7R1_FB12_Msk
 
#define CAN_F7R1_FB13_Pos   (13U)
 
#define CAN_F7R1_FB13_Msk   (0x1UL << CAN_F7R1_FB13_Pos)
 
#define CAN_F7R1_FB13   CAN_F7R1_FB13_Msk
 
#define CAN_F7R1_FB14_Pos   (14U)
 
#define CAN_F7R1_FB14_Msk   (0x1UL << CAN_F7R1_FB14_Pos)
 
#define CAN_F7R1_FB14   CAN_F7R1_FB14_Msk
 
#define CAN_F7R1_FB15_Pos   (15U)
 
#define CAN_F7R1_FB15_Msk   (0x1UL << CAN_F7R1_FB15_Pos)
 
#define CAN_F7R1_FB15   CAN_F7R1_FB15_Msk
 
#define CAN_F7R1_FB16_Pos   (16U)
 
#define CAN_F7R1_FB16_Msk   (0x1UL << CAN_F7R1_FB16_Pos)
 
#define CAN_F7R1_FB16   CAN_F7R1_FB16_Msk
 
#define CAN_F7R1_FB17_Pos   (17U)
 
#define CAN_F7R1_FB17_Msk   (0x1UL << CAN_F7R1_FB17_Pos)
 
#define CAN_F7R1_FB17   CAN_F7R1_FB17_Msk
 
#define CAN_F7R1_FB18_Pos   (18U)
 
#define CAN_F7R1_FB18_Msk   (0x1UL << CAN_F7R1_FB18_Pos)
 
#define CAN_F7R1_FB18   CAN_F7R1_FB18_Msk
 
#define CAN_F7R1_FB19_Pos   (19U)
 
#define CAN_F7R1_FB19_Msk   (0x1UL << CAN_F7R1_FB19_Pos)
 
#define CAN_F7R1_FB19   CAN_F7R1_FB19_Msk
 
#define CAN_F7R1_FB20_Pos   (20U)
 
#define CAN_F7R1_FB20_Msk   (0x1UL << CAN_F7R1_FB20_Pos)
 
#define CAN_F7R1_FB20   CAN_F7R1_FB20_Msk
 
#define CAN_F7R1_FB21_Pos   (21U)
 
#define CAN_F7R1_FB21_Msk   (0x1UL << CAN_F7R1_FB21_Pos)
 
#define CAN_F7R1_FB21   CAN_F7R1_FB21_Msk
 
#define CAN_F7R1_FB22_Pos   (22U)
 
#define CAN_F7R1_FB22_Msk   (0x1UL << CAN_F7R1_FB22_Pos)
 
#define CAN_F7R1_FB22   CAN_F7R1_FB22_Msk
 
#define CAN_F7R1_FB23_Pos   (23U)
 
#define CAN_F7R1_FB23_Msk   (0x1UL << CAN_F7R1_FB23_Pos)
 
#define CAN_F7R1_FB23   CAN_F7R1_FB23_Msk
 
#define CAN_F7R1_FB24_Pos   (24U)
 
#define CAN_F7R1_FB24_Msk   (0x1UL << CAN_F7R1_FB24_Pos)
 
#define CAN_F7R1_FB24   CAN_F7R1_FB24_Msk
 
#define CAN_F7R1_FB25_Pos   (25U)
 
#define CAN_F7R1_FB25_Msk   (0x1UL << CAN_F7R1_FB25_Pos)
 
#define CAN_F7R1_FB25   CAN_F7R1_FB25_Msk
 
#define CAN_F7R1_FB26_Pos   (26U)
 
#define CAN_F7R1_FB26_Msk   (0x1UL << CAN_F7R1_FB26_Pos)
 
#define CAN_F7R1_FB26   CAN_F7R1_FB26_Msk
 
#define CAN_F7R1_FB27_Pos   (27U)
 
#define CAN_F7R1_FB27_Msk   (0x1UL << CAN_F7R1_FB27_Pos)
 
#define CAN_F7R1_FB27   CAN_F7R1_FB27_Msk
 
#define CAN_F7R1_FB28_Pos   (28U)
 
#define CAN_F7R1_FB28_Msk   (0x1UL << CAN_F7R1_FB28_Pos)
 
#define CAN_F7R1_FB28   CAN_F7R1_FB28_Msk
 
#define CAN_F7R1_FB29_Pos   (29U)
 
#define CAN_F7R1_FB29_Msk   (0x1UL << CAN_F7R1_FB29_Pos)
 
#define CAN_F7R1_FB29   CAN_F7R1_FB29_Msk
 
#define CAN_F7R1_FB30_Pos   (30U)
 
#define CAN_F7R1_FB30_Msk   (0x1UL << CAN_F7R1_FB30_Pos)
 
#define CAN_F7R1_FB30   CAN_F7R1_FB30_Msk
 
#define CAN_F7R1_FB31_Pos   (31U)
 
#define CAN_F7R1_FB31_Msk   (0x1UL << CAN_F7R1_FB31_Pos)
 
#define CAN_F7R1_FB31   CAN_F7R1_FB31_Msk
 
#define CAN_F8R1_FB0_Pos   (0U)
 
#define CAN_F8R1_FB0_Msk   (0x1UL << CAN_F8R1_FB0_Pos)
 
#define CAN_F8R1_FB0   CAN_F8R1_FB0_Msk
 
#define CAN_F8R1_FB1_Pos   (1U)
 
#define CAN_F8R1_FB1_Msk   (0x1UL << CAN_F8R1_FB1_Pos)
 
#define CAN_F8R1_FB1   CAN_F8R1_FB1_Msk
 
#define CAN_F8R1_FB2_Pos   (2U)
 
#define CAN_F8R1_FB2_Msk   (0x1UL << CAN_F8R1_FB2_Pos)
 
#define CAN_F8R1_FB2   CAN_F8R1_FB2_Msk
 
#define CAN_F8R1_FB3_Pos   (3U)
 
#define CAN_F8R1_FB3_Msk   (0x1UL << CAN_F8R1_FB3_Pos)
 
#define CAN_F8R1_FB3   CAN_F8R1_FB3_Msk
 
#define CAN_F8R1_FB4_Pos   (4U)
 
#define CAN_F8R1_FB4_Msk   (0x1UL << CAN_F8R1_FB4_Pos)
 
#define CAN_F8R1_FB4   CAN_F8R1_FB4_Msk
 
#define CAN_F8R1_FB5_Pos   (5U)
 
#define CAN_F8R1_FB5_Msk   (0x1UL << CAN_F8R1_FB5_Pos)
 
#define CAN_F8R1_FB5   CAN_F8R1_FB5_Msk
 
#define CAN_F8R1_FB6_Pos   (6U)
 
#define CAN_F8R1_FB6_Msk   (0x1UL << CAN_F8R1_FB6_Pos)
 
#define CAN_F8R1_FB6   CAN_F8R1_FB6_Msk
 
#define CAN_F8R1_FB7_Pos   (7U)
 
#define CAN_F8R1_FB7_Msk   (0x1UL << CAN_F8R1_FB7_Pos)
 
#define CAN_F8R1_FB7   CAN_F8R1_FB7_Msk
 
#define CAN_F8R1_FB8_Pos   (8U)
 
#define CAN_F8R1_FB8_Msk   (0x1UL << CAN_F8R1_FB8_Pos)
 
#define CAN_F8R1_FB8   CAN_F8R1_FB8_Msk
 
#define CAN_F8R1_FB9_Pos   (9U)
 
#define CAN_F8R1_FB9_Msk   (0x1UL << CAN_F8R1_FB9_Pos)
 
#define CAN_F8R1_FB9   CAN_F8R1_FB9_Msk
 
#define CAN_F8R1_FB10_Pos   (10U)
 
#define CAN_F8R1_FB10_Msk   (0x1UL << CAN_F8R1_FB10_Pos)
 
#define CAN_F8R1_FB10   CAN_F8R1_FB10_Msk
 
#define CAN_F8R1_FB11_Pos   (11U)
 
#define CAN_F8R1_FB11_Msk   (0x1UL << CAN_F8R1_FB11_Pos)
 
#define CAN_F8R1_FB11   CAN_F8R1_FB11_Msk
 
#define CAN_F8R1_FB12_Pos   (12U)
 
#define CAN_F8R1_FB12_Msk   (0x1UL << CAN_F8R1_FB12_Pos)
 
#define CAN_F8R1_FB12   CAN_F8R1_FB12_Msk
 
#define CAN_F8R1_FB13_Pos   (13U)
 
#define CAN_F8R1_FB13_Msk   (0x1UL << CAN_F8R1_FB13_Pos)
 
#define CAN_F8R1_FB13   CAN_F8R1_FB13_Msk
 
#define CAN_F8R1_FB14_Pos   (14U)
 
#define CAN_F8R1_FB14_Msk   (0x1UL << CAN_F8R1_FB14_Pos)
 
#define CAN_F8R1_FB14   CAN_F8R1_FB14_Msk
 
#define CAN_F8R1_FB15_Pos   (15U)
 
#define CAN_F8R1_FB15_Msk   (0x1UL << CAN_F8R1_FB15_Pos)
 
#define CAN_F8R1_FB15   CAN_F8R1_FB15_Msk
 
#define CAN_F8R1_FB16_Pos   (16U)
 
#define CAN_F8R1_FB16_Msk   (0x1UL << CAN_F8R1_FB16_Pos)
 
#define CAN_F8R1_FB16   CAN_F8R1_FB16_Msk
 
#define CAN_F8R1_FB17_Pos   (17U)
 
#define CAN_F8R1_FB17_Msk   (0x1UL << CAN_F8R1_FB17_Pos)
 
#define CAN_F8R1_FB17   CAN_F8R1_FB17_Msk
 
#define CAN_F8R1_FB18_Pos   (18U)
 
#define CAN_F8R1_FB18_Msk   (0x1UL << CAN_F8R1_FB18_Pos)
 
#define CAN_F8R1_FB18   CAN_F8R1_FB18_Msk
 
#define CAN_F8R1_FB19_Pos   (19U)
 
#define CAN_F8R1_FB19_Msk   (0x1UL << CAN_F8R1_FB19_Pos)
 
#define CAN_F8R1_FB19   CAN_F8R1_FB19_Msk
 
#define CAN_F8R1_FB20_Pos   (20U)
 
#define CAN_F8R1_FB20_Msk   (0x1UL << CAN_F8R1_FB20_Pos)
 
#define CAN_F8R1_FB20   CAN_F8R1_FB20_Msk
 
#define CAN_F8R1_FB21_Pos   (21U)
 
#define CAN_F8R1_FB21_Msk   (0x1UL << CAN_F8R1_FB21_Pos)
 
#define CAN_F8R1_FB21   CAN_F8R1_FB21_Msk
 
#define CAN_F8R1_FB22_Pos   (22U)
 
#define CAN_F8R1_FB22_Msk   (0x1UL << CAN_F8R1_FB22_Pos)
 
#define CAN_F8R1_FB22   CAN_F8R1_FB22_Msk
 
#define CAN_F8R1_FB23_Pos   (23U)
 
#define CAN_F8R1_FB23_Msk   (0x1UL << CAN_F8R1_FB23_Pos)
 
#define CAN_F8R1_FB23   CAN_F8R1_FB23_Msk
 
#define CAN_F8R1_FB24_Pos   (24U)
 
#define CAN_F8R1_FB24_Msk   (0x1UL << CAN_F8R1_FB24_Pos)
 
#define CAN_F8R1_FB24   CAN_F8R1_FB24_Msk
 
#define CAN_F8R1_FB25_Pos   (25U)
 
#define CAN_F8R1_FB25_Msk   (0x1UL << CAN_F8R1_FB25_Pos)
 
#define CAN_F8R1_FB25   CAN_F8R1_FB25_Msk
 
#define CAN_F8R1_FB26_Pos   (26U)
 
#define CAN_F8R1_FB26_Msk   (0x1UL << CAN_F8R1_FB26_Pos)
 
#define CAN_F8R1_FB26   CAN_F8R1_FB26_Msk
 
#define CAN_F8R1_FB27_Pos   (27U)
 
#define CAN_F8R1_FB27_Msk   (0x1UL << CAN_F8R1_FB27_Pos)
 
#define CAN_F8R1_FB27   CAN_F8R1_FB27_Msk
 
#define CAN_F8R1_FB28_Pos   (28U)
 
#define CAN_F8R1_FB28_Msk   (0x1UL << CAN_F8R1_FB28_Pos)
 
#define CAN_F8R1_FB28   CAN_F8R1_FB28_Msk
 
#define CAN_F8R1_FB29_Pos   (29U)
 
#define CAN_F8R1_FB29_Msk   (0x1UL << CAN_F8R1_FB29_Pos)
 
#define CAN_F8R1_FB29   CAN_F8R1_FB29_Msk
 
#define CAN_F8R1_FB30_Pos   (30U)
 
#define CAN_F8R1_FB30_Msk   (0x1UL << CAN_F8R1_FB30_Pos)
 
#define CAN_F8R1_FB30   CAN_F8R1_FB30_Msk
 
#define CAN_F8R1_FB31_Pos   (31U)
 
#define CAN_F8R1_FB31_Msk   (0x1UL << CAN_F8R1_FB31_Pos)
 
#define CAN_F8R1_FB31   CAN_F8R1_FB31_Msk
 
#define CAN_F9R1_FB0_Pos   (0U)
 
#define CAN_F9R1_FB0_Msk   (0x1UL << CAN_F9R1_FB0_Pos)
 
#define CAN_F9R1_FB0   CAN_F9R1_FB0_Msk
 
#define CAN_F9R1_FB1_Pos   (1U)
 
#define CAN_F9R1_FB1_Msk   (0x1UL << CAN_F9R1_FB1_Pos)
 
#define CAN_F9R1_FB1   CAN_F9R1_FB1_Msk
 
#define CAN_F9R1_FB2_Pos   (2U)
 
#define CAN_F9R1_FB2_Msk   (0x1UL << CAN_F9R1_FB2_Pos)
 
#define CAN_F9R1_FB2   CAN_F9R1_FB2_Msk
 
#define CAN_F9R1_FB3_Pos   (3U)
 
#define CAN_F9R1_FB3_Msk   (0x1UL << CAN_F9R1_FB3_Pos)
 
#define CAN_F9R1_FB3   CAN_F9R1_FB3_Msk
 
#define CAN_F9R1_FB4_Pos   (4U)
 
#define CAN_F9R1_FB4_Msk   (0x1UL << CAN_F9R1_FB4_Pos)
 
#define CAN_F9R1_FB4   CAN_F9R1_FB4_Msk
 
#define CAN_F9R1_FB5_Pos   (5U)
 
#define CAN_F9R1_FB5_Msk   (0x1UL << CAN_F9R1_FB5_Pos)
 
#define CAN_F9R1_FB5   CAN_F9R1_FB5_Msk
 
#define CAN_F9R1_FB6_Pos   (6U)
 
#define CAN_F9R1_FB6_Msk   (0x1UL << CAN_F9R1_FB6_Pos)
 
#define CAN_F9R1_FB6   CAN_F9R1_FB6_Msk
 
#define CAN_F9R1_FB7_Pos   (7U)
 
#define CAN_F9R1_FB7_Msk   (0x1UL << CAN_F9R1_FB7_Pos)
 
#define CAN_F9R1_FB7   CAN_F9R1_FB7_Msk
 
#define CAN_F9R1_FB8_Pos   (8U)
 
#define CAN_F9R1_FB8_Msk   (0x1UL << CAN_F9R1_FB8_Pos)
 
#define CAN_F9R1_FB8   CAN_F9R1_FB8_Msk
 
#define CAN_F9R1_FB9_Pos   (9U)
 
#define CAN_F9R1_FB9_Msk   (0x1UL << CAN_F9R1_FB9_Pos)
 
#define CAN_F9R1_FB9   CAN_F9R1_FB9_Msk
 
#define CAN_F9R1_FB10_Pos   (10U)
 
#define CAN_F9R1_FB10_Msk   (0x1UL << CAN_F9R1_FB10_Pos)
 
#define CAN_F9R1_FB10   CAN_F9R1_FB10_Msk
 
#define CAN_F9R1_FB11_Pos   (11U)
 
#define CAN_F9R1_FB11_Msk   (0x1UL << CAN_F9R1_FB11_Pos)
 
#define CAN_F9R1_FB11   CAN_F9R1_FB11_Msk
 
#define CAN_F9R1_FB12_Pos   (12U)
 
#define CAN_F9R1_FB12_Msk   (0x1UL << CAN_F9R1_FB12_Pos)
 
#define CAN_F9R1_FB12   CAN_F9R1_FB12_Msk
 
#define CAN_F9R1_FB13_Pos   (13U)
 
#define CAN_F9R1_FB13_Msk   (0x1UL << CAN_F9R1_FB13_Pos)
 
#define CAN_F9R1_FB13   CAN_F9R1_FB13_Msk
 
#define CAN_F9R1_FB14_Pos   (14U)
 
#define CAN_F9R1_FB14_Msk   (0x1UL << CAN_F9R1_FB14_Pos)
 
#define CAN_F9R1_FB14   CAN_F9R1_FB14_Msk
 
#define CAN_F9R1_FB15_Pos   (15U)
 
#define CAN_F9R1_FB15_Msk   (0x1UL << CAN_F9R1_FB15_Pos)
 
#define CAN_F9R1_FB15   CAN_F9R1_FB15_Msk
 
#define CAN_F9R1_FB16_Pos   (16U)
 
#define CAN_F9R1_FB16_Msk   (0x1UL << CAN_F9R1_FB16_Pos)
 
#define CAN_F9R1_FB16   CAN_F9R1_FB16_Msk
 
#define CAN_F9R1_FB17_Pos   (17U)
 
#define CAN_F9R1_FB17_Msk   (0x1UL << CAN_F9R1_FB17_Pos)
 
#define CAN_F9R1_FB17   CAN_F9R1_FB17_Msk
 
#define CAN_F9R1_FB18_Pos   (18U)
 
#define CAN_F9R1_FB18_Msk   (0x1UL << CAN_F9R1_FB18_Pos)
 
#define CAN_F9R1_FB18   CAN_F9R1_FB18_Msk
 
#define CAN_F9R1_FB19_Pos   (19U)
 
#define CAN_F9R1_FB19_Msk   (0x1UL << CAN_F9R1_FB19_Pos)
 
#define CAN_F9R1_FB19   CAN_F9R1_FB19_Msk
 
#define CAN_F9R1_FB20_Pos   (20U)
 
#define CAN_F9R1_FB20_Msk   (0x1UL << CAN_F9R1_FB20_Pos)
 
#define CAN_F9R1_FB20   CAN_F9R1_FB20_Msk
 
#define CAN_F9R1_FB21_Pos   (21U)
 
#define CAN_F9R1_FB21_Msk   (0x1UL << CAN_F9R1_FB21_Pos)
 
#define CAN_F9R1_FB21   CAN_F9R1_FB21_Msk
 
#define CAN_F9R1_FB22_Pos   (22U)
 
#define CAN_F9R1_FB22_Msk   (0x1UL << CAN_F9R1_FB22_Pos)
 
#define CAN_F9R1_FB22   CAN_F9R1_FB22_Msk
 
#define CAN_F9R1_FB23_Pos   (23U)
 
#define CAN_F9R1_FB23_Msk   (0x1UL << CAN_F9R1_FB23_Pos)
 
#define CAN_F9R1_FB23   CAN_F9R1_FB23_Msk
 
#define CAN_F9R1_FB24_Pos   (24U)
 
#define CAN_F9R1_FB24_Msk   (0x1UL << CAN_F9R1_FB24_Pos)
 
#define CAN_F9R1_FB24   CAN_F9R1_FB24_Msk
 
#define CAN_F9R1_FB25_Pos   (25U)
 
#define CAN_F9R1_FB25_Msk   (0x1UL << CAN_F9R1_FB25_Pos)
 
#define CAN_F9R1_FB25   CAN_F9R1_FB25_Msk
 
#define CAN_F9R1_FB26_Pos   (26U)
 
#define CAN_F9R1_FB26_Msk   (0x1UL << CAN_F9R1_FB26_Pos)
 
#define CAN_F9R1_FB26   CAN_F9R1_FB26_Msk
 
#define CAN_F9R1_FB27_Pos   (27U)
 
#define CAN_F9R1_FB27_Msk   (0x1UL << CAN_F9R1_FB27_Pos)
 
#define CAN_F9R1_FB27   CAN_F9R1_FB27_Msk
 
#define CAN_F9R1_FB28_Pos   (28U)
 
#define CAN_F9R1_FB28_Msk   (0x1UL << CAN_F9R1_FB28_Pos)
 
#define CAN_F9R1_FB28   CAN_F9R1_FB28_Msk
 
#define CAN_F9R1_FB29_Pos   (29U)
 
#define CAN_F9R1_FB29_Msk   (0x1UL << CAN_F9R1_FB29_Pos)
 
#define CAN_F9R1_FB29   CAN_F9R1_FB29_Msk
 
#define CAN_F9R1_FB30_Pos   (30U)
 
#define CAN_F9R1_FB30_Msk   (0x1UL << CAN_F9R1_FB30_Pos)
 
#define CAN_F9R1_FB30   CAN_F9R1_FB30_Msk
 
#define CAN_F9R1_FB31_Pos   (31U)
 
#define CAN_F9R1_FB31_Msk   (0x1UL << CAN_F9R1_FB31_Pos)
 
#define CAN_F9R1_FB31   CAN_F9R1_FB31_Msk
 
#define CAN_F10R1_FB0_Pos   (0U)
 
#define CAN_F10R1_FB0_Msk   (0x1UL << CAN_F10R1_FB0_Pos)
 
#define CAN_F10R1_FB0   CAN_F10R1_FB0_Msk
 
#define CAN_F10R1_FB1_Pos   (1U)
 
#define CAN_F10R1_FB1_Msk   (0x1UL << CAN_F10R1_FB1_Pos)
 
#define CAN_F10R1_FB1   CAN_F10R1_FB1_Msk
 
#define CAN_F10R1_FB2_Pos   (2U)
 
#define CAN_F10R1_FB2_Msk   (0x1UL << CAN_F10R1_FB2_Pos)
 
#define CAN_F10R1_FB2   CAN_F10R1_FB2_Msk
 
#define CAN_F10R1_FB3_Pos   (3U)
 
#define CAN_F10R1_FB3_Msk   (0x1UL << CAN_F10R1_FB3_Pos)
 
#define CAN_F10R1_FB3   CAN_F10R1_FB3_Msk
 
#define CAN_F10R1_FB4_Pos   (4U)
 
#define CAN_F10R1_FB4_Msk   (0x1UL << CAN_F10R1_FB4_Pos)
 
#define CAN_F10R1_FB4   CAN_F10R1_FB4_Msk
 
#define CAN_F10R1_FB5_Pos   (5U)
 
#define CAN_F10R1_FB5_Msk   (0x1UL << CAN_F10R1_FB5_Pos)
 
#define CAN_F10R1_FB5   CAN_F10R1_FB5_Msk
 
#define CAN_F10R1_FB6_Pos   (6U)
 
#define CAN_F10R1_FB6_Msk   (0x1UL << CAN_F10R1_FB6_Pos)
 
#define CAN_F10R1_FB6   CAN_F10R1_FB6_Msk
 
#define CAN_F10R1_FB7_Pos   (7U)
 
#define CAN_F10R1_FB7_Msk   (0x1UL << CAN_F10R1_FB7_Pos)
 
#define CAN_F10R1_FB7   CAN_F10R1_FB7_Msk
 
#define CAN_F10R1_FB8_Pos   (8U)
 
#define CAN_F10R1_FB8_Msk   (0x1UL << CAN_F10R1_FB8_Pos)
 
#define CAN_F10R1_FB8   CAN_F10R1_FB8_Msk
 
#define CAN_F10R1_FB9_Pos   (9U)
 
#define CAN_F10R1_FB9_Msk   (0x1UL << CAN_F10R1_FB9_Pos)
 
#define CAN_F10R1_FB9   CAN_F10R1_FB9_Msk
 
#define CAN_F10R1_FB10_Pos   (10U)
 
#define CAN_F10R1_FB10_Msk   (0x1UL << CAN_F10R1_FB10_Pos)
 
#define CAN_F10R1_FB10   CAN_F10R1_FB10_Msk
 
#define CAN_F10R1_FB11_Pos   (11U)
 
#define CAN_F10R1_FB11_Msk   (0x1UL << CAN_F10R1_FB11_Pos)
 
#define CAN_F10R1_FB11   CAN_F10R1_FB11_Msk
 
#define CAN_F10R1_FB12_Pos   (12U)
 
#define CAN_F10R1_FB12_Msk   (0x1UL << CAN_F10R1_FB12_Pos)
 
#define CAN_F10R1_FB12   CAN_F10R1_FB12_Msk
 
#define CAN_F10R1_FB13_Pos   (13U)
 
#define CAN_F10R1_FB13_Msk   (0x1UL << CAN_F10R1_FB13_Pos)
 
#define CAN_F10R1_FB13   CAN_F10R1_FB13_Msk
 
#define CAN_F10R1_FB14_Pos   (14U)
 
#define CAN_F10R1_FB14_Msk   (0x1UL << CAN_F10R1_FB14_Pos)
 
#define CAN_F10R1_FB14   CAN_F10R1_FB14_Msk
 
#define CAN_F10R1_FB15_Pos   (15U)
 
#define CAN_F10R1_FB15_Msk   (0x1UL << CAN_F10R1_FB15_Pos)
 
#define CAN_F10R1_FB15   CAN_F10R1_FB15_Msk
 
#define CAN_F10R1_FB16_Pos   (16U)
 
#define CAN_F10R1_FB16_Msk   (0x1UL << CAN_F10R1_FB16_Pos)
 
#define CAN_F10R1_FB16   CAN_F10R1_FB16_Msk
 
#define CAN_F10R1_FB17_Pos   (17U)
 
#define CAN_F10R1_FB17_Msk   (0x1UL << CAN_F10R1_FB17_Pos)
 
#define CAN_F10R1_FB17   CAN_F10R1_FB17_Msk
 
#define CAN_F10R1_FB18_Pos   (18U)
 
#define CAN_F10R1_FB18_Msk   (0x1UL << CAN_F10R1_FB18_Pos)
 
#define CAN_F10R1_FB18   CAN_F10R1_FB18_Msk
 
#define CAN_F10R1_FB19_Pos   (19U)
 
#define CAN_F10R1_FB19_Msk   (0x1UL << CAN_F10R1_FB19_Pos)
 
#define CAN_F10R1_FB19   CAN_F10R1_FB19_Msk
 
#define CAN_F10R1_FB20_Pos   (20U)
 
#define CAN_F10R1_FB20_Msk   (0x1UL << CAN_F10R1_FB20_Pos)
 
#define CAN_F10R1_FB20   CAN_F10R1_FB20_Msk
 
#define CAN_F10R1_FB21_Pos   (21U)
 
#define CAN_F10R1_FB21_Msk   (0x1UL << CAN_F10R1_FB21_Pos)
 
#define CAN_F10R1_FB21   CAN_F10R1_FB21_Msk
 
#define CAN_F10R1_FB22_Pos   (22U)
 
#define CAN_F10R1_FB22_Msk   (0x1UL << CAN_F10R1_FB22_Pos)
 
#define CAN_F10R1_FB22   CAN_F10R1_FB22_Msk
 
#define CAN_F10R1_FB23_Pos   (23U)
 
#define CAN_F10R1_FB23_Msk   (0x1UL << CAN_F10R1_FB23_Pos)
 
#define CAN_F10R1_FB23   CAN_F10R1_FB23_Msk
 
#define CAN_F10R1_FB24_Pos   (24U)
 
#define CAN_F10R1_FB24_Msk   (0x1UL << CAN_F10R1_FB24_Pos)
 
#define CAN_F10R1_FB24   CAN_F10R1_FB24_Msk
 
#define CAN_F10R1_FB25_Pos   (25U)
 
#define CAN_F10R1_FB25_Msk   (0x1UL << CAN_F10R1_FB25_Pos)
 
#define CAN_F10R1_FB25   CAN_F10R1_FB25_Msk
 
#define CAN_F10R1_FB26_Pos   (26U)
 
#define CAN_F10R1_FB26_Msk   (0x1UL << CAN_F10R1_FB26_Pos)
 
#define CAN_F10R1_FB26   CAN_F10R1_FB26_Msk
 
#define CAN_F10R1_FB27_Pos   (27U)
 
#define CAN_F10R1_FB27_Msk   (0x1UL << CAN_F10R1_FB27_Pos)
 
#define CAN_F10R1_FB27   CAN_F10R1_FB27_Msk
 
#define CAN_F10R1_FB28_Pos   (28U)
 
#define CAN_F10R1_FB28_Msk   (0x1UL << CAN_F10R1_FB28_Pos)
 
#define CAN_F10R1_FB28   CAN_F10R1_FB28_Msk
 
#define CAN_F10R1_FB29_Pos   (29U)
 
#define CAN_F10R1_FB29_Msk   (0x1UL << CAN_F10R1_FB29_Pos)
 
#define CAN_F10R1_FB29   CAN_F10R1_FB29_Msk
 
#define CAN_F10R1_FB30_Pos   (30U)
 
#define CAN_F10R1_FB30_Msk   (0x1UL << CAN_F10R1_FB30_Pos)
 
#define CAN_F10R1_FB30   CAN_F10R1_FB30_Msk
 
#define CAN_F10R1_FB31_Pos   (31U)
 
#define CAN_F10R1_FB31_Msk   (0x1UL << CAN_F10R1_FB31_Pos)
 
#define CAN_F10R1_FB31   CAN_F10R1_FB31_Msk
 
#define CAN_F11R1_FB0_Pos   (0U)
 
#define CAN_F11R1_FB0_Msk   (0x1UL << CAN_F11R1_FB0_Pos)
 
#define CAN_F11R1_FB0   CAN_F11R1_FB0_Msk
 
#define CAN_F11R1_FB1_Pos   (1U)
 
#define CAN_F11R1_FB1_Msk   (0x1UL << CAN_F11R1_FB1_Pos)
 
#define CAN_F11R1_FB1   CAN_F11R1_FB1_Msk
 
#define CAN_F11R1_FB2_Pos   (2U)
 
#define CAN_F11R1_FB2_Msk   (0x1UL << CAN_F11R1_FB2_Pos)
 
#define CAN_F11R1_FB2   CAN_F11R1_FB2_Msk
 
#define CAN_F11R1_FB3_Pos   (3U)
 
#define CAN_F11R1_FB3_Msk   (0x1UL << CAN_F11R1_FB3_Pos)
 
#define CAN_F11R1_FB3   CAN_F11R1_FB3_Msk
 
#define CAN_F11R1_FB4_Pos   (4U)
 
#define CAN_F11R1_FB4_Msk   (0x1UL << CAN_F11R1_FB4_Pos)
 
#define CAN_F11R1_FB4   CAN_F11R1_FB4_Msk
 
#define CAN_F11R1_FB5_Pos   (5U)
 
#define CAN_F11R1_FB5_Msk   (0x1UL << CAN_F11R1_FB5_Pos)
 
#define CAN_F11R1_FB5   CAN_F11R1_FB5_Msk
 
#define CAN_F11R1_FB6_Pos   (6U)
 
#define CAN_F11R1_FB6_Msk   (0x1UL << CAN_F11R1_FB6_Pos)
 
#define CAN_F11R1_FB6   CAN_F11R1_FB6_Msk
 
#define CAN_F11R1_FB7_Pos   (7U)
 
#define CAN_F11R1_FB7_Msk   (0x1UL << CAN_F11R1_FB7_Pos)
 
#define CAN_F11R1_FB7   CAN_F11R1_FB7_Msk
 
#define CAN_F11R1_FB8_Pos   (8U)
 
#define CAN_F11R1_FB8_Msk   (0x1UL << CAN_F11R1_FB8_Pos)
 
#define CAN_F11R1_FB8   CAN_F11R1_FB8_Msk
 
#define CAN_F11R1_FB9_Pos   (9U)
 
#define CAN_F11R1_FB9_Msk   (0x1UL << CAN_F11R1_FB9_Pos)
 
#define CAN_F11R1_FB9   CAN_F11R1_FB9_Msk
 
#define CAN_F11R1_FB10_Pos   (10U)
 
#define CAN_F11R1_FB10_Msk   (0x1UL << CAN_F11R1_FB10_Pos)
 
#define CAN_F11R1_FB10   CAN_F11R1_FB10_Msk
 
#define CAN_F11R1_FB11_Pos   (11U)
 
#define CAN_F11R1_FB11_Msk   (0x1UL << CAN_F11R1_FB11_Pos)
 
#define CAN_F11R1_FB11   CAN_F11R1_FB11_Msk
 
#define CAN_F11R1_FB12_Pos   (12U)
 
#define CAN_F11R1_FB12_Msk   (0x1UL << CAN_F11R1_FB12_Pos)
 
#define CAN_F11R1_FB12   CAN_F11R1_FB12_Msk
 
#define CAN_F11R1_FB13_Pos   (13U)
 
#define CAN_F11R1_FB13_Msk   (0x1UL << CAN_F11R1_FB13_Pos)
 
#define CAN_F11R1_FB13   CAN_F11R1_FB13_Msk
 
#define CAN_F11R1_FB14_Pos   (14U)
 
#define CAN_F11R1_FB14_Msk   (0x1UL << CAN_F11R1_FB14_Pos)
 
#define CAN_F11R1_FB14   CAN_F11R1_FB14_Msk
 
#define CAN_F11R1_FB15_Pos   (15U)
 
#define CAN_F11R1_FB15_Msk   (0x1UL << CAN_F11R1_FB15_Pos)
 
#define CAN_F11R1_FB15   CAN_F11R1_FB15_Msk
 
#define CAN_F11R1_FB16_Pos   (16U)
 
#define CAN_F11R1_FB16_Msk   (0x1UL << CAN_F11R1_FB16_Pos)
 
#define CAN_F11R1_FB16   CAN_F11R1_FB16_Msk
 
#define CAN_F11R1_FB17_Pos   (17U)
 
#define CAN_F11R1_FB17_Msk   (0x1UL << CAN_F11R1_FB17_Pos)
 
#define CAN_F11R1_FB17   CAN_F11R1_FB17_Msk
 
#define CAN_F11R1_FB18_Pos   (18U)
 
#define CAN_F11R1_FB18_Msk   (0x1UL << CAN_F11R1_FB18_Pos)
 
#define CAN_F11R1_FB18   CAN_F11R1_FB18_Msk
 
#define CAN_F11R1_FB19_Pos   (19U)
 
#define CAN_F11R1_FB19_Msk   (0x1UL << CAN_F11R1_FB19_Pos)
 
#define CAN_F11R1_FB19   CAN_F11R1_FB19_Msk
 
#define CAN_F11R1_FB20_Pos   (20U)
 
#define CAN_F11R1_FB20_Msk   (0x1UL << CAN_F11R1_FB20_Pos)
 
#define CAN_F11R1_FB20   CAN_F11R1_FB20_Msk
 
#define CAN_F11R1_FB21_Pos   (21U)
 
#define CAN_F11R1_FB21_Msk   (0x1UL << CAN_F11R1_FB21_Pos)
 
#define CAN_F11R1_FB21   CAN_F11R1_FB21_Msk
 
#define CAN_F11R1_FB22_Pos   (22U)
 
#define CAN_F11R1_FB22_Msk   (0x1UL << CAN_F11R1_FB22_Pos)
 
#define CAN_F11R1_FB22   CAN_F11R1_FB22_Msk
 
#define CAN_F11R1_FB23_Pos   (23U)
 
#define CAN_F11R1_FB23_Msk   (0x1UL << CAN_F11R1_FB23_Pos)
 
#define CAN_F11R1_FB23   CAN_F11R1_FB23_Msk
 
#define CAN_F11R1_FB24_Pos   (24U)
 
#define CAN_F11R1_FB24_Msk   (0x1UL << CAN_F11R1_FB24_Pos)
 
#define CAN_F11R1_FB24   CAN_F11R1_FB24_Msk
 
#define CAN_F11R1_FB25_Pos   (25U)
 
#define CAN_F11R1_FB25_Msk   (0x1UL << CAN_F11R1_FB25_Pos)
 
#define CAN_F11R1_FB25   CAN_F11R1_FB25_Msk
 
#define CAN_F11R1_FB26_Pos   (26U)
 
#define CAN_F11R1_FB26_Msk   (0x1UL << CAN_F11R1_FB26_Pos)
 
#define CAN_F11R1_FB26   CAN_F11R1_FB26_Msk
 
#define CAN_F11R1_FB27_Pos   (27U)
 
#define CAN_F11R1_FB27_Msk   (0x1UL << CAN_F11R1_FB27_Pos)
 
#define CAN_F11R1_FB27   CAN_F11R1_FB27_Msk
 
#define CAN_F11R1_FB28_Pos   (28U)
 
#define CAN_F11R1_FB28_Msk   (0x1UL << CAN_F11R1_FB28_Pos)
 
#define CAN_F11R1_FB28   CAN_F11R1_FB28_Msk
 
#define CAN_F11R1_FB29_Pos   (29U)
 
#define CAN_F11R1_FB29_Msk   (0x1UL << CAN_F11R1_FB29_Pos)
 
#define CAN_F11R1_FB29   CAN_F11R1_FB29_Msk
 
#define CAN_F11R1_FB30_Pos   (30U)
 
#define CAN_F11R1_FB30_Msk   (0x1UL << CAN_F11R1_FB30_Pos)
 
#define CAN_F11R1_FB30   CAN_F11R1_FB30_Msk
 
#define CAN_F11R1_FB31_Pos   (31U)
 
#define CAN_F11R1_FB31_Msk   (0x1UL << CAN_F11R1_FB31_Pos)
 
#define CAN_F11R1_FB31   CAN_F11R1_FB31_Msk
 
#define CAN_F12R1_FB0_Pos   (0U)
 
#define CAN_F12R1_FB0_Msk   (0x1UL << CAN_F12R1_FB0_Pos)
 
#define CAN_F12R1_FB0   CAN_F12R1_FB0_Msk
 
#define CAN_F12R1_FB1_Pos   (1U)
 
#define CAN_F12R1_FB1_Msk   (0x1UL << CAN_F12R1_FB1_Pos)
 
#define CAN_F12R1_FB1   CAN_F12R1_FB1_Msk
 
#define CAN_F12R1_FB2_Pos   (2U)
 
#define CAN_F12R1_FB2_Msk   (0x1UL << CAN_F12R1_FB2_Pos)
 
#define CAN_F12R1_FB2   CAN_F12R1_FB2_Msk
 
#define CAN_F12R1_FB3_Pos   (3U)
 
#define CAN_F12R1_FB3_Msk   (0x1UL << CAN_F12R1_FB3_Pos)
 
#define CAN_F12R1_FB3   CAN_F12R1_FB3_Msk
 
#define CAN_F12R1_FB4_Pos   (4U)
 
#define CAN_F12R1_FB4_Msk   (0x1UL << CAN_F12R1_FB4_Pos)
 
#define CAN_F12R1_FB4   CAN_F12R1_FB4_Msk
 
#define CAN_F12R1_FB5_Pos   (5U)
 
#define CAN_F12R1_FB5_Msk   (0x1UL << CAN_F12R1_FB5_Pos)
 
#define CAN_F12R1_FB5   CAN_F12R1_FB5_Msk
 
#define CAN_F12R1_FB6_Pos   (6U)
 
#define CAN_F12R1_FB6_Msk   (0x1UL << CAN_F12R1_FB6_Pos)
 
#define CAN_F12R1_FB6   CAN_F12R1_FB6_Msk
 
#define CAN_F12R1_FB7_Pos   (7U)
 
#define CAN_F12R1_FB7_Msk   (0x1UL << CAN_F12R1_FB7_Pos)
 
#define CAN_F12R1_FB7   CAN_F12R1_FB7_Msk
 
#define CAN_F12R1_FB8_Pos   (8U)
 
#define CAN_F12R1_FB8_Msk   (0x1UL << CAN_F12R1_FB8_Pos)
 
#define CAN_F12R1_FB8   CAN_F12R1_FB8_Msk
 
#define CAN_F12R1_FB9_Pos   (9U)
 
#define CAN_F12R1_FB9_Msk   (0x1UL << CAN_F12R1_FB9_Pos)
 
#define CAN_F12R1_FB9   CAN_F12R1_FB9_Msk
 
#define CAN_F12R1_FB10_Pos   (10U)
 
#define CAN_F12R1_FB10_Msk   (0x1UL << CAN_F12R1_FB10_Pos)
 
#define CAN_F12R1_FB10   CAN_F12R1_FB10_Msk
 
#define CAN_F12R1_FB11_Pos   (11U)
 
#define CAN_F12R1_FB11_Msk   (0x1UL << CAN_F12R1_FB11_Pos)
 
#define CAN_F12R1_FB11   CAN_F12R1_FB11_Msk
 
#define CAN_F12R1_FB12_Pos   (12U)
 
#define CAN_F12R1_FB12_Msk   (0x1UL << CAN_F12R1_FB12_Pos)
 
#define CAN_F12R1_FB12   CAN_F12R1_FB12_Msk
 
#define CAN_F12R1_FB13_Pos   (13U)
 
#define CAN_F12R1_FB13_Msk   (0x1UL << CAN_F12R1_FB13_Pos)
 
#define CAN_F12R1_FB13   CAN_F12R1_FB13_Msk
 
#define CAN_F12R1_FB14_Pos   (14U)
 
#define CAN_F12R1_FB14_Msk   (0x1UL << CAN_F12R1_FB14_Pos)
 
#define CAN_F12R1_FB14   CAN_F12R1_FB14_Msk
 
#define CAN_F12R1_FB15_Pos   (15U)
 
#define CAN_F12R1_FB15_Msk   (0x1UL << CAN_F12R1_FB15_Pos)
 
#define CAN_F12R1_FB15   CAN_F12R1_FB15_Msk
 
#define CAN_F12R1_FB16_Pos   (16U)
 
#define CAN_F12R1_FB16_Msk   (0x1UL << CAN_F12R1_FB16_Pos)
 
#define CAN_F12R1_FB16   CAN_F12R1_FB16_Msk
 
#define CAN_F12R1_FB17_Pos   (17U)
 
#define CAN_F12R1_FB17_Msk   (0x1UL << CAN_F12R1_FB17_Pos)
 
#define CAN_F12R1_FB17   CAN_F12R1_FB17_Msk
 
#define CAN_F12R1_FB18_Pos   (18U)
 
#define CAN_F12R1_FB18_Msk   (0x1UL << CAN_F12R1_FB18_Pos)
 
#define CAN_F12R1_FB18   CAN_F12R1_FB18_Msk
 
#define CAN_F12R1_FB19_Pos   (19U)
 
#define CAN_F12R1_FB19_Msk   (0x1UL << CAN_F12R1_FB19_Pos)
 
#define CAN_F12R1_FB19   CAN_F12R1_FB19_Msk
 
#define CAN_F12R1_FB20_Pos   (20U)
 
#define CAN_F12R1_FB20_Msk   (0x1UL << CAN_F12R1_FB20_Pos)
 
#define CAN_F12R1_FB20   CAN_F12R1_FB20_Msk
 
#define CAN_F12R1_FB21_Pos   (21U)
 
#define CAN_F12R1_FB21_Msk   (0x1UL << CAN_F12R1_FB21_Pos)
 
#define CAN_F12R1_FB21   CAN_F12R1_FB21_Msk
 
#define CAN_F12R1_FB22_Pos   (22U)
 
#define CAN_F12R1_FB22_Msk   (0x1UL << CAN_F12R1_FB22_Pos)
 
#define CAN_F12R1_FB22   CAN_F12R1_FB22_Msk
 
#define CAN_F12R1_FB23_Pos   (23U)
 
#define CAN_F12R1_FB23_Msk   (0x1UL << CAN_F12R1_FB23_Pos)
 
#define CAN_F12R1_FB23   CAN_F12R1_FB23_Msk
 
#define CAN_F12R1_FB24_Pos   (24U)
 
#define CAN_F12R1_FB24_Msk   (0x1UL << CAN_F12R1_FB24_Pos)
 
#define CAN_F12R1_FB24   CAN_F12R1_FB24_Msk
 
#define CAN_F12R1_FB25_Pos   (25U)
 
#define CAN_F12R1_FB25_Msk   (0x1UL << CAN_F12R1_FB25_Pos)
 
#define CAN_F12R1_FB25   CAN_F12R1_FB25_Msk
 
#define CAN_F12R1_FB26_Pos   (26U)
 
#define CAN_F12R1_FB26_Msk   (0x1UL << CAN_F12R1_FB26_Pos)
 
#define CAN_F12R1_FB26   CAN_F12R1_FB26_Msk
 
#define CAN_F12R1_FB27_Pos   (27U)
 
#define CAN_F12R1_FB27_Msk   (0x1UL << CAN_F12R1_FB27_Pos)
 
#define CAN_F12R1_FB27   CAN_F12R1_FB27_Msk
 
#define CAN_F12R1_FB28_Pos   (28U)
 
#define CAN_F12R1_FB28_Msk   (0x1UL << CAN_F12R1_FB28_Pos)
 
#define CAN_F12R1_FB28   CAN_F12R1_FB28_Msk
 
#define CAN_F12R1_FB29_Pos   (29U)
 
#define CAN_F12R1_FB29_Msk   (0x1UL << CAN_F12R1_FB29_Pos)
 
#define CAN_F12R1_FB29   CAN_F12R1_FB29_Msk
 
#define CAN_F12R1_FB30_Pos   (30U)
 
#define CAN_F12R1_FB30_Msk   (0x1UL << CAN_F12R1_FB30_Pos)
 
#define CAN_F12R1_FB30   CAN_F12R1_FB30_Msk
 
#define CAN_F12R1_FB31_Pos   (31U)
 
#define CAN_F12R1_FB31_Msk   (0x1UL << CAN_F12R1_FB31_Pos)
 
#define CAN_F12R1_FB31   CAN_F12R1_FB31_Msk
 
#define CAN_F13R1_FB0_Pos   (0U)
 
#define CAN_F13R1_FB0_Msk   (0x1UL << CAN_F13R1_FB0_Pos)
 
#define CAN_F13R1_FB0   CAN_F13R1_FB0_Msk
 
#define CAN_F13R1_FB1_Pos   (1U)
 
#define CAN_F13R1_FB1_Msk   (0x1UL << CAN_F13R1_FB1_Pos)
 
#define CAN_F13R1_FB1   CAN_F13R1_FB1_Msk
 
#define CAN_F13R1_FB2_Pos   (2U)
 
#define CAN_F13R1_FB2_Msk   (0x1UL << CAN_F13R1_FB2_Pos)
 
#define CAN_F13R1_FB2   CAN_F13R1_FB2_Msk
 
#define CAN_F13R1_FB3_Pos   (3U)
 
#define CAN_F13R1_FB3_Msk   (0x1UL << CAN_F13R1_FB3_Pos)
 
#define CAN_F13R1_FB3   CAN_F13R1_FB3_Msk
 
#define CAN_F13R1_FB4_Pos   (4U)
 
#define CAN_F13R1_FB4_Msk   (0x1UL << CAN_F13R1_FB4_Pos)
 
#define CAN_F13R1_FB4   CAN_F13R1_FB4_Msk
 
#define CAN_F13R1_FB5_Pos   (5U)
 
#define CAN_F13R1_FB5_Msk   (0x1UL << CAN_F13R1_FB5_Pos)
 
#define CAN_F13R1_FB5   CAN_F13R1_FB5_Msk
 
#define CAN_F13R1_FB6_Pos   (6U)
 
#define CAN_F13R1_FB6_Msk   (0x1UL << CAN_F13R1_FB6_Pos)
 
#define CAN_F13R1_FB6   CAN_F13R1_FB6_Msk
 
#define CAN_F13R1_FB7_Pos   (7U)
 
#define CAN_F13R1_FB7_Msk   (0x1UL << CAN_F13R1_FB7_Pos)
 
#define CAN_F13R1_FB7   CAN_F13R1_FB7_Msk
 
#define CAN_F13R1_FB8_Pos   (8U)
 
#define CAN_F13R1_FB8_Msk   (0x1UL << CAN_F13R1_FB8_Pos)
 
#define CAN_F13R1_FB8   CAN_F13R1_FB8_Msk
 
#define CAN_F13R1_FB9_Pos   (9U)
 
#define CAN_F13R1_FB9_Msk   (0x1UL << CAN_F13R1_FB9_Pos)
 
#define CAN_F13R1_FB9   CAN_F13R1_FB9_Msk
 
#define CAN_F13R1_FB10_Pos   (10U)
 
#define CAN_F13R1_FB10_Msk   (0x1UL << CAN_F13R1_FB10_Pos)
 
#define CAN_F13R1_FB10   CAN_F13R1_FB10_Msk
 
#define CAN_F13R1_FB11_Pos   (11U)
 
#define CAN_F13R1_FB11_Msk   (0x1UL << CAN_F13R1_FB11_Pos)
 
#define CAN_F13R1_FB11   CAN_F13R1_FB11_Msk
 
#define CAN_F13R1_FB12_Pos   (12U)
 
#define CAN_F13R1_FB12_Msk   (0x1UL << CAN_F13R1_FB12_Pos)
 
#define CAN_F13R1_FB12   CAN_F13R1_FB12_Msk
 
#define CAN_F13R1_FB13_Pos   (13U)
 
#define CAN_F13R1_FB13_Msk   (0x1UL << CAN_F13R1_FB13_Pos)
 
#define CAN_F13R1_FB13   CAN_F13R1_FB13_Msk
 
#define CAN_F13R1_FB14_Pos   (14U)
 
#define CAN_F13R1_FB14_Msk   (0x1UL << CAN_F13R1_FB14_Pos)
 
#define CAN_F13R1_FB14   CAN_F13R1_FB14_Msk
 
#define CAN_F13R1_FB15_Pos   (15U)
 
#define CAN_F13R1_FB15_Msk   (0x1UL << CAN_F13R1_FB15_Pos)
 
#define CAN_F13R1_FB15   CAN_F13R1_FB15_Msk
 
#define CAN_F13R1_FB16_Pos   (16U)
 
#define CAN_F13R1_FB16_Msk   (0x1UL << CAN_F13R1_FB16_Pos)
 
#define CAN_F13R1_FB16   CAN_F13R1_FB16_Msk
 
#define CAN_F13R1_FB17_Pos   (17U)
 
#define CAN_F13R1_FB17_Msk   (0x1UL << CAN_F13R1_FB17_Pos)
 
#define CAN_F13R1_FB17   CAN_F13R1_FB17_Msk
 
#define CAN_F13R1_FB18_Pos   (18U)
 
#define CAN_F13R1_FB18_Msk   (0x1UL << CAN_F13R1_FB18_Pos)
 
#define CAN_F13R1_FB18   CAN_F13R1_FB18_Msk
 
#define CAN_F13R1_FB19_Pos   (19U)
 
#define CAN_F13R1_FB19_Msk   (0x1UL << CAN_F13R1_FB19_Pos)
 
#define CAN_F13R1_FB19   CAN_F13R1_FB19_Msk
 
#define CAN_F13R1_FB20_Pos   (20U)
 
#define CAN_F13R1_FB20_Msk   (0x1UL << CAN_F13R1_FB20_Pos)
 
#define CAN_F13R1_FB20   CAN_F13R1_FB20_Msk
 
#define CAN_F13R1_FB21_Pos   (21U)
 
#define CAN_F13R1_FB21_Msk   (0x1UL << CAN_F13R1_FB21_Pos)
 
#define CAN_F13R1_FB21   CAN_F13R1_FB21_Msk
 
#define CAN_F13R1_FB22_Pos   (22U)
 
#define CAN_F13R1_FB22_Msk   (0x1UL << CAN_F13R1_FB22_Pos)
 
#define CAN_F13R1_FB22   CAN_F13R1_FB22_Msk
 
#define CAN_F13R1_FB23_Pos   (23U)
 
#define CAN_F13R1_FB23_Msk   (0x1UL << CAN_F13R1_FB23_Pos)
 
#define CAN_F13R1_FB23   CAN_F13R1_FB23_Msk
 
#define CAN_F13R1_FB24_Pos   (24U)
 
#define CAN_F13R1_FB24_Msk   (0x1UL << CAN_F13R1_FB24_Pos)
 
#define CAN_F13R1_FB24   CAN_F13R1_FB24_Msk
 
#define CAN_F13R1_FB25_Pos   (25U)
 
#define CAN_F13R1_FB25_Msk   (0x1UL << CAN_F13R1_FB25_Pos)
 
#define CAN_F13R1_FB25   CAN_F13R1_FB25_Msk
 
#define CAN_F13R1_FB26_Pos   (26U)
 
#define CAN_F13R1_FB26_Msk   (0x1UL << CAN_F13R1_FB26_Pos)
 
#define CAN_F13R1_FB26   CAN_F13R1_FB26_Msk
 
#define CAN_F13R1_FB27_Pos   (27U)
 
#define CAN_F13R1_FB27_Msk   (0x1UL << CAN_F13R1_FB27_Pos)
 
#define CAN_F13R1_FB27   CAN_F13R1_FB27_Msk
 
#define CAN_F13R1_FB28_Pos   (28U)
 
#define CAN_F13R1_FB28_Msk   (0x1UL << CAN_F13R1_FB28_Pos)
 
#define CAN_F13R1_FB28   CAN_F13R1_FB28_Msk
 
#define CAN_F13R1_FB29_Pos   (29U)
 
#define CAN_F13R1_FB29_Msk   (0x1UL << CAN_F13R1_FB29_Pos)
 
#define CAN_F13R1_FB29   CAN_F13R1_FB29_Msk
 
#define CAN_F13R1_FB30_Pos   (30U)
 
#define CAN_F13R1_FB30_Msk   (0x1UL << CAN_F13R1_FB30_Pos)
 
#define CAN_F13R1_FB30   CAN_F13R1_FB30_Msk
 
#define CAN_F13R1_FB31_Pos   (31U)
 
#define CAN_F13R1_FB31_Msk   (0x1UL << CAN_F13R1_FB31_Pos)
 
#define CAN_F13R1_FB31   CAN_F13R1_FB31_Msk
 
#define CAN_F0R2_FB0_Pos   (0U)
 
#define CAN_F0R2_FB0_Msk   (0x1UL << CAN_F0R2_FB0_Pos)
 
#define CAN_F0R2_FB0   CAN_F0R2_FB0_Msk
 
#define CAN_F0R2_FB1_Pos   (1U)
 
#define CAN_F0R2_FB1_Msk   (0x1UL << CAN_F0R2_FB1_Pos)
 
#define CAN_F0R2_FB1   CAN_F0R2_FB1_Msk
 
#define CAN_F0R2_FB2_Pos   (2U)
 
#define CAN_F0R2_FB2_Msk   (0x1UL << CAN_F0R2_FB2_Pos)
 
#define CAN_F0R2_FB2   CAN_F0R2_FB2_Msk
 
#define CAN_F0R2_FB3_Pos   (3U)
 
#define CAN_F0R2_FB3_Msk   (0x1UL << CAN_F0R2_FB3_Pos)
 
#define CAN_F0R2_FB3   CAN_F0R2_FB3_Msk
 
#define CAN_F0R2_FB4_Pos   (4U)
 
#define CAN_F0R2_FB4_Msk   (0x1UL << CAN_F0R2_FB4_Pos)
 
#define CAN_F0R2_FB4   CAN_F0R2_FB4_Msk
 
#define CAN_F0R2_FB5_Pos   (5U)
 
#define CAN_F0R2_FB5_Msk   (0x1UL << CAN_F0R2_FB5_Pos)
 
#define CAN_F0R2_FB5   CAN_F0R2_FB5_Msk
 
#define CAN_F0R2_FB6_Pos   (6U)
 
#define CAN_F0R2_FB6_Msk   (0x1UL << CAN_F0R2_FB6_Pos)
 
#define CAN_F0R2_FB6   CAN_F0R2_FB6_Msk
 
#define CAN_F0R2_FB7_Pos   (7U)
 
#define CAN_F0R2_FB7_Msk   (0x1UL << CAN_F0R2_FB7_Pos)
 
#define CAN_F0R2_FB7   CAN_F0R2_FB7_Msk
 
#define CAN_F0R2_FB8_Pos   (8U)
 
#define CAN_F0R2_FB8_Msk   (0x1UL << CAN_F0R2_FB8_Pos)
 
#define CAN_F0R2_FB8   CAN_F0R2_FB8_Msk
 
#define CAN_F0R2_FB9_Pos   (9U)
 
#define CAN_F0R2_FB9_Msk   (0x1UL << CAN_F0R2_FB9_Pos)
 
#define CAN_F0R2_FB9   CAN_F0R2_FB9_Msk
 
#define CAN_F0R2_FB10_Pos   (10U)
 
#define CAN_F0R2_FB10_Msk   (0x1UL << CAN_F0R2_FB10_Pos)
 
#define CAN_F0R2_FB10   CAN_F0R2_FB10_Msk
 
#define CAN_F0R2_FB11_Pos   (11U)
 
#define CAN_F0R2_FB11_Msk   (0x1UL << CAN_F0R2_FB11_Pos)
 
#define CAN_F0R2_FB11   CAN_F0R2_FB11_Msk
 
#define CAN_F0R2_FB12_Pos   (12U)
 
#define CAN_F0R2_FB12_Msk   (0x1UL << CAN_F0R2_FB12_Pos)
 
#define CAN_F0R2_FB12   CAN_F0R2_FB12_Msk
 
#define CAN_F0R2_FB13_Pos   (13U)
 
#define CAN_F0R2_FB13_Msk   (0x1UL << CAN_F0R2_FB13_Pos)
 
#define CAN_F0R2_FB13   CAN_F0R2_FB13_Msk
 
#define CAN_F0R2_FB14_Pos   (14U)
 
#define CAN_F0R2_FB14_Msk   (0x1UL << CAN_F0R2_FB14_Pos)
 
#define CAN_F0R2_FB14   CAN_F0R2_FB14_Msk
 
#define CAN_F0R2_FB15_Pos   (15U)
 
#define CAN_F0R2_FB15_Msk   (0x1UL << CAN_F0R2_FB15_Pos)
 
#define CAN_F0R2_FB15   CAN_F0R2_FB15_Msk
 
#define CAN_F0R2_FB16_Pos   (16U)
 
#define CAN_F0R2_FB16_Msk   (0x1UL << CAN_F0R2_FB16_Pos)
 
#define CAN_F0R2_FB16   CAN_F0R2_FB16_Msk
 
#define CAN_F0R2_FB17_Pos   (17U)
 
#define CAN_F0R2_FB17_Msk   (0x1UL << CAN_F0R2_FB17_Pos)
 
#define CAN_F0R2_FB17   CAN_F0R2_FB17_Msk
 
#define CAN_F0R2_FB18_Pos   (18U)
 
#define CAN_F0R2_FB18_Msk   (0x1UL << CAN_F0R2_FB18_Pos)
 
#define CAN_F0R2_FB18   CAN_F0R2_FB18_Msk
 
#define CAN_F0R2_FB19_Pos   (19U)
 
#define CAN_F0R2_FB19_Msk   (0x1UL << CAN_F0R2_FB19_Pos)
 
#define CAN_F0R2_FB19   CAN_F0R2_FB19_Msk
 
#define CAN_F0R2_FB20_Pos   (20U)
 
#define CAN_F0R2_FB20_Msk   (0x1UL << CAN_F0R2_FB20_Pos)
 
#define CAN_F0R2_FB20   CAN_F0R2_FB20_Msk
 
#define CAN_F0R2_FB21_Pos   (21U)
 
#define CAN_F0R2_FB21_Msk   (0x1UL << CAN_F0R2_FB21_Pos)
 
#define CAN_F0R2_FB21   CAN_F0R2_FB21_Msk
 
#define CAN_F0R2_FB22_Pos   (22U)
 
#define CAN_F0R2_FB22_Msk   (0x1UL << CAN_F0R2_FB22_Pos)
 
#define CAN_F0R2_FB22   CAN_F0R2_FB22_Msk
 
#define CAN_F0R2_FB23_Pos   (23U)
 
#define CAN_F0R2_FB23_Msk   (0x1UL << CAN_F0R2_FB23_Pos)
 
#define CAN_F0R2_FB23   CAN_F0R2_FB23_Msk
 
#define CAN_F0R2_FB24_Pos   (24U)
 
#define CAN_F0R2_FB24_Msk   (0x1UL << CAN_F0R2_FB24_Pos)
 
#define CAN_F0R2_FB24   CAN_F0R2_FB24_Msk
 
#define CAN_F0R2_FB25_Pos   (25U)
 
#define CAN_F0R2_FB25_Msk   (0x1UL << CAN_F0R2_FB25_Pos)
 
#define CAN_F0R2_FB25   CAN_F0R2_FB25_Msk
 
#define CAN_F0R2_FB26_Pos   (26U)
 
#define CAN_F0R2_FB26_Msk   (0x1UL << CAN_F0R2_FB26_Pos)
 
#define CAN_F0R2_FB26   CAN_F0R2_FB26_Msk
 
#define CAN_F0R2_FB27_Pos   (27U)
 
#define CAN_F0R2_FB27_Msk   (0x1UL << CAN_F0R2_FB27_Pos)
 
#define CAN_F0R2_FB27   CAN_F0R2_FB27_Msk
 
#define CAN_F0R2_FB28_Pos   (28U)
 
#define CAN_F0R2_FB28_Msk   (0x1UL << CAN_F0R2_FB28_Pos)
 
#define CAN_F0R2_FB28   CAN_F0R2_FB28_Msk
 
#define CAN_F0R2_FB29_Pos   (29U)
 
#define CAN_F0R2_FB29_Msk   (0x1UL << CAN_F0R2_FB29_Pos)
 
#define CAN_F0R2_FB29   CAN_F0R2_FB29_Msk
 
#define CAN_F0R2_FB30_Pos   (30U)
 
#define CAN_F0R2_FB30_Msk   (0x1UL << CAN_F0R2_FB30_Pos)
 
#define CAN_F0R2_FB30   CAN_F0R2_FB30_Msk
 
#define CAN_F0R2_FB31_Pos   (31U)
 
#define CAN_F0R2_FB31_Msk   (0x1UL << CAN_F0R2_FB31_Pos)
 
#define CAN_F0R2_FB31   CAN_F0R2_FB31_Msk
 
#define CAN_F1R2_FB0_Pos   (0U)
 
#define CAN_F1R2_FB0_Msk   (0x1UL << CAN_F1R2_FB0_Pos)
 
#define CAN_F1R2_FB0   CAN_F1R2_FB0_Msk
 
#define CAN_F1R2_FB1_Pos   (1U)
 
#define CAN_F1R2_FB1_Msk   (0x1UL << CAN_F1R2_FB1_Pos)
 
#define CAN_F1R2_FB1   CAN_F1R2_FB1_Msk
 
#define CAN_F1R2_FB2_Pos   (2U)
 
#define CAN_F1R2_FB2_Msk   (0x1UL << CAN_F1R2_FB2_Pos)
 
#define CAN_F1R2_FB2   CAN_F1R2_FB2_Msk
 
#define CAN_F1R2_FB3_Pos   (3U)
 
#define CAN_F1R2_FB3_Msk   (0x1UL << CAN_F1R2_FB3_Pos)
 
#define CAN_F1R2_FB3   CAN_F1R2_FB3_Msk
 
#define CAN_F1R2_FB4_Pos   (4U)
 
#define CAN_F1R2_FB4_Msk   (0x1UL << CAN_F1R2_FB4_Pos)
 
#define CAN_F1R2_FB4   CAN_F1R2_FB4_Msk
 
#define CAN_F1R2_FB5_Pos   (5U)
 
#define CAN_F1R2_FB5_Msk   (0x1UL << CAN_F1R2_FB5_Pos)
 
#define CAN_F1R2_FB5   CAN_F1R2_FB5_Msk
 
#define CAN_F1R2_FB6_Pos   (6U)
 
#define CAN_F1R2_FB6_Msk   (0x1UL << CAN_F1R2_FB6_Pos)
 
#define CAN_F1R2_FB6   CAN_F1R2_FB6_Msk
 
#define CAN_F1R2_FB7_Pos   (7U)
 
#define CAN_F1R2_FB7_Msk   (0x1UL << CAN_F1R2_FB7_Pos)
 
#define CAN_F1R2_FB7   CAN_F1R2_FB7_Msk
 
#define CAN_F1R2_FB8_Pos   (8U)
 
#define CAN_F1R2_FB8_Msk   (0x1UL << CAN_F1R2_FB8_Pos)
 
#define CAN_F1R2_FB8   CAN_F1R2_FB8_Msk
 
#define CAN_F1R2_FB9_Pos   (9U)
 
#define CAN_F1R2_FB9_Msk   (0x1UL << CAN_F1R2_FB9_Pos)
 
#define CAN_F1R2_FB9   CAN_F1R2_FB9_Msk
 
#define CAN_F1R2_FB10_Pos   (10U)
 
#define CAN_F1R2_FB10_Msk   (0x1UL << CAN_F1R2_FB10_Pos)
 
#define CAN_F1R2_FB10   CAN_F1R2_FB10_Msk
 
#define CAN_F1R2_FB11_Pos   (11U)
 
#define CAN_F1R2_FB11_Msk   (0x1UL << CAN_F1R2_FB11_Pos)
 
#define CAN_F1R2_FB11   CAN_F1R2_FB11_Msk
 
#define CAN_F1R2_FB12_Pos   (12U)
 
#define CAN_F1R2_FB12_Msk   (0x1UL << CAN_F1R2_FB12_Pos)
 
#define CAN_F1R2_FB12   CAN_F1R2_FB12_Msk
 
#define CAN_F1R2_FB13_Pos   (13U)
 
#define CAN_F1R2_FB13_Msk   (0x1UL << CAN_F1R2_FB13_Pos)
 
#define CAN_F1R2_FB13   CAN_F1R2_FB13_Msk
 
#define CAN_F1R2_FB14_Pos   (14U)
 
#define CAN_F1R2_FB14_Msk   (0x1UL << CAN_F1R2_FB14_Pos)
 
#define CAN_F1R2_FB14   CAN_F1R2_FB14_Msk
 
#define CAN_F1R2_FB15_Pos   (15U)
 
#define CAN_F1R2_FB15_Msk   (0x1UL << CAN_F1R2_FB15_Pos)
 
#define CAN_F1R2_FB15   CAN_F1R2_FB15_Msk
 
#define CAN_F1R2_FB16_Pos   (16U)
 
#define CAN_F1R2_FB16_Msk   (0x1UL << CAN_F1R2_FB16_Pos)
 
#define CAN_F1R2_FB16   CAN_F1R2_FB16_Msk
 
#define CAN_F1R2_FB17_Pos   (17U)
 
#define CAN_F1R2_FB17_Msk   (0x1UL << CAN_F1R2_FB17_Pos)
 
#define CAN_F1R2_FB17   CAN_F1R2_FB17_Msk
 
#define CAN_F1R2_FB18_Pos   (18U)
 
#define CAN_F1R2_FB18_Msk   (0x1UL << CAN_F1R2_FB18_Pos)
 
#define CAN_F1R2_FB18   CAN_F1R2_FB18_Msk
 
#define CAN_F1R2_FB19_Pos   (19U)
 
#define CAN_F1R2_FB19_Msk   (0x1UL << CAN_F1R2_FB19_Pos)
 
#define CAN_F1R2_FB19   CAN_F1R2_FB19_Msk
 
#define CAN_F1R2_FB20_Pos   (20U)
 
#define CAN_F1R2_FB20_Msk   (0x1UL << CAN_F1R2_FB20_Pos)
 
#define CAN_F1R2_FB20   CAN_F1R2_FB20_Msk
 
#define CAN_F1R2_FB21_Pos   (21U)
 
#define CAN_F1R2_FB21_Msk   (0x1UL << CAN_F1R2_FB21_Pos)
 
#define CAN_F1R2_FB21   CAN_F1R2_FB21_Msk
 
#define CAN_F1R2_FB22_Pos   (22U)
 
#define CAN_F1R2_FB22_Msk   (0x1UL << CAN_F1R2_FB22_Pos)
 
#define CAN_F1R2_FB22   CAN_F1R2_FB22_Msk
 
#define CAN_F1R2_FB23_Pos   (23U)
 
#define CAN_F1R2_FB23_Msk   (0x1UL << CAN_F1R2_FB23_Pos)
 
#define CAN_F1R2_FB23   CAN_F1R2_FB23_Msk
 
#define CAN_F1R2_FB24_Pos   (24U)
 
#define CAN_F1R2_FB24_Msk   (0x1UL << CAN_F1R2_FB24_Pos)
 
#define CAN_F1R2_FB24   CAN_F1R2_FB24_Msk
 
#define CAN_F1R2_FB25_Pos   (25U)
 
#define CAN_F1R2_FB25_Msk   (0x1UL << CAN_F1R2_FB25_Pos)
 
#define CAN_F1R2_FB25   CAN_F1R2_FB25_Msk
 
#define CAN_F1R2_FB26_Pos   (26U)
 
#define CAN_F1R2_FB26_Msk   (0x1UL << CAN_F1R2_FB26_Pos)
 
#define CAN_F1R2_FB26   CAN_F1R2_FB26_Msk
 
#define CAN_F1R2_FB27_Pos   (27U)
 
#define CAN_F1R2_FB27_Msk   (0x1UL << CAN_F1R2_FB27_Pos)
 
#define CAN_F1R2_FB27   CAN_F1R2_FB27_Msk
 
#define CAN_F1R2_FB28_Pos   (28U)
 
#define CAN_F1R2_FB28_Msk   (0x1UL << CAN_F1R2_FB28_Pos)
 
#define CAN_F1R2_FB28   CAN_F1R2_FB28_Msk
 
#define CAN_F1R2_FB29_Pos   (29U)
 
#define CAN_F1R2_FB29_Msk   (0x1UL << CAN_F1R2_FB29_Pos)
 
#define CAN_F1R2_FB29   CAN_F1R2_FB29_Msk
 
#define CAN_F1R2_FB30_Pos   (30U)
 
#define CAN_F1R2_FB30_Msk   (0x1UL << CAN_F1R2_FB30_Pos)
 
#define CAN_F1R2_FB30   CAN_F1R2_FB30_Msk
 
#define CAN_F1R2_FB31_Pos   (31U)
 
#define CAN_F1R2_FB31_Msk   (0x1UL << CAN_F1R2_FB31_Pos)
 
#define CAN_F1R2_FB31   CAN_F1R2_FB31_Msk
 
#define CAN_F2R2_FB0_Pos   (0U)
 
#define CAN_F2R2_FB0_Msk   (0x1UL << CAN_F2R2_FB0_Pos)
 
#define CAN_F2R2_FB0   CAN_F2R2_FB0_Msk
 
#define CAN_F2R2_FB1_Pos   (1U)
 
#define CAN_F2R2_FB1_Msk   (0x1UL << CAN_F2R2_FB1_Pos)
 
#define CAN_F2R2_FB1   CAN_F2R2_FB1_Msk
 
#define CAN_F2R2_FB2_Pos   (2U)
 
#define CAN_F2R2_FB2_Msk   (0x1UL << CAN_F2R2_FB2_Pos)
 
#define CAN_F2R2_FB2   CAN_F2R2_FB2_Msk
 
#define CAN_F2R2_FB3_Pos   (3U)
 
#define CAN_F2R2_FB3_Msk   (0x1UL << CAN_F2R2_FB3_Pos)
 
#define CAN_F2R2_FB3   CAN_F2R2_FB3_Msk
 
#define CAN_F2R2_FB4_Pos   (4U)
 
#define CAN_F2R2_FB4_Msk   (0x1UL << CAN_F2R2_FB4_Pos)
 
#define CAN_F2R2_FB4   CAN_F2R2_FB4_Msk
 
#define CAN_F2R2_FB5_Pos   (5U)
 
#define CAN_F2R2_FB5_Msk   (0x1UL << CAN_F2R2_FB5_Pos)
 
#define CAN_F2R2_FB5   CAN_F2R2_FB5_Msk
 
#define CAN_F2R2_FB6_Pos   (6U)
 
#define CAN_F2R2_FB6_Msk   (0x1UL << CAN_F2R2_FB6_Pos)
 
#define CAN_F2R2_FB6   CAN_F2R2_FB6_Msk
 
#define CAN_F2R2_FB7_Pos   (7U)
 
#define CAN_F2R2_FB7_Msk   (0x1UL << CAN_F2R2_FB7_Pos)
 
#define CAN_F2R2_FB7   CAN_F2R2_FB7_Msk
 
#define CAN_F2R2_FB8_Pos   (8U)
 
#define CAN_F2R2_FB8_Msk   (0x1UL << CAN_F2R2_FB8_Pos)
 
#define CAN_F2R2_FB8   CAN_F2R2_FB8_Msk
 
#define CAN_F2R2_FB9_Pos   (9U)
 
#define CAN_F2R2_FB9_Msk   (0x1UL << CAN_F2R2_FB9_Pos)
 
#define CAN_F2R2_FB9   CAN_F2R2_FB9_Msk
 
#define CAN_F2R2_FB10_Pos   (10U)
 
#define CAN_F2R2_FB10_Msk   (0x1UL << CAN_F2R2_FB10_Pos)
 
#define CAN_F2R2_FB10   CAN_F2R2_FB10_Msk
 
#define CAN_F2R2_FB11_Pos   (11U)
 
#define CAN_F2R2_FB11_Msk   (0x1UL << CAN_F2R2_FB11_Pos)
 
#define CAN_F2R2_FB11   CAN_F2R2_FB11_Msk
 
#define CAN_F2R2_FB12_Pos   (12U)
 
#define CAN_F2R2_FB12_Msk   (0x1UL << CAN_F2R2_FB12_Pos)
 
#define CAN_F2R2_FB12   CAN_F2R2_FB12_Msk
 
#define CAN_F2R2_FB13_Pos   (13U)
 
#define CAN_F2R2_FB13_Msk   (0x1UL << CAN_F2R2_FB13_Pos)
 
#define CAN_F2R2_FB13   CAN_F2R2_FB13_Msk
 
#define CAN_F2R2_FB14_Pos   (14U)
 
#define CAN_F2R2_FB14_Msk   (0x1UL << CAN_F2R2_FB14_Pos)
 
#define CAN_F2R2_FB14   CAN_F2R2_FB14_Msk
 
#define CAN_F2R2_FB15_Pos   (15U)
 
#define CAN_F2R2_FB15_Msk   (0x1UL << CAN_F2R2_FB15_Pos)
 
#define CAN_F2R2_FB15   CAN_F2R2_FB15_Msk
 
#define CAN_F2R2_FB16_Pos   (16U)
 
#define CAN_F2R2_FB16_Msk   (0x1UL << CAN_F2R2_FB16_Pos)
 
#define CAN_F2R2_FB16   CAN_F2R2_FB16_Msk
 
#define CAN_F2R2_FB17_Pos   (17U)
 
#define CAN_F2R2_FB17_Msk   (0x1UL << CAN_F2R2_FB17_Pos)
 
#define CAN_F2R2_FB17   CAN_F2R2_FB17_Msk
 
#define CAN_F2R2_FB18_Pos   (18U)
 
#define CAN_F2R2_FB18_Msk   (0x1UL << CAN_F2R2_FB18_Pos)
 
#define CAN_F2R2_FB18   CAN_F2R2_FB18_Msk
 
#define CAN_F2R2_FB19_Pos   (19U)
 
#define CAN_F2R2_FB19_Msk   (0x1UL << CAN_F2R2_FB19_Pos)
 
#define CAN_F2R2_FB19   CAN_F2R2_FB19_Msk
 
#define CAN_F2R2_FB20_Pos   (20U)
 
#define CAN_F2R2_FB20_Msk   (0x1UL << CAN_F2R2_FB20_Pos)
 
#define CAN_F2R2_FB20   CAN_F2R2_FB20_Msk
 
#define CAN_F2R2_FB21_Pos   (21U)
 
#define CAN_F2R2_FB21_Msk   (0x1UL << CAN_F2R2_FB21_Pos)
 
#define CAN_F2R2_FB21   CAN_F2R2_FB21_Msk
 
#define CAN_F2R2_FB22_Pos   (22U)
 
#define CAN_F2R2_FB22_Msk   (0x1UL << CAN_F2R2_FB22_Pos)
 
#define CAN_F2R2_FB22   CAN_F2R2_FB22_Msk
 
#define CAN_F2R2_FB23_Pos   (23U)
 
#define CAN_F2R2_FB23_Msk   (0x1UL << CAN_F2R2_FB23_Pos)
 
#define CAN_F2R2_FB23   CAN_F2R2_FB23_Msk
 
#define CAN_F2R2_FB24_Pos   (24U)
 
#define CAN_F2R2_FB24_Msk   (0x1UL << CAN_F2R2_FB24_Pos)
 
#define CAN_F2R2_FB24   CAN_F2R2_FB24_Msk
 
#define CAN_F2R2_FB25_Pos   (25U)
 
#define CAN_F2R2_FB25_Msk   (0x1UL << CAN_F2R2_FB25_Pos)
 
#define CAN_F2R2_FB25   CAN_F2R2_FB25_Msk
 
#define CAN_F2R2_FB26_Pos   (26U)
 
#define CAN_F2R2_FB26_Msk   (0x1UL << CAN_F2R2_FB26_Pos)
 
#define CAN_F2R2_FB26   CAN_F2R2_FB26_Msk
 
#define CAN_F2R2_FB27_Pos   (27U)
 
#define CAN_F2R2_FB27_Msk   (0x1UL << CAN_F2R2_FB27_Pos)
 
#define CAN_F2R2_FB27   CAN_F2R2_FB27_Msk
 
#define CAN_F2R2_FB28_Pos   (28U)
 
#define CAN_F2R2_FB28_Msk   (0x1UL << CAN_F2R2_FB28_Pos)
 
#define CAN_F2R2_FB28   CAN_F2R2_FB28_Msk
 
#define CAN_F2R2_FB29_Pos   (29U)
 
#define CAN_F2R2_FB29_Msk   (0x1UL << CAN_F2R2_FB29_Pos)
 
#define CAN_F2R2_FB29   CAN_F2R2_FB29_Msk
 
#define CAN_F2R2_FB30_Pos   (30U)
 
#define CAN_F2R2_FB30_Msk   (0x1UL << CAN_F2R2_FB30_Pos)
 
#define CAN_F2R2_FB30   CAN_F2R2_FB30_Msk
 
#define CAN_F2R2_FB31_Pos   (31U)
 
#define CAN_F2R2_FB31_Msk   (0x1UL << CAN_F2R2_FB31_Pos)
 
#define CAN_F2R2_FB31   CAN_F2R2_FB31_Msk
 
#define CAN_F3R2_FB0_Pos   (0U)
 
#define CAN_F3R2_FB0_Msk   (0x1UL << CAN_F3R2_FB0_Pos)
 
#define CAN_F3R2_FB0   CAN_F3R2_FB0_Msk
 
#define CAN_F3R2_FB1_Pos   (1U)
 
#define CAN_F3R2_FB1_Msk   (0x1UL << CAN_F3R2_FB1_Pos)
 
#define CAN_F3R2_FB1   CAN_F3R2_FB1_Msk
 
#define CAN_F3R2_FB2_Pos   (2U)
 
#define CAN_F3R2_FB2_Msk   (0x1UL << CAN_F3R2_FB2_Pos)
 
#define CAN_F3R2_FB2   CAN_F3R2_FB2_Msk
 
#define CAN_F3R2_FB3_Pos   (3U)
 
#define CAN_F3R2_FB3_Msk   (0x1UL << CAN_F3R2_FB3_Pos)
 
#define CAN_F3R2_FB3   CAN_F3R2_FB3_Msk
 
#define CAN_F3R2_FB4_Pos   (4U)
 
#define CAN_F3R2_FB4_Msk   (0x1UL << CAN_F3R2_FB4_Pos)
 
#define CAN_F3R2_FB4   CAN_F3R2_FB4_Msk
 
#define CAN_F3R2_FB5_Pos   (5U)
 
#define CAN_F3R2_FB5_Msk   (0x1UL << CAN_F3R2_FB5_Pos)
 
#define CAN_F3R2_FB5   CAN_F3R2_FB5_Msk
 
#define CAN_F3R2_FB6_Pos   (6U)
 
#define CAN_F3R2_FB6_Msk   (0x1UL << CAN_F3R2_FB6_Pos)
 
#define CAN_F3R2_FB6   CAN_F3R2_FB6_Msk
 
#define CAN_F3R2_FB7_Pos   (7U)
 
#define CAN_F3R2_FB7_Msk   (0x1UL << CAN_F3R2_FB7_Pos)
 
#define CAN_F3R2_FB7   CAN_F3R2_FB7_Msk
 
#define CAN_F3R2_FB8_Pos   (8U)
 
#define CAN_F3R2_FB8_Msk   (0x1UL << CAN_F3R2_FB8_Pos)
 
#define CAN_F3R2_FB8   CAN_F3R2_FB8_Msk
 
#define CAN_F3R2_FB9_Pos   (9U)
 
#define CAN_F3R2_FB9_Msk   (0x1UL << CAN_F3R2_FB9_Pos)
 
#define CAN_F3R2_FB9   CAN_F3R2_FB9_Msk
 
#define CAN_F3R2_FB10_Pos   (10U)
 
#define CAN_F3R2_FB10_Msk   (0x1UL << CAN_F3R2_FB10_Pos)
 
#define CAN_F3R2_FB10   CAN_F3R2_FB10_Msk
 
#define CAN_F3R2_FB11_Pos   (11U)
 
#define CAN_F3R2_FB11_Msk   (0x1UL << CAN_F3R2_FB11_Pos)
 
#define CAN_F3R2_FB11   CAN_F3R2_FB11_Msk
 
#define CAN_F3R2_FB12_Pos   (12U)
 
#define CAN_F3R2_FB12_Msk   (0x1UL << CAN_F3R2_FB12_Pos)
 
#define CAN_F3R2_FB12   CAN_F3R2_FB12_Msk
 
#define CAN_F3R2_FB13_Pos   (13U)
 
#define CAN_F3R2_FB13_Msk   (0x1UL << CAN_F3R2_FB13_Pos)
 
#define CAN_F3R2_FB13   CAN_F3R2_FB13_Msk
 
#define CAN_F3R2_FB14_Pos   (14U)
 
#define CAN_F3R2_FB14_Msk   (0x1UL << CAN_F3R2_FB14_Pos)
 
#define CAN_F3R2_FB14   CAN_F3R2_FB14_Msk
 
#define CAN_F3R2_FB15_Pos   (15U)
 
#define CAN_F3R2_FB15_Msk   (0x1UL << CAN_F3R2_FB15_Pos)
 
#define CAN_F3R2_FB15   CAN_F3R2_FB15_Msk
 
#define CAN_F3R2_FB16_Pos   (16U)
 
#define CAN_F3R2_FB16_Msk   (0x1UL << CAN_F3R2_FB16_Pos)
 
#define CAN_F3R2_FB16   CAN_F3R2_FB16_Msk
 
#define CAN_F3R2_FB17_Pos   (17U)
 
#define CAN_F3R2_FB17_Msk   (0x1UL << CAN_F3R2_FB17_Pos)
 
#define CAN_F3R2_FB17   CAN_F3R2_FB17_Msk
 
#define CAN_F3R2_FB18_Pos   (18U)
 
#define CAN_F3R2_FB18_Msk   (0x1UL << CAN_F3R2_FB18_Pos)
 
#define CAN_F3R2_FB18   CAN_F3R2_FB18_Msk
 
#define CAN_F3R2_FB19_Pos   (19U)
 
#define CAN_F3R2_FB19_Msk   (0x1UL << CAN_F3R2_FB19_Pos)
 
#define CAN_F3R2_FB19   CAN_F3R2_FB19_Msk
 
#define CAN_F3R2_FB20_Pos   (20U)
 
#define CAN_F3R2_FB20_Msk   (0x1UL << CAN_F3R2_FB20_Pos)
 
#define CAN_F3R2_FB20   CAN_F3R2_FB20_Msk
 
#define CAN_F3R2_FB21_Pos   (21U)
 
#define CAN_F3R2_FB21_Msk   (0x1UL << CAN_F3R2_FB21_Pos)
 
#define CAN_F3R2_FB21   CAN_F3R2_FB21_Msk
 
#define CAN_F3R2_FB22_Pos   (22U)
 
#define CAN_F3R2_FB22_Msk   (0x1UL << CAN_F3R2_FB22_Pos)
 
#define CAN_F3R2_FB22   CAN_F3R2_FB22_Msk
 
#define CAN_F3R2_FB23_Pos   (23U)
 
#define CAN_F3R2_FB23_Msk   (0x1UL << CAN_F3R2_FB23_Pos)
 
#define CAN_F3R2_FB23   CAN_F3R2_FB23_Msk
 
#define CAN_F3R2_FB24_Pos   (24U)
 
#define CAN_F3R2_FB24_Msk   (0x1UL << CAN_F3R2_FB24_Pos)
 
#define CAN_F3R2_FB24   CAN_F3R2_FB24_Msk
 
#define CAN_F3R2_FB25_Pos   (25U)
 
#define CAN_F3R2_FB25_Msk   (0x1UL << CAN_F3R2_FB25_Pos)
 
#define CAN_F3R2_FB25   CAN_F3R2_FB25_Msk
 
#define CAN_F3R2_FB26_Pos   (26U)
 
#define CAN_F3R2_FB26_Msk   (0x1UL << CAN_F3R2_FB26_Pos)
 
#define CAN_F3R2_FB26   CAN_F3R2_FB26_Msk
 
#define CAN_F3R2_FB27_Pos   (27U)
 
#define CAN_F3R2_FB27_Msk   (0x1UL << CAN_F3R2_FB27_Pos)
 
#define CAN_F3R2_FB27   CAN_F3R2_FB27_Msk
 
#define CAN_F3R2_FB28_Pos   (28U)
 
#define CAN_F3R2_FB28_Msk   (0x1UL << CAN_F3R2_FB28_Pos)
 
#define CAN_F3R2_FB28   CAN_F3R2_FB28_Msk
 
#define CAN_F3R2_FB29_Pos   (29U)
 
#define CAN_F3R2_FB29_Msk   (0x1UL << CAN_F3R2_FB29_Pos)
 
#define CAN_F3R2_FB29   CAN_F3R2_FB29_Msk
 
#define CAN_F3R2_FB30_Pos   (30U)
 
#define CAN_F3R2_FB30_Msk   (0x1UL << CAN_F3R2_FB30_Pos)
 
#define CAN_F3R2_FB30   CAN_F3R2_FB30_Msk
 
#define CAN_F3R2_FB31_Pos   (31U)
 
#define CAN_F3R2_FB31_Msk   (0x1UL << CAN_F3R2_FB31_Pos)
 
#define CAN_F3R2_FB31   CAN_F3R2_FB31_Msk
 
#define CAN_F4R2_FB0_Pos   (0U)
 
#define CAN_F4R2_FB0_Msk   (0x1UL << CAN_F4R2_FB0_Pos)
 
#define CAN_F4R2_FB0   CAN_F4R2_FB0_Msk
 
#define CAN_F4R2_FB1_Pos   (1U)
 
#define CAN_F4R2_FB1_Msk   (0x1UL << CAN_F4R2_FB1_Pos)
 
#define CAN_F4R2_FB1   CAN_F4R2_FB1_Msk
 
#define CAN_F4R2_FB2_Pos   (2U)
 
#define CAN_F4R2_FB2_Msk   (0x1UL << CAN_F4R2_FB2_Pos)
 
#define CAN_F4R2_FB2   CAN_F4R2_FB2_Msk
 
#define CAN_F4R2_FB3_Pos   (3U)
 
#define CAN_F4R2_FB3_Msk   (0x1UL << CAN_F4R2_FB3_Pos)
 
#define CAN_F4R2_FB3   CAN_F4R2_FB3_Msk
 
#define CAN_F4R2_FB4_Pos   (4U)
 
#define CAN_F4R2_FB4_Msk   (0x1UL << CAN_F4R2_FB4_Pos)
 
#define CAN_F4R2_FB4   CAN_F4R2_FB4_Msk
 
#define CAN_F4R2_FB5_Pos   (5U)
 
#define CAN_F4R2_FB5_Msk   (0x1UL << CAN_F4R2_FB5_Pos)
 
#define CAN_F4R2_FB5   CAN_F4R2_FB5_Msk
 
#define CAN_F4R2_FB6_Pos   (6U)
 
#define CAN_F4R2_FB6_Msk   (0x1UL << CAN_F4R2_FB6_Pos)
 
#define CAN_F4R2_FB6   CAN_F4R2_FB6_Msk
 
#define CAN_F4R2_FB7_Pos   (7U)
 
#define CAN_F4R2_FB7_Msk   (0x1UL << CAN_F4R2_FB7_Pos)
 
#define CAN_F4R2_FB7   CAN_F4R2_FB7_Msk
 
#define CAN_F4R2_FB8_Pos   (8U)
 
#define CAN_F4R2_FB8_Msk   (0x1UL << CAN_F4R2_FB8_Pos)
 
#define CAN_F4R2_FB8   CAN_F4R2_FB8_Msk
 
#define CAN_F4R2_FB9_Pos   (9U)
 
#define CAN_F4R2_FB9_Msk   (0x1UL << CAN_F4R2_FB9_Pos)
 
#define CAN_F4R2_FB9   CAN_F4R2_FB9_Msk
 
#define CAN_F4R2_FB10_Pos   (10U)
 
#define CAN_F4R2_FB10_Msk   (0x1UL << CAN_F4R2_FB10_Pos)
 
#define CAN_F4R2_FB10   CAN_F4R2_FB10_Msk
 
#define CAN_F4R2_FB11_Pos   (11U)
 
#define CAN_F4R2_FB11_Msk   (0x1UL << CAN_F4R2_FB11_Pos)
 
#define CAN_F4R2_FB11   CAN_F4R2_FB11_Msk
 
#define CAN_F4R2_FB12_Pos   (12U)
 
#define CAN_F4R2_FB12_Msk   (0x1UL << CAN_F4R2_FB12_Pos)
 
#define CAN_F4R2_FB12   CAN_F4R2_FB12_Msk
 
#define CAN_F4R2_FB13_Pos   (13U)
 
#define CAN_F4R2_FB13_Msk   (0x1UL << CAN_F4R2_FB13_Pos)
 
#define CAN_F4R2_FB13   CAN_F4R2_FB13_Msk
 
#define CAN_F4R2_FB14_Pos   (14U)
 
#define CAN_F4R2_FB14_Msk   (0x1UL << CAN_F4R2_FB14_Pos)
 
#define CAN_F4R2_FB14   CAN_F4R2_FB14_Msk
 
#define CAN_F4R2_FB15_Pos   (15U)
 
#define CAN_F4R2_FB15_Msk   (0x1UL << CAN_F4R2_FB15_Pos)
 
#define CAN_F4R2_FB15   CAN_F4R2_FB15_Msk
 
#define CAN_F4R2_FB16_Pos   (16U)
 
#define CAN_F4R2_FB16_Msk   (0x1UL << CAN_F4R2_FB16_Pos)
 
#define CAN_F4R2_FB16   CAN_F4R2_FB16_Msk
 
#define CAN_F4R2_FB17_Pos   (17U)
 
#define CAN_F4R2_FB17_Msk   (0x1UL << CAN_F4R2_FB17_Pos)
 
#define CAN_F4R2_FB17   CAN_F4R2_FB17_Msk
 
#define CAN_F4R2_FB18_Pos   (18U)
 
#define CAN_F4R2_FB18_Msk   (0x1UL << CAN_F4R2_FB18_Pos)
 
#define CAN_F4R2_FB18   CAN_F4R2_FB18_Msk
 
#define CAN_F4R2_FB19_Pos   (19U)
 
#define CAN_F4R2_FB19_Msk   (0x1UL << CAN_F4R2_FB19_Pos)
 
#define CAN_F4R2_FB19   CAN_F4R2_FB19_Msk
 
#define CAN_F4R2_FB20_Pos   (20U)
 
#define CAN_F4R2_FB20_Msk   (0x1UL << CAN_F4R2_FB20_Pos)
 
#define CAN_F4R2_FB20   CAN_F4R2_FB20_Msk
 
#define CAN_F4R2_FB21_Pos   (21U)
 
#define CAN_F4R2_FB21_Msk   (0x1UL << CAN_F4R2_FB21_Pos)
 
#define CAN_F4R2_FB21   CAN_F4R2_FB21_Msk
 
#define CAN_F4R2_FB22_Pos   (22U)
 
#define CAN_F4R2_FB22_Msk   (0x1UL << CAN_F4R2_FB22_Pos)
 
#define CAN_F4R2_FB22   CAN_F4R2_FB22_Msk
 
#define CAN_F4R2_FB23_Pos   (23U)
 
#define CAN_F4R2_FB23_Msk   (0x1UL << CAN_F4R2_FB23_Pos)
 
#define CAN_F4R2_FB23   CAN_F4R2_FB23_Msk
 
#define CAN_F4R2_FB24_Pos   (24U)
 
#define CAN_F4R2_FB24_Msk   (0x1UL << CAN_F4R2_FB24_Pos)
 
#define CAN_F4R2_FB24   CAN_F4R2_FB24_Msk
 
#define CAN_F4R2_FB25_Pos   (25U)
 
#define CAN_F4R2_FB25_Msk   (0x1UL << CAN_F4R2_FB25_Pos)
 
#define CAN_F4R2_FB25   CAN_F4R2_FB25_Msk
 
#define CAN_F4R2_FB26_Pos   (26U)
 
#define CAN_F4R2_FB26_Msk   (0x1UL << CAN_F4R2_FB26_Pos)
 
#define CAN_F4R2_FB26   CAN_F4R2_FB26_Msk
 
#define CAN_F4R2_FB27_Pos   (27U)
 
#define CAN_F4R2_FB27_Msk   (0x1UL << CAN_F4R2_FB27_Pos)
 
#define CAN_F4R2_FB27   CAN_F4R2_FB27_Msk
 
#define CAN_F4R2_FB28_Pos   (28U)
 
#define CAN_F4R2_FB28_Msk   (0x1UL << CAN_F4R2_FB28_Pos)
 
#define CAN_F4R2_FB28   CAN_F4R2_FB28_Msk
 
#define CAN_F4R2_FB29_Pos   (29U)
 
#define CAN_F4R2_FB29_Msk   (0x1UL << CAN_F4R2_FB29_Pos)
 
#define CAN_F4R2_FB29   CAN_F4R2_FB29_Msk
 
#define CAN_F4R2_FB30_Pos   (30U)
 
#define CAN_F4R2_FB30_Msk   (0x1UL << CAN_F4R2_FB30_Pos)
 
#define CAN_F4R2_FB30   CAN_F4R2_FB30_Msk
 
#define CAN_F4R2_FB31_Pos   (31U)
 
#define CAN_F4R2_FB31_Msk   (0x1UL << CAN_F4R2_FB31_Pos)
 
#define CAN_F4R2_FB31   CAN_F4R2_FB31_Msk
 
#define CAN_F5R2_FB0_Pos   (0U)
 
#define CAN_F5R2_FB0_Msk   (0x1UL << CAN_F5R2_FB0_Pos)
 
#define CAN_F5R2_FB0   CAN_F5R2_FB0_Msk
 
#define CAN_F5R2_FB1_Pos   (1U)
 
#define CAN_F5R2_FB1_Msk   (0x1UL << CAN_F5R2_FB1_Pos)
 
#define CAN_F5R2_FB1   CAN_F5R2_FB1_Msk
 
#define CAN_F5R2_FB2_Pos   (2U)
 
#define CAN_F5R2_FB2_Msk   (0x1UL << CAN_F5R2_FB2_Pos)
 
#define CAN_F5R2_FB2   CAN_F5R2_FB2_Msk
 
#define CAN_F5R2_FB3_Pos   (3U)
 
#define CAN_F5R2_FB3_Msk   (0x1UL << CAN_F5R2_FB3_Pos)
 
#define CAN_F5R2_FB3   CAN_F5R2_FB3_Msk
 
#define CAN_F5R2_FB4_Pos   (4U)
 
#define CAN_F5R2_FB4_Msk   (0x1UL << CAN_F5R2_FB4_Pos)
 
#define CAN_F5R2_FB4   CAN_F5R2_FB4_Msk
 
#define CAN_F5R2_FB5_Pos   (5U)
 
#define CAN_F5R2_FB5_Msk   (0x1UL << CAN_F5R2_FB5_Pos)
 
#define CAN_F5R2_FB5   CAN_F5R2_FB5_Msk
 
#define CAN_F5R2_FB6_Pos   (6U)
 
#define CAN_F5R2_FB6_Msk   (0x1UL << CAN_F5R2_FB6_Pos)
 
#define CAN_F5R2_FB6   CAN_F5R2_FB6_Msk
 
#define CAN_F5R2_FB7_Pos   (7U)
 
#define CAN_F5R2_FB7_Msk   (0x1UL << CAN_F5R2_FB7_Pos)
 
#define CAN_F5R2_FB7   CAN_F5R2_FB7_Msk
 
#define CAN_F5R2_FB8_Pos   (8U)
 
#define CAN_F5R2_FB8_Msk   (0x1UL << CAN_F5R2_FB8_Pos)
 
#define CAN_F5R2_FB8   CAN_F5R2_FB8_Msk
 
#define CAN_F5R2_FB9_Pos   (9U)
 
#define CAN_F5R2_FB9_Msk   (0x1UL << CAN_F5R2_FB9_Pos)
 
#define CAN_F5R2_FB9   CAN_F5R2_FB9_Msk
 
#define CAN_F5R2_FB10_Pos   (10U)
 
#define CAN_F5R2_FB10_Msk   (0x1UL << CAN_F5R2_FB10_Pos)
 
#define CAN_F5R2_FB10   CAN_F5R2_FB10_Msk
 
#define CAN_F5R2_FB11_Pos   (11U)
 
#define CAN_F5R2_FB11_Msk   (0x1UL << CAN_F5R2_FB11_Pos)
 
#define CAN_F5R2_FB11   CAN_F5R2_FB11_Msk
 
#define CAN_F5R2_FB12_Pos   (12U)
 
#define CAN_F5R2_FB12_Msk   (0x1UL << CAN_F5R2_FB12_Pos)
 
#define CAN_F5R2_FB12   CAN_F5R2_FB12_Msk
 
#define CAN_F5R2_FB13_Pos   (13U)
 
#define CAN_F5R2_FB13_Msk   (0x1UL << CAN_F5R2_FB13_Pos)
 
#define CAN_F5R2_FB13   CAN_F5R2_FB13_Msk
 
#define CAN_F5R2_FB14_Pos   (14U)
 
#define CAN_F5R2_FB14_Msk   (0x1UL << CAN_F5R2_FB14_Pos)
 
#define CAN_F5R2_FB14   CAN_F5R2_FB14_Msk
 
#define CAN_F5R2_FB15_Pos   (15U)
 
#define CAN_F5R2_FB15_Msk   (0x1UL << CAN_F5R2_FB15_Pos)
 
#define CAN_F5R2_FB15   CAN_F5R2_FB15_Msk
 
#define CAN_F5R2_FB16_Pos   (16U)
 
#define CAN_F5R2_FB16_Msk   (0x1UL << CAN_F5R2_FB16_Pos)
 
#define CAN_F5R2_FB16   CAN_F5R2_FB16_Msk
 
#define CAN_F5R2_FB17_Pos   (17U)
 
#define CAN_F5R2_FB17_Msk   (0x1UL << CAN_F5R2_FB17_Pos)
 
#define CAN_F5R2_FB17   CAN_F5R2_FB17_Msk
 
#define CAN_F5R2_FB18_Pos   (18U)
 
#define CAN_F5R2_FB18_Msk   (0x1UL << CAN_F5R2_FB18_Pos)
 
#define CAN_F5R2_FB18   CAN_F5R2_FB18_Msk
 
#define CAN_F5R2_FB19_Pos   (19U)
 
#define CAN_F5R2_FB19_Msk   (0x1UL << CAN_F5R2_FB19_Pos)
 
#define CAN_F5R2_FB19   CAN_F5R2_FB19_Msk
 
#define CAN_F5R2_FB20_Pos   (20U)
 
#define CAN_F5R2_FB20_Msk   (0x1UL << CAN_F5R2_FB20_Pos)
 
#define CAN_F5R2_FB20   CAN_F5R2_FB20_Msk
 
#define CAN_F5R2_FB21_Pos   (21U)
 
#define CAN_F5R2_FB21_Msk   (0x1UL << CAN_F5R2_FB21_Pos)
 
#define CAN_F5R2_FB21   CAN_F5R2_FB21_Msk
 
#define CAN_F5R2_FB22_Pos   (22U)
 
#define CAN_F5R2_FB22_Msk   (0x1UL << CAN_F5R2_FB22_Pos)
 
#define CAN_F5R2_FB22   CAN_F5R2_FB22_Msk
 
#define CAN_F5R2_FB23_Pos   (23U)
 
#define CAN_F5R2_FB23_Msk   (0x1UL << CAN_F5R2_FB23_Pos)
 
#define CAN_F5R2_FB23   CAN_F5R2_FB23_Msk
 
#define CAN_F5R2_FB24_Pos   (24U)
 
#define CAN_F5R2_FB24_Msk   (0x1UL << CAN_F5R2_FB24_Pos)
 
#define CAN_F5R2_FB24   CAN_F5R2_FB24_Msk
 
#define CAN_F5R2_FB25_Pos   (25U)
 
#define CAN_F5R2_FB25_Msk   (0x1UL << CAN_F5R2_FB25_Pos)
 
#define CAN_F5R2_FB25   CAN_F5R2_FB25_Msk
 
#define CAN_F5R2_FB26_Pos   (26U)
 
#define CAN_F5R2_FB26_Msk   (0x1UL << CAN_F5R2_FB26_Pos)
 
#define CAN_F5R2_FB26   CAN_F5R2_FB26_Msk
 
#define CAN_F5R2_FB27_Pos   (27U)
 
#define CAN_F5R2_FB27_Msk   (0x1UL << CAN_F5R2_FB27_Pos)
 
#define CAN_F5R2_FB27   CAN_F5R2_FB27_Msk
 
#define CAN_F5R2_FB28_Pos   (28U)
 
#define CAN_F5R2_FB28_Msk   (0x1UL << CAN_F5R2_FB28_Pos)
 
#define CAN_F5R2_FB28   CAN_F5R2_FB28_Msk
 
#define CAN_F5R2_FB29_Pos   (29U)
 
#define CAN_F5R2_FB29_Msk   (0x1UL << CAN_F5R2_FB29_Pos)
 
#define CAN_F5R2_FB29   CAN_F5R2_FB29_Msk
 
#define CAN_F5R2_FB30_Pos   (30U)
 
#define CAN_F5R2_FB30_Msk   (0x1UL << CAN_F5R2_FB30_Pos)
 
#define CAN_F5R2_FB30   CAN_F5R2_FB30_Msk
 
#define CAN_F5R2_FB31_Pos   (31U)
 
#define CAN_F5R2_FB31_Msk   (0x1UL << CAN_F5R2_FB31_Pos)
 
#define CAN_F5R2_FB31   CAN_F5R2_FB31_Msk
 
#define CAN_F6R2_FB0_Pos   (0U)
 
#define CAN_F6R2_FB0_Msk   (0x1UL << CAN_F6R2_FB0_Pos)
 
#define CAN_F6R2_FB0   CAN_F6R2_FB0_Msk
 
#define CAN_F6R2_FB1_Pos   (1U)
 
#define CAN_F6R2_FB1_Msk   (0x1UL << CAN_F6R2_FB1_Pos)
 
#define CAN_F6R2_FB1   CAN_F6R2_FB1_Msk
 
#define CAN_F6R2_FB2_Pos   (2U)
 
#define CAN_F6R2_FB2_Msk   (0x1UL << CAN_F6R2_FB2_Pos)
 
#define CAN_F6R2_FB2   CAN_F6R2_FB2_Msk
 
#define CAN_F6R2_FB3_Pos   (3U)
 
#define CAN_F6R2_FB3_Msk   (0x1UL << CAN_F6R2_FB3_Pos)
 
#define CAN_F6R2_FB3   CAN_F6R2_FB3_Msk
 
#define CAN_F6R2_FB4_Pos   (4U)
 
#define CAN_F6R2_FB4_Msk   (0x1UL << CAN_F6R2_FB4_Pos)
 
#define CAN_F6R2_FB4   CAN_F6R2_FB4_Msk
 
#define CAN_F6R2_FB5_Pos   (5U)
 
#define CAN_F6R2_FB5_Msk   (0x1UL << CAN_F6R2_FB5_Pos)
 
#define CAN_F6R2_FB5   CAN_F6R2_FB5_Msk
 
#define CAN_F6R2_FB6_Pos   (6U)
 
#define CAN_F6R2_FB6_Msk   (0x1UL << CAN_F6R2_FB6_Pos)
 
#define CAN_F6R2_FB6   CAN_F6R2_FB6_Msk
 
#define CAN_F6R2_FB7_Pos   (7U)
 
#define CAN_F6R2_FB7_Msk   (0x1UL << CAN_F6R2_FB7_Pos)
 
#define CAN_F6R2_FB7   CAN_F6R2_FB7_Msk
 
#define CAN_F6R2_FB8_Pos   (8U)
 
#define CAN_F6R2_FB8_Msk   (0x1UL << CAN_F6R2_FB8_Pos)
 
#define CAN_F6R2_FB8   CAN_F6R2_FB8_Msk
 
#define CAN_F6R2_FB9_Pos   (9U)
 
#define CAN_F6R2_FB9_Msk   (0x1UL << CAN_F6R2_FB9_Pos)
 
#define CAN_F6R2_FB9   CAN_F6R2_FB9_Msk
 
#define CAN_F6R2_FB10_Pos   (10U)
 
#define CAN_F6R2_FB10_Msk   (0x1UL << CAN_F6R2_FB10_Pos)
 
#define CAN_F6R2_FB10   CAN_F6R2_FB10_Msk
 
#define CAN_F6R2_FB11_Pos   (11U)
 
#define CAN_F6R2_FB11_Msk   (0x1UL << CAN_F6R2_FB11_Pos)
 
#define CAN_F6R2_FB11   CAN_F6R2_FB11_Msk
 
#define CAN_F6R2_FB12_Pos   (12U)
 
#define CAN_F6R2_FB12_Msk   (0x1UL << CAN_F6R2_FB12_Pos)
 
#define CAN_F6R2_FB12   CAN_F6R2_FB12_Msk
 
#define CAN_F6R2_FB13_Pos   (13U)
 
#define CAN_F6R2_FB13_Msk   (0x1UL << CAN_F6R2_FB13_Pos)
 
#define CAN_F6R2_FB13   CAN_F6R2_FB13_Msk
 
#define CAN_F6R2_FB14_Pos   (14U)
 
#define CAN_F6R2_FB14_Msk   (0x1UL << CAN_F6R2_FB14_Pos)
 
#define CAN_F6R2_FB14   CAN_F6R2_FB14_Msk
 
#define CAN_F6R2_FB15_Pos   (15U)
 
#define CAN_F6R2_FB15_Msk   (0x1UL << CAN_F6R2_FB15_Pos)
 
#define CAN_F6R2_FB15   CAN_F6R2_FB15_Msk
 
#define CAN_F6R2_FB16_Pos   (16U)
 
#define CAN_F6R2_FB16_Msk   (0x1UL << CAN_F6R2_FB16_Pos)
 
#define CAN_F6R2_FB16   CAN_F6R2_FB16_Msk
 
#define CAN_F6R2_FB17_Pos   (17U)
 
#define CAN_F6R2_FB17_Msk   (0x1UL << CAN_F6R2_FB17_Pos)
 
#define CAN_F6R2_FB17   CAN_F6R2_FB17_Msk
 
#define CAN_F6R2_FB18_Pos   (18U)
 
#define CAN_F6R2_FB18_Msk   (0x1UL << CAN_F6R2_FB18_Pos)
 
#define CAN_F6R2_FB18   CAN_F6R2_FB18_Msk
 
#define CAN_F6R2_FB19_Pos   (19U)
 
#define CAN_F6R2_FB19_Msk   (0x1UL << CAN_F6R2_FB19_Pos)
 
#define CAN_F6R2_FB19   CAN_F6R2_FB19_Msk
 
#define CAN_F6R2_FB20_Pos   (20U)
 
#define CAN_F6R2_FB20_Msk   (0x1UL << CAN_F6R2_FB20_Pos)
 
#define CAN_F6R2_FB20   CAN_F6R2_FB20_Msk
 
#define CAN_F6R2_FB21_Pos   (21U)
 
#define CAN_F6R2_FB21_Msk   (0x1UL << CAN_F6R2_FB21_Pos)
 
#define CAN_F6R2_FB21   CAN_F6R2_FB21_Msk
 
#define CAN_F6R2_FB22_Pos   (22U)
 
#define CAN_F6R2_FB22_Msk   (0x1UL << CAN_F6R2_FB22_Pos)
 
#define CAN_F6R2_FB22   CAN_F6R2_FB22_Msk
 
#define CAN_F6R2_FB23_Pos   (23U)
 
#define CAN_F6R2_FB23_Msk   (0x1UL << CAN_F6R2_FB23_Pos)
 
#define CAN_F6R2_FB23   CAN_F6R2_FB23_Msk
 
#define CAN_F6R2_FB24_Pos   (24U)
 
#define CAN_F6R2_FB24_Msk   (0x1UL << CAN_F6R2_FB24_Pos)
 
#define CAN_F6R2_FB24   CAN_F6R2_FB24_Msk
 
#define CAN_F6R2_FB25_Pos   (25U)
 
#define CAN_F6R2_FB25_Msk   (0x1UL << CAN_F6R2_FB25_Pos)
 
#define CAN_F6R2_FB25   CAN_F6R2_FB25_Msk
 
#define CAN_F6R2_FB26_Pos   (26U)
 
#define CAN_F6R2_FB26_Msk   (0x1UL << CAN_F6R2_FB26_Pos)
 
#define CAN_F6R2_FB26   CAN_F6R2_FB26_Msk
 
#define CAN_F6R2_FB27_Pos   (27U)
 
#define CAN_F6R2_FB27_Msk   (0x1UL << CAN_F6R2_FB27_Pos)
 
#define CAN_F6R2_FB27   CAN_F6R2_FB27_Msk
 
#define CAN_F6R2_FB28_Pos   (28U)
 
#define CAN_F6R2_FB28_Msk   (0x1UL << CAN_F6R2_FB28_Pos)
 
#define CAN_F6R2_FB28   CAN_F6R2_FB28_Msk
 
#define CAN_F6R2_FB29_Pos   (29U)
 
#define CAN_F6R2_FB29_Msk   (0x1UL << CAN_F6R2_FB29_Pos)
 
#define CAN_F6R2_FB29   CAN_F6R2_FB29_Msk
 
#define CAN_F6R2_FB30_Pos   (30U)
 
#define CAN_F6R2_FB30_Msk   (0x1UL << CAN_F6R2_FB30_Pos)
 
#define CAN_F6R2_FB30   CAN_F6R2_FB30_Msk
 
#define CAN_F6R2_FB31_Pos   (31U)
 
#define CAN_F6R2_FB31_Msk   (0x1UL << CAN_F6R2_FB31_Pos)
 
#define CAN_F6R2_FB31   CAN_F6R2_FB31_Msk
 
#define CAN_F7R2_FB0_Pos   (0U)
 
#define CAN_F7R2_FB0_Msk   (0x1UL << CAN_F7R2_FB0_Pos)
 
#define CAN_F7R2_FB0   CAN_F7R2_FB0_Msk
 
#define CAN_F7R2_FB1_Pos   (1U)
 
#define CAN_F7R2_FB1_Msk   (0x1UL << CAN_F7R2_FB1_Pos)
 
#define CAN_F7R2_FB1   CAN_F7R2_FB1_Msk
 
#define CAN_F7R2_FB2_Pos   (2U)
 
#define CAN_F7R2_FB2_Msk   (0x1UL << CAN_F7R2_FB2_Pos)
 
#define CAN_F7R2_FB2   CAN_F7R2_FB2_Msk
 
#define CAN_F7R2_FB3_Pos   (3U)
 
#define CAN_F7R2_FB3_Msk   (0x1UL << CAN_F7R2_FB3_Pos)
 
#define CAN_F7R2_FB3   CAN_F7R2_FB3_Msk
 
#define CAN_F7R2_FB4_Pos   (4U)
 
#define CAN_F7R2_FB4_Msk   (0x1UL << CAN_F7R2_FB4_Pos)
 
#define CAN_F7R2_FB4   CAN_F7R2_FB4_Msk
 
#define CAN_F7R2_FB5_Pos   (5U)
 
#define CAN_F7R2_FB5_Msk   (0x1UL << CAN_F7R2_FB5_Pos)
 
#define CAN_F7R2_FB5   CAN_F7R2_FB5_Msk
 
#define CAN_F7R2_FB6_Pos   (6U)
 
#define CAN_F7R2_FB6_Msk   (0x1UL << CAN_F7R2_FB6_Pos)
 
#define CAN_F7R2_FB6   CAN_F7R2_FB6_Msk
 
#define CAN_F7R2_FB7_Pos   (7U)
 
#define CAN_F7R2_FB7_Msk   (0x1UL << CAN_F7R2_FB7_Pos)
 
#define CAN_F7R2_FB7   CAN_F7R2_FB7_Msk
 
#define CAN_F7R2_FB8_Pos   (8U)
 
#define CAN_F7R2_FB8_Msk   (0x1UL << CAN_F7R2_FB8_Pos)
 
#define CAN_F7R2_FB8   CAN_F7R2_FB8_Msk
 
#define CAN_F7R2_FB9_Pos   (9U)
 
#define CAN_F7R2_FB9_Msk   (0x1UL << CAN_F7R2_FB9_Pos)
 
#define CAN_F7R2_FB9   CAN_F7R2_FB9_Msk
 
#define CAN_F7R2_FB10_Pos   (10U)
 
#define CAN_F7R2_FB10_Msk   (0x1UL << CAN_F7R2_FB10_Pos)
 
#define CAN_F7R2_FB10   CAN_F7R2_FB10_Msk
 
#define CAN_F7R2_FB11_Pos   (11U)
 
#define CAN_F7R2_FB11_Msk   (0x1UL << CAN_F7R2_FB11_Pos)
 
#define CAN_F7R2_FB11   CAN_F7R2_FB11_Msk
 
#define CAN_F7R2_FB12_Pos   (12U)
 
#define CAN_F7R2_FB12_Msk   (0x1UL << CAN_F7R2_FB12_Pos)
 
#define CAN_F7R2_FB12   CAN_F7R2_FB12_Msk
 
#define CAN_F7R2_FB13_Pos   (13U)
 
#define CAN_F7R2_FB13_Msk   (0x1UL << CAN_F7R2_FB13_Pos)
 
#define CAN_F7R2_FB13   CAN_F7R2_FB13_Msk
 
#define CAN_F7R2_FB14_Pos   (14U)
 
#define CAN_F7R2_FB14_Msk   (0x1UL << CAN_F7R2_FB14_Pos)
 
#define CAN_F7R2_FB14   CAN_F7R2_FB14_Msk
 
#define CAN_F7R2_FB15_Pos   (15U)
 
#define CAN_F7R2_FB15_Msk   (0x1UL << CAN_F7R2_FB15_Pos)
 
#define CAN_F7R2_FB15   CAN_F7R2_FB15_Msk
 
#define CAN_F7R2_FB16_Pos   (16U)
 
#define CAN_F7R2_FB16_Msk   (0x1UL << CAN_F7R2_FB16_Pos)
 
#define CAN_F7R2_FB16   CAN_F7R2_FB16_Msk
 
#define CAN_F7R2_FB17_Pos   (17U)
 
#define CAN_F7R2_FB17_Msk   (0x1UL << CAN_F7R2_FB17_Pos)
 
#define CAN_F7R2_FB17   CAN_F7R2_FB17_Msk
 
#define CAN_F7R2_FB18_Pos   (18U)
 
#define CAN_F7R2_FB18_Msk   (0x1UL << CAN_F7R2_FB18_Pos)
 
#define CAN_F7R2_FB18   CAN_F7R2_FB18_Msk
 
#define CAN_F7R2_FB19_Pos   (19U)
 
#define CAN_F7R2_FB19_Msk   (0x1UL << CAN_F7R2_FB19_Pos)
 
#define CAN_F7R2_FB19   CAN_F7R2_FB19_Msk
 
#define CAN_F7R2_FB20_Pos   (20U)
 
#define CAN_F7R2_FB20_Msk   (0x1UL << CAN_F7R2_FB20_Pos)
 
#define CAN_F7R2_FB20   CAN_F7R2_FB20_Msk
 
#define CAN_F7R2_FB21_Pos   (21U)
 
#define CAN_F7R2_FB21_Msk   (0x1UL << CAN_F7R2_FB21_Pos)
 
#define CAN_F7R2_FB21   CAN_F7R2_FB21_Msk
 
#define CAN_F7R2_FB22_Pos   (22U)
 
#define CAN_F7R2_FB22_Msk   (0x1UL << CAN_F7R2_FB22_Pos)
 
#define CAN_F7R2_FB22   CAN_F7R2_FB22_Msk
 
#define CAN_F7R2_FB23_Pos   (23U)
 
#define CAN_F7R2_FB23_Msk   (0x1UL << CAN_F7R2_FB23_Pos)
 
#define CAN_F7R2_FB23   CAN_F7R2_FB23_Msk
 
#define CAN_F7R2_FB24_Pos   (24U)
 
#define CAN_F7R2_FB24_Msk   (0x1UL << CAN_F7R2_FB24_Pos)
 
#define CAN_F7R2_FB24   CAN_F7R2_FB24_Msk
 
#define CAN_F7R2_FB25_Pos   (25U)
 
#define CAN_F7R2_FB25_Msk   (0x1UL << CAN_F7R2_FB25_Pos)
 
#define CAN_F7R2_FB25   CAN_F7R2_FB25_Msk
 
#define CAN_F7R2_FB26_Pos   (26U)
 
#define CAN_F7R2_FB26_Msk   (0x1UL << CAN_F7R2_FB26_Pos)
 
#define CAN_F7R2_FB26   CAN_F7R2_FB26_Msk
 
#define CAN_F7R2_FB27_Pos   (27U)
 
#define CAN_F7R2_FB27_Msk   (0x1UL << CAN_F7R2_FB27_Pos)
 
#define CAN_F7R2_FB27   CAN_F7R2_FB27_Msk
 
#define CAN_F7R2_FB28_Pos   (28U)
 
#define CAN_F7R2_FB28_Msk   (0x1UL << CAN_F7R2_FB28_Pos)
 
#define CAN_F7R2_FB28   CAN_F7R2_FB28_Msk
 
#define CAN_F7R2_FB29_Pos   (29U)
 
#define CAN_F7R2_FB29_Msk   (0x1UL << CAN_F7R2_FB29_Pos)
 
#define CAN_F7R2_FB29   CAN_F7R2_FB29_Msk
 
#define CAN_F7R2_FB30_Pos   (30U)
 
#define CAN_F7R2_FB30_Msk   (0x1UL << CAN_F7R2_FB30_Pos)
 
#define CAN_F7R2_FB30   CAN_F7R2_FB30_Msk
 
#define CAN_F7R2_FB31_Pos   (31U)
 
#define CAN_F7R2_FB31_Msk   (0x1UL << CAN_F7R2_FB31_Pos)
 
#define CAN_F7R2_FB31   CAN_F7R2_FB31_Msk
 
#define CAN_F8R2_FB0_Pos   (0U)
 
#define CAN_F8R2_FB0_Msk   (0x1UL << CAN_F8R2_FB0_Pos)
 
#define CAN_F8R2_FB0   CAN_F8R2_FB0_Msk
 
#define CAN_F8R2_FB1_Pos   (1U)
 
#define CAN_F8R2_FB1_Msk   (0x1UL << CAN_F8R2_FB1_Pos)
 
#define CAN_F8R2_FB1   CAN_F8R2_FB1_Msk
 
#define CAN_F8R2_FB2_Pos   (2U)
 
#define CAN_F8R2_FB2_Msk   (0x1UL << CAN_F8R2_FB2_Pos)
 
#define CAN_F8R2_FB2   CAN_F8R2_FB2_Msk
 
#define CAN_F8R2_FB3_Pos   (3U)
 
#define CAN_F8R2_FB3_Msk   (0x1UL << CAN_F8R2_FB3_Pos)
 
#define CAN_F8R2_FB3   CAN_F8R2_FB3_Msk
 
#define CAN_F8R2_FB4_Pos   (4U)
 
#define CAN_F8R2_FB4_Msk   (0x1UL << CAN_F8R2_FB4_Pos)
 
#define CAN_F8R2_FB4   CAN_F8R2_FB4_Msk
 
#define CAN_F8R2_FB5_Pos   (5U)
 
#define CAN_F8R2_FB5_Msk   (0x1UL << CAN_F8R2_FB5_Pos)
 
#define CAN_F8R2_FB5   CAN_F8R2_FB5_Msk
 
#define CAN_F8R2_FB6_Pos   (6U)
 
#define CAN_F8R2_FB6_Msk   (0x1UL << CAN_F8R2_FB6_Pos)
 
#define CAN_F8R2_FB6   CAN_F8R2_FB6_Msk
 
#define CAN_F8R2_FB7_Pos   (7U)
 
#define CAN_F8R2_FB7_Msk   (0x1UL << CAN_F8R2_FB7_Pos)
 
#define CAN_F8R2_FB7   CAN_F8R2_FB7_Msk
 
#define CAN_F8R2_FB8_Pos   (8U)
 
#define CAN_F8R2_FB8_Msk   (0x1UL << CAN_F8R2_FB8_Pos)
 
#define CAN_F8R2_FB8   CAN_F8R2_FB8_Msk
 
#define CAN_F8R2_FB9_Pos   (9U)
 
#define CAN_F8R2_FB9_Msk   (0x1UL << CAN_F8R2_FB9_Pos)
 
#define CAN_F8R2_FB9   CAN_F8R2_FB9_Msk
 
#define CAN_F8R2_FB10_Pos   (10U)
 
#define CAN_F8R2_FB10_Msk   (0x1UL << CAN_F8R2_FB10_Pos)
 
#define CAN_F8R2_FB10   CAN_F8R2_FB10_Msk
 
#define CAN_F8R2_FB11_Pos   (11U)
 
#define CAN_F8R2_FB11_Msk   (0x1UL << CAN_F8R2_FB11_Pos)
 
#define CAN_F8R2_FB11   CAN_F8R2_FB11_Msk
 
#define CAN_F8R2_FB12_Pos   (12U)
 
#define CAN_F8R2_FB12_Msk   (0x1UL << CAN_F8R2_FB12_Pos)
 
#define CAN_F8R2_FB12   CAN_F8R2_FB12_Msk
 
#define CAN_F8R2_FB13_Pos   (13U)
 
#define CAN_F8R2_FB13_Msk   (0x1UL << CAN_F8R2_FB13_Pos)
 
#define CAN_F8R2_FB13   CAN_F8R2_FB13_Msk
 
#define CAN_F8R2_FB14_Pos   (14U)
 
#define CAN_F8R2_FB14_Msk   (0x1UL << CAN_F8R2_FB14_Pos)
 
#define CAN_F8R2_FB14   CAN_F8R2_FB14_Msk
 
#define CAN_F8R2_FB15_Pos   (15U)
 
#define CAN_F8R2_FB15_Msk   (0x1UL << CAN_F8R2_FB15_Pos)
 
#define CAN_F8R2_FB15   CAN_F8R2_FB15_Msk
 
#define CAN_F8R2_FB16_Pos   (16U)
 
#define CAN_F8R2_FB16_Msk   (0x1UL << CAN_F8R2_FB16_Pos)
 
#define CAN_F8R2_FB16   CAN_F8R2_FB16_Msk
 
#define CAN_F8R2_FB17_Pos   (17U)
 
#define CAN_F8R2_FB17_Msk   (0x1UL << CAN_F8R2_FB17_Pos)
 
#define CAN_F8R2_FB17   CAN_F8R2_FB17_Msk
 
#define CAN_F8R2_FB18_Pos   (18U)
 
#define CAN_F8R2_FB18_Msk   (0x1UL << CAN_F8R2_FB18_Pos)
 
#define CAN_F8R2_FB18   CAN_F8R2_FB18_Msk
 
#define CAN_F8R2_FB19_Pos   (19U)
 
#define CAN_F8R2_FB19_Msk   (0x1UL << CAN_F8R2_FB19_Pos)
 
#define CAN_F8R2_FB19   CAN_F8R2_FB19_Msk
 
#define CAN_F8R2_FB20_Pos   (20U)
 
#define CAN_F8R2_FB20_Msk   (0x1UL << CAN_F8R2_FB20_Pos)
 
#define CAN_F8R2_FB20   CAN_F8R2_FB20_Msk
 
#define CAN_F8R2_FB21_Pos   (21U)
 
#define CAN_F8R2_FB21_Msk   (0x1UL << CAN_F8R2_FB21_Pos)
 
#define CAN_F8R2_FB21   CAN_F8R2_FB21_Msk
 
#define CAN_F8R2_FB22_Pos   (22U)
 
#define CAN_F8R2_FB22_Msk   (0x1UL << CAN_F8R2_FB22_Pos)
 
#define CAN_F8R2_FB22   CAN_F8R2_FB22_Msk
 
#define CAN_F8R2_FB23_Pos   (23U)
 
#define CAN_F8R2_FB23_Msk   (0x1UL << CAN_F8R2_FB23_Pos)
 
#define CAN_F8R2_FB23   CAN_F8R2_FB23_Msk
 
#define CAN_F8R2_FB24_Pos   (24U)
 
#define CAN_F8R2_FB24_Msk   (0x1UL << CAN_F8R2_FB24_Pos)
 
#define CAN_F8R2_FB24   CAN_F8R2_FB24_Msk
 
#define CAN_F8R2_FB25_Pos   (25U)
 
#define CAN_F8R2_FB25_Msk   (0x1UL << CAN_F8R2_FB25_Pos)
 
#define CAN_F8R2_FB25   CAN_F8R2_FB25_Msk
 
#define CAN_F8R2_FB26_Pos   (26U)
 
#define CAN_F8R2_FB26_Msk   (0x1UL << CAN_F8R2_FB26_Pos)
 
#define CAN_F8R2_FB26   CAN_F8R2_FB26_Msk
 
#define CAN_F8R2_FB27_Pos   (27U)
 
#define CAN_F8R2_FB27_Msk   (0x1UL << CAN_F8R2_FB27_Pos)
 
#define CAN_F8R2_FB27   CAN_F8R2_FB27_Msk
 
#define CAN_F8R2_FB28_Pos   (28U)
 
#define CAN_F8R2_FB28_Msk   (0x1UL << CAN_F8R2_FB28_Pos)
 
#define CAN_F8R2_FB28   CAN_F8R2_FB28_Msk
 
#define CAN_F8R2_FB29_Pos   (29U)
 
#define CAN_F8R2_FB29_Msk   (0x1UL << CAN_F8R2_FB29_Pos)
 
#define CAN_F8R2_FB29   CAN_F8R2_FB29_Msk
 
#define CAN_F8R2_FB30_Pos   (30U)
 
#define CAN_F8R2_FB30_Msk   (0x1UL << CAN_F8R2_FB30_Pos)
 
#define CAN_F8R2_FB30   CAN_F8R2_FB30_Msk
 
#define CAN_F8R2_FB31_Pos   (31U)
 
#define CAN_F8R2_FB31_Msk   (0x1UL << CAN_F8R2_FB31_Pos)
 
#define CAN_F8R2_FB31   CAN_F8R2_FB31_Msk
 
#define CAN_F9R2_FB0_Pos   (0U)
 
#define CAN_F9R2_FB0_Msk   (0x1UL << CAN_F9R2_FB0_Pos)
 
#define CAN_F9R2_FB0   CAN_F9R2_FB0_Msk
 
#define CAN_F9R2_FB1_Pos   (1U)
 
#define CAN_F9R2_FB1_Msk   (0x1UL << CAN_F9R2_FB1_Pos)
 
#define CAN_F9R2_FB1   CAN_F9R2_FB1_Msk
 
#define CAN_F9R2_FB2_Pos   (2U)
 
#define CAN_F9R2_FB2_Msk   (0x1UL << CAN_F9R2_FB2_Pos)
 
#define CAN_F9R2_FB2   CAN_F9R2_FB2_Msk
 
#define CAN_F9R2_FB3_Pos   (3U)
 
#define CAN_F9R2_FB3_Msk   (0x1UL << CAN_F9R2_FB3_Pos)
 
#define CAN_F9R2_FB3   CAN_F9R2_FB3_Msk
 
#define CAN_F9R2_FB4_Pos   (4U)
 
#define CAN_F9R2_FB4_Msk   (0x1UL << CAN_F9R2_FB4_Pos)
 
#define CAN_F9R2_FB4   CAN_F9R2_FB4_Msk
 
#define CAN_F9R2_FB5_Pos   (5U)
 
#define CAN_F9R2_FB5_Msk   (0x1UL << CAN_F9R2_FB5_Pos)
 
#define CAN_F9R2_FB5   CAN_F9R2_FB5_Msk
 
#define CAN_F9R2_FB6_Pos   (6U)
 
#define CAN_F9R2_FB6_Msk   (0x1UL << CAN_F9R2_FB6_Pos)
 
#define CAN_F9R2_FB6   CAN_F9R2_FB6_Msk
 
#define CAN_F9R2_FB7_Pos   (7U)
 
#define CAN_F9R2_FB7_Msk   (0x1UL << CAN_F9R2_FB7_Pos)
 
#define CAN_F9R2_FB7   CAN_F9R2_FB7_Msk
 
#define CAN_F9R2_FB8_Pos   (8U)
 
#define CAN_F9R2_FB8_Msk   (0x1UL << CAN_F9R2_FB8_Pos)
 
#define CAN_F9R2_FB8   CAN_F9R2_FB8_Msk
 
#define CAN_F9R2_FB9_Pos   (9U)
 
#define CAN_F9R2_FB9_Msk   (0x1UL << CAN_F9R2_FB9_Pos)
 
#define CAN_F9R2_FB9   CAN_F9R2_FB9_Msk
 
#define CAN_F9R2_FB10_Pos   (10U)
 
#define CAN_F9R2_FB10_Msk   (0x1UL << CAN_F9R2_FB10_Pos)
 
#define CAN_F9R2_FB10   CAN_F9R2_FB10_Msk
 
#define CAN_F9R2_FB11_Pos   (11U)
 
#define CAN_F9R2_FB11_Msk   (0x1UL << CAN_F9R2_FB11_Pos)
 
#define CAN_F9R2_FB11   CAN_F9R2_FB11_Msk
 
#define CAN_F9R2_FB12_Pos   (12U)
 
#define CAN_F9R2_FB12_Msk   (0x1UL << CAN_F9R2_FB12_Pos)
 
#define CAN_F9R2_FB12   CAN_F9R2_FB12_Msk
 
#define CAN_F9R2_FB13_Pos   (13U)
 
#define CAN_F9R2_FB13_Msk   (0x1UL << CAN_F9R2_FB13_Pos)
 
#define CAN_F9R2_FB13   CAN_F9R2_FB13_Msk
 
#define CAN_F9R2_FB14_Pos   (14U)
 
#define CAN_F9R2_FB14_Msk   (0x1UL << CAN_F9R2_FB14_Pos)
 
#define CAN_F9R2_FB14   CAN_F9R2_FB14_Msk
 
#define CAN_F9R2_FB15_Pos   (15U)
 
#define CAN_F9R2_FB15_Msk   (0x1UL << CAN_F9R2_FB15_Pos)
 
#define CAN_F9R2_FB15   CAN_F9R2_FB15_Msk
 
#define CAN_F9R2_FB16_Pos   (16U)
 
#define CAN_F9R2_FB16_Msk   (0x1UL << CAN_F9R2_FB16_Pos)
 
#define CAN_F9R2_FB16   CAN_F9R2_FB16_Msk
 
#define CAN_F9R2_FB17_Pos   (17U)
 
#define CAN_F9R2_FB17_Msk   (0x1UL << CAN_F9R2_FB17_Pos)
 
#define CAN_F9R2_FB17   CAN_F9R2_FB17_Msk
 
#define CAN_F9R2_FB18_Pos   (18U)
 
#define CAN_F9R2_FB18_Msk   (0x1UL << CAN_F9R2_FB18_Pos)
 
#define CAN_F9R2_FB18   CAN_F9R2_FB18_Msk
 
#define CAN_F9R2_FB19_Pos   (19U)
 
#define CAN_F9R2_FB19_Msk   (0x1UL << CAN_F9R2_FB19_Pos)
 
#define CAN_F9R2_FB19   CAN_F9R2_FB19_Msk
 
#define CAN_F9R2_FB20_Pos   (20U)
 
#define CAN_F9R2_FB20_Msk   (0x1UL << CAN_F9R2_FB20_Pos)
 
#define CAN_F9R2_FB20   CAN_F9R2_FB20_Msk
 
#define CAN_F9R2_FB21_Pos   (21U)
 
#define CAN_F9R2_FB21_Msk   (0x1UL << CAN_F9R2_FB21_Pos)
 
#define CAN_F9R2_FB21   CAN_F9R2_FB21_Msk
 
#define CAN_F9R2_FB22_Pos   (22U)
 
#define CAN_F9R2_FB22_Msk   (0x1UL << CAN_F9R2_FB22_Pos)
 
#define CAN_F9R2_FB22   CAN_F9R2_FB22_Msk
 
#define CAN_F9R2_FB23_Pos   (23U)
 
#define CAN_F9R2_FB23_Msk   (0x1UL << CAN_F9R2_FB23_Pos)
 
#define CAN_F9R2_FB23   CAN_F9R2_FB23_Msk
 
#define CAN_F9R2_FB24_Pos   (24U)
 
#define CAN_F9R2_FB24_Msk   (0x1UL << CAN_F9R2_FB24_Pos)
 
#define CAN_F9R2_FB24   CAN_F9R2_FB24_Msk
 
#define CAN_F9R2_FB25_Pos   (25U)
 
#define CAN_F9R2_FB25_Msk   (0x1UL << CAN_F9R2_FB25_Pos)
 
#define CAN_F9R2_FB25   CAN_F9R2_FB25_Msk
 
#define CAN_F9R2_FB26_Pos   (26U)
 
#define CAN_F9R2_FB26_Msk   (0x1UL << CAN_F9R2_FB26_Pos)
 
#define CAN_F9R2_FB26   CAN_F9R2_FB26_Msk
 
#define CAN_F9R2_FB27_Pos   (27U)
 
#define CAN_F9R2_FB27_Msk   (0x1UL << CAN_F9R2_FB27_Pos)
 
#define CAN_F9R2_FB27   CAN_F9R2_FB27_Msk
 
#define CAN_F9R2_FB28_Pos   (28U)
 
#define CAN_F9R2_FB28_Msk   (0x1UL << CAN_F9R2_FB28_Pos)
 
#define CAN_F9R2_FB28   CAN_F9R2_FB28_Msk
 
#define CAN_F9R2_FB29_Pos   (29U)
 
#define CAN_F9R2_FB29_Msk   (0x1UL << CAN_F9R2_FB29_Pos)
 
#define CAN_F9R2_FB29   CAN_F9R2_FB29_Msk
 
#define CAN_F9R2_FB30_Pos   (30U)
 
#define CAN_F9R2_FB30_Msk   (0x1UL << CAN_F9R2_FB30_Pos)
 
#define CAN_F9R2_FB30   CAN_F9R2_FB30_Msk
 
#define CAN_F9R2_FB31_Pos   (31U)
 
#define CAN_F9R2_FB31_Msk   (0x1UL << CAN_F9R2_FB31_Pos)
 
#define CAN_F9R2_FB31   CAN_F9R2_FB31_Msk
 
#define CAN_F10R2_FB0_Pos   (0U)
 
#define CAN_F10R2_FB0_Msk   (0x1UL << CAN_F10R2_FB0_Pos)
 
#define CAN_F10R2_FB0   CAN_F10R2_FB0_Msk
 
#define CAN_F10R2_FB1_Pos   (1U)
 
#define CAN_F10R2_FB1_Msk   (0x1UL << CAN_F10R2_FB1_Pos)
 
#define CAN_F10R2_FB1   CAN_F10R2_FB1_Msk
 
#define CAN_F10R2_FB2_Pos   (2U)
 
#define CAN_F10R2_FB2_Msk   (0x1UL << CAN_F10R2_FB2_Pos)
 
#define CAN_F10R2_FB2   CAN_F10R2_FB2_Msk
 
#define CAN_F10R2_FB3_Pos   (3U)
 
#define CAN_F10R2_FB3_Msk   (0x1UL << CAN_F10R2_FB3_Pos)
 
#define CAN_F10R2_FB3   CAN_F10R2_FB3_Msk
 
#define CAN_F10R2_FB4_Pos   (4U)
 
#define CAN_F10R2_FB4_Msk   (0x1UL << CAN_F10R2_FB4_Pos)
 
#define CAN_F10R2_FB4   CAN_F10R2_FB4_Msk
 
#define CAN_F10R2_FB5_Pos   (5U)
 
#define CAN_F10R2_FB5_Msk   (0x1UL << CAN_F10R2_FB5_Pos)
 
#define CAN_F10R2_FB5   CAN_F10R2_FB5_Msk
 
#define CAN_F10R2_FB6_Pos   (6U)
 
#define CAN_F10R2_FB6_Msk   (0x1UL << CAN_F10R2_FB6_Pos)
 
#define CAN_F10R2_FB6   CAN_F10R2_FB6_Msk
 
#define CAN_F10R2_FB7_Pos   (7U)
 
#define CAN_F10R2_FB7_Msk   (0x1UL << CAN_F10R2_FB7_Pos)
 
#define CAN_F10R2_FB7   CAN_F10R2_FB7_Msk
 
#define CAN_F10R2_FB8_Pos   (8U)
 
#define CAN_F10R2_FB8_Msk   (0x1UL << CAN_F10R2_FB8_Pos)
 
#define CAN_F10R2_FB8   CAN_F10R2_FB8_Msk
 
#define CAN_F10R2_FB9_Pos   (9U)
 
#define CAN_F10R2_FB9_Msk   (0x1UL << CAN_F10R2_FB9_Pos)
 
#define CAN_F10R2_FB9   CAN_F10R2_FB9_Msk
 
#define CAN_F10R2_FB10_Pos   (10U)
 
#define CAN_F10R2_FB10_Msk   (0x1UL << CAN_F10R2_FB10_Pos)
 
#define CAN_F10R2_FB10   CAN_F10R2_FB10_Msk
 
#define CAN_F10R2_FB11_Pos   (11U)
 
#define CAN_F10R2_FB11_Msk   (0x1UL << CAN_F10R2_FB11_Pos)
 
#define CAN_F10R2_FB11   CAN_F10R2_FB11_Msk
 
#define CAN_F10R2_FB12_Pos   (12U)
 
#define CAN_F10R2_FB12_Msk   (0x1UL << CAN_F10R2_FB12_Pos)
 
#define CAN_F10R2_FB12   CAN_F10R2_FB12_Msk
 
#define CAN_F10R2_FB13_Pos   (13U)
 
#define CAN_F10R2_FB13_Msk   (0x1UL << CAN_F10R2_FB13_Pos)
 
#define CAN_F10R2_FB13   CAN_F10R2_FB13_Msk
 
#define CAN_F10R2_FB14_Pos   (14U)
 
#define CAN_F10R2_FB14_Msk   (0x1UL << CAN_F10R2_FB14_Pos)
 
#define CAN_F10R2_FB14   CAN_F10R2_FB14_Msk
 
#define CAN_F10R2_FB15_Pos   (15U)
 
#define CAN_F10R2_FB15_Msk   (0x1UL << CAN_F10R2_FB15_Pos)
 
#define CAN_F10R2_FB15   CAN_F10R2_FB15_Msk
 
#define CAN_F10R2_FB16_Pos   (16U)
 
#define CAN_F10R2_FB16_Msk   (0x1UL << CAN_F10R2_FB16_Pos)
 
#define CAN_F10R2_FB16   CAN_F10R2_FB16_Msk
 
#define CAN_F10R2_FB17_Pos   (17U)
 
#define CAN_F10R2_FB17_Msk   (0x1UL << CAN_F10R2_FB17_Pos)
 
#define CAN_F10R2_FB17   CAN_F10R2_FB17_Msk
 
#define CAN_F10R2_FB18_Pos   (18U)
 
#define CAN_F10R2_FB18_Msk   (0x1UL << CAN_F10R2_FB18_Pos)
 
#define CAN_F10R2_FB18   CAN_F10R2_FB18_Msk
 
#define CAN_F10R2_FB19_Pos   (19U)
 
#define CAN_F10R2_FB19_Msk   (0x1UL << CAN_F10R2_FB19_Pos)
 
#define CAN_F10R2_FB19   CAN_F10R2_FB19_Msk
 
#define CAN_F10R2_FB20_Pos   (20U)
 
#define CAN_F10R2_FB20_Msk   (0x1UL << CAN_F10R2_FB20_Pos)
 
#define CAN_F10R2_FB20   CAN_F10R2_FB20_Msk
 
#define CAN_F10R2_FB21_Pos   (21U)
 
#define CAN_F10R2_FB21_Msk   (0x1UL << CAN_F10R2_FB21_Pos)
 
#define CAN_F10R2_FB21   CAN_F10R2_FB21_Msk
 
#define CAN_F10R2_FB22_Pos   (22U)
 
#define CAN_F10R2_FB22_Msk   (0x1UL << CAN_F10R2_FB22_Pos)
 
#define CAN_F10R2_FB22   CAN_F10R2_FB22_Msk
 
#define CAN_F10R2_FB23_Pos   (23U)
 
#define CAN_F10R2_FB23_Msk   (0x1UL << CAN_F10R2_FB23_Pos)
 
#define CAN_F10R2_FB23   CAN_F10R2_FB23_Msk
 
#define CAN_F10R2_FB24_Pos   (24U)
 
#define CAN_F10R2_FB24_Msk   (0x1UL << CAN_F10R2_FB24_Pos)
 
#define CAN_F10R2_FB24   CAN_F10R2_FB24_Msk
 
#define CAN_F10R2_FB25_Pos   (25U)
 
#define CAN_F10R2_FB25_Msk   (0x1UL << CAN_F10R2_FB25_Pos)
 
#define CAN_F10R2_FB25   CAN_F10R2_FB25_Msk
 
#define CAN_F10R2_FB26_Pos   (26U)
 
#define CAN_F10R2_FB26_Msk   (0x1UL << CAN_F10R2_FB26_Pos)
 
#define CAN_F10R2_FB26   CAN_F10R2_FB26_Msk
 
#define CAN_F10R2_FB27_Pos   (27U)
 
#define CAN_F10R2_FB27_Msk   (0x1UL << CAN_F10R2_FB27_Pos)
 
#define CAN_F10R2_FB27   CAN_F10R2_FB27_Msk
 
#define CAN_F10R2_FB28_Pos   (28U)
 
#define CAN_F10R2_FB28_Msk   (0x1UL << CAN_F10R2_FB28_Pos)
 
#define CAN_F10R2_FB28   CAN_F10R2_FB28_Msk
 
#define CAN_F10R2_FB29_Pos   (29U)
 
#define CAN_F10R2_FB29_Msk   (0x1UL << CAN_F10R2_FB29_Pos)
 
#define CAN_F10R2_FB29   CAN_F10R2_FB29_Msk
 
#define CAN_F10R2_FB30_Pos   (30U)
 
#define CAN_F10R2_FB30_Msk   (0x1UL << CAN_F10R2_FB30_Pos)
 
#define CAN_F10R2_FB30   CAN_F10R2_FB30_Msk
 
#define CAN_F10R2_FB31_Pos   (31U)
 
#define CAN_F10R2_FB31_Msk   (0x1UL << CAN_F10R2_FB31_Pos)
 
#define CAN_F10R2_FB31   CAN_F10R2_FB31_Msk
 
#define CAN_F11R2_FB0_Pos   (0U)
 
#define CAN_F11R2_FB0_Msk   (0x1UL << CAN_F11R2_FB0_Pos)
 
#define CAN_F11R2_FB0   CAN_F11R2_FB0_Msk
 
#define CAN_F11R2_FB1_Pos   (1U)
 
#define CAN_F11R2_FB1_Msk   (0x1UL << CAN_F11R2_FB1_Pos)
 
#define CAN_F11R2_FB1   CAN_F11R2_FB1_Msk
 
#define CAN_F11R2_FB2_Pos   (2U)
 
#define CAN_F11R2_FB2_Msk   (0x1UL << CAN_F11R2_FB2_Pos)
 
#define CAN_F11R2_FB2   CAN_F11R2_FB2_Msk
 
#define CAN_F11R2_FB3_Pos   (3U)
 
#define CAN_F11R2_FB3_Msk   (0x1UL << CAN_F11R2_FB3_Pos)
 
#define CAN_F11R2_FB3   CAN_F11R2_FB3_Msk
 
#define CAN_F11R2_FB4_Pos   (4U)
 
#define CAN_F11R2_FB4_Msk   (0x1UL << CAN_F11R2_FB4_Pos)
 
#define CAN_F11R2_FB4   CAN_F11R2_FB4_Msk
 
#define CAN_F11R2_FB5_Pos   (5U)
 
#define CAN_F11R2_FB5_Msk   (0x1UL << CAN_F11R2_FB5_Pos)
 
#define CAN_F11R2_FB5   CAN_F11R2_FB5_Msk
 
#define CAN_F11R2_FB6_Pos   (6U)
 
#define CAN_F11R2_FB6_Msk   (0x1UL << CAN_F11R2_FB6_Pos)
 
#define CAN_F11R2_FB6   CAN_F11R2_FB6_Msk
 
#define CAN_F11R2_FB7_Pos   (7U)
 
#define CAN_F11R2_FB7_Msk   (0x1UL << CAN_F11R2_FB7_Pos)
 
#define CAN_F11R2_FB7   CAN_F11R2_FB7_Msk
 
#define CAN_F11R2_FB8_Pos   (8U)
 
#define CAN_F11R2_FB8_Msk   (0x1UL << CAN_F11R2_FB8_Pos)
 
#define CAN_F11R2_FB8   CAN_F11R2_FB8_Msk
 
#define CAN_F11R2_FB9_Pos   (9U)
 
#define CAN_F11R2_FB9_Msk   (0x1UL << CAN_F11R2_FB9_Pos)
 
#define CAN_F11R2_FB9   CAN_F11R2_FB9_Msk
 
#define CAN_F11R2_FB10_Pos   (10U)
 
#define CAN_F11R2_FB10_Msk   (0x1UL << CAN_F11R2_FB10_Pos)
 
#define CAN_F11R2_FB10   CAN_F11R2_FB10_Msk
 
#define CAN_F11R2_FB11_Pos   (11U)
 
#define CAN_F11R2_FB11_Msk   (0x1UL << CAN_F11R2_FB11_Pos)
 
#define CAN_F11R2_FB11   CAN_F11R2_FB11_Msk
 
#define CAN_F11R2_FB12_Pos   (12U)
 
#define CAN_F11R2_FB12_Msk   (0x1UL << CAN_F11R2_FB12_Pos)
 
#define CAN_F11R2_FB12   CAN_F11R2_FB12_Msk
 
#define CAN_F11R2_FB13_Pos   (13U)
 
#define CAN_F11R2_FB13_Msk   (0x1UL << CAN_F11R2_FB13_Pos)
 
#define CAN_F11R2_FB13   CAN_F11R2_FB13_Msk
 
#define CAN_F11R2_FB14_Pos   (14U)
 
#define CAN_F11R2_FB14_Msk   (0x1UL << CAN_F11R2_FB14_Pos)
 
#define CAN_F11R2_FB14   CAN_F11R2_FB14_Msk
 
#define CAN_F11R2_FB15_Pos   (15U)
 
#define CAN_F11R2_FB15_Msk   (0x1UL << CAN_F11R2_FB15_Pos)
 
#define CAN_F11R2_FB15   CAN_F11R2_FB15_Msk
 
#define CAN_F11R2_FB16_Pos   (16U)
 
#define CAN_F11R2_FB16_Msk   (0x1UL << CAN_F11R2_FB16_Pos)
 
#define CAN_F11R2_FB16   CAN_F11R2_FB16_Msk
 
#define CAN_F11R2_FB17_Pos   (17U)
 
#define CAN_F11R2_FB17_Msk   (0x1UL << CAN_F11R2_FB17_Pos)
 
#define CAN_F11R2_FB17   CAN_F11R2_FB17_Msk
 
#define CAN_F11R2_FB18_Pos   (18U)
 
#define CAN_F11R2_FB18_Msk   (0x1UL << CAN_F11R2_FB18_Pos)
 
#define CAN_F11R2_FB18   CAN_F11R2_FB18_Msk
 
#define CAN_F11R2_FB19_Pos   (19U)
 
#define CAN_F11R2_FB19_Msk   (0x1UL << CAN_F11R2_FB19_Pos)
 
#define CAN_F11R2_FB19   CAN_F11R2_FB19_Msk
 
#define CAN_F11R2_FB20_Pos   (20U)
 
#define CAN_F11R2_FB20_Msk   (0x1UL << CAN_F11R2_FB20_Pos)
 
#define CAN_F11R2_FB20   CAN_F11R2_FB20_Msk
 
#define CAN_F11R2_FB21_Pos   (21U)
 
#define CAN_F11R2_FB21_Msk   (0x1UL << CAN_F11R2_FB21_Pos)
 
#define CAN_F11R2_FB21   CAN_F11R2_FB21_Msk
 
#define CAN_F11R2_FB22_Pos   (22U)
 
#define CAN_F11R2_FB22_Msk   (0x1UL << CAN_F11R2_FB22_Pos)
 
#define CAN_F11R2_FB22   CAN_F11R2_FB22_Msk
 
#define CAN_F11R2_FB23_Pos   (23U)
 
#define CAN_F11R2_FB23_Msk   (0x1UL << CAN_F11R2_FB23_Pos)
 
#define CAN_F11R2_FB23   CAN_F11R2_FB23_Msk
 
#define CAN_F11R2_FB24_Pos   (24U)
 
#define CAN_F11R2_FB24_Msk   (0x1UL << CAN_F11R2_FB24_Pos)
 
#define CAN_F11R2_FB24   CAN_F11R2_FB24_Msk
 
#define CAN_F11R2_FB25_Pos   (25U)
 
#define CAN_F11R2_FB25_Msk   (0x1UL << CAN_F11R2_FB25_Pos)
 
#define CAN_F11R2_FB25   CAN_F11R2_FB25_Msk
 
#define CAN_F11R2_FB26_Pos   (26U)
 
#define CAN_F11R2_FB26_Msk   (0x1UL << CAN_F11R2_FB26_Pos)
 
#define CAN_F11R2_FB26   CAN_F11R2_FB26_Msk
 
#define CAN_F11R2_FB27_Pos   (27U)
 
#define CAN_F11R2_FB27_Msk   (0x1UL << CAN_F11R2_FB27_Pos)
 
#define CAN_F11R2_FB27   CAN_F11R2_FB27_Msk
 
#define CAN_F11R2_FB28_Pos   (28U)
 
#define CAN_F11R2_FB28_Msk   (0x1UL << CAN_F11R2_FB28_Pos)
 
#define CAN_F11R2_FB28   CAN_F11R2_FB28_Msk
 
#define CAN_F11R2_FB29_Pos   (29U)
 
#define CAN_F11R2_FB29_Msk   (0x1UL << CAN_F11R2_FB29_Pos)
 
#define CAN_F11R2_FB29   CAN_F11R2_FB29_Msk
 
#define CAN_F11R2_FB30_Pos   (30U)
 
#define CAN_F11R2_FB30_Msk   (0x1UL << CAN_F11R2_FB30_Pos)
 
#define CAN_F11R2_FB30   CAN_F11R2_FB30_Msk
 
#define CAN_F11R2_FB31_Pos   (31U)
 
#define CAN_F11R2_FB31_Msk   (0x1UL << CAN_F11R2_FB31_Pos)
 
#define CAN_F11R2_FB31   CAN_F11R2_FB31_Msk
 
#define CAN_F12R2_FB0_Pos   (0U)
 
#define CAN_F12R2_FB0_Msk   (0x1UL << CAN_F12R2_FB0_Pos)
 
#define CAN_F12R2_FB0   CAN_F12R2_FB0_Msk
 
#define CAN_F12R2_FB1_Pos   (1U)
 
#define CAN_F12R2_FB1_Msk   (0x1UL << CAN_F12R2_FB1_Pos)
 
#define CAN_F12R2_FB1   CAN_F12R2_FB1_Msk
 
#define CAN_F12R2_FB2_Pos   (2U)
 
#define CAN_F12R2_FB2_Msk   (0x1UL << CAN_F12R2_FB2_Pos)
 
#define CAN_F12R2_FB2   CAN_F12R2_FB2_Msk
 
#define CAN_F12R2_FB3_Pos   (3U)
 
#define CAN_F12R2_FB3_Msk   (0x1UL << CAN_F12R2_FB3_Pos)
 
#define CAN_F12R2_FB3   CAN_F12R2_FB3_Msk
 
#define CAN_F12R2_FB4_Pos   (4U)
 
#define CAN_F12R2_FB4_Msk   (0x1UL << CAN_F12R2_FB4_Pos)
 
#define CAN_F12R2_FB4   CAN_F12R2_FB4_Msk
 
#define CAN_F12R2_FB5_Pos   (5U)
 
#define CAN_F12R2_FB5_Msk   (0x1UL << CAN_F12R2_FB5_Pos)
 
#define CAN_F12R2_FB5   CAN_F12R2_FB5_Msk
 
#define CAN_F12R2_FB6_Pos   (6U)
 
#define CAN_F12R2_FB6_Msk   (0x1UL << CAN_F12R2_FB6_Pos)
 
#define CAN_F12R2_FB6   CAN_F12R2_FB6_Msk
 
#define CAN_F12R2_FB7_Pos   (7U)
 
#define CAN_F12R2_FB7_Msk   (0x1UL << CAN_F12R2_FB7_Pos)
 
#define CAN_F12R2_FB7   CAN_F12R2_FB7_Msk
 
#define CAN_F12R2_FB8_Pos   (8U)
 
#define CAN_F12R2_FB8_Msk   (0x1UL << CAN_F12R2_FB8_Pos)
 
#define CAN_F12R2_FB8   CAN_F12R2_FB8_Msk
 
#define CAN_F12R2_FB9_Pos   (9U)
 
#define CAN_F12R2_FB9_Msk   (0x1UL << CAN_F12R2_FB9_Pos)
 
#define CAN_F12R2_FB9   CAN_F12R2_FB9_Msk
 
#define CAN_F12R2_FB10_Pos   (10U)
 
#define CAN_F12R2_FB10_Msk   (0x1UL << CAN_F12R2_FB10_Pos)
 
#define CAN_F12R2_FB10   CAN_F12R2_FB10_Msk
 
#define CAN_F12R2_FB11_Pos   (11U)
 
#define CAN_F12R2_FB11_Msk   (0x1UL << CAN_F12R2_FB11_Pos)
 
#define CAN_F12R2_FB11   CAN_F12R2_FB11_Msk
 
#define CAN_F12R2_FB12_Pos   (12U)
 
#define CAN_F12R2_FB12_Msk   (0x1UL << CAN_F12R2_FB12_Pos)
 
#define CAN_F12R2_FB12   CAN_F12R2_FB12_Msk
 
#define CAN_F12R2_FB13_Pos   (13U)
 
#define CAN_F12R2_FB13_Msk   (0x1UL << CAN_F12R2_FB13_Pos)
 
#define CAN_F12R2_FB13   CAN_F12R2_FB13_Msk
 
#define CAN_F12R2_FB14_Pos   (14U)
 
#define CAN_F12R2_FB14_Msk   (0x1UL << CAN_F12R2_FB14_Pos)
 
#define CAN_F12R2_FB14   CAN_F12R2_FB14_Msk
 
#define CAN_F12R2_FB15_Pos   (15U)
 
#define CAN_F12R2_FB15_Msk   (0x1UL << CAN_F12R2_FB15_Pos)
 
#define CAN_F12R2_FB15   CAN_F12R2_FB15_Msk
 
#define CAN_F12R2_FB16_Pos   (16U)
 
#define CAN_F12R2_FB16_Msk   (0x1UL << CAN_F12R2_FB16_Pos)
 
#define CAN_F12R2_FB16   CAN_F12R2_FB16_Msk
 
#define CAN_F12R2_FB17_Pos   (17U)
 
#define CAN_F12R2_FB17_Msk   (0x1UL << CAN_F12R2_FB17_Pos)
 
#define CAN_F12R2_FB17   CAN_F12R2_FB17_Msk
 
#define CAN_F12R2_FB18_Pos   (18U)
 
#define CAN_F12R2_FB18_Msk   (0x1UL << CAN_F12R2_FB18_Pos)
 
#define CAN_F12R2_FB18   CAN_F12R2_FB18_Msk
 
#define CAN_F12R2_FB19_Pos   (19U)
 
#define CAN_F12R2_FB19_Msk   (0x1UL << CAN_F12R2_FB19_Pos)
 
#define CAN_F12R2_FB19   CAN_F12R2_FB19_Msk
 
#define CAN_F12R2_FB20_Pos   (20U)
 
#define CAN_F12R2_FB20_Msk   (0x1UL << CAN_F12R2_FB20_Pos)
 
#define CAN_F12R2_FB20   CAN_F12R2_FB20_Msk
 
#define CAN_F12R2_FB21_Pos   (21U)
 
#define CAN_F12R2_FB21_Msk   (0x1UL << CAN_F12R2_FB21_Pos)
 
#define CAN_F12R2_FB21   CAN_F12R2_FB21_Msk
 
#define CAN_F12R2_FB22_Pos   (22U)
 
#define CAN_F12R2_FB22_Msk   (0x1UL << CAN_F12R2_FB22_Pos)
 
#define CAN_F12R2_FB22   CAN_F12R2_FB22_Msk
 
#define CAN_F12R2_FB23_Pos   (23U)
 
#define CAN_F12R2_FB23_Msk   (0x1UL << CAN_F12R2_FB23_Pos)
 
#define CAN_F12R2_FB23   CAN_F12R2_FB23_Msk
 
#define CAN_F12R2_FB24_Pos   (24U)
 
#define CAN_F12R2_FB24_Msk   (0x1UL << CAN_F12R2_FB24_Pos)
 
#define CAN_F12R2_FB24   CAN_F12R2_FB24_Msk
 
#define CAN_F12R2_FB25_Pos   (25U)
 
#define CAN_F12R2_FB25_Msk   (0x1UL << CAN_F12R2_FB25_Pos)
 
#define CAN_F12R2_FB25   CAN_F12R2_FB25_Msk
 
#define CAN_F12R2_FB26_Pos   (26U)
 
#define CAN_F12R2_FB26_Msk   (0x1UL << CAN_F12R2_FB26_Pos)
 
#define CAN_F12R2_FB26   CAN_F12R2_FB26_Msk
 
#define CAN_F12R2_FB27_Pos   (27U)
 
#define CAN_F12R2_FB27_Msk   (0x1UL << CAN_F12R2_FB27_Pos)
 
#define CAN_F12R2_FB27   CAN_F12R2_FB27_Msk
 
#define CAN_F12R2_FB28_Pos   (28U)
 
#define CAN_F12R2_FB28_Msk   (0x1UL << CAN_F12R2_FB28_Pos)
 
#define CAN_F12R2_FB28   CAN_F12R2_FB28_Msk
 
#define CAN_F12R2_FB29_Pos   (29U)
 
#define CAN_F12R2_FB29_Msk   (0x1UL << CAN_F12R2_FB29_Pos)
 
#define CAN_F12R2_FB29   CAN_F12R2_FB29_Msk
 
#define CAN_F12R2_FB30_Pos   (30U)
 
#define CAN_F12R2_FB30_Msk   (0x1UL << CAN_F12R2_FB30_Pos)
 
#define CAN_F12R2_FB30   CAN_F12R2_FB30_Msk
 
#define CAN_F12R2_FB31_Pos   (31U)
 
#define CAN_F12R2_FB31_Msk   (0x1UL << CAN_F12R2_FB31_Pos)
 
#define CAN_F12R2_FB31   CAN_F12R2_FB31_Msk
 
#define CAN_F13R2_FB0_Pos   (0U)
 
#define CAN_F13R2_FB0_Msk   (0x1UL << CAN_F13R2_FB0_Pos)
 
#define CAN_F13R2_FB0   CAN_F13R2_FB0_Msk
 
#define CAN_F13R2_FB1_Pos   (1U)
 
#define CAN_F13R2_FB1_Msk   (0x1UL << CAN_F13R2_FB1_Pos)
 
#define CAN_F13R2_FB1   CAN_F13R2_FB1_Msk
 
#define CAN_F13R2_FB2_Pos   (2U)
 
#define CAN_F13R2_FB2_Msk   (0x1UL << CAN_F13R2_FB2_Pos)
 
#define CAN_F13R2_FB2   CAN_F13R2_FB2_Msk
 
#define CAN_F13R2_FB3_Pos   (3U)
 
#define CAN_F13R2_FB3_Msk   (0x1UL << CAN_F13R2_FB3_Pos)
 
#define CAN_F13R2_FB3   CAN_F13R2_FB3_Msk
 
#define CAN_F13R2_FB4_Pos   (4U)
 
#define CAN_F13R2_FB4_Msk   (0x1UL << CAN_F13R2_FB4_Pos)
 
#define CAN_F13R2_FB4   CAN_F13R2_FB4_Msk
 
#define CAN_F13R2_FB5_Pos   (5U)
 
#define CAN_F13R2_FB5_Msk   (0x1UL << CAN_F13R2_FB5_Pos)
 
#define CAN_F13R2_FB5   CAN_F13R2_FB5_Msk
 
#define CAN_F13R2_FB6_Pos   (6U)
 
#define CAN_F13R2_FB6_Msk   (0x1UL << CAN_F13R2_FB6_Pos)
 
#define CAN_F13R2_FB6   CAN_F13R2_FB6_Msk
 
#define CAN_F13R2_FB7_Pos   (7U)
 
#define CAN_F13R2_FB7_Msk   (0x1UL << CAN_F13R2_FB7_Pos)
 
#define CAN_F13R2_FB7   CAN_F13R2_FB7_Msk
 
#define CAN_F13R2_FB8_Pos   (8U)
 
#define CAN_F13R2_FB8_Msk   (0x1UL << CAN_F13R2_FB8_Pos)
 
#define CAN_F13R2_FB8   CAN_F13R2_FB8_Msk
 
#define CAN_F13R2_FB9_Pos   (9U)
 
#define CAN_F13R2_FB9_Msk   (0x1UL << CAN_F13R2_FB9_Pos)
 
#define CAN_F13R2_FB9   CAN_F13R2_FB9_Msk
 
#define CAN_F13R2_FB10_Pos   (10U)
 
#define CAN_F13R2_FB10_Msk   (0x1UL << CAN_F13R2_FB10_Pos)
 
#define CAN_F13R2_FB10   CAN_F13R2_FB10_Msk
 
#define CAN_F13R2_FB11_Pos   (11U)
 
#define CAN_F13R2_FB11_Msk   (0x1UL << CAN_F13R2_FB11_Pos)
 
#define CAN_F13R2_FB11   CAN_F13R2_FB11_Msk
 
#define CAN_F13R2_FB12_Pos   (12U)
 
#define CAN_F13R2_FB12_Msk   (0x1UL << CAN_F13R2_FB12_Pos)
 
#define CAN_F13R2_FB12   CAN_F13R2_FB12_Msk
 
#define CAN_F13R2_FB13_Pos   (13U)
 
#define CAN_F13R2_FB13_Msk   (0x1UL << CAN_F13R2_FB13_Pos)
 
#define CAN_F13R2_FB13   CAN_F13R2_FB13_Msk
 
#define CAN_F13R2_FB14_Pos   (14U)
 
#define CAN_F13R2_FB14_Msk   (0x1UL << CAN_F13R2_FB14_Pos)
 
#define CAN_F13R2_FB14   CAN_F13R2_FB14_Msk
 
#define CAN_F13R2_FB15_Pos   (15U)
 
#define CAN_F13R2_FB15_Msk   (0x1UL << CAN_F13R2_FB15_Pos)
 
#define CAN_F13R2_FB15   CAN_F13R2_FB15_Msk
 
#define CAN_F13R2_FB16_Pos   (16U)
 
#define CAN_F13R2_FB16_Msk   (0x1UL << CAN_F13R2_FB16_Pos)
 
#define CAN_F13R2_FB16   CAN_F13R2_FB16_Msk
 
#define CAN_F13R2_FB17_Pos   (17U)
 
#define CAN_F13R2_FB17_Msk   (0x1UL << CAN_F13R2_FB17_Pos)
 
#define CAN_F13R2_FB17   CAN_F13R2_FB17_Msk
 
#define CAN_F13R2_FB18_Pos   (18U)
 
#define CAN_F13R2_FB18_Msk   (0x1UL << CAN_F13R2_FB18_Pos)
 
#define CAN_F13R2_FB18   CAN_F13R2_FB18_Msk
 
#define CAN_F13R2_FB19_Pos   (19U)
 
#define CAN_F13R2_FB19_Msk   (0x1UL << CAN_F13R2_FB19_Pos)
 
#define CAN_F13R2_FB19   CAN_F13R2_FB19_Msk
 
#define CAN_F13R2_FB20_Pos   (20U)
 
#define CAN_F13R2_FB20_Msk   (0x1UL << CAN_F13R2_FB20_Pos)
 
#define CAN_F13R2_FB20   CAN_F13R2_FB20_Msk
 
#define CAN_F13R2_FB21_Pos   (21U)
 
#define CAN_F13R2_FB21_Msk   (0x1UL << CAN_F13R2_FB21_Pos)
 
#define CAN_F13R2_FB21   CAN_F13R2_FB21_Msk
 
#define CAN_F13R2_FB22_Pos   (22U)
 
#define CAN_F13R2_FB22_Msk   (0x1UL << CAN_F13R2_FB22_Pos)
 
#define CAN_F13R2_FB22   CAN_F13R2_FB22_Msk
 
#define CAN_F13R2_FB23_Pos   (23U)
 
#define CAN_F13R2_FB23_Msk   (0x1UL << CAN_F13R2_FB23_Pos)
 
#define CAN_F13R2_FB23   CAN_F13R2_FB23_Msk
 
#define CAN_F13R2_FB24_Pos   (24U)
 
#define CAN_F13R2_FB24_Msk   (0x1UL << CAN_F13R2_FB24_Pos)
 
#define CAN_F13R2_FB24   CAN_F13R2_FB24_Msk
 
#define CAN_F13R2_FB25_Pos   (25U)
 
#define CAN_F13R2_FB25_Msk   (0x1UL << CAN_F13R2_FB25_Pos)
 
#define CAN_F13R2_FB25   CAN_F13R2_FB25_Msk
 
#define CAN_F13R2_FB26_Pos   (26U)
 
#define CAN_F13R2_FB26_Msk   (0x1UL << CAN_F13R2_FB26_Pos)
 
#define CAN_F13R2_FB26   CAN_F13R2_FB26_Msk
 
#define CAN_F13R2_FB27_Pos   (27U)
 
#define CAN_F13R2_FB27_Msk   (0x1UL << CAN_F13R2_FB27_Pos)
 
#define CAN_F13R2_FB27   CAN_F13R2_FB27_Msk
 
#define CAN_F13R2_FB28_Pos   (28U)
 
#define CAN_F13R2_FB28_Msk   (0x1UL << CAN_F13R2_FB28_Pos)
 
#define CAN_F13R2_FB28   CAN_F13R2_FB28_Msk
 
#define CAN_F13R2_FB29_Pos   (29U)
 
#define CAN_F13R2_FB29_Msk   (0x1UL << CAN_F13R2_FB29_Pos)
 
#define CAN_F13R2_FB29   CAN_F13R2_FB29_Msk
 
#define CAN_F13R2_FB30_Pos   (30U)
 
#define CAN_F13R2_FB30_Msk   (0x1UL << CAN_F13R2_FB30_Pos)
 
#define CAN_F13R2_FB30   CAN_F13R2_FB30_Msk
 
#define CAN_F13R2_FB31_Pos   (31U)
 
#define CAN_F13R2_FB31_Msk   (0x1UL << CAN_F13R2_FB31_Pos)
 
#define CAN_F13R2_FB31   CAN_F13R2_FB31_Msk
 
#define CRC_DR_DR_Pos   (0U)
 
#define CRC_DR_DR_Msk   (0xFFFFFFFFUL << CRC_DR_DR_Pos)
 
#define CRC_DR_DR   CRC_DR_DR_Msk
 
#define CRC_IDR_IDR   ((uint8_t)0xFFU)
 
#define CRC_CR_RESET_Pos   (0U)
 
#define CRC_CR_RESET_Msk   (0x1UL << CRC_CR_RESET_Pos)
 
#define CRC_CR_RESET   CRC_CR_RESET_Msk
 
#define CRC_CR_POLYSIZE_Pos   (3U)
 
#define CRC_CR_POLYSIZE_Msk   (0x3UL << CRC_CR_POLYSIZE_Pos)
 
#define CRC_CR_POLYSIZE   CRC_CR_POLYSIZE_Msk
 
#define CRC_CR_POLYSIZE_0   (0x1UL << CRC_CR_POLYSIZE_Pos)
 
#define CRC_CR_POLYSIZE_1   (0x2UL << CRC_CR_POLYSIZE_Pos)
 
#define CRC_CR_REV_IN_Pos   (5U)
 
#define CRC_CR_REV_IN_Msk   (0x3UL << CRC_CR_REV_IN_Pos)
 
#define CRC_CR_REV_IN   CRC_CR_REV_IN_Msk
 
#define CRC_CR_REV_IN_0   (0x1UL << CRC_CR_REV_IN_Pos)
 
#define CRC_CR_REV_IN_1   (0x2UL << CRC_CR_REV_IN_Pos)
 
#define CRC_CR_REV_OUT_Pos   (7U)
 
#define CRC_CR_REV_OUT_Msk   (0x1UL << CRC_CR_REV_OUT_Pos)
 
#define CRC_CR_REV_OUT   CRC_CR_REV_OUT_Msk
 
#define CRC_INIT_INIT_Pos   (0U)
 
#define CRC_INIT_INIT_Msk   (0xFFFFFFFFUL << CRC_INIT_INIT_Pos)
 
#define CRC_INIT_INIT   CRC_INIT_INIT_Msk
 
#define CRC_POL_POL_Pos   (0U)
 
#define CRC_POL_POL_Msk   (0xFFFFFFFFUL << CRC_POL_POL_Pos)
 
#define CRC_POL_POL   CRC_POL_POL_Msk
 
#define DAC_CHANNEL2_SUPPORT
 
#define DAC_CR_EN1_Pos   (0U)
 
#define DAC_CR_EN1_Msk   (0x1UL << DAC_CR_EN1_Pos)
 
#define DAC_CR_EN1   DAC_CR_EN1_Msk
 
#define DAC_CR_BOFF1_Pos   (1U)
 
#define DAC_CR_BOFF1_Msk   (0x1UL << DAC_CR_BOFF1_Pos)
 
#define DAC_CR_BOFF1   DAC_CR_BOFF1_Msk
 
#define DAC_CR_TEN1_Pos   (2U)
 
#define DAC_CR_TEN1_Msk   (0x1UL << DAC_CR_TEN1_Pos)
 
#define DAC_CR_TEN1   DAC_CR_TEN1_Msk
 
#define DAC_CR_TSEL1_Pos   (3U)
 
#define DAC_CR_TSEL1_Msk   (0x7UL << DAC_CR_TSEL1_Pos)
 
#define DAC_CR_TSEL1   DAC_CR_TSEL1_Msk
 
#define DAC_CR_TSEL1_0   (0x1UL << DAC_CR_TSEL1_Pos)
 
#define DAC_CR_TSEL1_1   (0x2UL << DAC_CR_TSEL1_Pos)
 
#define DAC_CR_TSEL1_2   (0x4UL << DAC_CR_TSEL1_Pos)
 
#define DAC_CR_WAVE1_Pos   (6U)
 
#define DAC_CR_WAVE1_Msk   (0x3UL << DAC_CR_WAVE1_Pos)
 
#define DAC_CR_WAVE1   DAC_CR_WAVE1_Msk
 
#define DAC_CR_WAVE1_0   (0x1UL << DAC_CR_WAVE1_Pos)
 
#define DAC_CR_WAVE1_1   (0x2UL << DAC_CR_WAVE1_Pos)
 
#define DAC_CR_MAMP1_Pos   (8U)
 
#define DAC_CR_MAMP1_Msk   (0xFUL << DAC_CR_MAMP1_Pos)
 
#define DAC_CR_MAMP1   DAC_CR_MAMP1_Msk
 
#define DAC_CR_MAMP1_0   (0x1UL << DAC_CR_MAMP1_Pos)
 
#define DAC_CR_MAMP1_1   (0x2UL << DAC_CR_MAMP1_Pos)
 
#define DAC_CR_MAMP1_2   (0x4UL << DAC_CR_MAMP1_Pos)
 
#define DAC_CR_MAMP1_3   (0x8UL << DAC_CR_MAMP1_Pos)
 
#define DAC_CR_DMAEN1_Pos   (12U)
 
#define DAC_CR_DMAEN1_Msk   (0x1UL << DAC_CR_DMAEN1_Pos)
 
#define DAC_CR_DMAEN1   DAC_CR_DMAEN1_Msk
 
#define DAC_CR_DMAUDRIE1_Pos   (13U)
 
#define DAC_CR_DMAUDRIE1_Msk   (0x1UL << DAC_CR_DMAUDRIE1_Pos)
 
#define DAC_CR_DMAUDRIE1   DAC_CR_DMAUDRIE1_Msk
 
#define DAC_CR_EN2_Pos   (16U)
 
#define DAC_CR_EN2_Msk   (0x1UL << DAC_CR_EN2_Pos)
 
#define DAC_CR_EN2   DAC_CR_EN2_Msk
 
#define DAC_CR_BOFF2_Pos   (17U)
 
#define DAC_CR_BOFF2_Msk   (0x1UL << DAC_CR_BOFF2_Pos)
 
#define DAC_CR_BOFF2   DAC_CR_BOFF2_Msk
 
#define DAC_CR_TEN2_Pos   (18U)
 
#define DAC_CR_TEN2_Msk   (0x1UL << DAC_CR_TEN2_Pos)
 
#define DAC_CR_TEN2   DAC_CR_TEN2_Msk
 
#define DAC_CR_TSEL2_Pos   (19U)
 
#define DAC_CR_TSEL2_Msk   (0x7UL << DAC_CR_TSEL2_Pos)
 
#define DAC_CR_TSEL2   DAC_CR_TSEL2_Msk
 
#define DAC_CR_TSEL2_0   (0x1UL << DAC_CR_TSEL2_Pos)
 
#define DAC_CR_TSEL2_1   (0x2UL << DAC_CR_TSEL2_Pos)
 
#define DAC_CR_TSEL2_2   (0x4UL << DAC_CR_TSEL2_Pos)
 
#define DAC_CR_WAVE2_Pos   (22U)
 
#define DAC_CR_WAVE2_Msk   (0x3UL << DAC_CR_WAVE2_Pos)
 
#define DAC_CR_WAVE2   DAC_CR_WAVE2_Msk
 
#define DAC_CR_WAVE2_0   (0x1UL << DAC_CR_WAVE2_Pos)
 
#define DAC_CR_WAVE2_1   (0x2UL << DAC_CR_WAVE2_Pos)
 
#define DAC_CR_MAMP2_Pos   (24U)
 
#define DAC_CR_MAMP2_Msk   (0xFUL << DAC_CR_MAMP2_Pos)
 
#define DAC_CR_MAMP2   DAC_CR_MAMP2_Msk
 
#define DAC_CR_MAMP2_0   (0x1UL << DAC_CR_MAMP2_Pos)
 
#define DAC_CR_MAMP2_1   (0x2UL << DAC_CR_MAMP2_Pos)
 
#define DAC_CR_MAMP2_2   (0x4UL << DAC_CR_MAMP2_Pos)
 
#define DAC_CR_MAMP2_3   (0x8UL << DAC_CR_MAMP2_Pos)
 
#define DAC_CR_DMAEN2_Pos   (28U)
 
#define DAC_CR_DMAEN2_Msk   (0x1UL << DAC_CR_DMAEN2_Pos)
 
#define DAC_CR_DMAEN2   DAC_CR_DMAEN2_Msk
 
#define DAC_CR_DMAUDRIE2_Pos   (29U)
 
#define DAC_CR_DMAUDRIE2_Msk   (0x1UL << DAC_CR_DMAUDRIE2_Pos)
 
#define DAC_CR_DMAUDRIE2   DAC_CR_DMAUDRIE2_Msk
 
#define DAC_SWTRIGR_SWTRIG1_Pos   (0U)
 
#define DAC_SWTRIGR_SWTRIG1_Msk   (0x1UL << DAC_SWTRIGR_SWTRIG1_Pos)
 
#define DAC_SWTRIGR_SWTRIG1   DAC_SWTRIGR_SWTRIG1_Msk
 
#define DAC_SWTRIGR_SWTRIG2_Pos   (1U)
 
#define DAC_SWTRIGR_SWTRIG2_Msk   (0x1UL << DAC_SWTRIGR_SWTRIG2_Pos)
 
#define DAC_SWTRIGR_SWTRIG2   DAC_SWTRIGR_SWTRIG2_Msk
 
#define DAC_DHR12R1_DACC1DHR_Pos   (0U)
 
#define DAC_DHR12R1_DACC1DHR_Msk   (0xFFFUL << DAC_DHR12R1_DACC1DHR_Pos)
 
#define DAC_DHR12R1_DACC1DHR   DAC_DHR12R1_DACC1DHR_Msk
 
#define DAC_DHR12L1_DACC1DHR_Pos   (4U)
 
#define DAC_DHR12L1_DACC1DHR_Msk   (0xFFFUL << DAC_DHR12L1_DACC1DHR_Pos)
 
#define DAC_DHR12L1_DACC1DHR   DAC_DHR12L1_DACC1DHR_Msk
 
#define DAC_DHR8R1_DACC1DHR_Pos   (0U)
 
#define DAC_DHR8R1_DACC1DHR_Msk   (0xFFUL << DAC_DHR8R1_DACC1DHR_Pos)
 
#define DAC_DHR8R1_DACC1DHR   DAC_DHR8R1_DACC1DHR_Msk
 
#define DAC_DHR12R2_DACC2DHR_Pos   (0U)
 
#define DAC_DHR12R2_DACC2DHR_Msk   (0xFFFUL << DAC_DHR12R2_DACC2DHR_Pos)
 
#define DAC_DHR12R2_DACC2DHR   DAC_DHR12R2_DACC2DHR_Msk
 
#define DAC_DHR12L2_DACC2DHR_Pos   (4U)
 
#define DAC_DHR12L2_DACC2DHR_Msk   (0xFFFUL << DAC_DHR12L2_DACC2DHR_Pos)
 
#define DAC_DHR12L2_DACC2DHR   DAC_DHR12L2_DACC2DHR_Msk
 
#define DAC_DHR8R2_DACC2DHR_Pos   (0U)
 
#define DAC_DHR8R2_DACC2DHR_Msk   (0xFFUL << DAC_DHR8R2_DACC2DHR_Pos)
 
#define DAC_DHR8R2_DACC2DHR   DAC_DHR8R2_DACC2DHR_Msk
 
#define DAC_DHR12RD_DACC1DHR_Pos   (0U)
 
#define DAC_DHR12RD_DACC1DHR_Msk   (0xFFFUL << DAC_DHR12RD_DACC1DHR_Pos)
 
#define DAC_DHR12RD_DACC1DHR   DAC_DHR12RD_DACC1DHR_Msk
 
#define DAC_DHR12RD_DACC2DHR_Pos   (16U)
 
#define DAC_DHR12RD_DACC2DHR_Msk   (0xFFFUL << DAC_DHR12RD_DACC2DHR_Pos)
 
#define DAC_DHR12RD_DACC2DHR   DAC_DHR12RD_DACC2DHR_Msk
 
#define DAC_DHR12LD_DACC1DHR_Pos   (4U)
 
#define DAC_DHR12LD_DACC1DHR_Msk   (0xFFFUL << DAC_DHR12LD_DACC1DHR_Pos)
 
#define DAC_DHR12LD_DACC1DHR   DAC_DHR12LD_DACC1DHR_Msk
 
#define DAC_DHR12LD_DACC2DHR_Pos   (20U)
 
#define DAC_DHR12LD_DACC2DHR_Msk   (0xFFFUL << DAC_DHR12LD_DACC2DHR_Pos)
 
#define DAC_DHR12LD_DACC2DHR   DAC_DHR12LD_DACC2DHR_Msk
 
#define DAC_DHR8RD_DACC1DHR_Pos   (0U)
 
#define DAC_DHR8RD_DACC1DHR_Msk   (0xFFUL << DAC_DHR8RD_DACC1DHR_Pos)
 
#define DAC_DHR8RD_DACC1DHR   DAC_DHR8RD_DACC1DHR_Msk
 
#define DAC_DHR8RD_DACC2DHR_Pos   (8U)
 
#define DAC_DHR8RD_DACC2DHR_Msk   (0xFFUL << DAC_DHR8RD_DACC2DHR_Pos)
 
#define DAC_DHR8RD_DACC2DHR   DAC_DHR8RD_DACC2DHR_Msk
 
#define DAC_DOR1_DACC1DOR_Pos   (0U)
 
#define DAC_DOR1_DACC1DOR_Msk   (0xFFFUL << DAC_DOR1_DACC1DOR_Pos)
 
#define DAC_DOR1_DACC1DOR   DAC_DOR1_DACC1DOR_Msk
 
#define DAC_DOR2_DACC2DOR_Pos   (0U)
 
#define DAC_DOR2_DACC2DOR_Msk   (0xFFFUL << DAC_DOR2_DACC2DOR_Pos)
 
#define DAC_DOR2_DACC2DOR   DAC_DOR2_DACC2DOR_Msk
 
#define DAC_SR_DMAUDR1_Pos   (13U)
 
#define DAC_SR_DMAUDR1_Msk   (0x1UL << DAC_SR_DMAUDR1_Pos)
 
#define DAC_SR_DMAUDR1   DAC_SR_DMAUDR1_Msk
 
#define DAC_SR_DMAUDR2_Pos   (29U)
 
#define DAC_SR_DMAUDR2_Msk   (0x1UL << DAC_SR_DMAUDR2_Pos)
 
#define DAC_SR_DMAUDR2   DAC_SR_DMAUDR2_Msk
 
#define DBGMCU_IDCODE_DEV_ID_Pos   (0U)
 
#define DBGMCU_IDCODE_DEV_ID_Msk   (0xFFFUL << DBGMCU_IDCODE_DEV_ID_Pos)
 
#define DBGMCU_IDCODE_DEV_ID   DBGMCU_IDCODE_DEV_ID_Msk
 
#define DBGMCU_IDCODE_REV_ID_Pos   (16U)
 
#define DBGMCU_IDCODE_REV_ID_Msk   (0xFFFFUL << DBGMCU_IDCODE_REV_ID_Pos)
 
#define DBGMCU_IDCODE_REV_ID   DBGMCU_IDCODE_REV_ID_Msk
 
#define DBGMCU_CR_DBG_SLEEP_Pos   (0U)
 
#define DBGMCU_CR_DBG_SLEEP_Msk   (0x1UL << DBGMCU_CR_DBG_SLEEP_Pos)
 
#define DBGMCU_CR_DBG_SLEEP   DBGMCU_CR_DBG_SLEEP_Msk
 
#define DBGMCU_CR_DBG_STOP_Pos   (1U)
 
#define DBGMCU_CR_DBG_STOP_Msk   (0x1UL << DBGMCU_CR_DBG_STOP_Pos)
 
#define DBGMCU_CR_DBG_STOP   DBGMCU_CR_DBG_STOP_Msk
 
#define DBGMCU_CR_DBG_STANDBY_Pos   (2U)
 
#define DBGMCU_CR_DBG_STANDBY_Msk   (0x1UL << DBGMCU_CR_DBG_STANDBY_Pos)
 
#define DBGMCU_CR_DBG_STANDBY   DBGMCU_CR_DBG_STANDBY_Msk
 
#define DBGMCU_CR_TRACE_IOEN_Pos   (5U)
 
#define DBGMCU_CR_TRACE_IOEN_Msk   (0x1UL << DBGMCU_CR_TRACE_IOEN_Pos)
 
#define DBGMCU_CR_TRACE_IOEN   DBGMCU_CR_TRACE_IOEN_Msk
 
#define DBGMCU_CR_TRACE_MODE_Pos   (6U)
 
#define DBGMCU_CR_TRACE_MODE_Msk   (0x3UL << DBGMCU_CR_TRACE_MODE_Pos)
 
#define DBGMCU_CR_TRACE_MODE   DBGMCU_CR_TRACE_MODE_Msk
 
#define DBGMCU_CR_TRACE_MODE_0   (0x1UL << DBGMCU_CR_TRACE_MODE_Pos)
 
#define DBGMCU_CR_TRACE_MODE_1   (0x2UL << DBGMCU_CR_TRACE_MODE_Pos)
 
#define DBGMCU_APB1_FZ_DBG_TIM2_STOP_Pos   (0U)
 
#define DBGMCU_APB1_FZ_DBG_TIM2_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_TIM2_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_TIM2_STOP   DBGMCU_APB1_FZ_DBG_TIM2_STOP_Msk
 
#define DBGMCU_APB1_FZ_DBG_TIM3_STOP_Pos   (1U)
 
#define DBGMCU_APB1_FZ_DBG_TIM3_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_TIM3_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_TIM3_STOP   DBGMCU_APB1_FZ_DBG_TIM3_STOP_Msk
 
#define DBGMCU_APB1_FZ_DBG_TIM4_STOP_Pos   (2U)
 
#define DBGMCU_APB1_FZ_DBG_TIM4_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_TIM4_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_TIM4_STOP   DBGMCU_APB1_FZ_DBG_TIM4_STOP_Msk
 
#define DBGMCU_APB1_FZ_DBG_TIM6_STOP_Pos   (4U)
 
#define DBGMCU_APB1_FZ_DBG_TIM6_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_TIM6_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_TIM6_STOP   DBGMCU_APB1_FZ_DBG_TIM6_STOP_Msk
 
#define DBGMCU_APB1_FZ_DBG_TIM7_STOP_Pos   (5U)
 
#define DBGMCU_APB1_FZ_DBG_TIM7_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_TIM7_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_TIM7_STOP   DBGMCU_APB1_FZ_DBG_TIM7_STOP_Msk
 
#define DBGMCU_APB1_FZ_DBG_RTC_STOP_Pos   (10U)
 
#define DBGMCU_APB1_FZ_DBG_RTC_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_RTC_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_RTC_STOP   DBGMCU_APB1_FZ_DBG_RTC_STOP_Msk
 
#define DBGMCU_APB1_FZ_DBG_WWDG_STOP_Pos   (11U)
 
#define DBGMCU_APB1_FZ_DBG_WWDG_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_WWDG_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_WWDG_STOP   DBGMCU_APB1_FZ_DBG_WWDG_STOP_Msk
 
#define DBGMCU_APB1_FZ_DBG_IWDG_STOP_Pos   (12U)
 
#define DBGMCU_APB1_FZ_DBG_IWDG_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_IWDG_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_IWDG_STOP   DBGMCU_APB1_FZ_DBG_IWDG_STOP_Msk
 
#define DBGMCU_APB1_FZ_DBG_I2C1_SMBUS_TIMEOUT_Pos   (21U)
 
#define DBGMCU_APB1_FZ_DBG_I2C1_SMBUS_TIMEOUT_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_I2C1_SMBUS_TIMEOUT_Pos)
 
#define DBGMCU_APB1_FZ_DBG_I2C1_SMBUS_TIMEOUT   DBGMCU_APB1_FZ_DBG_I2C1_SMBUS_TIMEOUT_Msk
 
#define DBGMCU_APB1_FZ_DBG_I2C2_SMBUS_TIMEOUT_Pos   (22U)
 
#define DBGMCU_APB1_FZ_DBG_I2C2_SMBUS_TIMEOUT_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_I2C2_SMBUS_TIMEOUT_Pos)
 
#define DBGMCU_APB1_FZ_DBG_I2C2_SMBUS_TIMEOUT   DBGMCU_APB1_FZ_DBG_I2C2_SMBUS_TIMEOUT_Msk
 
#define DBGMCU_APB1_FZ_DBG_I2C3_SMBUS_TIMEOUT_Pos   (30U)
 
#define DBGMCU_APB1_FZ_DBG_I2C3_SMBUS_TIMEOUT_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_I2C3_SMBUS_TIMEOUT_Pos)
 
#define DBGMCU_APB1_FZ_DBG_I2C3_SMBUS_TIMEOUT   DBGMCU_APB1_FZ_DBG_I2C3_SMBUS_TIMEOUT_Msk
 
#define DBGMCU_APB1_FZ_DBG_CAN_STOP_Pos   (25U)
 
#define DBGMCU_APB1_FZ_DBG_CAN_STOP_Msk   (0x1UL << DBGMCU_APB1_FZ_DBG_CAN_STOP_Pos)
 
#define DBGMCU_APB1_FZ_DBG_CAN_STOP   DBGMCU_APB1_FZ_DBG_CAN_STOP_Msk
 
#define DBGMCU_APB2_FZ_DBG_TIM1_STOP_Pos   (0U)
 
#define DBGMCU_APB2_FZ_DBG_TIM1_STOP_Msk   (0x1UL << DBGMCU_APB2_FZ_DBG_TIM1_STOP_Pos)
 
#define DBGMCU_APB2_FZ_DBG_TIM1_STOP   DBGMCU_APB2_FZ_DBG_TIM1_STOP_Msk
 
#define DBGMCU_APB2_FZ_DBG_TIM8_STOP_Pos   (1U)
 
#define DBGMCU_APB2_FZ_DBG_TIM8_STOP_Msk   (0x1UL << DBGMCU_APB2_FZ_DBG_TIM8_STOP_Pos)
 
#define DBGMCU_APB2_FZ_DBG_TIM8_STOP   DBGMCU_APB2_FZ_DBG_TIM8_STOP_Msk
 
#define DBGMCU_APB2_FZ_DBG_TIM15_STOP_Pos   (2U)
 
#define DBGMCU_APB2_FZ_DBG_TIM15_STOP_Msk   (0x1UL << DBGMCU_APB2_FZ_DBG_TIM15_STOP_Pos)
 
#define DBGMCU_APB2_FZ_DBG_TIM15_STOP   DBGMCU_APB2_FZ_DBG_TIM15_STOP_Msk
 
#define DBGMCU_APB2_FZ_DBG_TIM16_STOP_Pos   (3U)
 
#define DBGMCU_APB2_FZ_DBG_TIM16_STOP_Msk   (0x1UL << DBGMCU_APB2_FZ_DBG_TIM16_STOP_Pos)
 
#define DBGMCU_APB2_FZ_DBG_TIM16_STOP   DBGMCU_APB2_FZ_DBG_TIM16_STOP_Msk
 
#define DBGMCU_APB2_FZ_DBG_TIM17_STOP_Pos   (4U)
 
#define DBGMCU_APB2_FZ_DBG_TIM17_STOP_Msk   (0x1UL << DBGMCU_APB2_FZ_DBG_TIM17_STOP_Pos)
 
#define DBGMCU_APB2_FZ_DBG_TIM17_STOP   DBGMCU_APB2_FZ_DBG_TIM17_STOP_Msk
 
#define DBGMCU_APB2_FZ_DBG_TIM20_STOP_Pos   (5U)
 
#define DBGMCU_APB2_FZ_DBG_TIM20_STOP_Msk   (0x1UL << DBGMCU_APB2_FZ_DBG_TIM20_STOP_Pos)
 
#define DBGMCU_APB2_FZ_DBG_TIM20_STOP   DBGMCU_APB2_FZ_DBG_TIM20_STOP_Msk
 
#define DMA_ISR_GIF1_Pos   (0U)
 
#define DMA_ISR_GIF1_Msk   (0x1UL << DMA_ISR_GIF1_Pos)
 
#define DMA_ISR_GIF1   DMA_ISR_GIF1_Msk
 
#define DMA_ISR_TCIF1_Pos   (1U)
 
#define DMA_ISR_TCIF1_Msk   (0x1UL << DMA_ISR_TCIF1_Pos)
 
#define DMA_ISR_TCIF1   DMA_ISR_TCIF1_Msk
 
#define DMA_ISR_HTIF1_Pos   (2U)
 
#define DMA_ISR_HTIF1_Msk   (0x1UL << DMA_ISR_HTIF1_Pos)
 
#define DMA_ISR_HTIF1   DMA_ISR_HTIF1_Msk
 
#define DMA_ISR_TEIF1_Pos   (3U)
 
#define DMA_ISR_TEIF1_Msk   (0x1UL << DMA_ISR_TEIF1_Pos)
 
#define DMA_ISR_TEIF1   DMA_ISR_TEIF1_Msk
 
#define DMA_ISR_GIF2_Pos   (4U)
 
#define DMA_ISR_GIF2_Msk   (0x1UL << DMA_ISR_GIF2_Pos)
 
#define DMA_ISR_GIF2   DMA_ISR_GIF2_Msk
 
#define DMA_ISR_TCIF2_Pos   (5U)
 
#define DMA_ISR_TCIF2_Msk   (0x1UL << DMA_ISR_TCIF2_Pos)
 
#define DMA_ISR_TCIF2   DMA_ISR_TCIF2_Msk
 
#define DMA_ISR_HTIF2_Pos   (6U)
 
#define DMA_ISR_HTIF2_Msk   (0x1UL << DMA_ISR_HTIF2_Pos)
 
#define DMA_ISR_HTIF2   DMA_ISR_HTIF2_Msk
 
#define DMA_ISR_TEIF2_Pos   (7U)
 
#define DMA_ISR_TEIF2_Msk   (0x1UL << DMA_ISR_TEIF2_Pos)
 
#define DMA_ISR_TEIF2   DMA_ISR_TEIF2_Msk
 
#define DMA_ISR_GIF3_Pos   (8U)
 
#define DMA_ISR_GIF3_Msk   (0x1UL << DMA_ISR_GIF3_Pos)
 
#define DMA_ISR_GIF3   DMA_ISR_GIF3_Msk
 
#define DMA_ISR_TCIF3_Pos   (9U)
 
#define DMA_ISR_TCIF3_Msk   (0x1UL << DMA_ISR_TCIF3_Pos)
 
#define DMA_ISR_TCIF3   DMA_ISR_TCIF3_Msk
 
#define DMA_ISR_HTIF3_Pos   (10U)
 
#define DMA_ISR_HTIF3_Msk   (0x1UL << DMA_ISR_HTIF3_Pos)
 
#define DMA_ISR_HTIF3   DMA_ISR_HTIF3_Msk
 
#define DMA_ISR_TEIF3_Pos   (11U)
 
#define DMA_ISR_TEIF3_Msk   (0x1UL << DMA_ISR_TEIF3_Pos)
 
#define DMA_ISR_TEIF3   DMA_ISR_TEIF3_Msk
 
#define DMA_ISR_GIF4_Pos   (12U)
 
#define DMA_ISR_GIF4_Msk   (0x1UL << DMA_ISR_GIF4_Pos)
 
#define DMA_ISR_GIF4   DMA_ISR_GIF4_Msk
 
#define DMA_ISR_TCIF4_Pos   (13U)
 
#define DMA_ISR_TCIF4_Msk   (0x1UL << DMA_ISR_TCIF4_Pos)
 
#define DMA_ISR_TCIF4   DMA_ISR_TCIF4_Msk
 
#define DMA_ISR_HTIF4_Pos   (14U)
 
#define DMA_ISR_HTIF4_Msk   (0x1UL << DMA_ISR_HTIF4_Pos)
 
#define DMA_ISR_HTIF4   DMA_ISR_HTIF4_Msk
 
#define DMA_ISR_TEIF4_Pos   (15U)
 
#define DMA_ISR_TEIF4_Msk   (0x1UL << DMA_ISR_TEIF4_Pos)
 
#define DMA_ISR_TEIF4   DMA_ISR_TEIF4_Msk
 
#define DMA_ISR_GIF5_Pos   (16U)
 
#define DMA_ISR_GIF5_Msk   (0x1UL << DMA_ISR_GIF5_Pos)
 
#define DMA_ISR_GIF5   DMA_ISR_GIF5_Msk
 
#define DMA_ISR_TCIF5_Pos   (17U)
 
#define DMA_ISR_TCIF5_Msk   (0x1UL << DMA_ISR_TCIF5_Pos)
 
#define DMA_ISR_TCIF5   DMA_ISR_TCIF5_Msk
 
#define DMA_ISR_HTIF5_Pos   (18U)
 
#define DMA_ISR_HTIF5_Msk   (0x1UL << DMA_ISR_HTIF5_Pos)
 
#define DMA_ISR_HTIF5   DMA_ISR_HTIF5_Msk
 
#define DMA_ISR_TEIF5_Pos   (19U)
 
#define DMA_ISR_TEIF5_Msk   (0x1UL << DMA_ISR_TEIF5_Pos)
 
#define DMA_ISR_TEIF5   DMA_ISR_TEIF5_Msk
 
#define DMA_ISR_GIF6_Pos   (20U)
 
#define DMA_ISR_GIF6_Msk   (0x1UL << DMA_ISR_GIF6_Pos)
 
#define DMA_ISR_GIF6   DMA_ISR_GIF6_Msk
 
#define DMA_ISR_TCIF6_Pos   (21U)
 
#define DMA_ISR_TCIF6_Msk   (0x1UL << DMA_ISR_TCIF6_Pos)
 
#define DMA_ISR_TCIF6   DMA_ISR_TCIF6_Msk
 
#define DMA_ISR_HTIF6_Pos   (22U)
 
#define DMA_ISR_HTIF6_Msk   (0x1UL << DMA_ISR_HTIF6_Pos)
 
#define DMA_ISR_HTIF6   DMA_ISR_HTIF6_Msk
 
#define DMA_ISR_TEIF6_Pos   (23U)
 
#define DMA_ISR_TEIF6_Msk   (0x1UL << DMA_ISR_TEIF6_Pos)
 
#define DMA_ISR_TEIF6   DMA_ISR_TEIF6_Msk
 
#define DMA_ISR_GIF7_Pos   (24U)
 
#define DMA_ISR_GIF7_Msk   (0x1UL << DMA_ISR_GIF7_Pos)
 
#define DMA_ISR_GIF7   DMA_ISR_GIF7_Msk
 
#define DMA_ISR_TCIF7_Pos   (25U)
 
#define DMA_ISR_TCIF7_Msk   (0x1UL << DMA_ISR_TCIF7_Pos)
 
#define DMA_ISR_TCIF7   DMA_ISR_TCIF7_Msk
 
#define DMA_ISR_HTIF7_Pos   (26U)
 
#define DMA_ISR_HTIF7_Msk   (0x1UL << DMA_ISR_HTIF7_Pos)
 
#define DMA_ISR_HTIF7   DMA_ISR_HTIF7_Msk
 
#define DMA_ISR_TEIF7_Pos   (27U)
 
#define DMA_ISR_TEIF7_Msk   (0x1UL << DMA_ISR_TEIF7_Pos)
 
#define DMA_ISR_TEIF7   DMA_ISR_TEIF7_Msk
 
#define DMA_IFCR_CGIF1_Pos   (0U)
 
#define DMA_IFCR_CGIF1_Msk   (0x1UL << DMA_IFCR_CGIF1_Pos)
 
#define DMA_IFCR_CGIF1   DMA_IFCR_CGIF1_Msk
 
#define DMA_IFCR_CTCIF1_Pos   (1U)
 
#define DMA_IFCR_CTCIF1_Msk   (0x1UL << DMA_IFCR_CTCIF1_Pos)
 
#define DMA_IFCR_CTCIF1   DMA_IFCR_CTCIF1_Msk
 
#define DMA_IFCR_CHTIF1_Pos   (2U)
 
#define DMA_IFCR_CHTIF1_Msk   (0x1UL << DMA_IFCR_CHTIF1_Pos)
 
#define DMA_IFCR_CHTIF1   DMA_IFCR_CHTIF1_Msk
 
#define DMA_IFCR_CTEIF1_Pos   (3U)
 
#define DMA_IFCR_CTEIF1_Msk   (0x1UL << DMA_IFCR_CTEIF1_Pos)
 
#define DMA_IFCR_CTEIF1   DMA_IFCR_CTEIF1_Msk
 
#define DMA_IFCR_CGIF2_Pos   (4U)
 
#define DMA_IFCR_CGIF2_Msk   (0x1UL << DMA_IFCR_CGIF2_Pos)
 
#define DMA_IFCR_CGIF2   DMA_IFCR_CGIF2_Msk
 
#define DMA_IFCR_CTCIF2_Pos   (5U)
 
#define DMA_IFCR_CTCIF2_Msk   (0x1UL << DMA_IFCR_CTCIF2_Pos)
 
#define DMA_IFCR_CTCIF2   DMA_IFCR_CTCIF2_Msk
 
#define DMA_IFCR_CHTIF2_Pos   (6U)
 
#define DMA_IFCR_CHTIF2_Msk   (0x1UL << DMA_IFCR_CHTIF2_Pos)
 
#define DMA_IFCR_CHTIF2   DMA_IFCR_CHTIF2_Msk
 
#define DMA_IFCR_CTEIF2_Pos   (7U)
 
#define DMA_IFCR_CTEIF2_Msk   (0x1UL << DMA_IFCR_CTEIF2_Pos)
 
#define DMA_IFCR_CTEIF2   DMA_IFCR_CTEIF2_Msk
 
#define DMA_IFCR_CGIF3_Pos   (8U)
 
#define DMA_IFCR_CGIF3_Msk   (0x1UL << DMA_IFCR_CGIF3_Pos)
 
#define DMA_IFCR_CGIF3   DMA_IFCR_CGIF3_Msk
 
#define DMA_IFCR_CTCIF3_Pos   (9U)
 
#define DMA_IFCR_CTCIF3_Msk   (0x1UL << DMA_IFCR_CTCIF3_Pos)
 
#define DMA_IFCR_CTCIF3   DMA_IFCR_CTCIF3_Msk
 
#define DMA_IFCR_CHTIF3_Pos   (10U)
 
#define DMA_IFCR_CHTIF3_Msk   (0x1UL << DMA_IFCR_CHTIF3_Pos)
 
#define DMA_IFCR_CHTIF3   DMA_IFCR_CHTIF3_Msk
 
#define DMA_IFCR_CTEIF3_Pos   (11U)
 
#define DMA_IFCR_CTEIF3_Msk   (0x1UL << DMA_IFCR_CTEIF3_Pos)
 
#define DMA_IFCR_CTEIF3   DMA_IFCR_CTEIF3_Msk
 
#define DMA_IFCR_CGIF4_Pos   (12U)
 
#define DMA_IFCR_CGIF4_Msk   (0x1UL << DMA_IFCR_CGIF4_Pos)
 
#define DMA_IFCR_CGIF4   DMA_IFCR_CGIF4_Msk
 
#define DMA_IFCR_CTCIF4_Pos   (13U)
 
#define DMA_IFCR_CTCIF4_Msk   (0x1UL << DMA_IFCR_CTCIF4_Pos)
 
#define DMA_IFCR_CTCIF4   DMA_IFCR_CTCIF4_Msk
 
#define DMA_IFCR_CHTIF4_Pos   (14U)
 
#define DMA_IFCR_CHTIF4_Msk   (0x1UL << DMA_IFCR_CHTIF4_Pos)
 
#define DMA_IFCR_CHTIF4   DMA_IFCR_CHTIF4_Msk
 
#define DMA_IFCR_CTEIF4_Pos   (15U)
 
#define DMA_IFCR_CTEIF4_Msk   (0x1UL << DMA_IFCR_CTEIF4_Pos)
 
#define DMA_IFCR_CTEIF4   DMA_IFCR_CTEIF4_Msk
 
#define DMA_IFCR_CGIF5_Pos   (16U)
 
#define DMA_IFCR_CGIF5_Msk   (0x1UL << DMA_IFCR_CGIF5_Pos)
 
#define DMA_IFCR_CGIF5   DMA_IFCR_CGIF5_Msk
 
#define DMA_IFCR_CTCIF5_Pos   (17U)
 
#define DMA_IFCR_CTCIF5_Msk   (0x1UL << DMA_IFCR_CTCIF5_Pos)
 
#define DMA_IFCR_CTCIF5   DMA_IFCR_CTCIF5_Msk
 
#define DMA_IFCR_CHTIF5_Pos   (18U)
 
#define DMA_IFCR_CHTIF5_Msk   (0x1UL << DMA_IFCR_CHTIF5_Pos)
 
#define DMA_IFCR_CHTIF5   DMA_IFCR_CHTIF5_Msk
 
#define DMA_IFCR_CTEIF5_Pos   (19U)
 
#define DMA_IFCR_CTEIF5_Msk   (0x1UL << DMA_IFCR_CTEIF5_Pos)
 
#define DMA_IFCR_CTEIF5   DMA_IFCR_CTEIF5_Msk
 
#define DMA_IFCR_CGIF6_Pos   (20U)
 
#define DMA_IFCR_CGIF6_Msk   (0x1UL << DMA_IFCR_CGIF6_Pos)
 
#define DMA_IFCR_CGIF6   DMA_IFCR_CGIF6_Msk
 
#define DMA_IFCR_CTCIF6_Pos   (21U)
 
#define DMA_IFCR_CTCIF6_Msk   (0x1UL << DMA_IFCR_CTCIF6_Pos)
 
#define DMA_IFCR_CTCIF6   DMA_IFCR_CTCIF6_Msk
 
#define DMA_IFCR_CHTIF6_Pos   (22U)
 
#define DMA_IFCR_CHTIF6_Msk   (0x1UL << DMA_IFCR_CHTIF6_Pos)
 
#define DMA_IFCR_CHTIF6   DMA_IFCR_CHTIF6_Msk
 
#define DMA_IFCR_CTEIF6_Pos   (23U)
 
#define DMA_IFCR_CTEIF6_Msk   (0x1UL << DMA_IFCR_CTEIF6_Pos)
 
#define DMA_IFCR_CTEIF6   DMA_IFCR_CTEIF6_Msk
 
#define DMA_IFCR_CGIF7_Pos   (24U)
 
#define DMA_IFCR_CGIF7_Msk   (0x1UL << DMA_IFCR_CGIF7_Pos)
 
#define DMA_IFCR_CGIF7   DMA_IFCR_CGIF7_Msk
 
#define DMA_IFCR_CTCIF7_Pos   (25U)
 
#define DMA_IFCR_CTCIF7_Msk   (0x1UL << DMA_IFCR_CTCIF7_Pos)
 
#define DMA_IFCR_CTCIF7   DMA_IFCR_CTCIF7_Msk
 
#define DMA_IFCR_CHTIF7_Pos   (26U)
 
#define DMA_IFCR_CHTIF7_Msk   (0x1UL << DMA_IFCR_CHTIF7_Pos)
 
#define DMA_IFCR_CHTIF7   DMA_IFCR_CHTIF7_Msk
 
#define DMA_IFCR_CTEIF7_Pos   (27U)
 
#define DMA_IFCR_CTEIF7_Msk   (0x1UL << DMA_IFCR_CTEIF7_Pos)
 
#define DMA_IFCR_CTEIF7   DMA_IFCR_CTEIF7_Msk
 
#define DMA_CCR_EN_Pos   (0U)
 
#define DMA_CCR_EN_Msk   (0x1UL << DMA_CCR_EN_Pos)
 
#define DMA_CCR_EN   DMA_CCR_EN_Msk
 
#define DMA_CCR_TCIE_Pos   (1U)
 
#define DMA_CCR_TCIE_Msk   (0x1UL << DMA_CCR_TCIE_Pos)
 
#define DMA_CCR_TCIE   DMA_CCR_TCIE_Msk
 
#define DMA_CCR_HTIE_Pos   (2U)
 
#define DMA_CCR_HTIE_Msk   (0x1UL << DMA_CCR_HTIE_Pos)
 
#define DMA_CCR_HTIE   DMA_CCR_HTIE_Msk
 
#define DMA_CCR_TEIE_Pos   (3U)
 
#define DMA_CCR_TEIE_Msk   (0x1UL << DMA_CCR_TEIE_Pos)
 
#define DMA_CCR_TEIE   DMA_CCR_TEIE_Msk
 
#define DMA_CCR_DIR_Pos   (4U)
 
#define DMA_CCR_DIR_Msk   (0x1UL << DMA_CCR_DIR_Pos)
 
#define DMA_CCR_DIR   DMA_CCR_DIR_Msk
 
#define DMA_CCR_CIRC_Pos   (5U)
 
#define DMA_CCR_CIRC_Msk   (0x1UL << DMA_CCR_CIRC_Pos)
 
#define DMA_CCR_CIRC   DMA_CCR_CIRC_Msk
 
#define DMA_CCR_PINC_Pos   (6U)
 
#define DMA_CCR_PINC_Msk   (0x1UL << DMA_CCR_PINC_Pos)
 
#define DMA_CCR_PINC   DMA_CCR_PINC_Msk
 
#define DMA_CCR_MINC_Pos   (7U)
 
#define DMA_CCR_MINC_Msk   (0x1UL << DMA_CCR_MINC_Pos)
 
#define DMA_CCR_MINC   DMA_CCR_MINC_Msk
 
#define DMA_CCR_PSIZE_Pos   (8U)
 
#define DMA_CCR_PSIZE_Msk   (0x3UL << DMA_CCR_PSIZE_Pos)
 
#define DMA_CCR_PSIZE   DMA_CCR_PSIZE_Msk
 
#define DMA_CCR_PSIZE_0   (0x1UL << DMA_CCR_PSIZE_Pos)
 
#define DMA_CCR_PSIZE_1   (0x2UL << DMA_CCR_PSIZE_Pos)
 
#define DMA_CCR_MSIZE_Pos   (10U)
 
#define DMA_CCR_MSIZE_Msk   (0x3UL << DMA_CCR_MSIZE_Pos)
 
#define DMA_CCR_MSIZE   DMA_CCR_MSIZE_Msk
 
#define DMA_CCR_MSIZE_0   (0x1UL << DMA_CCR_MSIZE_Pos)
 
#define DMA_CCR_MSIZE_1   (0x2UL << DMA_CCR_MSIZE_Pos)
 
#define DMA_CCR_PL_Pos   (12U)
 
#define DMA_CCR_PL_Msk   (0x3UL << DMA_CCR_PL_Pos)
 
#define DMA_CCR_PL   DMA_CCR_PL_Msk
 
#define DMA_CCR_PL_0   (0x1UL << DMA_CCR_PL_Pos)
 
#define DMA_CCR_PL_1   (0x2UL << DMA_CCR_PL_Pos)
 
#define DMA_CCR_MEM2MEM_Pos   (14U)
 
#define DMA_CCR_MEM2MEM_Msk   (0x1UL << DMA_CCR_MEM2MEM_Pos)
 
#define DMA_CCR_MEM2MEM   DMA_CCR_MEM2MEM_Msk
 
#define DMA_CNDTR_NDT_Pos   (0U)
 
#define DMA_CNDTR_NDT_Msk   (0xFFFFUL << DMA_CNDTR_NDT_Pos)
 
#define DMA_CNDTR_NDT   DMA_CNDTR_NDT_Msk
 
#define DMA_CPAR_PA_Pos   (0U)
 
#define DMA_CPAR_PA_Msk   (0xFFFFFFFFUL << DMA_CPAR_PA_Pos)
 
#define DMA_CPAR_PA   DMA_CPAR_PA_Msk
 
#define DMA_CMAR_MA_Pos   (0U)
 
#define DMA_CMAR_MA_Msk   (0xFFFFFFFFUL << DMA_CMAR_MA_Pos)
 
#define DMA_CMAR_MA   DMA_CMAR_MA_Msk
 
#define EXTI_IMR_MR0_Pos   (0U)
 
#define EXTI_IMR_MR0_Msk   (0x1UL << EXTI_IMR_MR0_Pos)
 
#define EXTI_IMR_MR0   EXTI_IMR_MR0_Msk
 
#define EXTI_IMR_MR1_Pos   (1U)
 
#define EXTI_IMR_MR1_Msk   (0x1UL << EXTI_IMR_MR1_Pos)
 
#define EXTI_IMR_MR1   EXTI_IMR_MR1_Msk
 
#define EXTI_IMR_MR2_Pos   (2U)
 
#define EXTI_IMR_MR2_Msk   (0x1UL << EXTI_IMR_MR2_Pos)
 
#define EXTI_IMR_MR2   EXTI_IMR_MR2_Msk
 
#define EXTI_IMR_MR3_Pos   (3U)
 
#define EXTI_IMR_MR3_Msk   (0x1UL << EXTI_IMR_MR3_Pos)
 
#define EXTI_IMR_MR3   EXTI_IMR_MR3_Msk
 
#define EXTI_IMR_MR4_Pos   (4U)
 
#define EXTI_IMR_MR4_Msk   (0x1UL << EXTI_IMR_MR4_Pos)
 
#define EXTI_IMR_MR4   EXTI_IMR_MR4_Msk
 
#define EXTI_IMR_MR5_Pos   (5U)
 
#define EXTI_IMR_MR5_Msk   (0x1UL << EXTI_IMR_MR5_Pos)
 
#define EXTI_IMR_MR5   EXTI_IMR_MR5_Msk
 
#define EXTI_IMR_MR6_Pos   (6U)
 
#define EXTI_IMR_MR6_Msk   (0x1UL << EXTI_IMR_MR6_Pos)
 
#define EXTI_IMR_MR6   EXTI_IMR_MR6_Msk
 
#define EXTI_IMR_MR7_Pos   (7U)
 
#define EXTI_IMR_MR7_Msk   (0x1UL << EXTI_IMR_MR7_Pos)
 
#define EXTI_IMR_MR7   EXTI_IMR_MR7_Msk
 
#define EXTI_IMR_MR8_Pos   (8U)
 
#define EXTI_IMR_MR8_Msk   (0x1UL << EXTI_IMR_MR8_Pos)
 
#define EXTI_IMR_MR8   EXTI_IMR_MR8_Msk
 
#define EXTI_IMR_MR9_Pos   (9U)
 
#define EXTI_IMR_MR9_Msk   (0x1UL << EXTI_IMR_MR9_Pos)
 
#define EXTI_IMR_MR9   EXTI_IMR_MR9_Msk
 
#define EXTI_IMR_MR10_Pos   (10U)
 
#define EXTI_IMR_MR10_Msk   (0x1UL << EXTI_IMR_MR10_Pos)
 
#define EXTI_IMR_MR10   EXTI_IMR_MR10_Msk
 
#define EXTI_IMR_MR11_Pos   (11U)
 
#define EXTI_IMR_MR11_Msk   (0x1UL << EXTI_IMR_MR11_Pos)
 
#define EXTI_IMR_MR11   EXTI_IMR_MR11_Msk
 
#define EXTI_IMR_MR12_Pos   (12U)
 
#define EXTI_IMR_MR12_Msk   (0x1UL << EXTI_IMR_MR12_Pos)
 
#define EXTI_IMR_MR12   EXTI_IMR_MR12_Msk
 
#define EXTI_IMR_MR13_Pos   (13U)
 
#define EXTI_IMR_MR13_Msk   (0x1UL << EXTI_IMR_MR13_Pos)
 
#define EXTI_IMR_MR13   EXTI_IMR_MR13_Msk
 
#define EXTI_IMR_MR14_Pos   (14U)
 
#define EXTI_IMR_MR14_Msk   (0x1UL << EXTI_IMR_MR14_Pos)
 
#define EXTI_IMR_MR14   EXTI_IMR_MR14_Msk
 
#define EXTI_IMR_MR15_Pos   (15U)
 
#define EXTI_IMR_MR15_Msk   (0x1UL << EXTI_IMR_MR15_Pos)
 
#define EXTI_IMR_MR15   EXTI_IMR_MR15_Msk
 
#define EXTI_IMR_MR16_Pos   (16U)
 
#define EXTI_IMR_MR16_Msk   (0x1UL << EXTI_IMR_MR16_Pos)
 
#define EXTI_IMR_MR16   EXTI_IMR_MR16_Msk
 
#define EXTI_IMR_MR17_Pos   (17U)
 
#define EXTI_IMR_MR17_Msk   (0x1UL << EXTI_IMR_MR17_Pos)
 
#define EXTI_IMR_MR17   EXTI_IMR_MR17_Msk
 
#define EXTI_IMR_MR18_Pos   (18U)
 
#define EXTI_IMR_MR18_Msk   (0x1UL << EXTI_IMR_MR18_Pos)
 
#define EXTI_IMR_MR18   EXTI_IMR_MR18_Msk
 
#define EXTI_IMR_MR19_Pos   (19U)
 
#define EXTI_IMR_MR19_Msk   (0x1UL << EXTI_IMR_MR19_Pos)
 
#define EXTI_IMR_MR19   EXTI_IMR_MR19_Msk
 
#define EXTI_IMR_MR20_Pos   (20U)
 
#define EXTI_IMR_MR20_Msk   (0x1UL << EXTI_IMR_MR20_Pos)
 
#define EXTI_IMR_MR20   EXTI_IMR_MR20_Msk
 
#define EXTI_IMR_MR21_Pos   (21U)
 
#define EXTI_IMR_MR21_Msk   (0x1UL << EXTI_IMR_MR21_Pos)
 
#define EXTI_IMR_MR21   EXTI_IMR_MR21_Msk
 
#define EXTI_IMR_MR22_Pos   (22U)
 
#define EXTI_IMR_MR22_Msk   (0x1UL << EXTI_IMR_MR22_Pos)
 
#define EXTI_IMR_MR22   EXTI_IMR_MR22_Msk
 
#define EXTI_IMR_MR23_Pos   (23U)
 
#define EXTI_IMR_MR23_Msk   (0x1UL << EXTI_IMR_MR23_Pos)
 
#define EXTI_IMR_MR23   EXTI_IMR_MR23_Msk
 
#define EXTI_IMR_MR24_Pos   (24U)
 
#define EXTI_IMR_MR24_Msk   (0x1UL << EXTI_IMR_MR24_Pos)
 
#define EXTI_IMR_MR24   EXTI_IMR_MR24_Msk
 
#define EXTI_IMR_MR25_Pos   (25U)
 
#define EXTI_IMR_MR25_Msk   (0x1UL << EXTI_IMR_MR25_Pos)
 
#define EXTI_IMR_MR25   EXTI_IMR_MR25_Msk
 
#define EXTI_IMR_MR26_Pos   (26U)
 
#define EXTI_IMR_MR26_Msk   (0x1UL << EXTI_IMR_MR26_Pos)
 
#define EXTI_IMR_MR26   EXTI_IMR_MR26_Msk
 
#define EXTI_IMR_MR27_Pos   (27U)
 
#define EXTI_IMR_MR27_Msk   (0x1UL << EXTI_IMR_MR27_Pos)
 
#define EXTI_IMR_MR27   EXTI_IMR_MR27_Msk
 
#define EXTI_IMR_MR28_Pos   (28U)
 
#define EXTI_IMR_MR28_Msk   (0x1UL << EXTI_IMR_MR28_Pos)
 
#define EXTI_IMR_MR28   EXTI_IMR_MR28_Msk
 
#define EXTI_IMR_MR29_Pos   (29U)
 
#define EXTI_IMR_MR29_Msk   (0x1UL << EXTI_IMR_MR29_Pos)
 
#define EXTI_IMR_MR29   EXTI_IMR_MR29_Msk
 
#define EXTI_IMR_MR30_Pos   (30U)
 
#define EXTI_IMR_MR30_Msk   (0x1UL << EXTI_IMR_MR30_Pos)
 
#define EXTI_IMR_MR30   EXTI_IMR_MR30_Msk
 
#define EXTI_IMR_MR31_Pos   (31U)
 
#define EXTI_IMR_MR31_Msk   (0x1UL << EXTI_IMR_MR31_Pos)
 
#define EXTI_IMR_MR31   EXTI_IMR_MR31_Msk
 
#define EXTI_IMR_IM0   EXTI_IMR_MR0
 
#define EXTI_IMR_IM1   EXTI_IMR_MR1
 
#define EXTI_IMR_IM2   EXTI_IMR_MR2
 
#define EXTI_IMR_IM3   EXTI_IMR_MR3
 
#define EXTI_IMR_IM4   EXTI_IMR_MR4
 
#define EXTI_IMR_IM5   EXTI_IMR_MR5
 
#define EXTI_IMR_IM6   EXTI_IMR_MR6
 
#define EXTI_IMR_IM7   EXTI_IMR_MR7
 
#define EXTI_IMR_IM8   EXTI_IMR_MR8
 
#define EXTI_IMR_IM9   EXTI_IMR_MR9
 
#define EXTI_IMR_IM10   EXTI_IMR_MR10
 
#define EXTI_IMR_IM11   EXTI_IMR_MR11
 
#define EXTI_IMR_IM12   EXTI_IMR_MR12
 
#define EXTI_IMR_IM13   EXTI_IMR_MR13
 
#define EXTI_IMR_IM14   EXTI_IMR_MR14
 
#define EXTI_IMR_IM15   EXTI_IMR_MR15
 
#define EXTI_IMR_IM16   EXTI_IMR_MR16
 
#define EXTI_IMR_IM17   EXTI_IMR_MR17
 
#define EXTI_IMR_IM18   EXTI_IMR_MR18
 
#define EXTI_IMR_IM19   EXTI_IMR_MR19
 
#define EXTI_IMR_IM20   EXTI_IMR_MR20
 
#define EXTI_IMR_IM21   EXTI_IMR_MR21
 
#define EXTI_IMR_IM22   EXTI_IMR_MR22
 
#define EXTI_IMR_IM23   EXTI_IMR_MR23
 
#define EXTI_IMR_IM24   EXTI_IMR_MR24
 
#define EXTI_IMR_IM25   EXTI_IMR_MR25
 
#define EXTI_IMR_IM26   EXTI_IMR_MR26
 
#define EXTI_IMR_IM27   EXTI_IMR_MR27
 
#define EXTI_IMR_IM28   EXTI_IMR_MR28
 
#define EXTI_IMR_IM29   EXTI_IMR_MR29
 
#define EXTI_IMR_IM30   EXTI_IMR_MR30
 
#define EXTI_IMR_IM31   EXTI_IMR_MR31
 
#define EXTI_IMR_IM_Pos   (0U)
 
#define EXTI_IMR_IM_Msk   (0xFFFFFFFFUL << EXTI_IMR_IM_Pos)
 
#define EXTI_IMR_IM   EXTI_IMR_IM_Msk
 
#define EXTI_EMR_MR0_Pos   (0U)
 
#define EXTI_EMR_MR0_Msk   (0x1UL << EXTI_EMR_MR0_Pos)
 
#define EXTI_EMR_MR0   EXTI_EMR_MR0_Msk
 
#define EXTI_EMR_MR1_Pos   (1U)
 
#define EXTI_EMR_MR1_Msk   (0x1UL << EXTI_EMR_MR1_Pos)
 
#define EXTI_EMR_MR1   EXTI_EMR_MR1_Msk
 
#define EXTI_EMR_MR2_Pos   (2U)
 
#define EXTI_EMR_MR2_Msk   (0x1UL << EXTI_EMR_MR2_Pos)
 
#define EXTI_EMR_MR2   EXTI_EMR_MR2_Msk
 
#define EXTI_EMR_MR3_Pos   (3U)
 
#define EXTI_EMR_MR3_Msk   (0x1UL << EXTI_EMR_MR3_Pos)
 
#define EXTI_EMR_MR3   EXTI_EMR_MR3_Msk
 
#define EXTI_EMR_MR4_Pos   (4U)
 
#define EXTI_EMR_MR4_Msk   (0x1UL << EXTI_EMR_MR4_Pos)
 
#define EXTI_EMR_MR4   EXTI_EMR_MR4_Msk
 
#define EXTI_EMR_MR5_Pos   (5U)
 
#define EXTI_EMR_MR5_Msk   (0x1UL << EXTI_EMR_MR5_Pos)
 
#define EXTI_EMR_MR5   EXTI_EMR_MR5_Msk
 
#define EXTI_EMR_MR6_Pos   (6U)
 
#define EXTI_EMR_MR6_Msk   (0x1UL << EXTI_EMR_MR6_Pos)
 
#define EXTI_EMR_MR6   EXTI_EMR_MR6_Msk
 
#define EXTI_EMR_MR7_Pos   (7U)
 
#define EXTI_EMR_MR7_Msk   (0x1UL << EXTI_EMR_MR7_Pos)
 
#define EXTI_EMR_MR7   EXTI_EMR_MR7_Msk
 
#define EXTI_EMR_MR8_Pos   (8U)
 
#define EXTI_EMR_MR8_Msk   (0x1UL << EXTI_EMR_MR8_Pos)
 
#define EXTI_EMR_MR8   EXTI_EMR_MR8_Msk
 
#define EXTI_EMR_MR9_Pos   (9U)
 
#define EXTI_EMR_MR9_Msk   (0x1UL << EXTI_EMR_MR9_Pos)
 
#define EXTI_EMR_MR9   EXTI_EMR_MR9_Msk
 
#define EXTI_EMR_MR10_Pos   (10U)
 
#define EXTI_EMR_MR10_Msk   (0x1UL << EXTI_EMR_MR10_Pos)
 
#define EXTI_EMR_MR10   EXTI_EMR_MR10_Msk
 
#define EXTI_EMR_MR11_Pos   (11U)
 
#define EXTI_EMR_MR11_Msk   (0x1UL << EXTI_EMR_MR11_Pos)
 
#define EXTI_EMR_MR11   EXTI_EMR_MR11_Msk
 
#define EXTI_EMR_MR12_Pos   (12U)
 
#define EXTI_EMR_MR12_Msk   (0x1UL << EXTI_EMR_MR12_Pos)
 
#define EXTI_EMR_MR12   EXTI_EMR_MR12_Msk
 
#define EXTI_EMR_MR13_Pos   (13U)
 
#define EXTI_EMR_MR13_Msk   (0x1UL << EXTI_EMR_MR13_Pos)
 
#define EXTI_EMR_MR13   EXTI_EMR_MR13_Msk
 
#define EXTI_EMR_MR14_Pos   (14U)
 
#define EXTI_EMR_MR14_Msk   (0x1UL << EXTI_EMR_MR14_Pos)
 
#define EXTI_EMR_MR14   EXTI_EMR_MR14_Msk
 
#define EXTI_EMR_MR15_Pos   (15U)
 
#define EXTI_EMR_MR15_Msk   (0x1UL << EXTI_EMR_MR15_Pos)
 
#define EXTI_EMR_MR15   EXTI_EMR_MR15_Msk
 
#define EXTI_EMR_MR16_Pos   (16U)
 
#define EXTI_EMR_MR16_Msk   (0x1UL << EXTI_EMR_MR16_Pos)
 
#define EXTI_EMR_MR16   EXTI_EMR_MR16_Msk
 
#define EXTI_EMR_MR17_Pos   (17U)
 
#define EXTI_EMR_MR17_Msk   (0x1UL << EXTI_EMR_MR17_Pos)
 
#define EXTI_EMR_MR17   EXTI_EMR_MR17_Msk
 
#define EXTI_EMR_MR18_Pos   (18U)
 
#define EXTI_EMR_MR18_Msk   (0x1UL << EXTI_EMR_MR18_Pos)
 
#define EXTI_EMR_MR18   EXTI_EMR_MR18_Msk
 
#define EXTI_EMR_MR19_Pos   (19U)
 
#define EXTI_EMR_MR19_Msk   (0x1UL << EXTI_EMR_MR19_Pos)
 
#define EXTI_EMR_MR19   EXTI_EMR_MR19_Msk
 
#define EXTI_EMR_MR20_Pos   (20U)
 
#define EXTI_EMR_MR20_Msk   (0x1UL << EXTI_EMR_MR20_Pos)
 
#define EXTI_EMR_MR20   EXTI_EMR_MR20_Msk
 
#define EXTI_EMR_MR21_Pos   (21U)
 
#define EXTI_EMR_MR21_Msk   (0x1UL << EXTI_EMR_MR21_Pos)
 
#define EXTI_EMR_MR21   EXTI_EMR_MR21_Msk
 
#define EXTI_EMR_MR22_Pos   (22U)
 
#define EXTI_EMR_MR22_Msk   (0x1UL << EXTI_EMR_MR22_Pos)
 
#define EXTI_EMR_MR22   EXTI_EMR_MR22_Msk
 
#define EXTI_EMR_MR23_Pos   (23U)
 
#define EXTI_EMR_MR23_Msk   (0x1UL << EXTI_EMR_MR23_Pos)
 
#define EXTI_EMR_MR23   EXTI_EMR_MR23_Msk
 
#define EXTI_EMR_MR24_Pos   (24U)
 
#define EXTI_EMR_MR24_Msk   (0x1UL << EXTI_EMR_MR24_Pos)
 
#define EXTI_EMR_MR24   EXTI_EMR_MR24_Msk
 
#define EXTI_EMR_MR25_Pos   (25U)
 
#define EXTI_EMR_MR25_Msk   (0x1UL << EXTI_EMR_MR25_Pos)
 
#define EXTI_EMR_MR25   EXTI_EMR_MR25_Msk
 
#define EXTI_EMR_MR26_Pos   (26U)
 
#define EXTI_EMR_MR26_Msk   (0x1UL << EXTI_EMR_MR26_Pos)
 
#define EXTI_EMR_MR26   EXTI_EMR_MR26_Msk
 
#define EXTI_EMR_MR27_Pos   (27U)
 
#define EXTI_EMR_MR27_Msk   (0x1UL << EXTI_EMR_MR27_Pos)
 
#define EXTI_EMR_MR27   EXTI_EMR_MR27_Msk
 
#define EXTI_EMR_MR28_Pos   (28U)
 
#define EXTI_EMR_MR28_Msk   (0x1UL << EXTI_EMR_MR28_Pos)
 
#define EXTI_EMR_MR28   EXTI_EMR_MR28_Msk
 
#define EXTI_EMR_MR29_Pos   (29U)
 
#define EXTI_EMR_MR29_Msk   (0x1UL << EXTI_EMR_MR29_Pos)
 
#define EXTI_EMR_MR29   EXTI_EMR_MR29_Msk
 
#define EXTI_EMR_MR30_Pos   (30U)
 
#define EXTI_EMR_MR30_Msk   (0x1UL << EXTI_EMR_MR30_Pos)
 
#define EXTI_EMR_MR30   EXTI_EMR_MR30_Msk
 
#define EXTI_EMR_MR31_Pos   (31U)
 
#define EXTI_EMR_MR31_Msk   (0x1UL << EXTI_EMR_MR31_Pos)
 
#define EXTI_EMR_MR31   EXTI_EMR_MR31_Msk
 
#define EXTI_EMR_EM0   EXTI_EMR_MR0
 
#define EXTI_EMR_EM1   EXTI_EMR_MR1
 
#define EXTI_EMR_EM2   EXTI_EMR_MR2
 
#define EXTI_EMR_EM3   EXTI_EMR_MR3
 
#define EXTI_EMR_EM4   EXTI_EMR_MR4
 
#define EXTI_EMR_EM5   EXTI_EMR_MR5
 
#define EXTI_EMR_EM6   EXTI_EMR_MR6
 
#define EXTI_EMR_EM7   EXTI_EMR_MR7
 
#define EXTI_EMR_EM8   EXTI_EMR_MR8
 
#define EXTI_EMR_EM9   EXTI_EMR_MR9
 
#define EXTI_EMR_EM10   EXTI_EMR_MR10
 
#define EXTI_EMR_EM11   EXTI_EMR_MR11
 
#define EXTI_EMR_EM12   EXTI_EMR_MR12
 
#define EXTI_EMR_EM13   EXTI_EMR_MR13
 
#define EXTI_EMR_EM14   EXTI_EMR_MR14
 
#define EXTI_EMR_EM15   EXTI_EMR_MR15
 
#define EXTI_EMR_EM16   EXTI_EMR_MR16
 
#define EXTI_EMR_EM17   EXTI_EMR_MR17
 
#define EXTI_EMR_EM18   EXTI_EMR_MR18
 
#define EXTI_EMR_EM19   EXTI_EMR_MR19
 
#define EXTI_EMR_EM20   EXTI_EMR_MR20
 
#define EXTI_EMR_EM21   EXTI_EMR_MR21
 
#define EXTI_EMR_EM22   EXTI_EMR_MR22
 
#define EXTI_EMR_EM23   EXTI_EMR_MR23
 
#define EXTI_EMR_EM24   EXTI_EMR_MR24
 
#define EXTI_EMR_EM25   EXTI_EMR_MR25
 
#define EXTI_EMR_EM26   EXTI_EMR_MR26
 
#define EXTI_EMR_EM27   EXTI_EMR_MR27
 
#define EXTI_EMR_EM28   EXTI_EMR_MR28
 
#define EXTI_EMR_EM29   EXTI_EMR_MR29
 
#define EXTI_EMR_EM30   EXTI_EMR_MR30
 
#define EXTI_EMR_EM31   EXTI_EMR_MR31
 
#define EXTI_RTSR_TR0_Pos   (0U)
 
#define EXTI_RTSR_TR0_Msk   (0x1UL << EXTI_RTSR_TR0_Pos)
 
#define EXTI_RTSR_TR0   EXTI_RTSR_TR0_Msk
 
#define EXTI_RTSR_TR1_Pos   (1U)
 
#define EXTI_RTSR_TR1_Msk   (0x1UL << EXTI_RTSR_TR1_Pos)
 
#define EXTI_RTSR_TR1   EXTI_RTSR_TR1_Msk
 
#define EXTI_RTSR_TR2_Pos   (2U)
 
#define EXTI_RTSR_TR2_Msk   (0x1UL << EXTI_RTSR_TR2_Pos)
 
#define EXTI_RTSR_TR2   EXTI_RTSR_TR2_Msk
 
#define EXTI_RTSR_TR3_Pos   (3U)
 
#define EXTI_RTSR_TR3_Msk   (0x1UL << EXTI_RTSR_TR3_Pos)
 
#define EXTI_RTSR_TR3   EXTI_RTSR_TR3_Msk
 
#define EXTI_RTSR_TR4_Pos   (4U)
 
#define EXTI_RTSR_TR4_Msk   (0x1UL << EXTI_RTSR_TR4_Pos)
 
#define EXTI_RTSR_TR4   EXTI_RTSR_TR4_Msk
 
#define EXTI_RTSR_TR5_Pos   (5U)
 
#define EXTI_RTSR_TR5_Msk   (0x1UL << EXTI_RTSR_TR5_Pos)
 
#define EXTI_RTSR_TR5   EXTI_RTSR_TR5_Msk
 
#define EXTI_RTSR_TR6_Pos   (6U)
 
#define EXTI_RTSR_TR6_Msk   (0x1UL << EXTI_RTSR_TR6_Pos)
 
#define EXTI_RTSR_TR6   EXTI_RTSR_TR6_Msk
 
#define EXTI_RTSR_TR7_Pos   (7U)
 
#define EXTI_RTSR_TR7_Msk   (0x1UL << EXTI_RTSR_TR7_Pos)
 
#define EXTI_RTSR_TR7   EXTI_RTSR_TR7_Msk
 
#define EXTI_RTSR_TR8_Pos   (8U)
 
#define EXTI_RTSR_TR8_Msk   (0x1UL << EXTI_RTSR_TR8_Pos)
 
#define EXTI_RTSR_TR8   EXTI_RTSR_TR8_Msk
 
#define EXTI_RTSR_TR9_Pos   (9U)
 
#define EXTI_RTSR_TR9_Msk   (0x1UL << EXTI_RTSR_TR9_Pos)
 
#define EXTI_RTSR_TR9   EXTI_RTSR_TR9_Msk
 
#define EXTI_RTSR_TR10_Pos   (10U)
 
#define EXTI_RTSR_TR10_Msk   (0x1UL << EXTI_RTSR_TR10_Pos)
 
#define EXTI_RTSR_TR10   EXTI_RTSR_TR10_Msk
 
#define EXTI_RTSR_TR11_Pos   (11U)
 
#define EXTI_RTSR_TR11_Msk   (0x1UL << EXTI_RTSR_TR11_Pos)
 
#define EXTI_RTSR_TR11   EXTI_RTSR_TR11_Msk
 
#define EXTI_RTSR_TR12_Pos   (12U)
 
#define EXTI_RTSR_TR12_Msk   (0x1UL << EXTI_RTSR_TR12_Pos)
 
#define EXTI_RTSR_TR12   EXTI_RTSR_TR12_Msk
 
#define EXTI_RTSR_TR13_Pos   (13U)
 
#define EXTI_RTSR_TR13_Msk   (0x1UL << EXTI_RTSR_TR13_Pos)
 
#define EXTI_RTSR_TR13   EXTI_RTSR_TR13_Msk
 
#define EXTI_RTSR_TR14_Pos   (14U)
 
#define EXTI_RTSR_TR14_Msk   (0x1UL << EXTI_RTSR_TR14_Pos)
 
#define EXTI_RTSR_TR14   EXTI_RTSR_TR14_Msk
 
#define EXTI_RTSR_TR15_Pos   (15U)
 
#define EXTI_RTSR_TR15_Msk   (0x1UL << EXTI_RTSR_TR15_Pos)
 
#define EXTI_RTSR_TR15   EXTI_RTSR_TR15_Msk
 
#define EXTI_RTSR_TR16_Pos   (16U)
 
#define EXTI_RTSR_TR16_Msk   (0x1UL << EXTI_RTSR_TR16_Pos)
 
#define EXTI_RTSR_TR16   EXTI_RTSR_TR16_Msk
 
#define EXTI_RTSR_TR17_Pos   (17U)
 
#define EXTI_RTSR_TR17_Msk   (0x1UL << EXTI_RTSR_TR17_Pos)
 
#define EXTI_RTSR_TR17   EXTI_RTSR_TR17_Msk
 
#define EXTI_RTSR_TR18_Pos   (18U)
 
#define EXTI_RTSR_TR18_Msk   (0x1UL << EXTI_RTSR_TR18_Pos)
 
#define EXTI_RTSR_TR18   EXTI_RTSR_TR18_Msk
 
#define EXTI_RTSR_TR19_Pos   (19U)
 
#define EXTI_RTSR_TR19_Msk   (0x1UL << EXTI_RTSR_TR19_Pos)
 
#define EXTI_RTSR_TR19   EXTI_RTSR_TR19_Msk
 
#define EXTI_RTSR_TR20_Pos   (20U)
 
#define EXTI_RTSR_TR20_Msk   (0x1UL << EXTI_RTSR_TR20_Pos)
 
#define EXTI_RTSR_TR20   EXTI_RTSR_TR20_Msk
 
#define EXTI_RTSR_TR21_Pos   (21U)
 
#define EXTI_RTSR_TR21_Msk   (0x1UL << EXTI_RTSR_TR21_Pos)
 
#define EXTI_RTSR_TR21   EXTI_RTSR_TR21_Msk
 
#define EXTI_RTSR_TR22_Pos   (22U)
 
#define EXTI_RTSR_TR22_Msk   (0x1UL << EXTI_RTSR_TR22_Pos)
 
#define EXTI_RTSR_TR22   EXTI_RTSR_TR22_Msk
 
#define EXTI_RTSR_TR29_Pos   (29U)
 
#define EXTI_RTSR_TR29_Msk   (0x1UL << EXTI_RTSR_TR29_Pos)
 
#define EXTI_RTSR_TR29   EXTI_RTSR_TR29_Msk
 
#define EXTI_RTSR_TR30_Pos   (30U)
 
#define EXTI_RTSR_TR30_Msk   (0x1UL << EXTI_RTSR_TR30_Pos)
 
#define EXTI_RTSR_TR30   EXTI_RTSR_TR30_Msk
 
#define EXTI_RTSR_TR31_Pos   (31U)
 
#define EXTI_RTSR_TR31_Msk   (0x1UL << EXTI_RTSR_TR31_Pos)
 
#define EXTI_RTSR_TR31   EXTI_RTSR_TR31_Msk
 
#define EXTI_RTSR_RT0   EXTI_RTSR_TR0
 
#define EXTI_RTSR_RT1   EXTI_RTSR_TR1
 
#define EXTI_RTSR_RT2   EXTI_RTSR_TR2
 
#define EXTI_RTSR_RT3   EXTI_RTSR_TR3
 
#define EXTI_RTSR_RT4   EXTI_RTSR_TR4
 
#define EXTI_RTSR_RT5   EXTI_RTSR_TR5
 
#define EXTI_RTSR_RT6   EXTI_RTSR_TR6
 
#define EXTI_RTSR_RT7   EXTI_RTSR_TR7
 
#define EXTI_RTSR_RT8   EXTI_RTSR_TR8
 
#define EXTI_RTSR_RT9   EXTI_RTSR_TR9
 
#define EXTI_RTSR_RT10   EXTI_RTSR_TR10
 
#define EXTI_RTSR_RT11   EXTI_RTSR_TR11
 
#define EXTI_RTSR_RT12   EXTI_RTSR_TR12
 
#define EXTI_RTSR_RT13   EXTI_RTSR_TR13
 
#define EXTI_RTSR_RT14   EXTI_RTSR_TR14
 
#define EXTI_RTSR_RT15   EXTI_RTSR_TR15
 
#define EXTI_RTSR_RT16   EXTI_RTSR_TR16
 
#define EXTI_RTSR_RT17   EXTI_RTSR_TR17
 
#define EXTI_RTSR_RT18   EXTI_RTSR_TR18
 
#define EXTI_RTSR_RT19   EXTI_RTSR_TR19
 
#define EXTI_RTSR_RT20   EXTI_RTSR_TR20
 
#define EXTI_RTSR_RT21   EXTI_RTSR_TR21
 
#define EXTI_RTSR_RT22   EXTI_RTSR_TR22
 
#define EXTI_RTSR_RT29   EXTI_RTSR_TR29
 
#define EXTI_RTSR_RT30   EXTI_RTSR_TR30
 
#define EXTI_RTSR_RT31   EXTI_RTSR_TR31
 
#define EXTI_FTSR_TR0_Pos   (0U)
 
#define EXTI_FTSR_TR0_Msk   (0x1UL << EXTI_FTSR_TR0_Pos)
 
#define EXTI_FTSR_TR0   EXTI_FTSR_TR0_Msk
 
#define EXTI_FTSR_TR1_Pos   (1U)
 
#define EXTI_FTSR_TR1_Msk   (0x1UL << EXTI_FTSR_TR1_Pos)
 
#define EXTI_FTSR_TR1   EXTI_FTSR_TR1_Msk
 
#define EXTI_FTSR_TR2_Pos   (2U)
 
#define EXTI_FTSR_TR2_Msk   (0x1UL << EXTI_FTSR_TR2_Pos)
 
#define EXTI_FTSR_TR2   EXTI_FTSR_TR2_Msk
 
#define EXTI_FTSR_TR3_Pos   (3U)
 
#define EXTI_FTSR_TR3_Msk   (0x1UL << EXTI_FTSR_TR3_Pos)
 
#define EXTI_FTSR_TR3   EXTI_FTSR_TR3_Msk
 
#define EXTI_FTSR_TR4_Pos   (4U)
 
#define EXTI_FTSR_TR4_Msk   (0x1UL << EXTI_FTSR_TR4_Pos)
 
#define EXTI_FTSR_TR4   EXTI_FTSR_TR4_Msk
 
#define EXTI_FTSR_TR5_Pos   (5U)
 
#define EXTI_FTSR_TR5_Msk   (0x1UL << EXTI_FTSR_TR5_Pos)
 
#define EXTI_FTSR_TR5   EXTI_FTSR_TR5_Msk
 
#define EXTI_FTSR_TR6_Pos   (6U)
 
#define EXTI_FTSR_TR6_Msk   (0x1UL << EXTI_FTSR_TR6_Pos)
 
#define EXTI_FTSR_TR6   EXTI_FTSR_TR6_Msk
 
#define EXTI_FTSR_TR7_Pos   (7U)
 
#define EXTI_FTSR_TR7_Msk   (0x1UL << EXTI_FTSR_TR7_Pos)
 
#define EXTI_FTSR_TR7   EXTI_FTSR_TR7_Msk
 
#define EXTI_FTSR_TR8_Pos   (8U)
 
#define EXTI_FTSR_TR8_Msk   (0x1UL << EXTI_FTSR_TR8_Pos)
 
#define EXTI_FTSR_TR8   EXTI_FTSR_TR8_Msk
 
#define EXTI_FTSR_TR9_Pos   (9U)
 
#define EXTI_FTSR_TR9_Msk   (0x1UL << EXTI_FTSR_TR9_Pos)
 
#define EXTI_FTSR_TR9   EXTI_FTSR_TR9_Msk
 
#define EXTI_FTSR_TR10_Pos   (10U)
 
#define EXTI_FTSR_TR10_Msk   (0x1UL << EXTI_FTSR_TR10_Pos)
 
#define EXTI_FTSR_TR10   EXTI_FTSR_TR10_Msk
 
#define EXTI_FTSR_TR11_Pos   (11U)
 
#define EXTI_FTSR_TR11_Msk   (0x1UL << EXTI_FTSR_TR11_Pos)
 
#define EXTI_FTSR_TR11   EXTI_FTSR_TR11_Msk
 
#define EXTI_FTSR_TR12_Pos   (12U)
 
#define EXTI_FTSR_TR12_Msk   (0x1UL << EXTI_FTSR_TR12_Pos)
 
#define EXTI_FTSR_TR12   EXTI_FTSR_TR12_Msk
 
#define EXTI_FTSR_TR13_Pos   (13U)
 
#define EXTI_FTSR_TR13_Msk   (0x1UL << EXTI_FTSR_TR13_Pos)
 
#define EXTI_FTSR_TR13   EXTI_FTSR_TR13_Msk
 
#define EXTI_FTSR_TR14_Pos   (14U)
 
#define EXTI_FTSR_TR14_Msk   (0x1UL << EXTI_FTSR_TR14_Pos)
 
#define EXTI_FTSR_TR14   EXTI_FTSR_TR14_Msk
 
#define EXTI_FTSR_TR15_Pos   (15U)
 
#define EXTI_FTSR_TR15_Msk   (0x1UL << EXTI_FTSR_TR15_Pos)
 
#define EXTI_FTSR_TR15   EXTI_FTSR_TR15_Msk
 
#define EXTI_FTSR_TR16_Pos   (16U)
 
#define EXTI_FTSR_TR16_Msk   (0x1UL << EXTI_FTSR_TR16_Pos)
 
#define EXTI_FTSR_TR16   EXTI_FTSR_TR16_Msk
 
#define EXTI_FTSR_TR17_Pos   (17U)
 
#define EXTI_FTSR_TR17_Msk   (0x1UL << EXTI_FTSR_TR17_Pos)
 
#define EXTI_FTSR_TR17   EXTI_FTSR_TR17_Msk
 
#define EXTI_FTSR_TR18_Pos   (18U)
 
#define EXTI_FTSR_TR18_Msk   (0x1UL << EXTI_FTSR_TR18_Pos)
 
#define EXTI_FTSR_TR18   EXTI_FTSR_TR18_Msk
 
#define EXTI_FTSR_TR19_Pos   (19U)
 
#define EXTI_FTSR_TR19_Msk   (0x1UL << EXTI_FTSR_TR19_Pos)
 
#define EXTI_FTSR_TR19   EXTI_FTSR_TR19_Msk
 
#define EXTI_FTSR_TR20_Pos   (20U)
 
#define EXTI_FTSR_TR20_Msk   (0x1UL << EXTI_FTSR_TR20_Pos)
 
#define EXTI_FTSR_TR20   EXTI_FTSR_TR20_Msk
 
#define EXTI_FTSR_TR21_Pos   (21U)
 
#define EXTI_FTSR_TR21_Msk   (0x1UL << EXTI_FTSR_TR21_Pos)
 
#define EXTI_FTSR_TR21   EXTI_FTSR_TR21_Msk
 
#define EXTI_FTSR_TR22_Pos   (22U)
 
#define EXTI_FTSR_TR22_Msk   (0x1UL << EXTI_FTSR_TR22_Pos)
 
#define EXTI_FTSR_TR22   EXTI_FTSR_TR22_Msk
 
#define EXTI_FTSR_TR29_Pos   (29U)
 
#define EXTI_FTSR_TR29_Msk   (0x1UL << EXTI_FTSR_TR29_Pos)
 
#define EXTI_FTSR_TR29   EXTI_FTSR_TR29_Msk
 
#define EXTI_FTSR_TR30_Pos   (30U)
 
#define EXTI_FTSR_TR30_Msk   (0x1UL << EXTI_FTSR_TR30_Pos)
 
#define EXTI_FTSR_TR30   EXTI_FTSR_TR30_Msk
 
#define EXTI_FTSR_TR31_Pos   (31U)
 
#define EXTI_FTSR_TR31_Msk   (0x1UL << EXTI_FTSR_TR31_Pos)
 
#define EXTI_FTSR_TR31   EXTI_FTSR_TR31_Msk
 
#define EXTI_FTSR_FT0   EXTI_FTSR_TR0
 
#define EXTI_FTSR_FT1   EXTI_FTSR_TR1
 
#define EXTI_FTSR_FT2   EXTI_FTSR_TR2
 
#define EXTI_FTSR_FT3   EXTI_FTSR_TR3
 
#define EXTI_FTSR_FT4   EXTI_FTSR_TR4
 
#define EXTI_FTSR_FT5   EXTI_FTSR_TR5
 
#define EXTI_FTSR_FT6   EXTI_FTSR_TR6
 
#define EXTI_FTSR_FT7   EXTI_FTSR_TR7
 
#define EXTI_FTSR_FT8   EXTI_FTSR_TR8
 
#define EXTI_FTSR_FT9   EXTI_FTSR_TR9
 
#define EXTI_FTSR_FT10   EXTI_FTSR_TR10
 
#define EXTI_FTSR_FT11   EXTI_FTSR_TR11
 
#define EXTI_FTSR_FT12   EXTI_FTSR_TR12
 
#define EXTI_FTSR_FT13   EXTI_FTSR_TR13
 
#define EXTI_FTSR_FT14   EXTI_FTSR_TR14
 
#define EXTI_FTSR_FT15   EXTI_FTSR_TR15
 
#define EXTI_FTSR_FT16   EXTI_FTSR_TR16
 
#define EXTI_FTSR_FT17   EXTI_FTSR_TR17
 
#define EXTI_FTSR_FT18   EXTI_FTSR_TR18
 
#define EXTI_FTSR_FT19   EXTI_FTSR_TR19
 
#define EXTI_FTSR_FT20   EXTI_FTSR_TR20
 
#define EXTI_FTSR_FT21   EXTI_FTSR_TR21
 
#define EXTI_FTSR_FT22   EXTI_FTSR_TR22
 
#define EXTI_FTSR_FT29   EXTI_FTSR_TR29
 
#define EXTI_FTSR_FT30   EXTI_FTSR_TR30
 
#define EXTI_FTSR_FT31   EXTI_FTSR_TR31
 
#define EXTI_SWIER_SWIER0_Pos   (0U)
 
#define EXTI_SWIER_SWIER0_Msk   (0x1UL << EXTI_SWIER_SWIER0_Pos)
 
#define EXTI_SWIER_SWIER0   EXTI_SWIER_SWIER0_Msk
 
#define EXTI_SWIER_SWIER1_Pos   (1U)
 
#define EXTI_SWIER_SWIER1_Msk   (0x1UL << EXTI_SWIER_SWIER1_Pos)
 
#define EXTI_SWIER_SWIER1   EXTI_SWIER_SWIER1_Msk
 
#define EXTI_SWIER_SWIER2_Pos   (2U)
 
#define EXTI_SWIER_SWIER2_Msk   (0x1UL << EXTI_SWIER_SWIER2_Pos)
 
#define EXTI_SWIER_SWIER2   EXTI_SWIER_SWIER2_Msk
 
#define EXTI_SWIER_SWIER3_Pos   (3U)
 
#define EXTI_SWIER_SWIER3_Msk   (0x1UL << EXTI_SWIER_SWIER3_Pos)
 
#define EXTI_SWIER_SWIER3   EXTI_SWIER_SWIER3_Msk
 
#define EXTI_SWIER_SWIER4_Pos   (4U)
 
#define EXTI_SWIER_SWIER4_Msk   (0x1UL << EXTI_SWIER_SWIER4_Pos)
 
#define EXTI_SWIER_SWIER4   EXTI_SWIER_SWIER4_Msk
 
#define EXTI_SWIER_SWIER5_Pos   (5U)
 
#define EXTI_SWIER_SWIER5_Msk   (0x1UL << EXTI_SWIER_SWIER5_Pos)
 
#define EXTI_SWIER_SWIER5   EXTI_SWIER_SWIER5_Msk
 
#define EXTI_SWIER_SWIER6_Pos   (6U)
 
#define EXTI_SWIER_SWIER6_Msk   (0x1UL << EXTI_SWIER_SWIER6_Pos)
 
#define EXTI_SWIER_SWIER6   EXTI_SWIER_SWIER6_Msk
 
#define EXTI_SWIER_SWIER7_Pos   (7U)
 
#define EXTI_SWIER_SWIER7_Msk   (0x1UL << EXTI_SWIER_SWIER7_Pos)
 
#define EXTI_SWIER_SWIER7   EXTI_SWIER_SWIER7_Msk
 
#define EXTI_SWIER_SWIER8_Pos   (8U)
 
#define EXTI_SWIER_SWIER8_Msk   (0x1UL << EXTI_SWIER_SWIER8_Pos)
 
#define EXTI_SWIER_SWIER8   EXTI_SWIER_SWIER8_Msk
 
#define EXTI_SWIER_SWIER9_Pos   (9U)
 
#define EXTI_SWIER_SWIER9_Msk   (0x1UL << EXTI_SWIER_SWIER9_Pos)
 
#define EXTI_SWIER_SWIER9   EXTI_SWIER_SWIER9_Msk
 
#define EXTI_SWIER_SWIER10_Pos   (10U)
 
#define EXTI_SWIER_SWIER10_Msk   (0x1UL << EXTI_SWIER_SWIER10_Pos)
 
#define EXTI_SWIER_SWIER10   EXTI_SWIER_SWIER10_Msk
 
#define EXTI_SWIER_SWIER11_Pos   (11U)
 
#define EXTI_SWIER_SWIER11_Msk   (0x1UL << EXTI_SWIER_SWIER11_Pos)
 
#define EXTI_SWIER_SWIER11   EXTI_SWIER_SWIER11_Msk
 
#define EXTI_SWIER_SWIER12_Pos   (12U)
 
#define EXTI_SWIER_SWIER12_Msk   (0x1UL << EXTI_SWIER_SWIER12_Pos)
 
#define EXTI_SWIER_SWIER12   EXTI_SWIER_SWIER12_Msk
 
#define EXTI_SWIER_SWIER13_Pos   (13U)
 
#define EXTI_SWIER_SWIER13_Msk   (0x1UL << EXTI_SWIER_SWIER13_Pos)
 
#define EXTI_SWIER_SWIER13   EXTI_SWIER_SWIER13_Msk
 
#define EXTI_SWIER_SWIER14_Pos   (14U)
 
#define EXTI_SWIER_SWIER14_Msk   (0x1UL << EXTI_SWIER_SWIER14_Pos)
 
#define EXTI_SWIER_SWIER14   EXTI_SWIER_SWIER14_Msk
 
#define EXTI_SWIER_SWIER15_Pos   (15U)
 
#define EXTI_SWIER_SWIER15_Msk   (0x1UL << EXTI_SWIER_SWIER15_Pos)
 
#define EXTI_SWIER_SWIER15   EXTI_SWIER_SWIER15_Msk
 
#define EXTI_SWIER_SWIER16_Pos   (16U)
 
#define EXTI_SWIER_SWIER16_Msk   (0x1UL << EXTI_SWIER_SWIER16_Pos)
 
#define EXTI_SWIER_SWIER16   EXTI_SWIER_SWIER16_Msk
 
#define EXTI_SWIER_SWIER17_Pos   (17U)
 
#define EXTI_SWIER_SWIER17_Msk   (0x1UL << EXTI_SWIER_SWIER17_Pos)
 
#define EXTI_SWIER_SWIER17   EXTI_SWIER_SWIER17_Msk
 
#define EXTI_SWIER_SWIER18_Pos   (18U)
 
#define EXTI_SWIER_SWIER18_Msk   (0x1UL << EXTI_SWIER_SWIER18_Pos)
 
#define EXTI_SWIER_SWIER18   EXTI_SWIER_SWIER18_Msk
 
#define EXTI_SWIER_SWIER19_Pos   (19U)
 
#define EXTI_SWIER_SWIER19_Msk   (0x1UL << EXTI_SWIER_SWIER19_Pos)
 
#define EXTI_SWIER_SWIER19   EXTI_SWIER_SWIER19_Msk
 
#define EXTI_SWIER_SWIER20_Pos   (20U)
 
#define EXTI_SWIER_SWIER20_Msk   (0x1UL << EXTI_SWIER_SWIER20_Pos)
 
#define EXTI_SWIER_SWIER20   EXTI_SWIER_SWIER20_Msk
 
#define EXTI_SWIER_SWIER21_Pos   (21U)
 
#define EXTI_SWIER_SWIER21_Msk   (0x1UL << EXTI_SWIER_SWIER21_Pos)
 
#define EXTI_SWIER_SWIER21   EXTI_SWIER_SWIER21_Msk
 
#define EXTI_SWIER_SWIER22_Pos   (22U)
 
#define EXTI_SWIER_SWIER22_Msk   (0x1UL << EXTI_SWIER_SWIER22_Pos)
 
#define EXTI_SWIER_SWIER22   EXTI_SWIER_SWIER22_Msk
 
#define EXTI_SWIER_SWIER29_Pos   (29U)
 
#define EXTI_SWIER_SWIER29_Msk   (0x1UL << EXTI_SWIER_SWIER29_Pos)
 
#define EXTI_SWIER_SWIER29   EXTI_SWIER_SWIER29_Msk
 
#define EXTI_SWIER_SWIER30_Pos   (30U)
 
#define EXTI_SWIER_SWIER30_Msk   (0x1UL << EXTI_SWIER_SWIER30_Pos)
 
#define EXTI_SWIER_SWIER30   EXTI_SWIER_SWIER30_Msk
 
#define EXTI_SWIER_SWIER31_Pos   (31U)
 
#define EXTI_SWIER_SWIER31_Msk   (0x1UL << EXTI_SWIER_SWIER31_Pos)
 
#define EXTI_SWIER_SWIER31   EXTI_SWIER_SWIER31_Msk
 
#define EXTI_SWIER_SWI0   EXTI_SWIER_SWIER0
 
#define EXTI_SWIER_SWI1   EXTI_SWIER_SWIER1
 
#define EXTI_SWIER_SWI2   EXTI_SWIER_SWIER2
 
#define EXTI_SWIER_SWI3   EXTI_SWIER_SWIER3
 
#define EXTI_SWIER_SWI4   EXTI_SWIER_SWIER4
 
#define EXTI_SWIER_SWI5   EXTI_SWIER_SWIER5
 
#define EXTI_SWIER_SWI6   EXTI_SWIER_SWIER6
 
#define EXTI_SWIER_SWI7   EXTI_SWIER_SWIER7
 
#define EXTI_SWIER_SWI8   EXTI_SWIER_SWIER8
 
#define EXTI_SWIER_SWI9   EXTI_SWIER_SWIER9
 
#define EXTI_SWIER_SWI10   EXTI_SWIER_SWIER10
 
#define EXTI_SWIER_SWI11   EXTI_SWIER_SWIER11
 
#define EXTI_SWIER_SWI12   EXTI_SWIER_SWIER12
 
#define EXTI_SWIER_SWI13   EXTI_SWIER_SWIER13
 
#define EXTI_SWIER_SWI14   EXTI_SWIER_SWIER14
 
#define EXTI_SWIER_SWI15   EXTI_SWIER_SWIER15
 
#define EXTI_SWIER_SWI16   EXTI_SWIER_SWIER16
 
#define EXTI_SWIER_SWI17   EXTI_SWIER_SWIER17
 
#define EXTI_SWIER_SWI18   EXTI_SWIER_SWIER18
 
#define EXTI_SWIER_SWI19   EXTI_SWIER_SWIER19
 
#define EXTI_SWIER_SWI20   EXTI_SWIER_SWIER20
 
#define EXTI_SWIER_SWI21   EXTI_SWIER_SWIER21
 
#define EXTI_SWIER_SWI22   EXTI_SWIER_SWIER22
 
#define EXTI_SWIER_SWI29   EXTI_SWIER_SWIER29
 
#define EXTI_SWIER_SWI30   EXTI_SWIER_SWIER30
 
#define EXTI_SWIER_SWI31   EXTI_SWIER_SWIER31
 
#define EXTI_PR_PR0_Pos   (0U)
 
#define EXTI_PR_PR0_Msk   (0x1UL << EXTI_PR_PR0_Pos)
 
#define EXTI_PR_PR0   EXTI_PR_PR0_Msk
 
#define EXTI_PR_PR1_Pos   (1U)
 
#define EXTI_PR_PR1_Msk   (0x1UL << EXTI_PR_PR1_Pos)
 
#define EXTI_PR_PR1   EXTI_PR_PR1_Msk
 
#define EXTI_PR_PR2_Pos   (2U)
 
#define EXTI_PR_PR2_Msk   (0x1UL << EXTI_PR_PR2_Pos)
 
#define EXTI_PR_PR2   EXTI_PR_PR2_Msk
 
#define EXTI_PR_PR3_Pos   (3U)
 
#define EXTI_PR_PR3_Msk   (0x1UL << EXTI_PR_PR3_Pos)
 
#define EXTI_PR_PR3   EXTI_PR_PR3_Msk
 
#define EXTI_PR_PR4_Pos   (4U)
 
#define EXTI_PR_PR4_Msk   (0x1UL << EXTI_PR_PR4_Pos)
 
#define EXTI_PR_PR4   EXTI_PR_PR4_Msk
 
#define EXTI_PR_PR5_Pos   (5U)
 
#define EXTI_PR_PR5_Msk   (0x1UL << EXTI_PR_PR5_Pos)
 
#define EXTI_PR_PR5   EXTI_PR_PR5_Msk
 
#define EXTI_PR_PR6_Pos   (6U)
 
#define EXTI_PR_PR6_Msk   (0x1UL << EXTI_PR_PR6_Pos)
 
#define EXTI_PR_PR6   EXTI_PR_PR6_Msk
 
#define EXTI_PR_PR7_Pos   (7U)
 
#define EXTI_PR_PR7_Msk   (0x1UL << EXTI_PR_PR7_Pos)
 
#define EXTI_PR_PR7   EXTI_PR_PR7_Msk
 
#define EXTI_PR_PR8_Pos   (8U)
 
#define EXTI_PR_PR8_Msk   (0x1UL << EXTI_PR_PR8_Pos)
 
#define EXTI_PR_PR8   EXTI_PR_PR8_Msk
 
#define EXTI_PR_PR9_Pos   (9U)
 
#define EXTI_PR_PR9_Msk   (0x1UL << EXTI_PR_PR9_Pos)
 
#define EXTI_PR_PR9   EXTI_PR_PR9_Msk
 
#define EXTI_PR_PR10_Pos   (10U)
 
#define EXTI_PR_PR10_Msk   (0x1UL << EXTI_PR_PR10_Pos)
 
#define EXTI_PR_PR10   EXTI_PR_PR10_Msk
 
#define EXTI_PR_PR11_Pos   (11U)
 
#define EXTI_PR_PR11_Msk   (0x1UL << EXTI_PR_PR11_Pos)
 
#define EXTI_PR_PR11   EXTI_PR_PR11_Msk
 
#define EXTI_PR_PR12_Pos   (12U)
 
#define EXTI_PR_PR12_Msk   (0x1UL << EXTI_PR_PR12_Pos)
 
#define EXTI_PR_PR12   EXTI_PR_PR12_Msk
 
#define EXTI_PR_PR13_Pos   (13U)
 
#define EXTI_PR_PR13_Msk   (0x1UL << EXTI_PR_PR13_Pos)
 
#define EXTI_PR_PR13   EXTI_PR_PR13_Msk
 
#define EXTI_PR_PR14_Pos   (14U)
 
#define EXTI_PR_PR14_Msk   (0x1UL << EXTI_PR_PR14_Pos)
 
#define EXTI_PR_PR14   EXTI_PR_PR14_Msk
 
#define EXTI_PR_PR15_Pos   (15U)
 
#define EXTI_PR_PR15_Msk   (0x1UL << EXTI_PR_PR15_Pos)
 
#define EXTI_PR_PR15   EXTI_PR_PR15_Msk
 
#define EXTI_PR_PR16_Pos   (16U)
 
#define EXTI_PR_PR16_Msk   (0x1UL << EXTI_PR_PR16_Pos)
 
#define EXTI_PR_PR16   EXTI_PR_PR16_Msk
 
#define EXTI_PR_PR17_Pos   (17U)
 
#define EXTI_PR_PR17_Msk   (0x1UL << EXTI_PR_PR17_Pos)
 
#define EXTI_PR_PR17   EXTI_PR_PR17_Msk
 
#define EXTI_PR_PR18_Pos   (18U)
 
#define EXTI_PR_PR18_Msk   (0x1UL << EXTI_PR_PR18_Pos)
 
#define EXTI_PR_PR18   EXTI_PR_PR18_Msk
 
#define EXTI_PR_PR19_Pos   (19U)
 
#define EXTI_PR_PR19_Msk   (0x1UL << EXTI_PR_PR19_Pos)
 
#define EXTI_PR_PR19   EXTI_PR_PR19_Msk
 
#define EXTI_PR_PR20_Pos   (20U)
 
#define EXTI_PR_PR20_Msk   (0x1UL << EXTI_PR_PR20_Pos)
 
#define EXTI_PR_PR20   EXTI_PR_PR20_Msk
 
#define EXTI_PR_PR21_Pos   (21U)
 
#define EXTI_PR_PR21_Msk   (0x1UL << EXTI_PR_PR21_Pos)
 
#define EXTI_PR_PR21   EXTI_PR_PR21_Msk
 
#define EXTI_PR_PR22_Pos   (22U)
 
#define EXTI_PR_PR22_Msk   (0x1UL << EXTI_PR_PR22_Pos)
 
#define EXTI_PR_PR22   EXTI_PR_PR22_Msk
 
#define EXTI_PR_PR29_Pos   (29U)
 
#define EXTI_PR_PR29_Msk   (0x1UL << EXTI_PR_PR29_Pos)
 
#define EXTI_PR_PR29   EXTI_PR_PR29_Msk
 
#define EXTI_PR_PR30_Pos   (30U)
 
#define EXTI_PR_PR30_Msk   (0x1UL << EXTI_PR_PR30_Pos)
 
#define EXTI_PR_PR30   EXTI_PR_PR30_Msk
 
#define EXTI_PR_PR31_Pos   (31U)
 
#define EXTI_PR_PR31_Msk   (0x1UL << EXTI_PR_PR31_Pos)
 
#define EXTI_PR_PR31   EXTI_PR_PR31_Msk
 
#define EXTI_PR_PIF0   EXTI_PR_PR0
 
#define EXTI_PR_PIF1   EXTI_PR_PR1
 
#define EXTI_PR_PIF2   EXTI_PR_PR2
 
#define EXTI_PR_PIF3   EXTI_PR_PR3
 
#define EXTI_PR_PIF4   EXTI_PR_PR4
 
#define EXTI_PR_PIF5   EXTI_PR_PR5
 
#define EXTI_PR_PIF6   EXTI_PR_PR6
 
#define EXTI_PR_PIF6   EXTI_PR_PR6
 
#define EXTI_PR_PIF7   EXTI_PR_PR7
 
#define EXTI_PR_PIF8   EXTI_PR_PR8
 
#define EXTI_PR_PIF9   EXTI_PR_PR9
 
#define EXTI_PR_PIF10   EXTI_PR_PR10
 
#define EXTI_PR_PIF11   EXTI_PR_PR11
 
#define EXTI_PR_PIF12   EXTI_PR_PR12
 
#define EXTI_PR_PIF13   EXTI_PR_PR13
 
#define EXTI_PR_PIF14   EXTI_PR_PR14
 
#define EXTI_PR_PIF15   EXTI_PR_PR15
 
#define EXTI_PR_PIF16   EXTI_PR_PR16
 
#define EXTI_PR_PIF17   EXTI_PR_PR17
 
#define EXTI_PR_PIF18   EXTI_PR_PR18
 
#define EXTI_PR_PIF19   EXTI_PR_PR19
 
#define EXTI_PR_PIF20   EXTI_PR_PR20
 
#define EXTI_PR_PIF21   EXTI_PR_PR21
 
#define EXTI_PR_PIF22   EXTI_PR_PR22
 
#define EXTI_PR_PIF29   EXTI_PR_PR29
 
#define EXTI_PR_PIF30   EXTI_PR_PR30
 
#define EXTI_PR_PIF31   EXTI_PR_PR31
 
#define EXTI_32_63_SUPPORT   /* EXTI support more than 32 lines */
 
#define EXTI_IMR2_MR32_Pos   (0U)
 
#define EXTI_IMR2_MR32_Msk   (0x1UL << EXTI_IMR2_MR32_Pos)
 
#define EXTI_IMR2_MR32   EXTI_IMR2_MR32_Msk
 
#define EXTI_IMR2_MR33_Pos   (1U)
 
#define EXTI_IMR2_MR33_Msk   (0x1UL << EXTI_IMR2_MR33_Pos)
 
#define EXTI_IMR2_MR33   EXTI_IMR2_MR33_Msk
 
#define EXTI_IMR2_MR34_Pos   (2U)
 
#define EXTI_IMR2_MR34_Msk   (0x1UL << EXTI_IMR2_MR34_Pos)
 
#define EXTI_IMR2_MR34   EXTI_IMR2_MR34_Msk
 
#define EXTI_IMR2_MR35_Pos   (3U)
 
#define EXTI_IMR2_MR35_Msk   (0x1UL << EXTI_IMR2_MR35_Pos)
 
#define EXTI_IMR2_MR35   EXTI_IMR2_MR35_Msk
 
#define EXTI_IMR2_IM32   EXTI_IMR2_MR32
 
#define EXTI_IMR2_IM33   EXTI_IMR2_MR33
 
#define EXTI_IMR2_IM34   EXTI_IMR2_MR34
 
#define EXTI_IMR2_IM35   EXTI_IMR2_MR35
 
#define EXTI_IMR2_IM_Pos   (0U)
 
#define EXTI_IMR2_IM_Msk   (0xFUL << EXTI_IMR2_IM_Pos)
 
#define EXTI_IMR2_IM   EXTI_IMR2_IM_Msk
 
#define EXTI_EMR2_MR32_Pos   (0U)
 
#define EXTI_EMR2_MR32_Msk   (0x1UL << EXTI_EMR2_MR32_Pos)
 
#define EXTI_EMR2_MR32   EXTI_EMR2_MR32_Msk
 
#define EXTI_EMR2_MR33_Pos   (1U)
 
#define EXTI_EMR2_MR33_Msk   (0x1UL << EXTI_EMR2_MR33_Pos)
 
#define EXTI_EMR2_MR33   EXTI_EMR2_MR33_Msk
 
#define EXTI_EMR2_MR34_Pos   (2U)
 
#define EXTI_EMR2_MR34_Msk   (0x1UL << EXTI_EMR2_MR34_Pos)
 
#define EXTI_EMR2_MR34   EXTI_EMR2_MR34_Msk
 
#define EXTI_EMR2_MR35_Pos   (3U)
 
#define EXTI_EMR2_MR35_Msk   (0x1UL << EXTI_EMR2_MR35_Pos)
 
#define EXTI_EMR2_MR35   EXTI_EMR2_MR35_Msk
 
#define EXTI_EMR2_EM32   EXTI_EMR2_MR32
 
#define EXTI_EMR2_EM33   EXTI_EMR2_MR33
 
#define EXTI_EMR2_EM34   EXTI_EMR2_MR34
 
#define EXTI_EMR2_EM35   EXTI_EMR2_MR35
 
#define EXTI_EMR2_EM_Pos   (0U)
 
#define EXTI_EMR2_EM_Msk   (0xFUL << EXTI_EMR2_EM_Pos)
 
#define EXTI_EMR2_EM   EXTI_EMR2_EM_Msk
 
#define EXTI_RTSR2_TR32_Pos   (0U)
 
#define EXTI_RTSR2_TR32_Msk   (0x1UL << EXTI_RTSR2_TR32_Pos)
 
#define EXTI_RTSR2_TR32   EXTI_RTSR2_TR32_Msk
 
#define EXTI_RTSR2_TR33_Pos   (1U)
 
#define EXTI_RTSR2_TR33_Msk   (0x1UL << EXTI_RTSR2_TR33_Pos)
 
#define EXTI_RTSR2_TR33   EXTI_RTSR2_TR33_Msk
 
#define EXTI_RTSR2_RT32   EXTI_RTSR2_TR32
 
#define EXTI_RTSR2_RT33   EXTI_RTSR2_TR33
 
#define EXTI_FTSR2_TR32_Pos   (0U)
 
#define EXTI_FTSR2_TR32_Msk   (0x1UL << EXTI_FTSR2_TR32_Pos)
 
#define EXTI_FTSR2_TR32   EXTI_FTSR2_TR32_Msk
 
#define EXTI_FTSR2_TR33_Pos   (1U)
 
#define EXTI_FTSR2_TR33_Msk   (0x1UL << EXTI_FTSR2_TR33_Pos)
 
#define EXTI_FTSR2_TR33   EXTI_FTSR2_TR33_Msk
 
#define EXTI_FTSR2_FT32   EXTI_FTSR2_TR32
 
#define EXTI_FTSR2_FT33   EXTI_FTSR2_TR33
 
#define EXTI_SWIER2_SWIER32_Pos   (0U)
 
#define EXTI_SWIER2_SWIER32_Msk   (0x1UL << EXTI_SWIER2_SWIER32_Pos)
 
#define EXTI_SWIER2_SWIER32   EXTI_SWIER2_SWIER32_Msk
 
#define EXTI_SWIER2_SWIER33_Pos   (1U)
 
#define EXTI_SWIER2_SWIER33_Msk   (0x1UL << EXTI_SWIER2_SWIER33_Pos)
 
#define EXTI_SWIER2_SWIER33   EXTI_SWIER2_SWIER33_Msk
 
#define EXTI_SWIER2_SWI32   EXTI_SWIER2_SWIER32
 
#define EXTI_SWIER2_SWI33   EXTI_SWIER2_SWIER33
 
#define EXTI_PR2_PR32_Pos   (0U)
 
#define EXTI_PR2_PR32_Msk   (0x1UL << EXTI_PR2_PR32_Pos)
 
#define EXTI_PR2_PR32   EXTI_PR2_PR32_Msk
 
#define EXTI_PR2_PR33_Pos   (1U)
 
#define EXTI_PR2_PR33_Msk   (0x1UL << EXTI_PR2_PR33_Pos)
 
#define EXTI_PR2_PR33   EXTI_PR2_PR33_Msk
 
#define EXTI_PR2_PIF32   EXTI_PR2_PR32
 
#define EXTI_PR2_PIF33   EXTI_PR2_PR33
 
#define FLASH_ACR_LATENCY_Pos   (0U)
 
#define FLASH_ACR_LATENCY_Msk   (0x7UL << FLASH_ACR_LATENCY_Pos)
 
#define FLASH_ACR_LATENCY   FLASH_ACR_LATENCY_Msk
 
#define FLASH_ACR_LATENCY_0   (0x1UL << FLASH_ACR_LATENCY_Pos)
 
#define FLASH_ACR_LATENCY_1   (0x2UL << FLASH_ACR_LATENCY_Pos)
 
#define FLASH_ACR_LATENCY_2   (0x4UL << FLASH_ACR_LATENCY_Pos)
 
#define FLASH_ACR_HLFCYA_Pos   (3U)
 
#define FLASH_ACR_HLFCYA_Msk   (0x1UL << FLASH_ACR_HLFCYA_Pos)
 
#define FLASH_ACR_HLFCYA   FLASH_ACR_HLFCYA_Msk
 
#define FLASH_ACR_PRFTBE_Pos   (4U)
 
#define FLASH_ACR_PRFTBE_Msk   (0x1UL << FLASH_ACR_PRFTBE_Pos)
 
#define FLASH_ACR_PRFTBE   FLASH_ACR_PRFTBE_Msk
 
#define FLASH_ACR_PRFTBS_Pos   (5U)
 
#define FLASH_ACR_PRFTBS_Msk   (0x1UL << FLASH_ACR_PRFTBS_Pos)
 
#define FLASH_ACR_PRFTBS   FLASH_ACR_PRFTBS_Msk
 
#define FLASH_KEYR_FKEYR_Pos   (0U)
 
#define FLASH_KEYR_FKEYR_Msk   (0xFFFFFFFFUL << FLASH_KEYR_FKEYR_Pos)
 
#define FLASH_KEYR_FKEYR   FLASH_KEYR_FKEYR_Msk
 
#define RDP_KEY_Pos   (0U)
 
#define RDP_KEY_Msk   (0xA5UL << RDP_KEY_Pos)
 
#define RDP_KEY   RDP_KEY_Msk
 
#define FLASH_KEY1_Pos   (0U)
 
#define FLASH_KEY1_Msk   (0x45670123UL << FLASH_KEY1_Pos)
 
#define FLASH_KEY1   FLASH_KEY1_Msk
 
#define FLASH_KEY2_Pos   (0U)
 
#define FLASH_KEY2_Msk   (0xCDEF89ABUL << FLASH_KEY2_Pos)
 
#define FLASH_KEY2   FLASH_KEY2_Msk
 
#define FLASH_OPTKEYR_OPTKEYR_Pos   (0U)
 
#define FLASH_OPTKEYR_OPTKEYR_Msk   (0xFFFFFFFFUL << FLASH_OPTKEYR_OPTKEYR_Pos)
 
#define FLASH_OPTKEYR_OPTKEYR   FLASH_OPTKEYR_OPTKEYR_Msk
 
#define FLASH_OPTKEY1   FLASH_KEY1
 
#define FLASH_OPTKEY2   FLASH_KEY2
 
#define FLASH_SR_BSY_Pos   (0U)
 
#define FLASH_SR_BSY_Msk   (0x1UL << FLASH_SR_BSY_Pos)
 
#define FLASH_SR_BSY   FLASH_SR_BSY_Msk
 
#define FLASH_SR_PGERR_Pos   (2U)
 
#define FLASH_SR_PGERR_Msk   (0x1UL << FLASH_SR_PGERR_Pos)
 
#define FLASH_SR_PGERR   FLASH_SR_PGERR_Msk
 
#define FLASH_SR_WRPERR_Pos   (4U)
 
#define FLASH_SR_WRPERR_Msk   (0x1UL << FLASH_SR_WRPERR_Pos)
 
#define FLASH_SR_WRPERR   FLASH_SR_WRPERR_Msk
 
#define FLASH_SR_EOP_Pos   (5U)
 
#define FLASH_SR_EOP_Msk   (0x1UL << FLASH_SR_EOP_Pos)
 
#define FLASH_SR_EOP   FLASH_SR_EOP_Msk
 
#define FLASH_CR_PG_Pos   (0U)
 
#define FLASH_CR_PG_Msk   (0x1UL << FLASH_CR_PG_Pos)
 
#define FLASH_CR_PG   FLASH_CR_PG_Msk
 
#define FLASH_CR_PER_Pos   (1U)
 
#define FLASH_CR_PER_Msk   (0x1UL << FLASH_CR_PER_Pos)
 
#define FLASH_CR_PER   FLASH_CR_PER_Msk
 
#define FLASH_CR_MER_Pos   (2U)
 
#define FLASH_CR_MER_Msk   (0x1UL << FLASH_CR_MER_Pos)
 
#define FLASH_CR_MER   FLASH_CR_MER_Msk
 
#define FLASH_CR_OPTPG_Pos   (4U)
 
#define FLASH_CR_OPTPG_Msk   (0x1UL << FLASH_CR_OPTPG_Pos)
 
#define FLASH_CR_OPTPG   FLASH_CR_OPTPG_Msk
 
#define FLASH_CR_OPTER_Pos   (5U)
 
#define FLASH_CR_OPTER_Msk   (0x1UL << FLASH_CR_OPTER_Pos)
 
#define FLASH_CR_OPTER   FLASH_CR_OPTER_Msk
 
#define FLASH_CR_STRT_Pos   (6U)
 
#define FLASH_CR_STRT_Msk   (0x1UL << FLASH_CR_STRT_Pos)
 
#define FLASH_CR_STRT   FLASH_CR_STRT_Msk
 
#define FLASH_CR_LOCK_Pos   (7U)
 
#define FLASH_CR_LOCK_Msk   (0x1UL << FLASH_CR_LOCK_Pos)
 
#define FLASH_CR_LOCK   FLASH_CR_LOCK_Msk
 
#define FLASH_CR_OPTWRE_Pos   (9U)
 
#define FLASH_CR_OPTWRE_Msk   (0x1UL << FLASH_CR_OPTWRE_Pos)
 
#define FLASH_CR_OPTWRE   FLASH_CR_OPTWRE_Msk
 
#define FLASH_CR_ERRIE_Pos   (10U)
 
#define FLASH_CR_ERRIE_Msk   (0x1UL << FLASH_CR_ERRIE_Pos)
 
#define FLASH_CR_ERRIE   FLASH_CR_ERRIE_Msk
 
#define FLASH_CR_EOPIE_Pos   (12U)
 
#define FLASH_CR_EOPIE_Msk   (0x1UL << FLASH_CR_EOPIE_Pos)
 
#define FLASH_CR_EOPIE   FLASH_CR_EOPIE_Msk
 
#define FLASH_CR_OBL_LAUNCH_Pos   (13U)
 
#define FLASH_CR_OBL_LAUNCH_Msk   (0x1UL << FLASH_CR_OBL_LAUNCH_Pos)
 
#define FLASH_CR_OBL_LAUNCH   FLASH_CR_OBL_LAUNCH_Msk
 
#define FLASH_AR_FAR_Pos   (0U)
 
#define FLASH_AR_FAR_Msk   (0xFFFFFFFFUL << FLASH_AR_FAR_Pos)
 
#define FLASH_AR_FAR   FLASH_AR_FAR_Msk
 
#define FLASH_OBR_OPTERR_Pos   (0U)
 
#define FLASH_OBR_OPTERR_Msk   (0x1UL << FLASH_OBR_OPTERR_Pos)
 
#define FLASH_OBR_OPTERR   FLASH_OBR_OPTERR_Msk
 
#define FLASH_OBR_RDPRT_Pos   (1U)
 
#define FLASH_OBR_RDPRT_Msk   (0x3UL << FLASH_OBR_RDPRT_Pos)
 
#define FLASH_OBR_RDPRT   FLASH_OBR_RDPRT_Msk
 
#define FLASH_OBR_RDPRT_1   (0x1UL << FLASH_OBR_RDPRT_Pos)
 
#define FLASH_OBR_RDPRT_2   (0x3UL << FLASH_OBR_RDPRT_Pos)
 
#define FLASH_OBR_USER_Pos   (8U)
 
#define FLASH_OBR_USER_Msk   (0x77UL << FLASH_OBR_USER_Pos)
 
#define FLASH_OBR_USER   FLASH_OBR_USER_Msk
 
#define FLASH_OBR_IWDG_SW_Pos   (8U)
 
#define FLASH_OBR_IWDG_SW_Msk   (0x1UL << FLASH_OBR_IWDG_SW_Pos)
 
#define FLASH_OBR_IWDG_SW   FLASH_OBR_IWDG_SW_Msk
 
#define FLASH_OBR_nRST_STOP_Pos   (9U)
 
#define FLASH_OBR_nRST_STOP_Msk   (0x1UL << FLASH_OBR_nRST_STOP_Pos)
 
#define FLASH_OBR_nRST_STOP   FLASH_OBR_nRST_STOP_Msk
 
#define FLASH_OBR_nRST_STDBY_Pos   (10U)
 
#define FLASH_OBR_nRST_STDBY_Msk   (0x1UL << FLASH_OBR_nRST_STDBY_Pos)
 
#define FLASH_OBR_nRST_STDBY   FLASH_OBR_nRST_STDBY_Msk
 
#define FLASH_OBR_nBOOT1_Pos   (12U)
 
#define FLASH_OBR_nBOOT1_Msk   (0x1UL << FLASH_OBR_nBOOT1_Pos)
 
#define FLASH_OBR_nBOOT1   FLASH_OBR_nBOOT1_Msk
 
#define FLASH_OBR_VDDA_MONITOR_Pos   (13U)
 
#define FLASH_OBR_VDDA_MONITOR_Msk   (0x1UL << FLASH_OBR_VDDA_MONITOR_Pos)
 
#define FLASH_OBR_VDDA_MONITOR   FLASH_OBR_VDDA_MONITOR_Msk
 
#define FLASH_OBR_SRAM_PE_Pos   (14U)
 
#define FLASH_OBR_SRAM_PE_Msk   (0x1UL << FLASH_OBR_SRAM_PE_Pos)
 
#define FLASH_OBR_SRAM_PE   FLASH_OBR_SRAM_PE_Msk
 
#define FLASH_OBR_DATA0_Pos   (16U)
 
#define FLASH_OBR_DATA0_Msk   (0xFFUL << FLASH_OBR_DATA0_Pos)
 
#define FLASH_OBR_DATA0   FLASH_OBR_DATA0_Msk
 
#define FLASH_OBR_DATA1_Pos   (24U)
 
#define FLASH_OBR_DATA1_Msk   (0xFFUL << FLASH_OBR_DATA1_Pos)
 
#define FLASH_OBR_DATA1   FLASH_OBR_DATA1_Msk
 
#define FLASH_OBR_WDG_SW   FLASH_OBR_IWDG_SW
 
#define FLASH_WRPR_WRP_Pos   (0U)
 
#define FLASH_WRPR_WRP_Msk   (0xFFFFFFFFUL << FLASH_WRPR_WRP_Pos)
 
#define FLASH_WRPR_WRP   FLASH_WRPR_WRP_Msk
 
#define OB_RDP_RDP_Pos   (0U)
 
#define OB_RDP_RDP_Msk   (0xFFUL << OB_RDP_RDP_Pos)
 
#define OB_RDP_RDP   OB_RDP_RDP_Msk
 
#define OB_RDP_nRDP_Pos   (8U)
 
#define OB_RDP_nRDP_Msk   (0xFFUL << OB_RDP_nRDP_Pos)
 
#define OB_RDP_nRDP   OB_RDP_nRDP_Msk
 
#define OB_USER_USER_Pos   (16U)
 
#define OB_USER_USER_Msk   (0xFFUL << OB_USER_USER_Pos)
 
#define OB_USER_USER   OB_USER_USER_Msk
 
#define OB_USER_nUSER_Pos   (24U)
 
#define OB_USER_nUSER_Msk   (0xFFUL << OB_USER_nUSER_Pos)
 
#define OB_USER_nUSER   OB_USER_nUSER_Msk
 
#define OB_WRP0_WRP0_Pos   (0U)
 
#define OB_WRP0_WRP0_Msk   (0xFFUL << OB_WRP0_WRP0_Pos)
 
#define OB_WRP0_WRP0   OB_WRP0_WRP0_Msk
 
#define OB_WRP0_nWRP0_Pos   (8U)
 
#define OB_WRP0_nWRP0_Msk   (0xFFUL << OB_WRP0_nWRP0_Pos)
 
#define OB_WRP0_nWRP0   OB_WRP0_nWRP0_Msk
 
#define OB_WRP1_WRP1_Pos   (16U)
 
#define OB_WRP1_WRP1_Msk   (0xFFUL << OB_WRP1_WRP1_Pos)
 
#define OB_WRP1_WRP1   OB_WRP1_WRP1_Msk
 
#define OB_WRP1_nWRP1_Pos   (24U)
 
#define OB_WRP1_nWRP1_Msk   (0xFFUL << OB_WRP1_nWRP1_Pos)
 
#define OB_WRP1_nWRP1   OB_WRP1_nWRP1_Msk
 
#define OB_WRP2_WRP2_Pos   (0U)
 
#define OB_WRP2_WRP2_Msk   (0xFFUL << OB_WRP2_WRP2_Pos)
 
#define OB_WRP2_WRP2   OB_WRP2_WRP2_Msk
 
#define OB_WRP2_nWRP2_Pos   (8U)
 
#define OB_WRP2_nWRP2_Msk   (0xFFUL << OB_WRP2_nWRP2_Pos)
 
#define OB_WRP2_nWRP2   OB_WRP2_nWRP2_Msk
 
#define OB_WRP3_WRP3_Pos   (16U)
 
#define OB_WRP3_WRP3_Msk   (0xFFUL << OB_WRP3_WRP3_Pos)
 
#define OB_WRP3_WRP3   OB_WRP3_WRP3_Msk
 
#define OB_WRP3_nWRP3_Pos   (24U)
 
#define OB_WRP3_nWRP3_Msk   (0xFFUL << OB_WRP3_nWRP3_Pos)
 
#define OB_WRP3_nWRP3   OB_WRP3_nWRP3_Msk
 
#define FMC_BCRx_MBKEN_Pos   (0U)
 
#define FMC_BCRx_MBKEN_Msk   (0x1UL << FMC_BCRx_MBKEN_Pos)
 
#define FMC_BCRx_MBKEN   FMC_BCRx_MBKEN_Msk
 
#define FMC_BCRx_MUXEN_Pos   (1U)
 
#define FMC_BCRx_MUXEN_Msk   (0x1UL << FMC_BCRx_MUXEN_Pos)
 
#define FMC_BCRx_MUXEN   FMC_BCRx_MUXEN_Msk
 
#define FMC_BCRx_MTYP_Pos   (2U)
 
#define FMC_BCRx_MTYP_Msk   (0x3UL << FMC_BCRx_MTYP_Pos)
 
#define FMC_BCRx_MTYP   FMC_BCRx_MTYP_Msk
 
#define FMC_BCRx_MTYP_0   (0x1UL << FMC_BCRx_MTYP_Pos)
 
#define FMC_BCRx_MTYP_1   (0x2UL << FMC_BCRx_MTYP_Pos)
 
#define FMC_BCRx_MWID_Pos   (4U)
 
#define FMC_BCRx_MWID_Msk   (0x3UL << FMC_BCRx_MWID_Pos)
 
#define FMC_BCRx_MWID   FMC_BCRx_MWID_Msk
 
#define FMC_BCRx_MWID_0   (0x1UL << FMC_BCRx_MWID_Pos)
 
#define FMC_BCRx_MWID_1   (0x2UL << FMC_BCRx_MWID_Pos)
 
#define FMC_BCRx_FACCEN_Pos   (6U)
 
#define FMC_BCRx_FACCEN_Msk   (0x1UL << FMC_BCRx_FACCEN_Pos)
 
#define FMC_BCRx_FACCEN   FMC_BCRx_FACCEN_Msk
 
#define FMC_BCRx_BURSTEN_Pos   (8U)
 
#define FMC_BCRx_BURSTEN_Msk   (0x1UL << FMC_BCRx_BURSTEN_Pos)
 
#define FMC_BCRx_BURSTEN   FMC_BCRx_BURSTEN_Msk
 
#define FMC_BCRx_WAITPOL_Pos   (9U)
 
#define FMC_BCRx_WAITPOL_Msk   (0x1UL << FMC_BCRx_WAITPOL_Pos)
 
#define FMC_BCRx_WAITPOL   FMC_BCRx_WAITPOL_Msk
 
#define FMC_BCRx_WRAPMOD_Pos   (10U)
 
#define FMC_BCRx_WRAPMOD_Msk   (0x1UL << FMC_BCRx_WRAPMOD_Pos)
 
#define FMC_BCRx_WRAPMOD   FMC_BCRx_WRAPMOD_Msk
 
#define FMC_BCRx_WAITCFG_Pos   (11U)
 
#define FMC_BCRx_WAITCFG_Msk   (0x1UL << FMC_BCRx_WAITCFG_Pos)
 
#define FMC_BCRx_WAITCFG   FMC_BCRx_WAITCFG_Msk
 
#define FMC_BCRx_WREN_Pos   (12U)
 
#define FMC_BCRx_WREN_Msk   (0x1UL << FMC_BCRx_WREN_Pos)
 
#define FMC_BCRx_WREN   FMC_BCRx_WREN_Msk
 
#define FMC_BCRx_WAITEN_Pos   (13U)
 
#define FMC_BCRx_WAITEN_Msk   (0x1UL << FMC_BCRx_WAITEN_Pos)
 
#define FMC_BCRx_WAITEN   FMC_BCRx_WAITEN_Msk
 
#define FMC_BCRx_EXTMOD_Pos   (14U)
 
#define FMC_BCRx_EXTMOD_Msk   (0x1UL << FMC_BCRx_EXTMOD_Pos)
 
#define FMC_BCRx_EXTMOD   FMC_BCRx_EXTMOD_Msk
 
#define FMC_BCRx_ASYNCWAIT_Pos   (15U)
 
#define FMC_BCRx_ASYNCWAIT_Msk   (0x1UL << FMC_BCRx_ASYNCWAIT_Pos)
 
#define FMC_BCRx_ASYNCWAIT   FMC_BCRx_ASYNCWAIT_Msk
 
#define FMC_BCRx_CBURSTRW_Pos   (19U)
 
#define FMC_BCRx_CBURSTRW_Msk   (0x1UL << FMC_BCRx_CBURSTRW_Pos)
 
#define FMC_BCRx_CBURSTRW   FMC_BCRx_CBURSTRW_Msk
 
#define FMC_BCR1_MBKEN_Pos   (0U)
 
#define FMC_BCR1_MBKEN_Msk   (0x1UL << FMC_BCR1_MBKEN_Pos)
 
#define FMC_BCR1_MBKEN   FMC_BCR1_MBKEN_Msk
 
#define FMC_BCR1_MUXEN_Pos   (1U)
 
#define FMC_BCR1_MUXEN_Msk   (0x1UL << FMC_BCR1_MUXEN_Pos)
 
#define FMC_BCR1_MUXEN   FMC_BCR1_MUXEN_Msk
 
#define FMC_BCR1_MTYP_Pos   (2U)
 
#define FMC_BCR1_MTYP_Msk   (0x3UL << FMC_BCR1_MTYP_Pos)
 
#define FMC_BCR1_MTYP   FMC_BCR1_MTYP_Msk
 
#define FMC_BCR1_MTYP_0   (0x1UL << FMC_BCR1_MTYP_Pos)
 
#define FMC_BCR1_MTYP_1   (0x2UL << FMC_BCR1_MTYP_Pos)
 
#define FMC_BCR1_MWID_Pos   (4U)
 
#define FMC_BCR1_MWID_Msk   (0x3UL << FMC_BCR1_MWID_Pos)
 
#define FMC_BCR1_MWID   FMC_BCR1_MWID_Msk
 
#define FMC_BCR1_MWID_0   (0x1UL << FMC_BCR1_MWID_Pos)
 
#define FMC_BCR1_MWID_1   (0x2UL << FMC_BCR1_MWID_Pos)
 
#define FMC_BCR1_FACCEN_Pos   (6U)
 
#define FMC_BCR1_FACCEN_Msk   (0x1UL << FMC_BCR1_FACCEN_Pos)
 
#define FMC_BCR1_FACCEN   FMC_BCR1_FACCEN_Msk
 
#define FMC_BCR1_BURSTEN_Pos   (8U)
 
#define FMC_BCR1_BURSTEN_Msk   (0x1UL << FMC_BCR1_BURSTEN_Pos)
 
#define FMC_BCR1_BURSTEN   FMC_BCR1_BURSTEN_Msk
 
#define FMC_BCR1_WAITPOL_Pos   (9U)
 
#define FMC_BCR1_WAITPOL_Msk   (0x1UL << FMC_BCR1_WAITPOL_Pos)
 
#define FMC_BCR1_WAITPOL   FMC_BCR1_WAITPOL_Msk
 
#define FMC_BCR1_WRAPMOD_Pos   (10U)
 
#define FMC_BCR1_WRAPMOD_Msk   (0x1UL << FMC_BCR1_WRAPMOD_Pos)
 
#define FMC_BCR1_WRAPMOD   FMC_BCR1_WRAPMOD_Msk
 
#define FMC_BCR1_WAITCFG_Pos   (11U)
 
#define FMC_BCR1_WAITCFG_Msk   (0x1UL << FMC_BCR1_WAITCFG_Pos)
 
#define FMC_BCR1_WAITCFG   FMC_BCR1_WAITCFG_Msk
 
#define FMC_BCR1_WREN_Pos   (12U)
 
#define FMC_BCR1_WREN_Msk   (0x1UL << FMC_BCR1_WREN_Pos)
 
#define FMC_BCR1_WREN   FMC_BCR1_WREN_Msk
 
#define FMC_BCR1_WAITEN_Pos   (13U)
 
#define FMC_BCR1_WAITEN_Msk   (0x1UL << FMC_BCR1_WAITEN_Pos)
 
#define FMC_BCR1_WAITEN   FMC_BCR1_WAITEN_Msk
 
#define FMC_BCR1_EXTMOD_Pos   (14U)
 
#define FMC_BCR1_EXTMOD_Msk   (0x1UL << FMC_BCR1_EXTMOD_Pos)
 
#define FMC_BCR1_EXTMOD   FMC_BCR1_EXTMOD_Msk
 
#define FMC_BCR1_ASYNCWAIT_Pos   (15U)
 
#define FMC_BCR1_ASYNCWAIT_Msk   (0x1UL << FMC_BCR1_ASYNCWAIT_Pos)
 
#define FMC_BCR1_ASYNCWAIT   FMC_BCR1_ASYNCWAIT_Msk
 
#define FMC_BCR1_CBURSTRW_Pos   (19U)
 
#define FMC_BCR1_CBURSTRW_Msk   (0x1UL << FMC_BCR1_CBURSTRW_Pos)
 
#define FMC_BCR1_CBURSTRW   FMC_BCR1_CBURSTRW_Msk
 
#define FMC_BCR1_CCLKEN_Pos   (20U)
 
#define FMC_BCR1_CCLKEN_Msk   (0x1UL << FMC_BCR1_CCLKEN_Pos)
 
#define FMC_BCR1_CCLKEN   FMC_BCR1_CCLKEN_Msk
 
#define FMC_BCR2_MBKEN_Pos   (0U)
 
#define FMC_BCR2_MBKEN_Msk   (0x1UL << FMC_BCR2_MBKEN_Pos)
 
#define FMC_BCR2_MBKEN   FMC_BCR2_MBKEN_Msk
 
#define FMC_BCR2_MUXEN_Pos   (1U)
 
#define FMC_BCR2_MUXEN_Msk   (0x1UL << FMC_BCR2_MUXEN_Pos)
 
#define FMC_BCR2_MUXEN   FMC_BCR2_MUXEN_Msk
 
#define FMC_BCR2_MTYP_Pos   (2U)
 
#define FMC_BCR2_MTYP_Msk   (0x3UL << FMC_BCR2_MTYP_Pos)
 
#define FMC_BCR2_MTYP   FMC_BCR2_MTYP_Msk
 
#define FMC_BCR2_MTYP_0   (0x1UL << FMC_BCR2_MTYP_Pos)
 
#define FMC_BCR2_MTYP_1   (0x2UL << FMC_BCR2_MTYP_Pos)
 
#define FMC_BCR2_MWID_Pos   (4U)
 
#define FMC_BCR2_MWID_Msk   (0x3UL << FMC_BCR2_MWID_Pos)
 
#define FMC_BCR2_MWID   FMC_BCR2_MWID_Msk
 
#define FMC_BCR2_MWID_0   (0x1UL << FMC_BCR2_MWID_Pos)
 
#define FMC_BCR2_MWID_1   (0x2UL << FMC_BCR2_MWID_Pos)
 
#define FMC_BCR2_FACCEN_Pos   (6U)
 
#define FMC_BCR2_FACCEN_Msk   (0x1UL << FMC_BCR2_FACCEN_Pos)
 
#define FMC_BCR2_FACCEN   FMC_BCR2_FACCEN_Msk
 
#define FMC_BCR2_BURSTEN_Pos   (8U)
 
#define FMC_BCR2_BURSTEN_Msk   (0x1UL << FMC_BCR2_BURSTEN_Pos)
 
#define FMC_BCR2_BURSTEN   FMC_BCR2_BURSTEN_Msk
 
#define FMC_BCR2_WAITPOL_Pos   (9U)
 
#define FMC_BCR2_WAITPOL_Msk   (0x1UL << FMC_BCR2_WAITPOL_Pos)
 
#define FMC_BCR2_WAITPOL   FMC_BCR2_WAITPOL_Msk
 
#define FMC_BCR2_WRAPMOD_Pos   (10U)
 
#define FMC_BCR2_WRAPMOD_Msk   (0x1UL << FMC_BCR2_WRAPMOD_Pos)
 
#define FMC_BCR2_WRAPMOD   FMC_BCR2_WRAPMOD_Msk
 
#define FMC_BCR2_WAITCFG_Pos   (11U)
 
#define FMC_BCR2_WAITCFG_Msk   (0x1UL << FMC_BCR2_WAITCFG_Pos)
 
#define FMC_BCR2_WAITCFG   FMC_BCR2_WAITCFG_Msk
 
#define FMC_BCR2_WREN_Pos   (12U)
 
#define FMC_BCR2_WREN_Msk   (0x1UL << FMC_BCR2_WREN_Pos)
 
#define FMC_BCR2_WREN   FMC_BCR2_WREN_Msk
 
#define FMC_BCR2_WAITEN_Pos   (13U)
 
#define FMC_BCR2_WAITEN_Msk   (0x1UL << FMC_BCR2_WAITEN_Pos)
 
#define FMC_BCR2_WAITEN   FMC_BCR2_WAITEN_Msk
 
#define FMC_BCR2_EXTMOD_Pos   (14U)
 
#define FMC_BCR2_EXTMOD_Msk   (0x1UL << FMC_BCR2_EXTMOD_Pos)
 
#define FMC_BCR2_EXTMOD   FMC_BCR2_EXTMOD_Msk
 
#define FMC_BCR2_ASYNCWAIT_Pos   (15U)
 
#define FMC_BCR2_ASYNCWAIT_Msk   (0x1UL << FMC_BCR2_ASYNCWAIT_Pos)
 
#define FMC_BCR2_ASYNCWAIT   FMC_BCR2_ASYNCWAIT_Msk
 
#define FMC_BCR2_CBURSTRW_Pos   (19U)
 
#define FMC_BCR2_CBURSTRW_Msk   (0x1UL << FMC_BCR2_CBURSTRW_Pos)
 
#define FMC_BCR2_CBURSTRW   FMC_BCR2_CBURSTRW_Msk
 
#define FMC_BCR3_MBKEN_Pos   (0U)
 
#define FMC_BCR3_MBKEN_Msk   (0x1UL << FMC_BCR3_MBKEN_Pos)
 
#define FMC_BCR3_MBKEN   FMC_BCR3_MBKEN_Msk
 
#define FMC_BCR3_MUXEN_Pos   (1U)
 
#define FMC_BCR3_MUXEN_Msk   (0x1UL << FMC_BCR3_MUXEN_Pos)
 
#define FMC_BCR3_MUXEN   FMC_BCR3_MUXEN_Msk
 
#define FMC_BCR3_MTYP_Pos   (2U)
 
#define FMC_BCR3_MTYP_Msk   (0x3UL << FMC_BCR3_MTYP_Pos)
 
#define FMC_BCR3_MTYP   FMC_BCR3_MTYP_Msk
 
#define FMC_BCR3_MTYP_0   (0x1UL << FMC_BCR3_MTYP_Pos)
 
#define FMC_BCR3_MTYP_1   (0x2UL << FMC_BCR3_MTYP_Pos)
 
#define FMC_BCR3_MWID_Pos   (4U)
 
#define FMC_BCR3_MWID_Msk   (0x3UL << FMC_BCR3_MWID_Pos)
 
#define FMC_BCR3_MWID   FMC_BCR3_MWID_Msk
 
#define FMC_BCR3_MWID_0   (0x1UL << FMC_BCR3_MWID_Pos)
 
#define FMC_BCR3_MWID_1   (0x2UL << FMC_BCR3_MWID_Pos)
 
#define FMC_BCR3_FACCEN_Pos   (6U)
 
#define FMC_BCR3_FACCEN_Msk   (0x1UL << FMC_BCR3_FACCEN_Pos)
 
#define FMC_BCR3_FACCEN   FMC_BCR3_FACCEN_Msk
 
#define FMC_BCR3_BURSTEN_Pos   (8U)
 
#define FMC_BCR3_BURSTEN_Msk   (0x1UL << FMC_BCR3_BURSTEN_Pos)
 
#define FMC_BCR3_BURSTEN   FMC_BCR3_BURSTEN_Msk
 
#define FMC_BCR3_WAITPOL_Pos   (9U)
 
#define FMC_BCR3_WAITPOL_Msk   (0x1UL << FMC_BCR3_WAITPOL_Pos)
 
#define FMC_BCR3_WAITPOL   FMC_BCR3_WAITPOL_Msk
 
#define FMC_BCR3_WRAPMOD_Pos   (10U)
 
#define FMC_BCR3_WRAPMOD_Msk   (0x1UL << FMC_BCR3_WRAPMOD_Pos)
 
#define FMC_BCR3_WRAPMOD   FMC_BCR3_WRAPMOD_Msk
 
#define FMC_BCR3_WAITCFG_Pos   (11U)
 
#define FMC_BCR3_WAITCFG_Msk   (0x1UL << FMC_BCR3_WAITCFG_Pos)
 
#define FMC_BCR3_WAITCFG   FMC_BCR3_WAITCFG_Msk
 
#define FMC_BCR3_WREN_Pos   (12U)
 
#define FMC_BCR3_WREN_Msk   (0x1UL << FMC_BCR3_WREN_Pos)
 
#define FMC_BCR3_WREN   FMC_BCR3_WREN_Msk
 
#define FMC_BCR3_WAITEN_Pos   (13U)
 
#define FMC_BCR3_WAITEN_Msk   (0x1UL << FMC_BCR3_WAITEN_Pos)
 
#define FMC_BCR3_WAITEN   FMC_BCR3_WAITEN_Msk
 
#define FMC_BCR3_EXTMOD_Pos   (14U)
 
#define FMC_BCR3_EXTMOD_Msk   (0x1UL << FMC_BCR3_EXTMOD_Pos)
 
#define FMC_BCR3_EXTMOD   FMC_BCR3_EXTMOD_Msk
 
#define FMC_BCR3_ASYNCWAIT_Pos   (15U)
 
#define FMC_BCR3_ASYNCWAIT_Msk   (0x1UL << FMC_BCR3_ASYNCWAIT_Pos)
 
#define FMC_BCR3_ASYNCWAIT   FMC_BCR3_ASYNCWAIT_Msk
 
#define FMC_BCR3_CBURSTRW_Pos   (19U)
 
#define FMC_BCR3_CBURSTRW_Msk   (0x1UL << FMC_BCR3_CBURSTRW_Pos)
 
#define FMC_BCR3_CBURSTRW   FMC_BCR3_CBURSTRW_Msk
 
#define FMC_BCR4_MBKEN_Pos   (0U)
 
#define FMC_BCR4_MBKEN_Msk   (0x1UL << FMC_BCR4_MBKEN_Pos)
 
#define FMC_BCR4_MBKEN   FMC_BCR4_MBKEN_Msk
 
#define FMC_BCR4_MUXEN_Pos   (1U)
 
#define FMC_BCR4_MUXEN_Msk   (0x1UL << FMC_BCR4_MUXEN_Pos)
 
#define FMC_BCR4_MUXEN   FMC_BCR4_MUXEN_Msk
 
#define FMC_BCR4_MTYP_Pos   (2U)
 
#define FMC_BCR4_MTYP_Msk   (0x3UL << FMC_BCR4_MTYP_Pos)
 
#define FMC_BCR4_MTYP   FMC_BCR4_MTYP_Msk
 
#define FMC_BCR4_MTYP_0   (0x1UL << FMC_BCR4_MTYP_Pos)
 
#define FMC_BCR4_MTYP_1   (0x2UL << FMC_BCR4_MTYP_Pos)
 
#define FMC_BCR4_MWID_Pos   (4U)
 
#define FMC_BCR4_MWID_Msk   (0x3UL << FMC_BCR4_MWID_Pos)
 
#define FMC_BCR4_MWID   FMC_BCR4_MWID_Msk
 
#define FMC_BCR4_MWID_0   (0x1UL << FMC_BCR4_MWID_Pos)
 
#define FMC_BCR4_MWID_1   (0x2UL << FMC_BCR4_MWID_Pos)
 
#define FMC_BCR4_FACCEN_Pos   (6U)
 
#define FMC_BCR4_FACCEN_Msk   (0x1UL << FMC_BCR4_FACCEN_Pos)
 
#define FMC_BCR4_FACCEN   FMC_BCR4_FACCEN_Msk
 
#define FMC_BCR4_BURSTEN_Pos   (8U)
 
#define FMC_BCR4_BURSTEN_Msk   (0x1UL << FMC_BCR4_BURSTEN_Pos)
 
#define FMC_BCR4_BURSTEN   FMC_BCR4_BURSTEN_Msk
 
#define FMC_BCR4_WAITPOL_Pos   (9U)
 
#define FMC_BCR4_WAITPOL_Msk   (0x1UL << FMC_BCR4_WAITPOL_Pos)
 
#define FMC_BCR4_WAITPOL   FMC_BCR4_WAITPOL_Msk
 
#define FMC_BCR4_WRAPMOD_Pos   (10U)
 
#define FMC_BCR4_WRAPMOD_Msk   (0x1UL << FMC_BCR4_WRAPMOD_Pos)
 
#define FMC_BCR4_WRAPMOD   FMC_BCR4_WRAPMOD_Msk
 
#define FMC_BCR4_WAITCFG_Pos   (11U)
 
#define FMC_BCR4_WAITCFG_Msk   (0x1UL << FMC_BCR4_WAITCFG_Pos)
 
#define FMC_BCR4_WAITCFG   FMC_BCR4_WAITCFG_Msk
 
#define FMC_BCR4_WREN_Pos   (12U)
 
#define FMC_BCR4_WREN_Msk   (0x1UL << FMC_BCR4_WREN_Pos)
 
#define FMC_BCR4_WREN   FMC_BCR4_WREN_Msk
 
#define FMC_BCR4_WAITEN_Pos   (13U)
 
#define FMC_BCR4_WAITEN_Msk   (0x1UL << FMC_BCR4_WAITEN_Pos)
 
#define FMC_BCR4_WAITEN   FMC_BCR4_WAITEN_Msk
 
#define FMC_BCR4_EXTMOD_Pos   (14U)
 
#define FMC_BCR4_EXTMOD_Msk   (0x1UL << FMC_BCR4_EXTMOD_Pos)
 
#define FMC_BCR4_EXTMOD   FMC_BCR4_EXTMOD_Msk
 
#define FMC_BCR4_ASYNCWAIT_Pos   (15U)
 
#define FMC_BCR4_ASYNCWAIT_Msk   (0x1UL << FMC_BCR4_ASYNCWAIT_Pos)
 
#define FMC_BCR4_ASYNCWAIT   FMC_BCR4_ASYNCWAIT_Msk
 
#define FMC_BCR4_CBURSTRW_Pos   (19U)
 
#define FMC_BCR4_CBURSTRW_Msk   (0x1UL << FMC_BCR4_CBURSTRW_Pos)
 
#define FMC_BCR4_CBURSTRW   FMC_BCR4_CBURSTRW_Msk
 
#define FMC_BTRx_ADDSET_Pos   (0U)
 
#define FMC_BTRx_ADDSET_Msk   (0xFUL << FMC_BTRx_ADDSET_Pos)
 
#define FMC_BTRx_ADDSET   FMC_BTRx_ADDSET_Msk
 
#define FMC_BTRx_ADDSET_0   (0x1UL << FMC_BTRx_ADDSET_Pos)
 
#define FMC_BTRx_ADDSET_1   (0x2UL << FMC_BTRx_ADDSET_Pos)
 
#define FMC_BTRx_ADDSET_2   (0x4UL << FMC_BTRx_ADDSET_Pos)
 
#define FMC_BTR_ADDSET_3   (0x00000008U)
 
#define FMC_BTRx_ADDHLD_Pos   (4U)
 
#define FMC_BTRx_ADDHLD_Msk   (0xFUL << FMC_BTRx_ADDHLD_Pos)
 
#define FMC_BTRx_ADDHLD   FMC_BTRx_ADDHLD_Msk
 
#define FMC_BTRx_ADDHLD_0   (0x1UL << FMC_BTRx_ADDHLD_Pos)
 
#define FMC_BTRx_ADDHLD_1   (0x2UL << FMC_BTRx_ADDHLD_Pos)
 
#define FMC_BTRx_ADDHLD_2   (0x4UL << FMC_BTRx_ADDHLD_Pos)
 
#define FMC_BTRx_ADDHLD_3   (0x8UL << FMC_BTRx_ADDHLD_Pos)
 
#define FMC_BTRx_DATAST_Pos   (8U)
 
#define FMC_BTRx_DATAST_Msk   (0xFFUL << FMC_BTRx_DATAST_Pos)
 
#define FMC_BTRx_DATAST   FMC_BTRx_DATAST_Msk
 
#define FMC_BTR_DATAST_0   (0x00000100U)
 
#define FMC_BTRx_DATAST_1   (0x00000200U)
 
#define FMC_BTRx_DATAST_2   (0x00000400U)
 
#define FMC_BTRx_DATAST_3   (0x00000800U)
 
#define FMC_BTRx_DATAST_4   (0x00001000U)
 
#define FMC_BTRx_DATAST_5   (0x00002000U)
 
#define FMC_BTRx_DATAST_6   (0x00004000U)
 
#define FMC_BTRx_DATAST_7   (0x00008000U)
 
#define FMC_BTRx_BUSTURN_Pos   (16U)
 
#define FMC_BTRx_BUSTURN_Msk   (0xFUL << FMC_BTRx_BUSTURN_Pos)
 
#define FMC_BTRx_BUSTURN   FMC_BTRx_BUSTURN_Msk
 
#define FMC_BTRx_BUSTURN_0   (0x1UL << FMC_BTRx_BUSTURN_Pos)
 
#define FMC_BTRx_BUSTURN_1   (0x2UL << FMC_BTRx_BUSTURN_Pos)
 
#define FMC_BTRx_BUSTURN_2   (0x4UL << FMC_BTRx_BUSTURN_Pos)
 
#define FMC_BTRx_BUSTURN_3   (0x8UL << FMC_BTRx_BUSTURN_Pos)
 
#define FMC_BTRx_CLKDIV_Pos   (20U)
 
#define FMC_BTRx_CLKDIV_Msk   (0xFUL << FMC_BTRx_CLKDIV_Pos)
 
#define FMC_BTRx_CLKDIV   FMC_BTRx_CLKDIV_Msk
 
#define FMC_BTRx_CLKDIV_0   (0x1UL << FMC_BTRx_CLKDIV_Pos)
 
#define FMC_BTRx_CLKDIV_1   (0x2UL << FMC_BTRx_CLKDIV_Pos)
 
#define FMC_BTRx_CLKDIV_2   (0x4UL << FMC_BTRx_CLKDIV_Pos)
 
#define FMC_BTRx_CLKDIV_3   (0x8UL << FMC_BTRx_CLKDIV_Pos)
 
#define FMC_BTRx_DATLAT_Pos   (24U)
 
#define FMC_BTRx_DATLAT_Msk   (0xFUL << FMC_BTRx_DATLAT_Pos)
 
#define FMC_BTRx_DATLAT   FMC_BTRx_DATLAT_Msk
 
#define FMC_BTRx_DATLAT_0   (0x1UL << FMC_BTRx_DATLAT_Pos)
 
#define FMC_BTRx_DATLAT_1   (0x2UL << FMC_BTRx_DATLAT_Pos)
 
#define FMC_BTRx_DATLAT_2   (0x4UL << FMC_BTRx_DATLAT_Pos)
 
#define FMC_BTRx_DATLAT_3   (0x8UL << FMC_BTRx_DATLAT_Pos)
 
#define FMC_BTRx_ACCMOD_Pos   (28U)
 
#define FMC_BTRx_ACCMOD_Msk   (0x3UL << FMC_BTRx_ACCMOD_Pos)
 
#define FMC_BTRx_ACCMOD   FMC_BTRx_ACCMOD_Msk
 
#define FMC_BTRx_ACCMOD_0   (0x1UL << FMC_BTRx_ACCMOD_Pos)
 
#define FMC_BTRx_ACCMOD_1   (0x2UL << FMC_BTRx_ACCMOD_Pos)
 
#define FMC_BTR1_ADDSET_Pos   (0U)
 
#define FMC_BTR1_ADDSET_Msk   (0xFUL << FMC_BTR1_ADDSET_Pos)
 
#define FMC_BTR1_ADDSET   FMC_BTR1_ADDSET_Msk
 
#define FMC_BTR1_ADDSET_0   (0x1UL << FMC_BTR1_ADDSET_Pos)
 
#define FMC_BTR1_ADDSET_1   (0x2UL << FMC_BTR1_ADDSET_Pos)
 
#define FMC_BTR1_ADDSET_2   (0x4UL << FMC_BTR1_ADDSET_Pos)
 
#define FMC_BTR1_ADDSET_3   (0x8UL << FMC_BTR1_ADDSET_Pos)
 
#define FMC_BTR1_ADDHLD_Pos   (4U)
 
#define FMC_BTR1_ADDHLD_Msk   (0xFUL << FMC_BTR1_ADDHLD_Pos)
 
#define FMC_BTR1_ADDHLD   FMC_BTR1_ADDHLD_Msk
 
#define FMC_BTR1_ADDHLD_0   (0x1UL << FMC_BTR1_ADDHLD_Pos)
 
#define FMC_BTR1_ADDHLD_1   (0x2UL << FMC_BTR1_ADDHLD_Pos)
 
#define FMC_BTR1_ADDHLD_2   (0x4UL << FMC_BTR1_ADDHLD_Pos)
 
#define FMC_BTR1_ADDHLD_3   (0x8UL << FMC_BTR1_ADDHLD_Pos)
 
#define FMC_BTR1_DATAST_Pos   (8U)
 
#define FMC_BTR1_DATAST_Msk   (0xFFUL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_DATAST   FMC_BTR1_DATAST_Msk
 
#define FMC_BTR1_DATAST_0   (0x01UL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_DATAST_1   (0x02UL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_DATAST_2   (0x04UL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_DATAST_3   (0x08UL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_DATAST_4   (0x10UL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_DATAST_5   (0x20UL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_DATAST_6   (0x40UL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_DATAST_7   (0x80UL << FMC_BTR1_DATAST_Pos)
 
#define FMC_BTR1_BUSTURN_Pos   (16U)
 
#define FMC_BTR1_BUSTURN_Msk   (0xFUL << FMC_BTR1_BUSTURN_Pos)
 
#define FMC_BTR1_BUSTURN   FMC_BTR1_BUSTURN_Msk
 
#define FMC_BTR1_BUSTURN_0   (0x1UL << FMC_BTR1_BUSTURN_Pos)
 
#define FMC_BTR1_BUSTURN_1   (0x2UL << FMC_BTR1_BUSTURN_Pos)
 
#define FMC_BTR1_BUSTURN_2   (0x4UL << FMC_BTR1_BUSTURN_Pos)
 
#define FMC_BTR1_BUSTURN_3   (0x8UL << FMC_BTR1_BUSTURN_Pos)
 
#define FMC_BTR1_CLKDIV_Pos   (20U)
 
#define FMC_BTR1_CLKDIV_Msk   (0xFUL << FMC_BTR1_CLKDIV_Pos)
 
#define FMC_BTR1_CLKDIV   FMC_BTR1_CLKDIV_Msk
 
#define FMC_BTR1_CLKDIV_0   (0x1UL << FMC_BTR1_CLKDIV_Pos)
 
#define FMC_BTR1_CLKDIV_1   (0x2UL << FMC_BTR1_CLKDIV_Pos)
 
#define FMC_BTR1_CLKDIV_2   (0x4UL << FMC_BTR1_CLKDIV_Pos)
 
#define FMC_BTR1_CLKDIV_3   (0x8UL << FMC_BTR1_CLKDIV_Pos)
 
#define FMC_BTR1_DATLAT_Pos   (24U)
 
#define FMC_BTR1_DATLAT_Msk   (0xFUL << FMC_BTR1_DATLAT_Pos)
 
#define FMC_BTR1_DATLAT   FMC_BTR1_DATLAT_Msk
 
#define FMC_BTR1_DATLAT_0   (0x1UL << FMC_BTR1_DATLAT_Pos)
 
#define FMC_BTR1_DATLAT_1   (0x2UL << FMC_BTR1_DATLAT_Pos)
 
#define FMC_BTR1_DATLAT_2   (0x4UL << FMC_BTR1_DATLAT_Pos)
 
#define FMC_BTR1_DATLAT_3   (0x8UL << FMC_BTR1_DATLAT_Pos)
 
#define FMC_BTR1_ACCMOD_Pos   (28U)
 
#define FMC_BTR1_ACCMOD_Msk   (0x3UL << FMC_BTR1_ACCMOD_Pos)
 
#define FMC_BTR1_ACCMOD   FMC_BTR1_ACCMOD_Msk
 
#define FMC_BTR1_ACCMOD_0   (0x1UL << FMC_BTR1_ACCMOD_Pos)
 
#define FMC_BTR1_ACCMOD_1   (0x2UL << FMC_BTR1_ACCMOD_Pos)
 
#define FMC_BTR2_ADDSET_Pos   (0U)
 
#define FMC_BTR2_ADDSET_Msk   (0xFUL << FMC_BTR2_ADDSET_Pos)
 
#define FMC_BTR2_ADDSET   FMC_BTR2_ADDSET_Msk
 
#define FMC_BTR2_ADDSET_0   (0x1UL << FMC_BTR2_ADDSET_Pos)
 
#define FMC_BTR2_ADDSET_1   (0x2UL << FMC_BTR2_ADDSET_Pos)
 
#define FMC_BTR2_ADDSET_2   (0x4UL << FMC_BTR2_ADDSET_Pos)
 
#define FMC_BTR2_ADDSET_3   (0x8UL << FMC_BTR2_ADDSET_Pos)
 
#define FMC_BTR2_ADDHLD_Pos   (4U)
 
#define FMC_BTR2_ADDHLD_Msk   (0xFUL << FMC_BTR2_ADDHLD_Pos)
 
#define FMC_BTR2_ADDHLD   FMC_BTR2_ADDHLD_Msk
 
#define FMC_BTR2_ADDHLD_0   (0x1UL << FMC_BTR2_ADDHLD_Pos)
 
#define FMC_BTR2_ADDHLD_1   (0x2UL << FMC_BTR2_ADDHLD_Pos)
 
#define FMC_BTR2_ADDHLD_2   (0x4UL << FMC_BTR2_ADDHLD_Pos)
 
#define FMC_BTR2_ADDHLD_3   (0x8UL << FMC_BTR2_ADDHLD_Pos)
 
#define FMC_BTR2_DATAST_Pos   (8U)
 
#define FMC_BTR2_DATAST_Msk   (0xFFUL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_DATAST   FMC_BTR2_DATAST_Msk
 
#define FMC_BTR2_DATAST_0   (0x01UL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_DATAST_1   (0x02UL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_DATAST_2   (0x04UL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_DATAST_3   (0x08UL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_DATAST_4   (0x10UL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_DATAST_5   (0x20UL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_DATAST_6   (0x40UL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_DATAST_7   (0x80UL << FMC_BTR2_DATAST_Pos)
 
#define FMC_BTR2_BUSTURN_Pos   (16U)
 
#define FMC_BTR2_BUSTURN_Msk   (0xFUL << FMC_BTR2_BUSTURN_Pos)
 
#define FMC_BTR2_BUSTURN   FMC_BTR2_BUSTURN_Msk
 
#define FMC_BTR2_BUSTURN_0   (0x1UL << FMC_BTR2_BUSTURN_Pos)
 
#define FMC_BTR2_BUSTURN_1   (0x2UL << FMC_BTR2_BUSTURN_Pos)
 
#define FMC_BTR2_BUSTURN_2   (0x4UL << FMC_BTR2_BUSTURN_Pos)
 
#define FMC_BTR2_BUSTURN_3   (0x8UL << FMC_BTR2_BUSTURN_Pos)
 
#define FMC_BTR2_CLKDIV_Pos   (20U)
 
#define FMC_BTR2_CLKDIV_Msk   (0xFUL << FMC_BTR2_CLKDIV_Pos)
 
#define FMC_BTR2_CLKDIV   FMC_BTR2_CLKDIV_Msk
 
#define FMC_BTR2_CLKDIV_0   (0x1UL << FMC_BTR2_CLKDIV_Pos)
 
#define FMC_BTR2_CLKDIV_1   (0x2UL << FMC_BTR2_CLKDIV_Pos)
 
#define FMC_BTR2_CLKDIV_2   (0x4UL << FMC_BTR2_CLKDIV_Pos)
 
#define FMC_BTR2_CLKDIV_3   (0x8UL << FMC_BTR2_CLKDIV_Pos)
 
#define FMC_BTR2_DATLAT_Pos   (24U)
 
#define FMC_BTR2_DATLAT_Msk   (0xFUL << FMC_BTR2_DATLAT_Pos)
 
#define FMC_BTR2_DATLAT   FMC_BTR2_DATLAT_Msk
 
#define FMC_BTR2_DATLAT_0   (0x1UL << FMC_BTR2_DATLAT_Pos)
 
#define FMC_BTR2_DATLAT_1   (0x2UL << FMC_BTR2_DATLAT_Pos)
 
#define FMC_BTR2_DATLAT_2   (0x4UL << FMC_BTR2_DATLAT_Pos)
 
#define FMC_BTR2_DATLAT_3   (0x8UL << FMC_BTR2_DATLAT_Pos)
 
#define FMC_BTR2_ACCMOD_Pos   (28U)
 
#define FMC_BTR2_ACCMOD_Msk   (0x3UL << FMC_BTR2_ACCMOD_Pos)
 
#define FMC_BTR2_ACCMOD   FMC_BTR2_ACCMOD_Msk
 
#define FMC_BTR2_ACCMOD_0   (0x1UL << FMC_BTR2_ACCMOD_Pos)
 
#define FMC_BTR2_ACCMOD_1   (0x2UL << FMC_BTR2_ACCMOD_Pos)
 
#define FMC_BTR3_ADDSET_Pos   (0U)
 
#define FMC_BTR3_ADDSET_Msk   (0xFUL << FMC_BTR3_ADDSET_Pos)
 
#define FMC_BTR3_ADDSET   FMC_BTR3_ADDSET_Msk
 
#define FMC_BTR3_ADDSET_0   (0x1UL << FMC_BTR3_ADDSET_Pos)
 
#define FMC_BTR3_ADDSET_1   (0x2UL << FMC_BTR3_ADDSET_Pos)
 
#define FMC_BTR3_ADDSET_2   (0x4UL << FMC_BTR3_ADDSET_Pos)
 
#define FMC_BTR3_ADDSET_3   (0x8UL << FMC_BTR3_ADDSET_Pos)
 
#define FMC_BTR3_ADDHLD_Pos   (4U)
 
#define FMC_BTR3_ADDHLD_Msk   (0xFUL << FMC_BTR3_ADDHLD_Pos)
 
#define FMC_BTR3_ADDHLD   FMC_BTR3_ADDHLD_Msk
 
#define FMC_BTR3_ADDHLD_0   (0x1UL << FMC_BTR3_ADDHLD_Pos)
 
#define FMC_BTR3_ADDHLD_1   (0x2UL << FMC_BTR3_ADDHLD_Pos)
 
#define FMC_BTR3_ADDHLD_2   (0x4UL << FMC_BTR3_ADDHLD_Pos)
 
#define FMC_BTR3_ADDHLD_3   (0x8UL << FMC_BTR3_ADDHLD_Pos)
 
#define FMC_BTR3_DATAST_Pos   (8U)
 
#define FMC_BTR3_DATAST_Msk   (0xFFUL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_DATAST   FMC_BTR3_DATAST_Msk
 
#define FMC_BTR3_DATAST_0   (0x01UL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_DATAST_1   (0x02UL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_DATAST_2   (0x04UL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_DATAST_3   (0x08UL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_DATAST_4   (0x10UL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_DATAST_5   (0x20UL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_DATAST_6   (0x40UL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_DATAST_7   (0x80UL << FMC_BTR3_DATAST_Pos)
 
#define FMC_BTR3_BUSTURN_Pos   (16U)
 
#define FMC_BTR3_BUSTURN_Msk   (0xFUL << FMC_BTR3_BUSTURN_Pos)
 
#define FMC_BTR3_BUSTURN   FMC_BTR3_BUSTURN_Msk
 
#define FMC_BTR3_BUSTURN_0   (0x1UL << FMC_BTR3_BUSTURN_Pos)
 
#define FMC_BTR3_BUSTURN_1   (0x2UL << FMC_BTR3_BUSTURN_Pos)
 
#define FMC_BTR3_BUSTURN_2   (0x4UL << FMC_BTR3_BUSTURN_Pos)
 
#define FMC_BTR3_BUSTURN_3   (0x8UL << FMC_BTR3_BUSTURN_Pos)
 
#define FMC_BTR3_CLKDIV_Pos   (20U)
 
#define FMC_BTR3_CLKDIV_Msk   (0xFUL << FMC_BTR3_CLKDIV_Pos)
 
#define FMC_BTR3_CLKDIV   FMC_BTR3_CLKDIV_Msk
 
#define FMC_BTR3_CLKDIV_0   (0x1UL << FMC_BTR3_CLKDIV_Pos)
 
#define FMC_BTR3_CLKDIV_1   (0x2UL << FMC_BTR3_CLKDIV_Pos)
 
#define FMC_BTR3_CLKDIV_2   (0x4UL << FMC_BTR3_CLKDIV_Pos)
 
#define FMC_BTR3_CLKDIV_3   (0x8UL << FMC_BTR3_CLKDIV_Pos)
 
#define FMC_BTR3_DATLAT_Pos   (24U)
 
#define FMC_BTR3_DATLAT_Msk   (0xFUL << FMC_BTR3_DATLAT_Pos)
 
#define FMC_BTR3_DATLAT   FMC_BTR3_DATLAT_Msk
 
#define FMC_BTR3_DATLAT_0   (0x1UL << FMC_BTR3_DATLAT_Pos)
 
#define FMC_BTR3_DATLAT_1   (0x2UL << FMC_BTR3_DATLAT_Pos)
 
#define FMC_BTR3_DATLAT_2   (0x4UL << FMC_BTR3_DATLAT_Pos)
 
#define FMC_BTR3_DATLAT_3   (0x8UL << FMC_BTR3_DATLAT_Pos)
 
#define FMC_BTR3_ACCMOD_Pos   (28U)
 
#define FMC_BTR3_ACCMOD_Msk   (0x3UL << FMC_BTR3_ACCMOD_Pos)
 
#define FMC_BTR3_ACCMOD   FMC_BTR3_ACCMOD_Msk
 
#define FMC_BTR3_ACCMOD_0   (0x1UL << FMC_BTR3_ACCMOD_Pos)
 
#define FMC_BTR3_ACCMOD_1   (0x2UL << FMC_BTR3_ACCMOD_Pos)
 
#define FMC_BTR4_ADDSET_Pos   (0U)
 
#define FMC_BTR4_ADDSET_Msk   (0xFUL << FMC_BTR4_ADDSET_Pos)
 
#define FMC_BTR4_ADDSET   FMC_BTR4_ADDSET_Msk
 
#define FMC_BTR4_ADDSET_0   (0x1UL << FMC_BTR4_ADDSET_Pos)
 
#define FMC_BTR4_ADDSET_1   (0x2UL << FMC_BTR4_ADDSET_Pos)
 
#define FMC_BTR4_ADDSET_2   (0x4UL << FMC_BTR4_ADDSET_Pos)
 
#define FMC_BTR4_ADDSET_3   (0x8UL << FMC_BTR4_ADDSET_Pos)
 
#define FMC_BTR4_ADDHLD_Pos   (4U)
 
#define FMC_BTR4_ADDHLD_Msk   (0xFUL << FMC_BTR4_ADDHLD_Pos)
 
#define FMC_BTR4_ADDHLD   FMC_BTR4_ADDHLD_Msk
 
#define FMC_BTR4_ADDHLD_0   (0x1UL << FMC_BTR4_ADDHLD_Pos)
 
#define FMC_BTR4_ADDHLD_1   (0x2UL << FMC_BTR4_ADDHLD_Pos)
 
#define FMC_BTR4_ADDHLD_2   (0x4UL << FMC_BTR4_ADDHLD_Pos)
 
#define FMC_BTR4_ADDHLD_3   (0x8UL << FMC_BTR4_ADDHLD_Pos)
 
#define FMC_BTR4_DATAST_Pos   (8U)
 
#define FMC_BTR4_DATAST_Msk   (0xFFUL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_DATAST   FMC_BTR4_DATAST_Msk
 
#define FMC_BTR4_DATAST_0   (0x01UL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_DATAST_1   (0x02UL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_DATAST_2   (0x04UL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_DATAST_3   (0x08UL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_DATAST_4   (0x10UL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_DATAST_5   (0x20UL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_DATAST_6   (0x40UL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_DATAST_7   (0x80UL << FMC_BTR4_DATAST_Pos)
 
#define FMC_BTR4_BUSTURN_Pos   (16U)
 
#define FMC_BTR4_BUSTURN_Msk   (0xFUL << FMC_BTR4_BUSTURN_Pos)
 
#define FMC_BTR4_BUSTURN   FMC_BTR4_BUSTURN_Msk
 
#define FMC_BTR4_BUSTURN_0   (0x1UL << FMC_BTR4_BUSTURN_Pos)
 
#define FMC_BTR4_BUSTURN_1   (0x2UL << FMC_BTR4_BUSTURN_Pos)
 
#define FMC_BTR4_BUSTURN_2   (0x4UL << FMC_BTR4_BUSTURN_Pos)
 
#define FMC_BTR4_BUSTURN_3   (0x8UL << FMC_BTR4_BUSTURN_Pos)
 
#define FMC_BTR4_CLKDIV_Pos   (20U)
 
#define FMC_BTR4_CLKDIV_Msk   (0xFUL << FMC_BTR4_CLKDIV_Pos)
 
#define FMC_BTR4_CLKDIV   FMC_BTR4_CLKDIV_Msk
 
#define FMC_BTR4_CLKDIV_0   (0x1UL << FMC_BTR4_CLKDIV_Pos)
 
#define FMC_BTR4_CLKDIV_1   (0x2UL << FMC_BTR4_CLKDIV_Pos)
 
#define FMC_BTR4_CLKDIV_2   (0x4UL << FMC_BTR4_CLKDIV_Pos)
 
#define FMC_BTR4_CLKDIV_3   (0x8UL << FMC_BTR4_CLKDIV_Pos)
 
#define FMC_BTR4_DATLAT_Pos   (24U)
 
#define FMC_BTR4_DATLAT_Msk   (0xFUL << FMC_BTR4_DATLAT_Pos)
 
#define FMC_BTR4_DATLAT   FMC_BTR4_DATLAT_Msk
 
#define FMC_BTR4_DATLAT_0   (0x1UL << FMC_BTR4_DATLAT_Pos)
 
#define FMC_BTR4_DATLAT_1   (0x2UL << FMC_BTR4_DATLAT_Pos)
 
#define FMC_BTR4_DATLAT_2   (0x4UL << FMC_BTR4_DATLAT_Pos)
 
#define FMC_BTR4_DATLAT_3   (0x8UL << FMC_BTR4_DATLAT_Pos)
 
#define FMC_BTR4_ACCMOD_Pos   (28U)
 
#define FMC_BTR4_ACCMOD_Msk   (0x3UL << FMC_BTR4_ACCMOD_Pos)
 
#define FMC_BTR4_ACCMOD   FMC_BTR4_ACCMOD_Msk
 
#define FMC_BTR4_ACCMOD_0   (0x1UL << FMC_BTR4_ACCMOD_Pos)
 
#define FMC_BTR4_ACCMOD_1   (0x2UL << FMC_BTR4_ACCMOD_Pos)
 
#define FMC_BWTRx_ADDSET_Pos   (0U)
 
#define FMC_BWTRx_ADDSET_Msk   (0xFUL << FMC_BWTRx_ADDSET_Pos)
 
#define FMC_BWTRx_ADDSET   FMC_BWTRx_ADDSET_Msk
 
#define FMC_BWTRx_ADDSET_0   (0x1UL << FMC_BWTRx_ADDSET_Pos)
 
#define FMC_BWTRx_ADDSET_1   (0x2UL << FMC_BWTRx_ADDSET_Pos)
 
#define FMC_BWTRx_ADDSET_2   (0x4UL << FMC_BWTRx_ADDSET_Pos)
 
#define FMC_BWTRx_ADDSET_3   (0x8UL << FMC_BWTRx_ADDSET_Pos)
 
#define FMC_BWTRx_ADDHLD_Pos   (4U)
 
#define FMC_BWTRx_ADDHLD_Msk   (0xFUL << FMC_BWTRx_ADDHLD_Pos)
 
#define FMC_BWTRx_ADDHLD   FMC_BWTRx_ADDHLD_Msk
 
#define FMC_BWTRx_ADDHLD_0   (0x1UL << FMC_BWTRx_ADDHLD_Pos)
 
#define FMC_BWTRx_ADDHLD_1   (0x2UL << FMC_BWTRx_ADDHLD_Pos)
 
#define FMC_BWTRx_ADDHLD_2   (0x4UL << FMC_BWTRx_ADDHLD_Pos)
 
#define FMC_BWTRx_ADDHLD_3   (0x8UL << FMC_BWTRx_ADDHLD_Pos)
 
#define FMC_BWTRx_DATAST_Pos   (8U)
 
#define FMC_BWTRx_DATAST_Msk   (0xFFUL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_DATAST   FMC_BWTRx_DATAST_Msk
 
#define FMC_BWTRx_DATAST_0   (0x01UL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_DATAST_1   (0x02UL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_DATAST_2   (0x04UL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_DATAST_3   (0x08UL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_DATAST_4   (0x10UL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_DATAST_5   (0x20UL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_DATAST_6   (0x40UL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_DATAST_7   (0x80UL << FMC_BWTRx_DATAST_Pos)
 
#define FMC_BWTRx_ACCMOD_Pos   (28U)
 
#define FMC_BWTRx_ACCMOD_Msk   (0x3UL << FMC_BWTRx_ACCMOD_Pos)
 
#define FMC_BWTRx_ACCMOD   FMC_BWTRx_ACCMOD_Msk
 
#define FMC_BWTRx_ACCMOD_0   (0x1UL << FMC_BWTRx_ACCMOD_Pos)
 
#define FMC_BWTRx_ACCMOD_1   (0x2UL << FMC_BWTRx_ACCMOD_Pos)
 
#define FMC_BWTRx_ADDSETx   FMC_BWTRx_ADDSET
 
#define FMC_BWTRx_ADDSETx_0   FMC_BWTRx_ADDSET_0
 
#define FMC_BWTRx_ADDSETx_1   FMC_BWTRx_ADDSET_1
 
#define FMC_BWTRx_ADDSETx_2   FMC_BWTRx_ADDSET_2
 
#define FMC_BWTRx_ADDSETx_3   FMC_BWTRx_ADDSET_3
 
#define FMC_BWTRx_ADDHLDx   FMC_BWTRx_ADDHLD
 
#define FMC_BWTRx_ADDHLDx_0   FMC_BWTRx_ADDHLD_0
 
#define FMC_BWTRx_ADDHLDx_1   FMC_BWTRx_ADDHLD_1
 
#define FMC_BWTRx_ADDHLDx_2   FMC_BWTRx_ADDHLD_2
 
#define FMC_BWTRx_ADDHLDx_3   FMC_BWTRx_ADDHLD_3
 
#define FMC_BWTRx_DATASTx   FMC_BWTRx_DATAST
 
#define FMC_BWTRx_DATASTx_0   FMC_BWTRx_DATAST_0
 
#define FMC_BWTRx_DATASTx_1   FMC_BWTRx_DATAST_1
 
#define FMC_BWTRx_DATASTx_2   FMC_BWTRx_DATAST_2
 
#define FMC_BWTRx_DATASTx_3   FMC_BWTRx_DATAST_3
 
#define FMC_BWTRx_DATASTx_4   FMC_BWTRx_DATAST_4
 
#define FMC_BWTRx_DATASTx_5   FMC_BWTRx_DATAST_5
 
#define FMC_BWTRx_DATASTx_6   FMC_BWTRx_DATAST_6
 
#define FMC_BWTRx_DATASTx_7   FMC_BWTRx_DATAST_7
 
#define FMC_BWTRx_ACCMODx   FMC_BWTRx_ACCMOD
 
#define FMC_BWTRx_ACCMODx_0   FMC_BWTRx_ACCMOD_0
 
#define FMC_BWTRx_ACCMODx_1   FMC_BWTRx_ACCMOD_1
 
#define FMC_BWTR1_ADDSET_Pos   (0U)
 
#define FMC_BWTR1_ADDSET_Msk   (0xFUL << FMC_BWTR1_ADDSET_Pos)
 
#define FMC_BWTR1_ADDSET   FMC_BWTR1_ADDSET_Msk
 
#define FMC_BWTR1_ADDSET_0   (0x1UL << FMC_BWTR1_ADDSET_Pos)
 
#define FMC_BWTR1_ADDSET_1   (0x2UL << FMC_BWTR1_ADDSET_Pos)
 
#define FMC_BWTR1_ADDSET_2   (0x4UL << FMC_BWTR1_ADDSET_Pos)
 
#define FMC_BWTR1_ADDSET_3   (0x8UL << FMC_BWTR1_ADDSET_Pos)
 
#define FMC_BWTR1_ADDHLD_Pos   (4U)
 
#define FMC_BWTR1_ADDHLD_Msk   (0xFUL << FMC_BWTR1_ADDHLD_Pos)
 
#define FMC_BWTR1_ADDHLD   FMC_BWTR1_ADDHLD_Msk
 
#define FMC_BWTR1_ADDHLD_0   (0x1UL << FMC_BWTR1_ADDHLD_Pos)
 
#define FMC_BWTR1_ADDHLD_1   (0x2UL << FMC_BWTR1_ADDHLD_Pos)
 
#define FMC_BWTR1_ADDHLD_2   (0x4UL << FMC_BWTR1_ADDHLD_Pos)
 
#define FMC_BWTR1_ADDHLD_3   (0x8UL << FMC_BWTR1_ADDHLD_Pos)
 
#define FMC_BWTR1_DATAST_Pos   (8U)
 
#define FMC_BWTR1_DATAST_Msk   (0xFFUL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_DATAST   FMC_BWTR1_DATAST_Msk
 
#define FMC_BWTR1_DATAST_0   (0x01UL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_DATAST_1   (0x02UL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_DATAST_2   (0x04UL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_DATAST_3   (0x08UL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_DATAST_4   (0x10UL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_DATAST_5   (0x20UL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_DATAST_6   (0x40UL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_DATAST_7   (0x80UL << FMC_BWTR1_DATAST_Pos)
 
#define FMC_BWTR1_CLKDIV_Pos   (20U)
 
#define FMC_BWTR1_CLKDIV_Msk   (0xFUL << FMC_BWTR1_CLKDIV_Pos)
 
#define FMC_BWTR1_CLKDIV   FMC_BWTR1_CLKDIV_Msk
 
#define FMC_BWTR1_CLKDIV_0   (0x1UL << FMC_BWTR1_CLKDIV_Pos)
 
#define FMC_BWTR1_CLKDIV_1   (0x2UL << FMC_BWTR1_CLKDIV_Pos)
 
#define FMC_BWTR1_CLKDIV_2   (0x4UL << FMC_BWTR1_CLKDIV_Pos)
 
#define FMC_BWTR1_CLKDIV_3   (0x8UL << FMC_BWTR1_CLKDIV_Pos)
 
#define FMC_BWTR1_DATLAT_Pos   (24U)
 
#define FMC_BWTR1_DATLAT_Msk   (0xFUL << FMC_BWTR1_DATLAT_Pos)
 
#define FMC_BWTR1_DATLAT   FMC_BWTR1_DATLAT_Msk
 
#define FMC_BWTR1_DATLAT_0   (0x1UL << FMC_BWTR1_DATLAT_Pos)
 
#define FMC_BWTR1_DATLAT_1   (0x2UL << FMC_BWTR1_DATLAT_Pos)
 
#define FMC_BWTR1_DATLAT_2   (0x4UL << FMC_BWTR1_DATLAT_Pos)
 
#define FMC_BWTR1_DATLAT_3   (0x8UL << FMC_BWTR1_DATLAT_Pos)
 
#define FMC_BWTR1_ACCMOD_Pos   (28U)
 
#define FMC_BWTR1_ACCMOD_Msk   (0x3UL << FMC_BWTR1_ACCMOD_Pos)
 
#define FMC_BWTR1_ACCMOD   FMC_BWTR1_ACCMOD_Msk
 
#define FMC_BWTR1_ACCMOD_0   (0x1UL << FMC_BWTR1_ACCMOD_Pos)
 
#define FMC_BWTR1_ACCMOD_1   (0x2UL << FMC_BWTR1_ACCMOD_Pos)
 
#define FMC_BWTR2_ADDSET_Pos   (0U)
 
#define FMC_BWTR2_ADDSET_Msk   (0xFUL << FMC_BWTR2_ADDSET_Pos)
 
#define FMC_BWTR2_ADDSET   FMC_BWTR2_ADDSET_Msk
 
#define FMC_BWTR2_ADDSET_0   (0x1UL << FMC_BWTR2_ADDSET_Pos)
 
#define FMC_BWTR2_ADDSET_1   (0x2UL << FMC_BWTR2_ADDSET_Pos)
 
#define FMC_BWTR2_ADDSET_2   (0x4UL << FMC_BWTR2_ADDSET_Pos)
 
#define FMC_BWTR2_ADDSET_3   (0x8UL << FMC_BWTR2_ADDSET_Pos)
 
#define FMC_BWTR2_ADDHLD_Pos   (4U)
 
#define FMC_BWTR2_ADDHLD_Msk   (0xFUL << FMC_BWTR2_ADDHLD_Pos)
 
#define FMC_BWTR2_ADDHLD   FMC_BWTR2_ADDHLD_Msk
 
#define FMC_BWTR2_ADDHLD_0   (0x1UL << FMC_BWTR2_ADDHLD_Pos)
 
#define FMC_BWTR2_ADDHLD_1   (0x2UL << FMC_BWTR2_ADDHLD_Pos)
 
#define FMC_BWTR2_ADDHLD_2   (0x4UL << FMC_BWTR2_ADDHLD_Pos)
 
#define FMC_BWTR2_ADDHLD_3   (0x8UL << FMC_BWTR2_ADDHLD_Pos)
 
#define FMC_BWTR2_DATAST_Pos   (8U)
 
#define FMC_BWTR2_DATAST_Msk   (0xFFUL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_DATAST   FMC_BWTR2_DATAST_Msk
 
#define FMC_BWTR2_DATAST_0   (0x01UL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_DATAST_1   (0x02UL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_DATAST_2   (0x04UL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_DATAST_3   (0x08UL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_DATAST_4   (0x10UL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_DATAST_5   (0x20UL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_DATAST_6   (0x40UL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_DATAST_7   (0x80UL << FMC_BWTR2_DATAST_Pos)
 
#define FMC_BWTR2_CLKDIV_Pos   (20U)
 
#define FMC_BWTR2_CLKDIV_Msk   (0xFUL << FMC_BWTR2_CLKDIV_Pos)
 
#define FMC_BWTR2_CLKDIV   FMC_BWTR2_CLKDIV_Msk
 
#define FMC_BWTR2_CLKDIV_0   (0x1UL << FMC_BWTR2_CLKDIV_Pos)
 
#define FMC_BWTR2_CLKDIV_1   (0x2UL << FMC_BWTR2_CLKDIV_Pos)
 
#define FMC_BWTR2_CLKDIV_2   (0x4UL << FMC_BWTR2_CLKDIV_Pos)
 
#define FMC_BWTR2_CLKDIV_3   (0x8UL << FMC_BWTR2_CLKDIV_Pos)
 
#define FMC_BWTR2_DATLAT_Pos   (24U)
 
#define FMC_BWTR2_DATLAT_Msk   (0xFUL << FMC_BWTR2_DATLAT_Pos)
 
#define FMC_BWTR2_DATLAT   FMC_BWTR2_DATLAT_Msk
 
#define FMC_BWTR2_DATLAT_0   (0x1UL << FMC_BWTR2_DATLAT_Pos)
 
#define FMC_BWTR2_DATLAT_1   (0x2UL << FMC_BWTR2_DATLAT_Pos)
 
#define FMC_BWTR2_DATLAT_2   (0x4UL << FMC_BWTR2_DATLAT_Pos)
 
#define FMC_BWTR2_DATLAT_3   (0x8UL << FMC_BWTR2_DATLAT_Pos)
 
#define FMC_BWTR2_ACCMOD_Pos   (28U)
 
#define FMC_BWTR2_ACCMOD_Msk   (0x3UL << FMC_BWTR2_ACCMOD_Pos)
 
#define FMC_BWTR2_ACCMOD   FMC_BWTR2_ACCMOD_Msk
 
#define FMC_BWTR2_ACCMOD_0   (0x1UL << FMC_BWTR2_ACCMOD_Pos)
 
#define FMC_BWTR2_ACCMOD_1   (0x2UL << FMC_BWTR2_ACCMOD_Pos)
 
#define FMC_BWTR3_ADDSET_Pos   (0U)
 
#define FMC_BWTR3_ADDSET_Msk   (0xFUL << FMC_BWTR3_ADDSET_Pos)
 
#define FMC_BWTR3_ADDSET   FMC_BWTR3_ADDSET_Msk
 
#define FMC_BWTR3_ADDSET_0   (0x1UL << FMC_BWTR3_ADDSET_Pos)
 
#define FMC_BWTR3_ADDSET_1   (0x2UL << FMC_BWTR3_ADDSET_Pos)
 
#define FMC_BWTR3_ADDSET_2   (0x4UL << FMC_BWTR3_ADDSET_Pos)
 
#define FMC_BWTR3_ADDSET_3   (0x8UL << FMC_BWTR3_ADDSET_Pos)
 
#define FMC_BWTR3_ADDHLD_Pos   (4U)
 
#define FMC_BWTR3_ADDHLD_Msk   (0xFUL << FMC_BWTR3_ADDHLD_Pos)
 
#define FMC_BWTR3_ADDHLD   FMC_BWTR3_ADDHLD_Msk
 
#define FMC_BWTR3_ADDHLD_0   (0x1UL << FMC_BWTR3_ADDHLD_Pos)
 
#define FMC_BWTR3_ADDHLD_1   (0x2UL << FMC_BWTR3_ADDHLD_Pos)
 
#define FMC_BWTR3_ADDHLD_2   (0x4UL << FMC_BWTR3_ADDHLD_Pos)
 
#define FMC_BWTR3_ADDHLD_3   (0x8UL << FMC_BWTR3_ADDHLD_Pos)
 
#define FMC_BWTR3_DATAST_Pos   (8U)
 
#define FMC_BWTR3_DATAST_Msk   (0xFFUL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_DATAST   FMC_BWTR3_DATAST_Msk
 
#define FMC_BWTR3_DATAST_0   (0x01UL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_DATAST_1   (0x02UL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_DATAST_2   (0x04UL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_DATAST_3   (0x08UL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_DATAST_4   (0x10UL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_DATAST_5   (0x20UL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_DATAST_6   (0x40UL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_DATAST_7   (0x80UL << FMC_BWTR3_DATAST_Pos)
 
#define FMC_BWTR3_CLKDIV_Pos   (20U)
 
#define FMC_BWTR3_CLKDIV_Msk   (0xFUL << FMC_BWTR3_CLKDIV_Pos)
 
#define FMC_BWTR3_CLKDIV   FMC_BWTR3_CLKDIV_Msk
 
#define FMC_BWTR3_CLKDIV_0   (0x1UL << FMC_BWTR3_CLKDIV_Pos)
 
#define FMC_BWTR3_CLKDIV_1   (0x2UL << FMC_BWTR3_CLKDIV_Pos)
 
#define FMC_BWTR3_CLKDIV_2   (0x4UL << FMC_BWTR3_CLKDIV_Pos)
 
#define FMC_BWTR3_CLKDIV_3   (0x8UL << FMC_BWTR3_CLKDIV_Pos)
 
#define FMC_BWTR3_DATLAT_Pos   (24U)
 
#define FMC_BWTR3_DATLAT_Msk   (0xFUL << FMC_BWTR3_DATLAT_Pos)
 
#define FMC_BWTR3_DATLAT   FMC_BWTR3_DATLAT_Msk
 
#define FMC_BWTR3_DATLAT_0   (0x1UL << FMC_BWTR3_DATLAT_Pos)
 
#define FMC_BWTR3_DATLAT_1   (0x2UL << FMC_BWTR3_DATLAT_Pos)
 
#define FMC_BWTR3_DATLAT_2   (0x4UL << FMC_BWTR3_DATLAT_Pos)
 
#define FMC_BWTR3_DATLAT_3   (0x8UL << FMC_BWTR3_DATLAT_Pos)
 
#define FMC_BWTR3_ACCMOD_Pos   (28U)
 
#define FMC_BWTR3_ACCMOD_Msk   (0x3UL << FMC_BWTR3_ACCMOD_Pos)
 
#define FMC_BWTR3_ACCMOD   FMC_BWTR3_ACCMOD_Msk
 
#define FMC_BWTR3_ACCMOD_0   (0x1UL << FMC_BWTR3_ACCMOD_Pos)
 
#define FMC_BWTR3_ACCMOD_1   (0x2UL << FMC_BWTR3_ACCMOD_Pos)
 
#define FMC_BWTR4_ADDSET_Pos   (0U)
 
#define FMC_BWTR4_ADDSET_Msk   (0xFUL << FMC_BWTR4_ADDSET_Pos)
 
#define FMC_BWTR4_ADDSET   FMC_BWTR4_ADDSET_Msk
 
#define FMC_BWTR4_ADDSET_0   (0x1UL << FMC_BWTR4_ADDSET_Pos)
 
#define FMC_BWTR4_ADDSET_1   (0x2UL << FMC_BWTR4_ADDSET_Pos)
 
#define FMC_BWTR4_ADDSET_2   (0x4UL << FMC_BWTR4_ADDSET_Pos)
 
#define FMC_BWTR4_ADDSET_3   (0x8UL << FMC_BWTR4_ADDSET_Pos)
 
#define FMC_BWTR4_ADDHLD_Pos   (4U)
 
#define FMC_BWTR4_ADDHLD_Msk   (0xFUL << FMC_BWTR4_ADDHLD_Pos)
 
#define FMC_BWTR4_ADDHLD   FMC_BWTR4_ADDHLD_Msk
 
#define FMC_BWTR4_ADDHLD_0   (0x1UL << FMC_BWTR4_ADDHLD_Pos)
 
#define FMC_BWTR4_ADDHLD_1   (0x2UL << FMC_BWTR4_ADDHLD_Pos)
 
#define FMC_BWTR4_ADDHLD_2   (0x4UL << FMC_BWTR4_ADDHLD_Pos)
 
#define FMC_BWTR4_ADDHLD_3   (0x8UL << FMC_BWTR4_ADDHLD_Pos)
 
#define FMC_BWTR4_DATAST_Pos   (8U)
 
#define FMC_BWTR4_DATAST_Msk   (0xFFUL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_DATAST   FMC_BWTR4_DATAST_Msk
 
#define FMC_BWTR4_DATAST_0   (0x01UL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_DATAST_1   (0x02UL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_DATAST_2   (0x04UL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_DATAST_3   (0x08UL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_DATAST_4   (0x10UL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_DATAST_5   (0x20UL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_DATAST_6   (0x40UL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_DATAST_7   (0x80UL << FMC_BWTR4_DATAST_Pos)
 
#define FMC_BWTR4_CLKDIV_Pos   (20U)
 
#define FMC_BWTR4_CLKDIV_Msk   (0xFUL << FMC_BWTR4_CLKDIV_Pos)
 
#define FMC_BWTR4_CLKDIV   FMC_BWTR4_CLKDIV_Msk
 
#define FMC_BWTR4_CLKDIV_0   (0x1UL << FMC_BWTR4_CLKDIV_Pos)
 
#define FMC_BWTR4_CLKDIV_1   (0x2UL << FMC_BWTR4_CLKDIV_Pos)
 
#define FMC_BWTR4_CLKDIV_2   (0x4UL << FMC_BWTR4_CLKDIV_Pos)
 
#define FMC_BWTR4_CLKDIV_3   (0x8UL << FMC_BWTR4_CLKDIV_Pos)
 
#define FMC_BWTR4_DATLAT_Pos   (24U)
 
#define FMC_BWTR4_DATLAT_Msk   (0xFUL << FMC_BWTR4_DATLAT_Pos)
 
#define FMC_BWTR4_DATLAT   FMC_BWTR4_DATLAT_Msk
 
#define FMC_BWTR4_DATLAT_0   (0x1UL << FMC_BWTR4_DATLAT_Pos)
 
#define FMC_BWTR4_DATLAT_1   (0x2UL << FMC_BWTR4_DATLAT_Pos)
 
#define FMC_BWTR4_DATLAT_2   (0x4UL << FMC_BWTR4_DATLAT_Pos)
 
#define FMC_BWTR4_DATLAT_3   (0x8UL << FMC_BWTR4_DATLAT_Pos)
 
#define FMC_BWTR4_ACCMOD_Pos   (28U)
 
#define FMC_BWTR4_ACCMOD_Msk   (0x3UL << FMC_BWTR4_ACCMOD_Pos)
 
#define FMC_BWTR4_ACCMOD   FMC_BWTR4_ACCMOD_Msk
 
#define FMC_BWTR4_ACCMOD_0   (0x1UL << FMC_BWTR4_ACCMOD_Pos)
 
#define FMC_BWTR4_ACCMOD_1   (0x2UL << FMC_BWTR4_ACCMOD_Pos)
 
#define FMC_PCRx_PWAITEN_Pos   (1U)
 
#define FMC_PCRx_PWAITEN_Msk   (0x1UL << FMC_PCRx_PWAITEN_Pos)
 
#define FMC_PCRx_PWAITEN   FMC_PCRx_PWAITEN_Msk
 
#define FMC_PCRx_PBKEN_Pos   (2U)
 
#define FMC_PCRx_PBKEN_Msk   (0x1UL << FMC_PCRx_PBKEN_Pos)
 
#define FMC_PCRx_PBKEN   FMC_PCRx_PBKEN_Msk
 
#define FMC_PCRx_PTYP_Pos   (3U)
 
#define FMC_PCRx_PTYP_Msk   (0x1UL << FMC_PCRx_PTYP_Pos)
 
#define FMC_PCRx_PTYP   FMC_PCRx_PTYP_Msk
 
#define FMC_PCRx_PWID_Pos   (4U)
 
#define FMC_PCRx_PWID_Msk   (0x3UL << FMC_PCRx_PWID_Pos)
 
#define FMC_PCRx_PWID   FMC_PCRx_PWID_Msk
 
#define FMC_PCRx_PWID_0   (0x1UL << FMC_PCRx_PWID_Pos)
 
#define FMC_PCRx_PWID_1   (0x2UL << FMC_PCRx_PWID_Pos)
 
#define FMC_PCRx_ECCEN_Pos   (6U)
 
#define FMC_PCRx_ECCEN_Msk   (0x1UL << FMC_PCRx_ECCEN_Pos)
 
#define FMC_PCRx_ECCEN   FMC_PCRx_ECCEN_Msk
 
#define FMC_PCRx_TCLR_Pos   (9U)
 
#define FMC_PCRx_TCLR_Msk   (0xFUL << FMC_PCRx_TCLR_Pos)
 
#define FMC_PCRx_TCLR   FMC_PCRx_TCLR_Msk
 
#define FMC_PCRx_TCLR_0   (0x1UL << FMC_PCRx_TCLR_Pos)
 
#define FMC_PCRx_TCLR_1   (0x2UL << FMC_PCRx_TCLR_Pos)
 
#define FMC_PCRx_TCLR_2   (0x4UL << FMC_PCRx_TCLR_Pos)
 
#define FMC_PCRx_TCLR_3   (0x8UL << FMC_PCRx_TCLR_Pos)
 
#define FMC_PCRx_TAR_Pos   (13U)
 
#define FMC_PCRx_TAR_Msk   (0xFUL << FMC_PCRx_TAR_Pos)
 
#define FMC_PCRx_TAR   FMC_PCRx_TAR_Msk
 
#define FMC_PCRx_TAR_0   (0x1UL << FMC_PCRx_TAR_Pos)
 
#define FMC_PCRx_TAR_1   (0x2UL << FMC_PCRx_TAR_Pos)
 
#define FMC_PCRx_TAR_2   (0x4UL << FMC_PCRx_TAR_Pos)
 
#define FMC_PCRx_TAR_3   (0x8UL << FMC_PCRx_TAR_Pos)
 
#define FMC_PCRx_ECCPS_Pos   (17U)
 
#define FMC_PCRx_ECCPS_Msk   (0x7UL << FMC_PCRx_ECCPS_Pos)
 
#define FMC_PCRx_ECCPS   FMC_PCRx_ECCPS_Msk
 
#define FMC_PCRx_ECCPS_0   (0x1UL << FMC_PCRx_ECCPS_Pos)
 
#define FMC_PCRx_ECCPS_1   (0x2UL << FMC_PCRx_ECCPS_Pos)
 
#define FMC_PCRx_ECCPS_2   (0x4UL << FMC_PCRx_ECCPS_Pos)
 
#define FMC_PCR2_PWAITEN_Pos   (1U)
 
#define FMC_PCR2_PWAITEN_Msk   (0x1UL << FMC_PCR2_PWAITEN_Pos)
 
#define FMC_PCR2_PWAITEN   FMC_PCR2_PWAITEN_Msk
 
#define FMC_PCR2_PBKEN_Pos   (2U)
 
#define FMC_PCR2_PBKEN_Msk   (0x1UL << FMC_PCR2_PBKEN_Pos)
 
#define FMC_PCR2_PBKEN   FMC_PCR2_PBKEN_Msk
 
#define FMC_PCR2_PTYP_Pos   (3U)
 
#define FMC_PCR2_PTYP_Msk   (0x1UL << FMC_PCR2_PTYP_Pos)
 
#define FMC_PCR2_PTYP   FMC_PCR2_PTYP_Msk
 
#define FMC_PCR2_PWID_Pos   (4U)
 
#define FMC_PCR2_PWID_Msk   (0x3UL << FMC_PCR2_PWID_Pos)
 
#define FMC_PCR2_PWID   FMC_PCR2_PWID_Msk
 
#define FMC_PCR2_PWID_0   (0x1UL << FMC_PCR2_PWID_Pos)
 
#define FMC_PCR2_PWID_1   (0x2UL << FMC_PCR2_PWID_Pos)
 
#define FMC_PCR2_ECCEN_Pos   (6U)
 
#define FMC_PCR2_ECCEN_Msk   (0x1UL << FMC_PCR2_ECCEN_Pos)
 
#define FMC_PCR2_ECCEN   FMC_PCR2_ECCEN_Msk
 
#define FMC_PCR2_TCLR_Pos   (9U)
 
#define FMC_PCR2_TCLR_Msk   (0xFUL << FMC_PCR2_TCLR_Pos)
 
#define FMC_PCR2_TCLR   FMC_PCR2_TCLR_Msk
 
#define FMC_PCR2_TCLR_0   (0x1UL << FMC_PCR2_TCLR_Pos)
 
#define FMC_PCR2_TCLR_1   (0x2UL << FMC_PCR2_TCLR_Pos)
 
#define FMC_PCR2_TCLR_2   (0x4UL << FMC_PCR2_TCLR_Pos)
 
#define FMC_PCR2_TCLR_3   (0x8UL << FMC_PCR2_TCLR_Pos)
 
#define FMC_PCR2_TAR_Pos   (13U)
 
#define FMC_PCR2_TAR_Msk   (0xFUL << FMC_PCR2_TAR_Pos)
 
#define FMC_PCR2_TAR   FMC_PCR2_TAR_Msk
 
#define FMC_PCR2_TAR_0   (0x1UL << FMC_PCR2_TAR_Pos)
 
#define FMC_PCR2_TAR_1   (0x2UL << FMC_PCR2_TAR_Pos)
 
#define FMC_PCR2_TAR_2   (0x4UL << FMC_PCR2_TAR_Pos)
 
#define FMC_PCR2_TAR_3   (0x8UL << FMC_PCR2_TAR_Pos)
 
#define FMC_PCR2_ECCPS_Pos   (17U)
 
#define FMC_PCR2_ECCPS_Msk   (0x7UL << FMC_PCR2_ECCPS_Pos)
 
#define FMC_PCR2_ECCPS   FMC_PCR2_ECCPS_Msk
 
#define FMC_PCR2_ECCPS_0   (0x1UL << FMC_PCR2_ECCPS_Pos)
 
#define FMC_PCR2_ECCPS_1   (0x2UL << FMC_PCR2_ECCPS_Pos)
 
#define FMC_PCR2_ECCPS_2   (0x4UL << FMC_PCR2_ECCPS_Pos)
 
#define FMC_PCR3_PWAITEN_Pos   (1U)
 
#define FMC_PCR3_PWAITEN_Msk   (0x1UL << FMC_PCR3_PWAITEN_Pos)
 
#define FMC_PCR3_PWAITEN   FMC_PCR3_PWAITEN_Msk
 
#define FMC_PCR3_PBKEN_Pos   (2U)
 
#define FMC_PCR3_PBKEN_Msk   (0x1UL << FMC_PCR3_PBKEN_Pos)
 
#define FMC_PCR3_PBKEN   FMC_PCR3_PBKEN_Msk
 
#define FMC_PCR3_PTYP_Pos   (3U)
 
#define FMC_PCR3_PTYP_Msk   (0x1UL << FMC_PCR3_PTYP_Pos)
 
#define FMC_PCR3_PTYP   FMC_PCR3_PTYP_Msk
 
#define FMC_PCR3_PWID_Pos   (4U)
 
#define FMC_PCR3_PWID_Msk   (0x3UL << FMC_PCR3_PWID_Pos)
 
#define FMC_PCR3_PWID   FMC_PCR3_PWID_Msk
 
#define FMC_PCR3_PWID_0   (0x1UL << FMC_PCR3_PWID_Pos)
 
#define FMC_PCR3_PWID_1   (0x2UL << FMC_PCR3_PWID_Pos)
 
#define FMC_PCR3_ECCEN_Pos   (6U)
 
#define FMC_PCR3_ECCEN_Msk   (0x1UL << FMC_PCR3_ECCEN_Pos)
 
#define FMC_PCR3_ECCEN   FMC_PCR3_ECCEN_Msk
 
#define FMC_PCR3_TCLR_Pos   (9U)
 
#define FMC_PCR3_TCLR_Msk   (0xFUL << FMC_PCR3_TCLR_Pos)
 
#define FMC_PCR3_TCLR   FMC_PCR3_TCLR_Msk
 
#define FMC_PCR3_TCLR_0   (0x1UL << FMC_PCR3_TCLR_Pos)
 
#define FMC_PCR3_TCLR_1   (0x2UL << FMC_PCR3_TCLR_Pos)
 
#define FMC_PCR3_TCLR_2   (0x4UL << FMC_PCR3_TCLR_Pos)
 
#define FMC_PCR3_TCLR_3   (0x8UL << FMC_PCR3_TCLR_Pos)
 
#define FMC_PCR3_TAR_Pos   (13U)
 
#define FMC_PCR3_TAR_Msk   (0xFUL << FMC_PCR3_TAR_Pos)
 
#define FMC_PCR3_TAR   FMC_PCR3_TAR_Msk
 
#define FMC_PCR3_TAR_0   (0x1UL << FMC_PCR3_TAR_Pos)
 
#define FMC_PCR3_TAR_1   (0x2UL << FMC_PCR3_TAR_Pos)
 
#define FMC_PCR3_TAR_2   (0x4UL << FMC_PCR3_TAR_Pos)
 
#define FMC_PCR3_TAR_3   (0x8UL << FMC_PCR3_TAR_Pos)
 
#define FMC_PCR3_ECCPS_Pos   (17U)
 
#define FMC_PCR3_ECCPS_Msk   (0x7UL << FMC_PCR3_ECCPS_Pos)
 
#define FMC_PCR3_ECCPS   FMC_PCR3_ECCPS_Msk
 
#define FMC_PCR3_ECCPS_0   (0x1UL << FMC_PCR3_ECCPS_Pos)
 
#define FMC_PCR3_ECCPS_1   (0x2UL << FMC_PCR3_ECCPS_Pos)
 
#define FMC_PCR3_ECCPS_2   (0x4UL << FMC_PCR3_ECCPS_Pos)
 
#define FMC_PCR4_PWAITEN_Pos   (1U)
 
#define FMC_PCR4_PWAITEN_Msk   (0x1UL << FMC_PCR4_PWAITEN_Pos)
 
#define FMC_PCR4_PWAITEN   FMC_PCR4_PWAITEN_Msk
 
#define FMC_PCR4_PBKEN_Pos   (2U)
 
#define FMC_PCR4_PBKEN_Msk   (0x1UL << FMC_PCR4_PBKEN_Pos)
 
#define FMC_PCR4_PBKEN   FMC_PCR4_PBKEN_Msk
 
#define FMC_PCR4_PTYP_Pos   (3U)
 
#define FMC_PCR4_PTYP_Msk   (0x1UL << FMC_PCR4_PTYP_Pos)
 
#define FMC_PCR4_PTYP   FMC_PCR4_PTYP_Msk
 
#define FMC_PCR4_PWID_Pos   (4U)
 
#define FMC_PCR4_PWID_Msk   (0x3UL << FMC_PCR4_PWID_Pos)
 
#define FMC_PCR4_PWID   FMC_PCR4_PWID_Msk
 
#define FMC_PCR4_PWID_0   (0x1UL << FMC_PCR4_PWID_Pos)
 
#define FMC_PCR4_PWID_1   (0x2UL << FMC_PCR4_PWID_Pos)
 
#define FMC_PCR4_ECCEN_Pos   (6U)
 
#define FMC_PCR4_ECCEN_Msk   (0x1UL << FMC_PCR4_ECCEN_Pos)
 
#define FMC_PCR4_ECCEN   FMC_PCR4_ECCEN_Msk
 
#define FMC_PCR4_TCLR_Pos   (9U)
 
#define FMC_PCR4_TCLR_Msk   (0xFUL << FMC_PCR4_TCLR_Pos)
 
#define FMC_PCR4_TCLR   FMC_PCR4_TCLR_Msk
 
#define FMC_PCR4_TCLR_0   (0x1UL << FMC_PCR4_TCLR_Pos)
 
#define FMC_PCR4_TCLR_1   (0x2UL << FMC_PCR4_TCLR_Pos)
 
#define FMC_PCR4_TCLR_2   (0x4UL << FMC_PCR4_TCLR_Pos)
 
#define FMC_PCR4_TCLR_3   (0x8UL << FMC_PCR4_TCLR_Pos)
 
#define FMC_PCR4_TAR_Pos   (13U)
 
#define FMC_PCR4_TAR_Msk   (0xFUL << FMC_PCR4_TAR_Pos)
 
#define FMC_PCR4_TAR   FMC_PCR4_TAR_Msk
 
#define FMC_PCR4_TAR_0   (0x1UL << FMC_PCR4_TAR_Pos)
 
#define FMC_PCR4_TAR_1   (0x2UL << FMC_PCR4_TAR_Pos)
 
#define FMC_PCR4_TAR_2   (0x4UL << FMC_PCR4_TAR_Pos)
 
#define FMC_PCR4_TAR_3   (0x8UL << FMC_PCR4_TAR_Pos)
 
#define FMC_PCR4_ECCPS_Pos   (17U)
 
#define FMC_PCR4_ECCPS_Msk   (0x7UL << FMC_PCR4_ECCPS_Pos)
 
#define FMC_PCR4_ECCPS   FMC_PCR4_ECCPS_Msk
 
#define FMC_PCR4_ECCPS_0   (0x1UL << FMC_PCR4_ECCPS_Pos)
 
#define FMC_PCR4_ECCPS_1   (0x2UL << FMC_PCR4_ECCPS_Pos)
 
#define FMC_PCR4_ECCPS_2   (0x4UL << FMC_PCR4_ECCPS_Pos)
 
#define FMC_SRx_IRS_Pos   (0U)
 
#define FMC_SRx_IRS_Msk   (0x1UL << FMC_SRx_IRS_Pos)
 
#define FMC_SRx_IRS   FMC_SRx_IRS_Msk
 
#define FMC_SRx_ILS_Pos   (1U)
 
#define FMC_SRx_ILS_Msk   (0x1UL << FMC_SRx_ILS_Pos)
 
#define FMC_SRx_ILS   FMC_SRx_ILS_Msk
 
#define FMC_SRx_IFS_Pos   (2U)
 
#define FMC_SRx_IFS_Msk   (0x1UL << FMC_SRx_IFS_Pos)
 
#define FMC_SRx_IFS   FMC_SRx_IFS_Msk
 
#define FMC_SRx_IREN_Pos   (3U)
 
#define FMC_SRx_IREN_Msk   (0x1UL << FMC_SRx_IREN_Pos)
 
#define FMC_SRx_IREN   FMC_SRx_IREN_Msk
 
#define FMC_SRx_ILEN_Pos   (4U)
 
#define FMC_SRx_ILEN_Msk   (0x1UL << FMC_SRx_ILEN_Pos)
 
#define FMC_SRx_ILEN   FMC_SRx_ILEN_Msk
 
#define FMC_SRx_IFEN_Pos   (5U)
 
#define FMC_SRx_IFEN_Msk   (0x1UL << FMC_SRx_IFEN_Pos)
 
#define FMC_SRx_IFEN   FMC_SRx_IFEN_Msk
 
#define FMC_SRx_FEMPT_Pos   (6U)
 
#define FMC_SRx_FEMPT_Msk   (0x1UL << FMC_SRx_FEMPT_Pos)
 
#define FMC_SRx_FEMPT   FMC_SRx_FEMPT_Msk
 
#define FMC_SR2_IRS_Pos   (0U)
 
#define FMC_SR2_IRS_Msk   (0x1UL << FMC_SR2_IRS_Pos)
 
#define FMC_SR2_IRS   FMC_SR2_IRS_Msk
 
#define FMC_SR2_ILS_Pos   (1U)
 
#define FMC_SR2_ILS_Msk   (0x1UL << FMC_SR2_ILS_Pos)
 
#define FMC_SR2_ILS   FMC_SR2_ILS_Msk
 
#define FMC_SR2_IFS_Pos   (2U)
 
#define FMC_SR2_IFS_Msk   (0x1UL << FMC_SR2_IFS_Pos)
 
#define FMC_SR2_IFS   FMC_SR2_IFS_Msk
 
#define FMC_SR2_IREN_Pos   (3U)
 
#define FMC_SR2_IREN_Msk   (0x1UL << FMC_SR2_IREN_Pos)
 
#define FMC_SR2_IREN   FMC_SR2_IREN_Msk
 
#define FMC_SR2_ILEN_Pos   (4U)
 
#define FMC_SR2_ILEN_Msk   (0x1UL << FMC_SR2_ILEN_Pos)
 
#define FMC_SR2_ILEN   FMC_SR2_ILEN_Msk
 
#define FMC_SR2_IFEN_Pos   (5U)
 
#define FMC_SR2_IFEN_Msk   (0x1UL << FMC_SR2_IFEN_Pos)
 
#define FMC_SR2_IFEN   FMC_SR2_IFEN_Msk
 
#define FMC_SR2_FEMPT_Pos   (6U)
 
#define FMC_SR2_FEMPT_Msk   (0x1UL << FMC_SR2_FEMPT_Pos)
 
#define FMC_SR2_FEMPT   FMC_SR2_FEMPT_Msk
 
#define FMC_SR3_IRS_Pos   (0U)
 
#define FMC_SR3_IRS_Msk   (0x1UL << FMC_SR3_IRS_Pos)
 
#define FMC_SR3_IRS   FMC_SR3_IRS_Msk
 
#define FMC_SR3_ILS_Pos   (1U)
 
#define FMC_SR3_ILS_Msk   (0x1UL << FMC_SR3_ILS_Pos)
 
#define FMC_SR3_ILS   FMC_SR3_ILS_Msk
 
#define FMC_SR3_IFS_Pos   (2U)
 
#define FMC_SR3_IFS_Msk   (0x1UL << FMC_SR3_IFS_Pos)
 
#define FMC_SR3_IFS   FMC_SR3_IFS_Msk
 
#define FMC_SR3_IREN_Pos   (3U)
 
#define FMC_SR3_IREN_Msk   (0x1UL << FMC_SR3_IREN_Pos)
 
#define FMC_SR3_IREN   FMC_SR3_IREN_Msk
 
#define FMC_SR3_ILEN_Pos   (4U)
 
#define FMC_SR3_ILEN_Msk   (0x1UL << FMC_SR3_ILEN_Pos)
 
#define FMC_SR3_ILEN   FMC_SR3_ILEN_Msk
 
#define FMC_SR3_IFEN_Pos   (5U)
 
#define FMC_SR3_IFEN_Msk   (0x1UL << FMC_SR3_IFEN_Pos)
 
#define FMC_SR3_IFEN   FMC_SR3_IFEN_Msk
 
#define FMC_SR3_FEMPT_Pos   (6U)
 
#define FMC_SR3_FEMPT_Msk   (0x1UL << FMC_SR3_FEMPT_Pos)
 
#define FMC_SR3_FEMPT   FMC_SR3_FEMPT_Msk
 
#define FMC_SR4_IRS_Pos   (0U)
 
#define FMC_SR4_IRS_Msk   (0x1UL << FMC_SR4_IRS_Pos)
 
#define FMC_SR4_IRS   FMC_SR4_IRS_Msk
 
#define FMC_SR4_ILS_Pos   (1U)
 
#define FMC_SR4_ILS_Msk   (0x1UL << FMC_SR4_ILS_Pos)
 
#define FMC_SR4_ILS   FMC_SR4_ILS_Msk
 
#define FMC_SR4_IFS_Pos   (2U)
 
#define FMC_SR4_IFS_Msk   (0x1UL << FMC_SR4_IFS_Pos)
 
#define FMC_SR4_IFS   FMC_SR4_IFS_Msk
 
#define FMC_SR4_IREN_Pos   (3U)
 
#define FMC_SR4_IREN_Msk   (0x1UL << FMC_SR4_IREN_Pos)
 
#define FMC_SR4_IREN   FMC_SR4_IREN_Msk
 
#define FMC_SR4_ILEN_Pos   (4U)
 
#define FMC_SR4_ILEN_Msk   (0x1UL << FMC_SR4_ILEN_Pos)
 
#define FMC_SR4_ILEN   FMC_SR4_ILEN_Msk
 
#define FMC_SR4_IFEN_Pos   (5U)
 
#define FMC_SR4_IFEN_Msk   (0x1UL << FMC_SR4_IFEN_Pos)
 
#define FMC_SR4_IFEN   FMC_SR4_IFEN_Msk
 
#define FMC_SR4_FEMPT_Pos   (6U)
 
#define FMC_SR4_FEMPT_Msk   (0x1UL << FMC_SR4_FEMPT_Pos)
 
#define FMC_SR4_FEMPT   FMC_SR4_FEMPT_Msk
 
#define FMC_PMEMx_MEMSETx_Pos   (0U)
 
#define FMC_PMEMx_MEMSETx_Msk   (0xFFUL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMSETx   FMC_PMEMx_MEMSETx_Msk
 
#define FMC_PMEMx_MEMSETx_0   (0x01UL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMSETx_1   (0x02UL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMSETx_2   (0x04UL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMSETx_3   (0x08UL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMSETx_4   (0x10UL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMSETx_5   (0x20UL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMSETx_6   (0x40UL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMSETx_7   (0x80UL << FMC_PMEMx_MEMSETx_Pos)
 
#define FMC_PMEMx_MEMWAITx_Pos   (8U)
 
#define FMC_PMEMx_MEMWAITx_Msk   (0xFFUL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMWAITx   FMC_PMEMx_MEMWAITx_Msk
 
#define FMC_PMEMx_MEMWAITx_0   (0x01UL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMWAITx_1   (0x02UL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMWAITx_2   (0x04UL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMWAITx_3   (0x08UL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMWAITx_4   (0x10UL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMWAITx_5   (0x20UL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMWAITx_6   (0x40UL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMWAITx_7   (0x80UL << FMC_PMEMx_MEMWAITx_Pos)
 
#define FMC_PMEMx_MEMHOLDx_Pos   (16U)
 
#define FMC_PMEMx_MEMHOLDx_Msk   (0xFFUL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHOLDx   FMC_PMEMx_MEMHOLDx_Msk
 
#define FMC_PMEMx_MEMHOLDx_0   (0x01UL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHOLDx_1   (0x02UL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHOLDx_2   (0x04UL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHOLDx_3   (0x08UL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHOLDx_4   (0x10UL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHOLDx_5   (0x20UL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHOLDx_6   (0x40UL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHOLDx_7   (0x80UL << FMC_PMEMx_MEMHOLDx_Pos)
 
#define FMC_PMEMx_MEMHIZx_Pos   (24U)
 
#define FMC_PMEMx_MEMHIZx_Msk   (0xFFUL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEMx_MEMHIZx   FMC_PMEMx_MEMHIZx_Msk
 
#define FMC_PMEMx_MEMHIZx_0   (0x01UL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEMx_MEMHIZx_1   (0x02UL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEMx_MEMHIZx_2   (0x04UL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEMx_MEMHIZx_3   (0x08UL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEMx_MEMHIZx_4   (0x10UL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEMx_MEMHIZx_5   (0x20UL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEMx_MEMHIZx_6   (0x40UL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEMx_MEMHIZx_7   (0x80UL << FMC_PMEMx_MEMHIZx_Pos)
 
#define FMC_PMEM2_MEMSET2_Pos   (0U)
 
#define FMC_PMEM2_MEMSET2_Msk   (0xFFUL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMSET2   FMC_PMEM2_MEMSET2_Msk
 
#define FMC_PMEM2_MEMSET2_0   (0x01UL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMSET2_1   (0x02UL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMSET2_2   (0x04UL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMSET2_3   (0x08UL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMSET2_4   (0x10UL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMSET2_5   (0x20UL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMSET2_6   (0x40UL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMSET2_7   (0x80UL << FMC_PMEM2_MEMSET2_Pos)
 
#define FMC_PMEM2_MEMWAIT2_Pos   (8U)
 
#define FMC_PMEM2_MEMWAIT2_Msk   (0xFFUL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMWAIT2   FMC_PMEM2_MEMWAIT2_Msk
 
#define FMC_PMEM2_MEMWAIT2_0   (0x01UL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMWAIT2_1   (0x02UL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMWAIT2_2   (0x04UL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMWAIT2_3   (0x08UL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMWAIT2_4   (0x10UL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMWAIT2_5   (0x20UL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMWAIT2_6   (0x40UL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMWAIT2_7   (0x80UL << FMC_PMEM2_MEMWAIT2_Pos)
 
#define FMC_PMEM2_MEMHOLD2_Pos   (16U)
 
#define FMC_PMEM2_MEMHOLD2_Msk   (0xFFUL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHOLD2   FMC_PMEM2_MEMHOLD2_Msk
 
#define FMC_PMEM2_MEMHOLD2_0   (0x01UL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHOLD2_1   (0x02UL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHOLD2_2   (0x04UL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHOLD2_3   (0x08UL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHOLD2_4   (0x10UL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHOLD2_5   (0x20UL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHOLD2_6   (0x40UL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHOLD2_7   (0x80UL << FMC_PMEM2_MEMHOLD2_Pos)
 
#define FMC_PMEM2_MEMHIZ2_Pos   (24U)
 
#define FMC_PMEM2_MEMHIZ2_Msk   (0xFFUL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM2_MEMHIZ2   FMC_PMEM2_MEMHIZ2_Msk
 
#define FMC_PMEM2_MEMHIZ2_0   (0x01UL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM2_MEMHIZ2_1   (0x02UL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM2_MEMHIZ2_2   (0x04UL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM2_MEMHIZ2_3   (0x08UL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM2_MEMHIZ2_4   (0x10UL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM2_MEMHIZ2_5   (0x20UL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM2_MEMHIZ2_6   (0x40UL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM2_MEMHIZ2_7   (0x80UL << FMC_PMEM2_MEMHIZ2_Pos)
 
#define FMC_PMEM3_MEMSET3_Pos   (0U)
 
#define FMC_PMEM3_MEMSET3_Msk   (0xFFUL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMSET3   FMC_PMEM3_MEMSET3_Msk
 
#define FMC_PMEM3_MEMSET3_0   (0x01UL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMSET3_1   (0x02UL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMSET3_2   (0x04UL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMSET3_3   (0x08UL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMSET3_4   (0x10UL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMSET3_5   (0x20UL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMSET3_6   (0x40UL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMSET3_7   (0x80UL << FMC_PMEM3_MEMSET3_Pos)
 
#define FMC_PMEM3_MEMWAIT3_Pos   (8U)
 
#define FMC_PMEM3_MEMWAIT3_Msk   (0xFFUL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMWAIT3   FMC_PMEM3_MEMWAIT3_Msk
 
#define FMC_PMEM3_MEMWAIT3_0   (0x01UL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMWAIT3_1   (0x02UL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMWAIT3_2   (0x04UL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMWAIT3_3   (0x08UL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMWAIT3_4   (0x10UL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMWAIT3_5   (0x20UL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMWAIT3_6   (0x40UL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMWAIT3_7   (0x80UL << FMC_PMEM3_MEMWAIT3_Pos)
 
#define FMC_PMEM3_MEMHOLD3_Pos   (16U)
 
#define FMC_PMEM3_MEMHOLD3_Msk   (0xFFUL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHOLD3   FMC_PMEM3_MEMHOLD3_Msk
 
#define FMC_PMEM3_MEMHOLD3_0   (0x01UL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHOLD3_1   (0x02UL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHOLD3_2   (0x04UL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHOLD3_3   (0x08UL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHOLD3_4   (0x10UL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHOLD3_5   (0x20UL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHOLD3_6   (0x40UL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHOLD3_7   (0x80UL << FMC_PMEM3_MEMHOLD3_Pos)
 
#define FMC_PMEM3_MEMHIZ3_Pos   (24U)
 
#define FMC_PMEM3_MEMHIZ3_Msk   (0xFFUL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM3_MEMHIZ3   FMC_PMEM3_MEMHIZ3_Msk
 
#define FMC_PMEM3_MEMHIZ3_0   (0x01UL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM3_MEMHIZ3_1   (0x02UL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM3_MEMHIZ3_2   (0x04UL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM3_MEMHIZ3_3   (0x08UL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM3_MEMHIZ3_4   (0x10UL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM3_MEMHIZ3_5   (0x20UL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM3_MEMHIZ3_6   (0x40UL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM3_MEMHIZ3_7   (0x80UL << FMC_PMEM3_MEMHIZ3_Pos)
 
#define FMC_PMEM4_MEMSET4_Pos   (0U)
 
#define FMC_PMEM4_MEMSET4_Msk   (0xFFUL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMSET4   FMC_PMEM4_MEMSET4_Msk
 
#define FMC_PMEM4_MEMSET4_0   (0x01UL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMSET4_1   (0x02UL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMSET4_2   (0x04UL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMSET4_3   (0x08UL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMSET4_4   (0x10UL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMSET4_5   (0x20UL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMSET4_6   (0x40UL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMSET4_7   (0x80UL << FMC_PMEM4_MEMSET4_Pos)
 
#define FMC_PMEM4_MEMWAIT4_Pos   (8U)
 
#define FMC_PMEM4_MEMWAIT4_Msk   (0xFFUL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMWAIT4   FMC_PMEM4_MEMWAIT4_Msk
 
#define FMC_PMEM4_MEMWAIT4_0   (0x01UL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMWAIT4_1   (0x02UL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMWAIT4_2   (0x04UL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMWAIT4_3   (0x08UL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMWAIT4_4   (0x10UL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMWAIT4_5   (0x20UL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMWAIT4_6   (0x40UL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMWAIT4_7   (0x80UL << FMC_PMEM4_MEMWAIT4_Pos)
 
#define FMC_PMEM4_MEMHOLD4_Pos   (16U)
 
#define FMC_PMEM4_MEMHOLD4_Msk   (0xFFUL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHOLD4   FMC_PMEM4_MEMHOLD4_Msk
 
#define FMC_PMEM4_MEMHOLD4_0   (0x01UL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHOLD4_1   (0x02UL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHOLD4_2   (0x04UL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHOLD4_3   (0x08UL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHOLD4_4   (0x10UL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHOLD4_5   (0x20UL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHOLD4_6   (0x40UL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHOLD4_7   (0x80UL << FMC_PMEM4_MEMHOLD4_Pos)
 
#define FMC_PMEM4_MEMHIZ4_Pos   (24U)
 
#define FMC_PMEM4_MEMHIZ4_Msk   (0xFFUL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PMEM4_MEMHIZ4   FMC_PMEM4_MEMHIZ4_Msk
 
#define FMC_PMEM4_MEMHIZ4_0   (0x01UL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PMEM4_MEMHIZ4_1   (0x02UL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PMEM4_MEMHIZ4_2   (0x04UL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PMEM4_MEMHIZ4_3   (0x08UL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PMEM4_MEMHIZ4_4   (0x10UL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PMEM4_MEMHIZ4_5   (0x20UL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PMEM4_MEMHIZ4_6   (0x40UL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PMEM4_MEMHIZ4_7   (0x80UL << FMC_PMEM4_MEMHIZ4_Pos)
 
#define FMC_PATTx_ATTSETx_Pos   (0U)
 
#define FMC_PATTx_ATTSETx_Msk   (0xFFUL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTSETx   FMC_PATTx_ATTSETx_Msk
 
#define FMC_PATTx_ATTSETx_0   (0x01UL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTSETx_1   (0x02UL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTSETx_2   (0x04UL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTSETx_3   (0x08UL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTSETx_4   (0x10UL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTSETx_5   (0x20UL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTSETx_6   (0x40UL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTSETx_7   (0x80UL << FMC_PATTx_ATTSETx_Pos)
 
#define FMC_PATTx_ATTWAITx_Pos   (8U)
 
#define FMC_PATTx_ATTWAITx_Msk   (0xFFUL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTWAITx   FMC_PATTx_ATTWAITx_Msk
 
#define FMC_PATTx_ATTWAITx_0   (0x01UL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTWAITx_1   (0x02UL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTWAITx_2   (0x04UL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTWAITx_3   (0x08UL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTWAITx_4   (0x10UL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTWAITx_5   (0x20UL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTWAITx_6   (0x40UL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTWAITx_7   (0x80UL << FMC_PATTx_ATTWAITx_Pos)
 
#define FMC_PATTx_ATTHOLDx_Pos   (16U)
 
#define FMC_PATTx_ATTHOLDx_Msk   (0xFFUL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHOLDx   FMC_PATTx_ATTHOLDx_Msk
 
#define FMC_PATTx_ATTHOLDx_0   (0x01UL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHOLDx_1   (0x02UL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHOLDx_2   (0x04UL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHOLDx_3   (0x08UL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHOLDx_4   (0x10UL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHOLDx_5   (0x20UL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHOLDx_6   (0x40UL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHOLDx_7   (0x80UL << FMC_PATTx_ATTHOLDx_Pos)
 
#define FMC_PATTx_ATTHIZx_Pos   (24U)
 
#define FMC_PATTx_ATTHIZx_Msk   (0xFFUL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATTx_ATTHIZx   FMC_PATTx_ATTHIZx_Msk
 
#define FMC_PATTx_ATTHIZx_0   (0x01UL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATTx_ATTHIZx_1   (0x02UL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATTx_ATTHIZx_2   (0x04UL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATTx_ATTHIZx_3   (0x08UL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATTx_ATTHIZx_4   (0x10UL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATTx_ATTHIZx_5   (0x20UL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATTx_ATTHIZx_6   (0x40UL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATTx_ATTHIZx_7   (0x80UL << FMC_PATTx_ATTHIZx_Pos)
 
#define FMC_PATT2_ATTSET2_Pos   (0U)
 
#define FMC_PATT2_ATTSET2_Msk   (0xFFUL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTSET2   FMC_PATT2_ATTSET2_Msk
 
#define FMC_PATT2_ATTSET2_0   (0x01UL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTSET2_1   (0x02UL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTSET2_2   (0x04UL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTSET2_3   (0x08UL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTSET2_4   (0x10UL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTSET2_5   (0x20UL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTSET2_6   (0x40UL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTSET2_7   (0x80UL << FMC_PATT2_ATTSET2_Pos)
 
#define FMC_PATT2_ATTWAIT2_Pos   (8U)
 
#define FMC_PATT2_ATTWAIT2_Msk   (0xFFUL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTWAIT2   FMC_PATT2_ATTWAIT2_Msk
 
#define FMC_PATT2_ATTWAIT2_0   (0x01UL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTWAIT2_1   (0x02UL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTWAIT2_2   (0x04UL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTWAIT2_3   (0x08UL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTWAIT2_4   (0x10UL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTWAIT2_5   (0x20UL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTWAIT2_6   (0x40UL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTWAIT2_7   (0x80UL << FMC_PATT2_ATTWAIT2_Pos)
 
#define FMC_PATT2_ATTHOLD2_Pos   (16U)
 
#define FMC_PATT2_ATTHOLD2_Msk   (0xFFUL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHOLD2   FMC_PATT2_ATTHOLD2_Msk
 
#define FMC_PATT2_ATTHOLD2_0   (0x01UL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHOLD2_1   (0x02UL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHOLD2_2   (0x04UL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHOLD2_3   (0x08UL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHOLD2_4   (0x10UL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHOLD2_5   (0x20UL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHOLD2_6   (0x40UL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHOLD2_7   (0x80UL << FMC_PATT2_ATTHOLD2_Pos)
 
#define FMC_PATT2_ATTHIZ2_Pos   (24U)
 
#define FMC_PATT2_ATTHIZ2_Msk   (0xFFUL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT2_ATTHIZ2   FMC_PATT2_ATTHIZ2_Msk
 
#define FMC_PATT2_ATTHIZ2_0   (0x01UL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT2_ATTHIZ2_1   (0x02UL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT2_ATTHIZ2_2   (0x04UL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT2_ATTHIZ2_3   (0x08UL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT2_ATTHIZ2_4   (0x10UL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT2_ATTHIZ2_5   (0x20UL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT2_ATTHIZ2_6   (0x40UL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT2_ATTHIZ2_7   (0x80UL << FMC_PATT2_ATTHIZ2_Pos)
 
#define FMC_PATT3_ATTSET3_Pos   (0U)
 
#define FMC_PATT3_ATTSET3_Msk   (0xFFUL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTSET3   FMC_PATT3_ATTSET3_Msk
 
#define FMC_PATT3_ATTSET3_0   (0x01UL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTSET3_1   (0x02UL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTSET3_2   (0x04UL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTSET3_3   (0x08UL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTSET3_4   (0x10UL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTSET3_5   (0x20UL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTSET3_6   (0x40UL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTSET3_7   (0x80UL << FMC_PATT3_ATTSET3_Pos)
 
#define FMC_PATT3_ATTWAIT3_Pos   (8U)
 
#define FMC_PATT3_ATTWAIT3_Msk   (0xFFUL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTWAIT3   FMC_PATT3_ATTWAIT3_Msk
 
#define FMC_PATT3_ATTWAIT3_0   (0x01UL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTWAIT3_1   (0x02UL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTWAIT3_2   (0x04UL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTWAIT3_3   (0x08UL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTWAIT3_4   (0x10UL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTWAIT3_5   (0x20UL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTWAIT3_6   (0x40UL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTWAIT3_7   (0x80UL << FMC_PATT3_ATTWAIT3_Pos)
 
#define FMC_PATT3_ATTHOLD3_Pos   (16U)
 
#define FMC_PATT3_ATTHOLD3_Msk   (0xFFUL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHOLD3   FMC_PATT3_ATTHOLD3_Msk
 
#define FMC_PATT3_ATTHOLD3_0   (0x01UL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHOLD3_1   (0x02UL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHOLD3_2   (0x04UL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHOLD3_3   (0x08UL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHOLD3_4   (0x10UL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHOLD3_5   (0x20UL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHOLD3_6   (0x40UL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHOLD3_7   (0x80UL << FMC_PATT3_ATTHOLD3_Pos)
 
#define FMC_PATT3_ATTHIZ3_Pos   (24U)
 
#define FMC_PATT3_ATTHIZ3_Msk   (0xFFUL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT3_ATTHIZ3   FMC_PATT3_ATTHIZ3_Msk
 
#define FMC_PATT3_ATTHIZ3_0   (0x01UL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT3_ATTHIZ3_1   (0x02UL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT3_ATTHIZ3_2   (0x04UL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT3_ATTHIZ3_3   (0x08UL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT3_ATTHIZ3_4   (0x10UL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT3_ATTHIZ3_5   (0x20UL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT3_ATTHIZ3_6   (0x40UL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT3_ATTHIZ3_7   (0x80UL << FMC_PATT3_ATTHIZ3_Pos)
 
#define FMC_PATT4_ATTSET4_Pos   (0U)
 
#define FMC_PATT4_ATTSET4_Msk   (0xFFUL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTSET4   FMC_PATT4_ATTSET4_Msk
 
#define FMC_PATT4_ATTSET4_0   (0x01UL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTSET4_1   (0x02UL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTSET4_2   (0x04UL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTSET4_3   (0x08UL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTSET4_4   (0x10UL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTSET4_5   (0x20UL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTSET4_6   (0x40UL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTSET4_7   (0x80UL << FMC_PATT4_ATTSET4_Pos)
 
#define FMC_PATT4_ATTWAIT4_Pos   (8U)
 
#define FMC_PATT4_ATTWAIT4_Msk   (0xFFUL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTWAIT4   FMC_PATT4_ATTWAIT4_Msk
 
#define FMC_PATT4_ATTWAIT4_0   (0x01UL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTWAIT4_1   (0x02UL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTWAIT4_2   (0x04UL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTWAIT4_3   (0x08UL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTWAIT4_4   (0x10UL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTWAIT4_5   (0x20UL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTWAIT4_6   (0x40UL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTWAIT4_7   (0x80UL << FMC_PATT4_ATTWAIT4_Pos)
 
#define FMC_PATT4_ATTHOLD4_Pos   (16U)
 
#define FMC_PATT4_ATTHOLD4_Msk   (0xFFUL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHOLD4   FMC_PATT4_ATTHOLD4_Msk
 
#define FMC_PATT4_ATTHOLD4_0   (0x01UL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHOLD4_1   (0x02UL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHOLD4_2   (0x04UL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHOLD4_3   (0x08UL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHOLD4_4   (0x10UL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHOLD4_5   (0x20UL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHOLD4_6   (0x40UL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHOLD4_7   (0x80UL << FMC_PATT4_ATTHOLD4_Pos)
 
#define FMC_PATT4_ATTHIZ4_Pos   (24U)
 
#define FMC_PATT4_ATTHIZ4_Msk   (0xFFUL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PATT4_ATTHIZ4   FMC_PATT4_ATTHIZ4_Msk
 
#define FMC_PATT4_ATTHIZ4_0   (0x01UL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PATT4_ATTHIZ4_1   (0x02UL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PATT4_ATTHIZ4_2   (0x04UL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PATT4_ATTHIZ4_3   (0x08UL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PATT4_ATTHIZ4_4   (0x10UL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PATT4_ATTHIZ4_5   (0x20UL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PATT4_ATTHIZ4_6   (0x40UL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PATT4_ATTHIZ4_7   (0x80UL << FMC_PATT4_ATTHIZ4_Pos)
 
#define FMC_PIO4_IOSET4_Pos   (0U)
 
#define FMC_PIO4_IOSET4_Msk   (0xFFUL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOSET4   FMC_PIO4_IOSET4_Msk
 
#define FMC_PIO4_IOSET4_0   (0x01UL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOSET4_1   (0x02UL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOSET4_2   (0x04UL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOSET4_3   (0x08UL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOSET4_4   (0x10UL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOSET4_5   (0x20UL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOSET4_6   (0x40UL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOSET4_7   (0x80UL << FMC_PIO4_IOSET4_Pos)
 
#define FMC_PIO4_IOWAIT4_Pos   (8U)
 
#define FMC_PIO4_IOWAIT4_Msk   (0xFFUL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOWAIT4   FMC_PIO4_IOWAIT4_Msk
 
#define FMC_PIO4_IOWAIT4_0   (0x01UL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOWAIT4_1   (0x02UL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOWAIT4_2   (0x04UL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOWAIT4_3   (0x08UL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOWAIT4_4   (0x10UL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOWAIT4_5   (0x20UL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOWAIT4_6   (0x40UL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOWAIT4_7   (0x80UL << FMC_PIO4_IOWAIT4_Pos)
 
#define FMC_PIO4_IOHOLD4_Pos   (16U)
 
#define FMC_PIO4_IOHOLD4_Msk   (0xFFUL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHOLD4   FMC_PIO4_IOHOLD4_Msk
 
#define FMC_PIO4_IOHOLD4_0   (0x01UL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHOLD4_1   (0x02UL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHOLD4_2   (0x04UL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHOLD4_3   (0x08UL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHOLD4_4   (0x10UL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHOLD4_5   (0x20UL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHOLD4_6   (0x40UL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHOLD4_7   (0x80UL << FMC_PIO4_IOHOLD4_Pos)
 
#define FMC_PIO4_IOHIZ4_Pos   (24U)
 
#define FMC_PIO4_IOHIZ4_Msk   (0xFFUL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_PIO4_IOHIZ4   FMC_PIO4_IOHIZ4_Msk
 
#define FMC_PIO4_IOHIZ4_0   (0x01UL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_PIO4_IOHIZ4_1   (0x02UL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_PIO4_IOHIZ4_2   (0x04UL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_PIO4_IOHIZ4_3   (0x08UL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_PIO4_IOHIZ4_4   (0x10UL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_PIO4_IOHIZ4_5   (0x20UL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_PIO4_IOHIZ4_6   (0x40UL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_PIO4_IOHIZ4_7   (0x80UL << FMC_PIO4_IOHIZ4_Pos)
 
#define FMC_ECCR2_ECC2_Pos   (0U)
 
#define FMC_ECCR2_ECC2_Msk   (0xFFFFFFFFUL << FMC_ECCR2_ECC2_Pos)
 
#define FMC_ECCR2_ECC2   FMC_ECCR2_ECC2_Msk
 
#define FMC_ECCR3_ECC3_Pos   (0U)
 
#define FMC_ECCR3_ECC3_Msk   (0xFFFFFFFFUL << FMC_ECCR3_ECC3_Pos)
 
#define FMC_ECCR3_ECC3   FMC_ECCR3_ECC3_Msk
 
#define GPIO_MODER_MODER0_Pos   (0U)
 
#define GPIO_MODER_MODER0_Msk   (0x3UL << GPIO_MODER_MODER0_Pos)
 
#define GPIO_MODER_MODER0   GPIO_MODER_MODER0_Msk
 
#define GPIO_MODER_MODER0_0   (0x1UL << GPIO_MODER_MODER0_Pos)
 
#define GPIO_MODER_MODER0_1   (0x2UL << GPIO_MODER_MODER0_Pos)
 
#define GPIO_MODER_MODER1_Pos   (2U)
 
#define GPIO_MODER_MODER1_Msk   (0x3UL << GPIO_MODER_MODER1_Pos)
 
#define GPIO_MODER_MODER1   GPIO_MODER_MODER1_Msk
 
#define GPIO_MODER_MODER1_0   (0x1UL << GPIO_MODER_MODER1_Pos)
 
#define GPIO_MODER_MODER1_1   (0x2UL << GPIO_MODER_MODER1_Pos)
 
#define GPIO_MODER_MODER2_Pos   (4U)
 
#define GPIO_MODER_MODER2_Msk   (0x3UL << GPIO_MODER_MODER2_Pos)
 
#define GPIO_MODER_MODER2   GPIO_MODER_MODER2_Msk
 
#define GPIO_MODER_MODER2_0   (0x1UL << GPIO_MODER_MODER2_Pos)
 
#define GPIO_MODER_MODER2_1   (0x2UL << GPIO_MODER_MODER2_Pos)
 
#define GPIO_MODER_MODER3_Pos   (6U)
 
#define GPIO_MODER_MODER3_Msk   (0x3UL << GPIO_MODER_MODER3_Pos)
 
#define GPIO_MODER_MODER3   GPIO_MODER_MODER3_Msk
 
#define GPIO_MODER_MODER3_0   (0x1UL << GPIO_MODER_MODER3_Pos)
 
#define GPIO_MODER_MODER3_1   (0x2UL << GPIO_MODER_MODER3_Pos)
 
#define GPIO_MODER_MODER4_Pos   (8U)
 
#define GPIO_MODER_MODER4_Msk   (0x3UL << GPIO_MODER_MODER4_Pos)
 
#define GPIO_MODER_MODER4   GPIO_MODER_MODER4_Msk
 
#define GPIO_MODER_MODER4_0   (0x1UL << GPIO_MODER_MODER4_Pos)
 
#define GPIO_MODER_MODER4_1   (0x2UL << GPIO_MODER_MODER4_Pos)
 
#define GPIO_MODER_MODER5_Pos   (10U)
 
#define GPIO_MODER_MODER5_Msk   (0x3UL << GPIO_MODER_MODER5_Pos)
 
#define GPIO_MODER_MODER5   GPIO_MODER_MODER5_Msk
 
#define GPIO_MODER_MODER5_0   (0x1UL << GPIO_MODER_MODER5_Pos)
 
#define GPIO_MODER_MODER5_1   (0x2UL << GPIO_MODER_MODER5_Pos)
 
#define GPIO_MODER_MODER6_Pos   (12U)
 
#define GPIO_MODER_MODER6_Msk   (0x3UL << GPIO_MODER_MODER6_Pos)
 
#define GPIO_MODER_MODER6   GPIO_MODER_MODER6_Msk
 
#define GPIO_MODER_MODER6_0   (0x1UL << GPIO_MODER_MODER6_Pos)
 
#define GPIO_MODER_MODER6_1   (0x2UL << GPIO_MODER_MODER6_Pos)
 
#define GPIO_MODER_MODER7_Pos   (14U)
 
#define GPIO_MODER_MODER7_Msk   (0x3UL << GPIO_MODER_MODER7_Pos)
 
#define GPIO_MODER_MODER7   GPIO_MODER_MODER7_Msk
 
#define GPIO_MODER_MODER7_0   (0x1UL << GPIO_MODER_MODER7_Pos)
 
#define GPIO_MODER_MODER7_1   (0x2UL << GPIO_MODER_MODER7_Pos)
 
#define GPIO_MODER_MODER8_Pos   (16U)
 
#define GPIO_MODER_MODER8_Msk   (0x3UL << GPIO_MODER_MODER8_Pos)
 
#define GPIO_MODER_MODER8   GPIO_MODER_MODER8_Msk
 
#define GPIO_MODER_MODER8_0   (0x1UL << GPIO_MODER_MODER8_Pos)
 
#define GPIO_MODER_MODER8_1   (0x2UL << GPIO_MODER_MODER8_Pos)
 
#define GPIO_MODER_MODER9_Pos   (18U)
 
#define GPIO_MODER_MODER9_Msk   (0x3UL << GPIO_MODER_MODER9_Pos)
 
#define GPIO_MODER_MODER9   GPIO_MODER_MODER9_Msk
 
#define GPIO_MODER_MODER9_0   (0x1UL << GPIO_MODER_MODER9_Pos)
 
#define GPIO_MODER_MODER9_1   (0x2UL << GPIO_MODER_MODER9_Pos)
 
#define GPIO_MODER_MODER10_Pos   (20U)
 
#define GPIO_MODER_MODER10_Msk   (0x3UL << GPIO_MODER_MODER10_Pos)
 
#define GPIO_MODER_MODER10   GPIO_MODER_MODER10_Msk
 
#define GPIO_MODER_MODER10_0   (0x1UL << GPIO_MODER_MODER10_Pos)
 
#define GPIO_MODER_MODER10_1   (0x2UL << GPIO_MODER_MODER10_Pos)
 
#define GPIO_MODER_MODER11_Pos   (22U)
 
#define GPIO_MODER_MODER11_Msk   (0x3UL << GPIO_MODER_MODER11_Pos)
 
#define GPIO_MODER_MODER11   GPIO_MODER_MODER11_Msk
 
#define GPIO_MODER_MODER11_0   (0x1UL << GPIO_MODER_MODER11_Pos)
 
#define GPIO_MODER_MODER11_1   (0x2UL << GPIO_MODER_MODER11_Pos)
 
#define GPIO_MODER_MODER12_Pos   (24U)
 
#define GPIO_MODER_MODER12_Msk   (0x3UL << GPIO_MODER_MODER12_Pos)
 
#define GPIO_MODER_MODER12   GPIO_MODER_MODER12_Msk
 
#define GPIO_MODER_MODER12_0   (0x1UL << GPIO_MODER_MODER12_Pos)
 
#define GPIO_MODER_MODER12_1   (0x2UL << GPIO_MODER_MODER12_Pos)
 
#define GPIO_MODER_MODER13_Pos   (26U)
 
#define GPIO_MODER_MODER13_Msk   (0x3UL << GPIO_MODER_MODER13_Pos)
 
#define GPIO_MODER_MODER13   GPIO_MODER_MODER13_Msk
 
#define GPIO_MODER_MODER13_0   (0x1UL << GPIO_MODER_MODER13_Pos)
 
#define GPIO_MODER_MODER13_1   (0x2UL << GPIO_MODER_MODER13_Pos)
 
#define GPIO_MODER_MODER14_Pos   (28U)
 
#define GPIO_MODER_MODER14_Msk   (0x3UL << GPIO_MODER_MODER14_Pos)
 
#define GPIO_MODER_MODER14   GPIO_MODER_MODER14_Msk
 
#define GPIO_MODER_MODER14_0   (0x1UL << GPIO_MODER_MODER14_Pos)
 
#define GPIO_MODER_MODER14_1   (0x2UL << GPIO_MODER_MODER14_Pos)
 
#define GPIO_MODER_MODER15_Pos   (30U)
 
#define GPIO_MODER_MODER15_Msk   (0x3UL << GPIO_MODER_MODER15_Pos)
 
#define GPIO_MODER_MODER15   GPIO_MODER_MODER15_Msk
 
#define GPIO_MODER_MODER15_0   (0x1UL << GPIO_MODER_MODER15_Pos)
 
#define GPIO_MODER_MODER15_1   (0x2UL << GPIO_MODER_MODER15_Pos)
 
#define GPIO_OTYPER_OT_0   (0x00000001U)
 
#define GPIO_OTYPER_OT_1   (0x00000002U)
 
#define GPIO_OTYPER_OT_2   (0x00000004U)
 
#define GPIO_OTYPER_OT_3   (0x00000008U)
 
#define GPIO_OTYPER_OT_4   (0x00000010U)
 
#define GPIO_OTYPER_OT_5   (0x00000020U)
 
#define GPIO_OTYPER_OT_6   (0x00000040U)
 
#define GPIO_OTYPER_OT_7   (0x00000080U)
 
#define GPIO_OTYPER_OT_8   (0x00000100U)
 
#define GPIO_OTYPER_OT_9   (0x00000200U)
 
#define GPIO_OTYPER_OT_10   (0x00000400U)
 
#define GPIO_OTYPER_OT_11   (0x00000800U)
 
#define GPIO_OTYPER_OT_12   (0x00001000U)
 
#define GPIO_OTYPER_OT_13   (0x00002000U)
 
#define GPIO_OTYPER_OT_14   (0x00004000U)
 
#define GPIO_OTYPER_OT_15   (0x00008000U)
 
#define GPIO_OSPEEDER_OSPEEDR0_Pos   (0U)
 
#define GPIO_OSPEEDER_OSPEEDR0_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR0_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR0   GPIO_OSPEEDER_OSPEEDR0_Msk
 
#define GPIO_OSPEEDER_OSPEEDR0_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR0_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR0_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR0_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR1_Pos   (2U)
 
#define GPIO_OSPEEDER_OSPEEDR1_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR1_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR1   GPIO_OSPEEDER_OSPEEDR1_Msk
 
#define GPIO_OSPEEDER_OSPEEDR1_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR1_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR1_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR1_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR2_Pos   (4U)
 
#define GPIO_OSPEEDER_OSPEEDR2_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR2_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR2   GPIO_OSPEEDER_OSPEEDR2_Msk
 
#define GPIO_OSPEEDER_OSPEEDR2_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR2_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR2_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR2_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR3_Pos   (6U)
 
#define GPIO_OSPEEDER_OSPEEDR3_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR3_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR3   GPIO_OSPEEDER_OSPEEDR3_Msk
 
#define GPIO_OSPEEDER_OSPEEDR3_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR3_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR3_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR3_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR4_Pos   (8U)
 
#define GPIO_OSPEEDER_OSPEEDR4_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR4_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR4   GPIO_OSPEEDER_OSPEEDR4_Msk
 
#define GPIO_OSPEEDER_OSPEEDR4_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR4_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR4_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR4_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR5_Pos   (10U)
 
#define GPIO_OSPEEDER_OSPEEDR5_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR5_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR5   GPIO_OSPEEDER_OSPEEDR5_Msk
 
#define GPIO_OSPEEDER_OSPEEDR5_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR5_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR5_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR5_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR6_Pos   (12U)
 
#define GPIO_OSPEEDER_OSPEEDR6_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR6_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR6   GPIO_OSPEEDER_OSPEEDR6_Msk
 
#define GPIO_OSPEEDER_OSPEEDR6_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR6_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR6_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR6_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR7_Pos   (14U)
 
#define GPIO_OSPEEDER_OSPEEDR7_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR7_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR7   GPIO_OSPEEDER_OSPEEDR7_Msk
 
#define GPIO_OSPEEDER_OSPEEDR7_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR7_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR7_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR7_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR8_Pos   (16U)
 
#define GPIO_OSPEEDER_OSPEEDR8_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR8_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR8   GPIO_OSPEEDER_OSPEEDR8_Msk
 
#define GPIO_OSPEEDER_OSPEEDR8_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR8_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR8_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR8_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR9_Pos   (18U)
 
#define GPIO_OSPEEDER_OSPEEDR9_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR9_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR9   GPIO_OSPEEDER_OSPEEDR9_Msk
 
#define GPIO_OSPEEDER_OSPEEDR9_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR9_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR9_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR9_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR10_Pos   (20U)
 
#define GPIO_OSPEEDER_OSPEEDR10_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR10_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR10   GPIO_OSPEEDER_OSPEEDR10_Msk
 
#define GPIO_OSPEEDER_OSPEEDR10_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR10_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR10_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR10_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR11_Pos   (22U)
 
#define GPIO_OSPEEDER_OSPEEDR11_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR11_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR11   GPIO_OSPEEDER_OSPEEDR11_Msk
 
#define GPIO_OSPEEDER_OSPEEDR11_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR11_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR11_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR11_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR12_Pos   (24U)
 
#define GPIO_OSPEEDER_OSPEEDR12_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR12_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR12   GPIO_OSPEEDER_OSPEEDR12_Msk
 
#define GPIO_OSPEEDER_OSPEEDR12_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR12_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR12_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR12_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR13_Pos   (26U)
 
#define GPIO_OSPEEDER_OSPEEDR13_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR13_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR13   GPIO_OSPEEDER_OSPEEDR13_Msk
 
#define GPIO_OSPEEDER_OSPEEDR13_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR13_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR13_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR13_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR14_Pos   (28U)
 
#define GPIO_OSPEEDER_OSPEEDR14_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR14_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR14   GPIO_OSPEEDER_OSPEEDR14_Msk
 
#define GPIO_OSPEEDER_OSPEEDR14_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR14_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR14_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR14_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR15_Pos   (30U)
 
#define GPIO_OSPEEDER_OSPEEDR15_Msk   (0x3UL << GPIO_OSPEEDER_OSPEEDR15_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR15   GPIO_OSPEEDER_OSPEEDR15_Msk
 
#define GPIO_OSPEEDER_OSPEEDR15_0   (0x1UL << GPIO_OSPEEDER_OSPEEDR15_Pos)
 
#define GPIO_OSPEEDER_OSPEEDR15_1   (0x2UL << GPIO_OSPEEDER_OSPEEDR15_Pos)
 
#define GPIO_PUPDR_PUPDR0_Pos   (0U)
 
#define GPIO_PUPDR_PUPDR0_Msk   (0x3UL << GPIO_PUPDR_PUPDR0_Pos)
 
#define GPIO_PUPDR_PUPDR0   GPIO_PUPDR_PUPDR0_Msk
 
#define GPIO_PUPDR_PUPDR0_0   (0x1UL << GPIO_PUPDR_PUPDR0_Pos)
 
#define GPIO_PUPDR_PUPDR0_1   (0x2UL << GPIO_PUPDR_PUPDR0_Pos)
 
#define GPIO_PUPDR_PUPDR1_Pos   (2U)
 
#define GPIO_PUPDR_PUPDR1_Msk   (0x3UL << GPIO_PUPDR_PUPDR1_Pos)
 
#define GPIO_PUPDR_PUPDR1   GPIO_PUPDR_PUPDR1_Msk
 
#define GPIO_PUPDR_PUPDR1_0   (0x1UL << GPIO_PUPDR_PUPDR1_Pos)
 
#define GPIO_PUPDR_PUPDR1_1   (0x2UL << GPIO_PUPDR_PUPDR1_Pos)
 
#define GPIO_PUPDR_PUPDR2_Pos   (4U)
 
#define GPIO_PUPDR_PUPDR2_Msk   (0x3UL << GPIO_PUPDR_PUPDR2_Pos)
 
#define GPIO_PUPDR_PUPDR2   GPIO_PUPDR_PUPDR2_Msk
 
#define GPIO_PUPDR_PUPDR2_0   (0x1UL << GPIO_PUPDR_PUPDR2_Pos)
 
#define GPIO_PUPDR_PUPDR2_1   (0x2UL << GPIO_PUPDR_PUPDR2_Pos)
 
#define GPIO_PUPDR_PUPDR3_Pos   (6U)
 
#define GPIO_PUPDR_PUPDR3_Msk   (0x3UL << GPIO_PUPDR_PUPDR3_Pos)
 
#define GPIO_PUPDR_PUPDR3   GPIO_PUPDR_PUPDR3_Msk
 
#define GPIO_PUPDR_PUPDR3_0   (0x1UL << GPIO_PUPDR_PUPDR3_Pos)
 
#define GPIO_PUPDR_PUPDR3_1   (0x2UL << GPIO_PUPDR_PUPDR3_Pos)
 
#define GPIO_PUPDR_PUPDR4_Pos   (8U)
 
#define GPIO_PUPDR_PUPDR4_Msk   (0x3UL << GPIO_PUPDR_PUPDR4_Pos)
 
#define GPIO_PUPDR_PUPDR4   GPIO_PUPDR_PUPDR4_Msk
 
#define GPIO_PUPDR_PUPDR4_0   (0x1UL << GPIO_PUPDR_PUPDR4_Pos)
 
#define GPIO_PUPDR_PUPDR4_1   (0x2UL << GPIO_PUPDR_PUPDR4_Pos)
 
#define GPIO_PUPDR_PUPDR5_Pos   (10U)
 
#define GPIO_PUPDR_PUPDR5_Msk   (0x3UL << GPIO_PUPDR_PUPDR5_Pos)
 
#define GPIO_PUPDR_PUPDR5   GPIO_PUPDR_PUPDR5_Msk
 
#define GPIO_PUPDR_PUPDR5_0   (0x1UL << GPIO_PUPDR_PUPDR5_Pos)
 
#define GPIO_PUPDR_PUPDR5_1   (0x2UL << GPIO_PUPDR_PUPDR5_Pos)
 
#define GPIO_PUPDR_PUPDR6_Pos   (12U)
 
#define GPIO_PUPDR_PUPDR6_Msk   (0x3UL << GPIO_PUPDR_PUPDR6_Pos)
 
#define GPIO_PUPDR_PUPDR6   GPIO_PUPDR_PUPDR6_Msk
 
#define GPIO_PUPDR_PUPDR6_0   (0x1UL << GPIO_PUPDR_PUPDR6_Pos)
 
#define GPIO_PUPDR_PUPDR6_1   (0x2UL << GPIO_PUPDR_PUPDR6_Pos)
 
#define GPIO_PUPDR_PUPDR7_Pos   (14U)
 
#define GPIO_PUPDR_PUPDR7_Msk   (0x3UL << GPIO_PUPDR_PUPDR7_Pos)
 
#define GPIO_PUPDR_PUPDR7   GPIO_PUPDR_PUPDR7_Msk
 
#define GPIO_PUPDR_PUPDR7_0   (0x1UL << GPIO_PUPDR_PUPDR7_Pos)
 
#define GPIO_PUPDR_PUPDR7_1   (0x2UL << GPIO_PUPDR_PUPDR7_Pos)
 
#define GPIO_PUPDR_PUPDR8_Pos   (16U)
 
#define GPIO_PUPDR_PUPDR8_Msk   (0x3UL << GPIO_PUPDR_PUPDR8_Pos)
 
#define GPIO_PUPDR_PUPDR8   GPIO_PUPDR_PUPDR8_Msk
 
#define GPIO_PUPDR_PUPDR8_0   (0x1UL << GPIO_PUPDR_PUPDR8_Pos)
 
#define GPIO_PUPDR_PUPDR8_1   (0x2UL << GPIO_PUPDR_PUPDR8_Pos)
 
#define GPIO_PUPDR_PUPDR9_Pos   (18U)
 
#define GPIO_PUPDR_PUPDR9_Msk   (0x3UL << GPIO_PUPDR_PUPDR9_Pos)
 
#define GPIO_PUPDR_PUPDR9   GPIO_PUPDR_PUPDR9_Msk
 
#define GPIO_PUPDR_PUPDR9_0   (0x1UL << GPIO_PUPDR_PUPDR9_Pos)
 
#define GPIO_PUPDR_PUPDR9_1   (0x2UL << GPIO_PUPDR_PUPDR9_Pos)
 
#define GPIO_PUPDR_PUPDR10_Pos   (20U)
 
#define GPIO_PUPDR_PUPDR10_Msk   (0x3UL << GPIO_PUPDR_PUPDR10_Pos)
 
#define GPIO_PUPDR_PUPDR10   GPIO_PUPDR_PUPDR10_Msk
 
#define GPIO_PUPDR_PUPDR10_0   (0x1UL << GPIO_PUPDR_PUPDR10_Pos)
 
#define GPIO_PUPDR_PUPDR10_1   (0x2UL << GPIO_PUPDR_PUPDR10_Pos)
 
#define GPIO_PUPDR_PUPDR11_Pos   (22U)
 
#define GPIO_PUPDR_PUPDR11_Msk   (0x3UL << GPIO_PUPDR_PUPDR11_Pos)
 
#define GPIO_PUPDR_PUPDR11   GPIO_PUPDR_PUPDR11_Msk
 
#define GPIO_PUPDR_PUPDR11_0   (0x1UL << GPIO_PUPDR_PUPDR11_Pos)
 
#define GPIO_PUPDR_PUPDR11_1   (0x2UL << GPIO_PUPDR_PUPDR11_Pos)
 
#define GPIO_PUPDR_PUPDR12_Pos   (24U)
 
#define GPIO_PUPDR_PUPDR12_Msk   (0x3UL << GPIO_PUPDR_PUPDR12_Pos)
 
#define GPIO_PUPDR_PUPDR12   GPIO_PUPDR_PUPDR12_Msk
 
#define GPIO_PUPDR_PUPDR12_0   (0x1UL << GPIO_PUPDR_PUPDR12_Pos)
 
#define GPIO_PUPDR_PUPDR12_1   (0x2UL << GPIO_PUPDR_PUPDR12_Pos)
 
#define GPIO_PUPDR_PUPDR13_Pos   (26U)
 
#define GPIO_PUPDR_PUPDR13_Msk   (0x3UL << GPIO_PUPDR_PUPDR13_Pos)
 
#define GPIO_PUPDR_PUPDR13   GPIO_PUPDR_PUPDR13_Msk
 
#define GPIO_PUPDR_PUPDR13_0   (0x1UL << GPIO_PUPDR_PUPDR13_Pos)
 
#define GPIO_PUPDR_PUPDR13_1   (0x2UL << GPIO_PUPDR_PUPDR13_Pos)
 
#define GPIO_PUPDR_PUPDR14_Pos   (28U)
 
#define GPIO_PUPDR_PUPDR14_Msk   (0x3UL << GPIO_PUPDR_PUPDR14_Pos)
 
#define GPIO_PUPDR_PUPDR14   GPIO_PUPDR_PUPDR14_Msk
 
#define GPIO_PUPDR_PUPDR14_0   (0x1UL << GPIO_PUPDR_PUPDR14_Pos)
 
#define GPIO_PUPDR_PUPDR14_1   (0x2UL << GPIO_PUPDR_PUPDR14_Pos)
 
#define GPIO_PUPDR_PUPDR15_Pos   (30U)
 
#define GPIO_PUPDR_PUPDR15_Msk   (0x3UL << GPIO_PUPDR_PUPDR15_Pos)
 
#define GPIO_PUPDR_PUPDR15   GPIO_PUPDR_PUPDR15_Msk
 
#define GPIO_PUPDR_PUPDR15_0   (0x1UL << GPIO_PUPDR_PUPDR15_Pos)
 
#define GPIO_PUPDR_PUPDR15_1   (0x2UL << GPIO_PUPDR_PUPDR15_Pos)
 
#define GPIO_IDR_0   (0x00000001U)
 
#define GPIO_IDR_1   (0x00000002U)
 
#define GPIO_IDR_2   (0x00000004U)
 
#define GPIO_IDR_3   (0x00000008U)
 
#define GPIO_IDR_4   (0x00000010U)
 
#define GPIO_IDR_5   (0x00000020U)
 
#define GPIO_IDR_6   (0x00000040U)
 
#define GPIO_IDR_7   (0x00000080U)
 
#define GPIO_IDR_8   (0x00000100U)
 
#define GPIO_IDR_9   (0x00000200U)
 
#define GPIO_IDR_10   (0x00000400U)
 
#define GPIO_IDR_11   (0x00000800U)
 
#define GPIO_IDR_12   (0x00001000U)
 
#define GPIO_IDR_13   (0x00002000U)
 
#define GPIO_IDR_14   (0x00004000U)
 
#define GPIO_IDR_15   (0x00008000U)
 
#define GPIO_ODR_0   (0x00000001U)
 
#define GPIO_ODR_1   (0x00000002U)
 
#define GPIO_ODR_2   (0x00000004U)
 
#define GPIO_ODR_3   (0x00000008U)
 
#define GPIO_ODR_4   (0x00000010U)
 
#define GPIO_ODR_5   (0x00000020U)
 
#define GPIO_ODR_6   (0x00000040U)
 
#define GPIO_ODR_7   (0x00000080U)
 
#define GPIO_ODR_8   (0x00000100U)
 
#define GPIO_ODR_9   (0x00000200U)
 
#define GPIO_ODR_10   (0x00000400U)
 
#define GPIO_ODR_11   (0x00000800U)
 
#define GPIO_ODR_12   (0x00001000U)
 
#define GPIO_ODR_13   (0x00002000U)
 
#define GPIO_ODR_14   (0x00004000U)
 
#define GPIO_ODR_15   (0x00008000U)
 
#define GPIO_BSRR_BS_0   (0x00000001U)
 
#define GPIO_BSRR_BS_1   (0x00000002U)
 
#define GPIO_BSRR_BS_2   (0x00000004U)
 
#define GPIO_BSRR_BS_3   (0x00000008U)
 
#define GPIO_BSRR_BS_4   (0x00000010U)
 
#define GPIO_BSRR_BS_5   (0x00000020U)
 
#define GPIO_BSRR_BS_6   (0x00000040U)
 
#define GPIO_BSRR_BS_7   (0x00000080U)
 
#define GPIO_BSRR_BS_8   (0x00000100U)
 
#define GPIO_BSRR_BS_9   (0x00000200U)
 
#define GPIO_BSRR_BS_10   (0x00000400U)
 
#define GPIO_BSRR_BS_11   (0x00000800U)
 
#define GPIO_BSRR_BS_12   (0x00001000U)
 
#define GPIO_BSRR_BS_13   (0x00002000U)
 
#define GPIO_BSRR_BS_14   (0x00004000U)
 
#define GPIO_BSRR_BS_15   (0x00008000U)
 
#define GPIO_BSRR_BR_0   (0x00010000U)
 
#define GPIO_BSRR_BR_1   (0x00020000U)
 
#define GPIO_BSRR_BR_2   (0x00040000U)
 
#define GPIO_BSRR_BR_3   (0x00080000U)
 
#define GPIO_BSRR_BR_4   (0x00100000U)
 
#define GPIO_BSRR_BR_5   (0x00200000U)
 
#define GPIO_BSRR_BR_6   (0x00400000U)
 
#define GPIO_BSRR_BR_7   (0x00800000U)
 
#define GPIO_BSRR_BR_8   (0x01000000U)
 
#define GPIO_BSRR_BR_9   (0x02000000U)
 
#define GPIO_BSRR_BR_10   (0x04000000U)
 
#define GPIO_BSRR_BR_11   (0x08000000U)
 
#define GPIO_BSRR_BR_12   (0x10000000U)
 
#define GPIO_BSRR_BR_13   (0x20000000U)
 
#define GPIO_BSRR_BR_14   (0x40000000U)
 
#define GPIO_BSRR_BR_15   (0x80000000U)
 
#define GPIO_LCKR_LCK0_Pos   (0U)
 
#define GPIO_LCKR_LCK0_Msk   (0x1UL << GPIO_LCKR_LCK0_Pos)
 
#define GPIO_LCKR_LCK0   GPIO_LCKR_LCK0_Msk
 
#define GPIO_LCKR_LCK1_Pos   (1U)
 
#define GPIO_LCKR_LCK1_Msk   (0x1UL << GPIO_LCKR_LCK1_Pos)
 
#define GPIO_LCKR_LCK1   GPIO_LCKR_LCK1_Msk
 
#define GPIO_LCKR_LCK2_Pos   (2U)
 
#define GPIO_LCKR_LCK2_Msk   (0x1UL << GPIO_LCKR_LCK2_Pos)
 
#define GPIO_LCKR_LCK2   GPIO_LCKR_LCK2_Msk
 
#define GPIO_LCKR_LCK3_Pos   (3U)
 
#define GPIO_LCKR_LCK3_Msk   (0x1UL << GPIO_LCKR_LCK3_Pos)
 
#define GPIO_LCKR_LCK3   GPIO_LCKR_LCK3_Msk
 
#define GPIO_LCKR_LCK4_Pos   (4U)
 
#define GPIO_LCKR_LCK4_Msk   (0x1UL << GPIO_LCKR_LCK4_Pos)
 
#define GPIO_LCKR_LCK4   GPIO_LCKR_LCK4_Msk
 
#define GPIO_LCKR_LCK5_Pos   (5U)
 
#define GPIO_LCKR_LCK5_Msk   (0x1UL << GPIO_LCKR_LCK5_Pos)
 
#define GPIO_LCKR_LCK5   GPIO_LCKR_LCK5_Msk
 
#define GPIO_LCKR_LCK6_Pos   (6U)
 
#define GPIO_LCKR_LCK6_Msk   (0x1UL << GPIO_LCKR_LCK6_Pos)
 
#define GPIO_LCKR_LCK6   GPIO_LCKR_LCK6_Msk
 
#define GPIO_LCKR_LCK7_Pos   (7U)
 
#define GPIO_LCKR_LCK7_Msk   (0x1UL << GPIO_LCKR_LCK7_Pos)
 
#define GPIO_LCKR_LCK7   GPIO_LCKR_LCK7_Msk
 
#define GPIO_LCKR_LCK8_Pos   (8U)
 
#define GPIO_LCKR_LCK8_Msk   (0x1UL << GPIO_LCKR_LCK8_Pos)
 
#define GPIO_LCKR_LCK8   GPIO_LCKR_LCK8_Msk
 
#define GPIO_LCKR_LCK9_Pos   (9U)
 
#define GPIO_LCKR_LCK9_Msk   (0x1UL << GPIO_LCKR_LCK9_Pos)
 
#define GPIO_LCKR_LCK9   GPIO_LCKR_LCK9_Msk
 
#define GPIO_LCKR_LCK10_Pos   (10U)
 
#define GPIO_LCKR_LCK10_Msk   (0x1UL << GPIO_LCKR_LCK10_Pos)
 
#define GPIO_LCKR_LCK10   GPIO_LCKR_LCK10_Msk
 
#define GPIO_LCKR_LCK11_Pos   (11U)
 
#define GPIO_LCKR_LCK11_Msk   (0x1UL << GPIO_LCKR_LCK11_Pos)
 
#define GPIO_LCKR_LCK11   GPIO_LCKR_LCK11_Msk
 
#define GPIO_LCKR_LCK12_Pos   (12U)
 
#define GPIO_LCKR_LCK12_Msk   (0x1UL << GPIO_LCKR_LCK12_Pos)
 
#define GPIO_LCKR_LCK12   GPIO_LCKR_LCK12_Msk
 
#define GPIO_LCKR_LCK13_Pos   (13U)
 
#define GPIO_LCKR_LCK13_Msk   (0x1UL << GPIO_LCKR_LCK13_Pos)
 
#define GPIO_LCKR_LCK13   GPIO_LCKR_LCK13_Msk
 
#define GPIO_LCKR_LCK14_Pos   (14U)
 
#define GPIO_LCKR_LCK14_Msk   (0x1UL << GPIO_LCKR_LCK14_Pos)
 
#define GPIO_LCKR_LCK14   GPIO_LCKR_LCK14_Msk
 
#define GPIO_LCKR_LCK15_Pos   (15U)
 
#define GPIO_LCKR_LCK15_Msk   (0x1UL << GPIO_LCKR_LCK15_Pos)
 
#define GPIO_LCKR_LCK15   GPIO_LCKR_LCK15_Msk
 
#define GPIO_LCKR_LCKK_Pos   (16U)
 
#define GPIO_LCKR_LCKK_Msk   (0x1UL << GPIO_LCKR_LCKK_Pos)
 
#define GPIO_LCKR_LCKK   GPIO_LCKR_LCKK_Msk
 
#define GPIO_AFRL_AFRL0_Pos   (0U)
 
#define GPIO_AFRL_AFRL0_Msk   (0xFUL << GPIO_AFRL_AFRL0_Pos)
 
#define GPIO_AFRL_AFRL0   GPIO_AFRL_AFRL0_Msk
 
#define GPIO_AFRL_AFRL1_Pos   (4U)
 
#define GPIO_AFRL_AFRL1_Msk   (0xFUL << GPIO_AFRL_AFRL1_Pos)
 
#define GPIO_AFRL_AFRL1   GPIO_AFRL_AFRL1_Msk
 
#define GPIO_AFRL_AFRL2_Pos   (8U)
 
#define GPIO_AFRL_AFRL2_Msk   (0xFUL << GPIO_AFRL_AFRL2_Pos)
 
#define GPIO_AFRL_AFRL2   GPIO_AFRL_AFRL2_Msk
 
#define GPIO_AFRL_AFRL3_Pos   (12U)
 
#define GPIO_AFRL_AFRL3_Msk   (0xFUL << GPIO_AFRL_AFRL3_Pos)
 
#define GPIO_AFRL_AFRL3   GPIO_AFRL_AFRL3_Msk
 
#define GPIO_AFRL_AFRL4_Pos   (16U)
 
#define GPIO_AFRL_AFRL4_Msk   (0xFUL << GPIO_AFRL_AFRL4_Pos)
 
#define GPIO_AFRL_AFRL4   GPIO_AFRL_AFRL4_Msk
 
#define GPIO_AFRL_AFRL5_Pos   (20U)
 
#define GPIO_AFRL_AFRL5_Msk   (0xFUL << GPIO_AFRL_AFRL5_Pos)
 
#define GPIO_AFRL_AFRL5   GPIO_AFRL_AFRL5_Msk
 
#define GPIO_AFRL_AFRL6_Pos   (24U)
 
#define GPIO_AFRL_AFRL6_Msk   (0xFUL << GPIO_AFRL_AFRL6_Pos)
 
#define GPIO_AFRL_AFRL6   GPIO_AFRL_AFRL6_Msk
 
#define GPIO_AFRL_AFRL7_Pos   (28U)
 
#define GPIO_AFRL_AFRL7_Msk   (0xFUL << GPIO_AFRL_AFRL7_Pos)
 
#define GPIO_AFRL_AFRL7   GPIO_AFRL_AFRL7_Msk
 
#define GPIO_AFRH_AFRH0_Pos   (0U)
 
#define GPIO_AFRH_AFRH0_Msk   (0xFUL << GPIO_AFRH_AFRH0_Pos)
 
#define GPIO_AFRH_AFRH0   GPIO_AFRH_AFRH0_Msk
 
#define GPIO_AFRH_AFRH1_Pos   (4U)
 
#define GPIO_AFRH_AFRH1_Msk   (0xFUL << GPIO_AFRH_AFRH1_Pos)
 
#define GPIO_AFRH_AFRH1   GPIO_AFRH_AFRH1_Msk
 
#define GPIO_AFRH_AFRH2_Pos   (8U)
 
#define GPIO_AFRH_AFRH2_Msk   (0xFUL << GPIO_AFRH_AFRH2_Pos)
 
#define GPIO_AFRH_AFRH2   GPIO_AFRH_AFRH2_Msk
 
#define GPIO_AFRH_AFRH3_Pos   (12U)
 
#define GPIO_AFRH_AFRH3_Msk   (0xFUL << GPIO_AFRH_AFRH3_Pos)
 
#define GPIO_AFRH_AFRH3   GPIO_AFRH_AFRH3_Msk
 
#define GPIO_AFRH_AFRH4_Pos   (16U)
 
#define GPIO_AFRH_AFRH4_Msk   (0xFUL << GPIO_AFRH_AFRH4_Pos)
 
#define GPIO_AFRH_AFRH4   GPIO_AFRH_AFRH4_Msk
 
#define GPIO_AFRH_AFRH5_Pos   (20U)
 
#define GPIO_AFRH_AFRH5_Msk   (0xFUL << GPIO_AFRH_AFRH5_Pos)
 
#define GPIO_AFRH_AFRH5   GPIO_AFRH_AFRH5_Msk
 
#define GPIO_AFRH_AFRH6_Pos   (24U)
 
#define GPIO_AFRH_AFRH6_Msk   (0xFUL << GPIO_AFRH_AFRH6_Pos)
 
#define GPIO_AFRH_AFRH6   GPIO_AFRH_AFRH6_Msk
 
#define GPIO_AFRH_AFRH7_Pos   (28U)
 
#define GPIO_AFRH_AFRH7_Msk   (0xFUL << GPIO_AFRH_AFRH7_Pos)
 
#define GPIO_AFRH_AFRH7   GPIO_AFRH_AFRH7_Msk
 
#define GPIO_BRR_BR_0   (0x00000001U)
 
#define GPIO_BRR_BR_1   (0x00000002U)
 
#define GPIO_BRR_BR_2   (0x00000004U)
 
#define GPIO_BRR_BR_3   (0x00000008U)
 
#define GPIO_BRR_BR_4   (0x00000010U)
 
#define GPIO_BRR_BR_5   (0x00000020U)
 
#define GPIO_BRR_BR_6   (0x00000040U)
 
#define GPIO_BRR_BR_7   (0x00000080U)
 
#define GPIO_BRR_BR_8   (0x00000100U)
 
#define GPIO_BRR_BR_9   (0x00000200U)
 
#define GPIO_BRR_BR_10   (0x00000400U)
 
#define GPIO_BRR_BR_11   (0x00000800U)
 
#define GPIO_BRR_BR_12   (0x00001000U)
 
#define GPIO_BRR_BR_13   (0x00002000U)
 
#define GPIO_BRR_BR_14   (0x00004000U)
 
#define GPIO_BRR_BR_15   (0x00008000U)
 
#define I2C_CR1_PE_Pos   (0U)
 
#define I2C_CR1_PE_Msk   (0x1UL << I2C_CR1_PE_Pos)
 
#define I2C_CR1_PE   I2C_CR1_PE_Msk
 
#define I2C_CR1_TXIE_Pos   (1U)
 
#define I2C_CR1_TXIE_Msk   (0x1UL << I2C_CR1_TXIE_Pos)
 
#define I2C_CR1_TXIE   I2C_CR1_TXIE_Msk
 
#define I2C_CR1_RXIE_Pos   (2U)
 
#define I2C_CR1_RXIE_Msk   (0x1UL << I2C_CR1_RXIE_Pos)
 
#define I2C_CR1_RXIE   I2C_CR1_RXIE_Msk
 
#define I2C_CR1_ADDRIE_Pos   (3U)
 
#define I2C_CR1_ADDRIE_Msk   (0x1UL << I2C_CR1_ADDRIE_Pos)
 
#define I2C_CR1_ADDRIE   I2C_CR1_ADDRIE_Msk
 
#define I2C_CR1_NACKIE_Pos   (4U)
 
#define I2C_CR1_NACKIE_Msk   (0x1UL << I2C_CR1_NACKIE_Pos)
 
#define I2C_CR1_NACKIE   I2C_CR1_NACKIE_Msk
 
#define I2C_CR1_STOPIE_Pos   (5U)
 
#define I2C_CR1_STOPIE_Msk   (0x1UL << I2C_CR1_STOPIE_Pos)
 
#define I2C_CR1_STOPIE   I2C_CR1_STOPIE_Msk
 
#define I2C_CR1_TCIE_Pos   (6U)
 
#define I2C_CR1_TCIE_Msk   (0x1UL << I2C_CR1_TCIE_Pos)
 
#define I2C_CR1_TCIE   I2C_CR1_TCIE_Msk
 
#define I2C_CR1_ERRIE_Pos   (7U)
 
#define I2C_CR1_ERRIE_Msk   (0x1UL << I2C_CR1_ERRIE_Pos)
 
#define I2C_CR1_ERRIE   I2C_CR1_ERRIE_Msk
 
#define I2C_CR1_DNF_Pos   (8U)
 
#define I2C_CR1_DNF_Msk   (0xFUL << I2C_CR1_DNF_Pos)
 
#define I2C_CR1_DNF   I2C_CR1_DNF_Msk
 
#define I2C_CR1_ANFOFF_Pos   (12U)
 
#define I2C_CR1_ANFOFF_Msk   (0x1UL << I2C_CR1_ANFOFF_Pos)
 
#define I2C_CR1_ANFOFF   I2C_CR1_ANFOFF_Msk
 
#define I2C_CR1_SWRST_Pos   (13U)
 
#define I2C_CR1_SWRST_Msk   (0x1UL << I2C_CR1_SWRST_Pos)
 
#define I2C_CR1_SWRST   I2C_CR1_SWRST_Msk
 
#define I2C_CR1_TXDMAEN_Pos   (14U)
 
#define I2C_CR1_TXDMAEN_Msk   (0x1UL << I2C_CR1_TXDMAEN_Pos)
 
#define I2C_CR1_TXDMAEN   I2C_CR1_TXDMAEN_Msk
 
#define I2C_CR1_RXDMAEN_Pos   (15U)
 
#define I2C_CR1_RXDMAEN_Msk   (0x1UL << I2C_CR1_RXDMAEN_Pos)
 
#define I2C_CR1_RXDMAEN   I2C_CR1_RXDMAEN_Msk
 
#define I2C_CR1_SBC_Pos   (16U)
 
#define I2C_CR1_SBC_Msk   (0x1UL << I2C_CR1_SBC_Pos)
 
#define I2C_CR1_SBC   I2C_CR1_SBC_Msk
 
#define I2C_CR1_NOSTRETCH_Pos   (17U)
 
#define I2C_CR1_NOSTRETCH_Msk   (0x1UL << I2C_CR1_NOSTRETCH_Pos)
 
#define I2C_CR1_NOSTRETCH   I2C_CR1_NOSTRETCH_Msk
 
#define I2C_CR1_WUPEN_Pos   (18U)
 
#define I2C_CR1_WUPEN_Msk   (0x1UL << I2C_CR1_WUPEN_Pos)
 
#define I2C_CR1_WUPEN   I2C_CR1_WUPEN_Msk
 
#define I2C_CR1_GCEN_Pos   (19U)
 
#define I2C_CR1_GCEN_Msk   (0x1UL << I2C_CR1_GCEN_Pos)
 
#define I2C_CR1_GCEN   I2C_CR1_GCEN_Msk
 
#define I2C_CR1_SMBHEN_Pos   (20U)
 
#define I2C_CR1_SMBHEN_Msk   (0x1UL << I2C_CR1_SMBHEN_Pos)
 
#define I2C_CR1_SMBHEN   I2C_CR1_SMBHEN_Msk
 
#define I2C_CR1_SMBDEN_Pos   (21U)
 
#define I2C_CR1_SMBDEN_Msk   (0x1UL << I2C_CR1_SMBDEN_Pos)
 
#define I2C_CR1_SMBDEN   I2C_CR1_SMBDEN_Msk
 
#define I2C_CR1_ALERTEN_Pos   (22U)
 
#define I2C_CR1_ALERTEN_Msk   (0x1UL << I2C_CR1_ALERTEN_Pos)
 
#define I2C_CR1_ALERTEN   I2C_CR1_ALERTEN_Msk
 
#define I2C_CR1_PECEN_Pos   (23U)
 
#define I2C_CR1_PECEN_Msk   (0x1UL << I2C_CR1_PECEN_Pos)
 
#define I2C_CR1_PECEN   I2C_CR1_PECEN_Msk
 
#define I2C_CR1_DFN   I2C_CR1_DNF
 
#define I2C_CR2_SADD_Pos   (0U)
 
#define I2C_CR2_SADD_Msk   (0x3FFUL << I2C_CR2_SADD_Pos)
 
#define I2C_CR2_SADD   I2C_CR2_SADD_Msk
 
#define I2C_CR2_RD_WRN_Pos   (10U)
 
#define I2C_CR2_RD_WRN_Msk   (0x1UL << I2C_CR2_RD_WRN_Pos)
 
#define I2C_CR2_RD_WRN   I2C_CR2_RD_WRN_Msk
 
#define I2C_CR2_ADD10_Pos   (11U)
 
#define I2C_CR2_ADD10_Msk   (0x1UL << I2C_CR2_ADD10_Pos)
 
#define I2C_CR2_ADD10   I2C_CR2_ADD10_Msk
 
#define I2C_CR2_HEAD10R_Pos   (12U)
 
#define I2C_CR2_HEAD10R_Msk   (0x1UL << I2C_CR2_HEAD10R_Pos)
 
#define I2C_CR2_HEAD10R   I2C_CR2_HEAD10R_Msk
 
#define I2C_CR2_START_Pos   (13U)
 
#define I2C_CR2_START_Msk   (0x1UL << I2C_CR2_START_Pos)
 
#define I2C_CR2_START   I2C_CR2_START_Msk
 
#define I2C_CR2_STOP_Pos   (14U)
 
#define I2C_CR2_STOP_Msk   (0x1UL << I2C_CR2_STOP_Pos)
 
#define I2C_CR2_STOP   I2C_CR2_STOP_Msk
 
#define I2C_CR2_NACK_Pos   (15U)
 
#define I2C_CR2_NACK_Msk   (0x1UL << I2C_CR2_NACK_Pos)
 
#define I2C_CR2_NACK   I2C_CR2_NACK_Msk
 
#define I2C_CR2_NBYTES_Pos   (16U)
 
#define I2C_CR2_NBYTES_Msk   (0xFFUL << I2C_CR2_NBYTES_Pos)
 
#define I2C_CR2_NBYTES   I2C_CR2_NBYTES_Msk
 
#define I2C_CR2_RELOAD_Pos   (24U)
 
#define I2C_CR2_RELOAD_Msk   (0x1UL << I2C_CR2_RELOAD_Pos)
 
#define I2C_CR2_RELOAD   I2C_CR2_RELOAD_Msk
 
#define I2C_CR2_AUTOEND_Pos   (25U)
 
#define I2C_CR2_AUTOEND_Msk   (0x1UL << I2C_CR2_AUTOEND_Pos)
 
#define I2C_CR2_AUTOEND   I2C_CR2_AUTOEND_Msk
 
#define I2C_CR2_PECBYTE_Pos   (26U)
 
#define I2C_CR2_PECBYTE_Msk   (0x1UL << I2C_CR2_PECBYTE_Pos)
 
#define I2C_CR2_PECBYTE   I2C_CR2_PECBYTE_Msk
 
#define I2C_OAR1_OA1_Pos   (0U)
 
#define I2C_OAR1_OA1_Msk   (0x3FFUL << I2C_OAR1_OA1_Pos)
 
#define I2C_OAR1_OA1   I2C_OAR1_OA1_Msk
 
#define I2C_OAR1_OA1MODE_Pos   (10U)
 
#define I2C_OAR1_OA1MODE_Msk   (0x1UL << I2C_OAR1_OA1MODE_Pos)
 
#define I2C_OAR1_OA1MODE   I2C_OAR1_OA1MODE_Msk
 
#define I2C_OAR1_OA1EN_Pos   (15U)
 
#define I2C_OAR1_OA1EN_Msk   (0x1UL << I2C_OAR1_OA1EN_Pos)
 
#define I2C_OAR1_OA1EN   I2C_OAR1_OA1EN_Msk
 
#define I2C_OAR2_OA2_Pos   (1U)
 
#define I2C_OAR2_OA2_Msk   (0x7FUL << I2C_OAR2_OA2_Pos)
 
#define I2C_OAR2_OA2   I2C_OAR2_OA2_Msk
 
#define I2C_OAR2_OA2MSK_Pos   (8U)
 
#define I2C_OAR2_OA2MSK_Msk   (0x7UL << I2C_OAR2_OA2MSK_Pos)
 
#define I2C_OAR2_OA2MSK   I2C_OAR2_OA2MSK_Msk
 
#define I2C_OAR2_OA2NOMASK   (0x00000000U)
 
#define I2C_OAR2_OA2MASK01_Pos   (8U)
 
#define I2C_OAR2_OA2MASK01_Msk   (0x1UL << I2C_OAR2_OA2MASK01_Pos)
 
#define I2C_OAR2_OA2MASK01   I2C_OAR2_OA2MASK01_Msk
 
#define I2C_OAR2_OA2MASK02_Pos   (9U)
 
#define I2C_OAR2_OA2MASK02_Msk   (0x1UL << I2C_OAR2_OA2MASK02_Pos)
 
#define I2C_OAR2_OA2MASK02   I2C_OAR2_OA2MASK02_Msk
 
#define I2C_OAR2_OA2MASK03_Pos   (8U)
 
#define I2C_OAR2_OA2MASK03_Msk   (0x3UL << I2C_OAR2_OA2MASK03_Pos)
 
#define I2C_OAR2_OA2MASK03   I2C_OAR2_OA2MASK03_Msk
 
#define I2C_OAR2_OA2MASK04_Pos   (10U)
 
#define I2C_OAR2_OA2MASK04_Msk   (0x1UL << I2C_OAR2_OA2MASK04_Pos)
 
#define I2C_OAR2_OA2MASK04   I2C_OAR2_OA2MASK04_Msk
 
#define I2C_OAR2_OA2MASK05_Pos   (8U)
 
#define I2C_OAR2_OA2MASK05_Msk   (0x5UL << I2C_OAR2_OA2MASK05_Pos)
 
#define I2C_OAR2_OA2MASK05   I2C_OAR2_OA2MASK05_Msk
 
#define I2C_OAR2_OA2MASK06_Pos   (9U)
 
#define I2C_OAR2_OA2MASK06_Msk   (0x3UL << I2C_OAR2_OA2MASK06_Pos)
 
#define I2C_OAR2_OA2MASK06   I2C_OAR2_OA2MASK06_Msk
 
#define I2C_OAR2_OA2MASK07_Pos   (8U)
 
#define I2C_OAR2_OA2MASK07_Msk   (0x7UL << I2C_OAR2_OA2MASK07_Pos)
 
#define I2C_OAR2_OA2MASK07   I2C_OAR2_OA2MASK07_Msk
 
#define I2C_OAR2_OA2EN_Pos   (15U)
 
#define I2C_OAR2_OA2EN_Msk   (0x1UL << I2C_OAR2_OA2EN_Pos)
 
#define I2C_OAR2_OA2EN   I2C_OAR2_OA2EN_Msk
 
#define I2C_TIMINGR_SCLL_Pos   (0U)
 
#define I2C_TIMINGR_SCLL_Msk   (0xFFUL << I2C_TIMINGR_SCLL_Pos)
 
#define I2C_TIMINGR_SCLL   I2C_TIMINGR_SCLL_Msk
 
#define I2C_TIMINGR_SCLH_Pos   (8U)
 
#define I2C_TIMINGR_SCLH_Msk   (0xFFUL << I2C_TIMINGR_SCLH_Pos)
 
#define I2C_TIMINGR_SCLH   I2C_TIMINGR_SCLH_Msk
 
#define I2C_TIMINGR_SDADEL_Pos   (16U)
 
#define I2C_TIMINGR_SDADEL_Msk   (0xFUL << I2C_TIMINGR_SDADEL_Pos)
 
#define I2C_TIMINGR_SDADEL   I2C_TIMINGR_SDADEL_Msk
 
#define I2C_TIMINGR_SCLDEL_Pos   (20U)
 
#define I2C_TIMINGR_SCLDEL_Msk   (0xFUL << I2C_TIMINGR_SCLDEL_Pos)
 
#define I2C_TIMINGR_SCLDEL   I2C_TIMINGR_SCLDEL_Msk
 
#define I2C_TIMINGR_PRESC_Pos   (28U)
 
#define I2C_TIMINGR_PRESC_Msk   (0xFUL << I2C_TIMINGR_PRESC_Pos)
 
#define I2C_TIMINGR_PRESC   I2C_TIMINGR_PRESC_Msk
 
#define I2C_TIMEOUTR_TIMEOUTA_Pos   (0U)
 
#define I2C_TIMEOUTR_TIMEOUTA_Msk   (0xFFFUL << I2C_TIMEOUTR_TIMEOUTA_Pos)
 
#define I2C_TIMEOUTR_TIMEOUTA   I2C_TIMEOUTR_TIMEOUTA_Msk
 
#define I2C_TIMEOUTR_TIDLE_Pos   (12U)
 
#define I2C_TIMEOUTR_TIDLE_Msk   (0x1UL << I2C_TIMEOUTR_TIDLE_Pos)
 
#define I2C_TIMEOUTR_TIDLE   I2C_TIMEOUTR_TIDLE_Msk
 
#define I2C_TIMEOUTR_TIMOUTEN_Pos   (15U)
 
#define I2C_TIMEOUTR_TIMOUTEN_Msk   (0x1UL << I2C_TIMEOUTR_TIMOUTEN_Pos)
 
#define I2C_TIMEOUTR_TIMOUTEN   I2C_TIMEOUTR_TIMOUTEN_Msk
 
#define I2C_TIMEOUTR_TIMEOUTB_Pos   (16U)
 
#define I2C_TIMEOUTR_TIMEOUTB_Msk   (0xFFFUL << I2C_TIMEOUTR_TIMEOUTB_Pos)
 
#define I2C_TIMEOUTR_TIMEOUTB   I2C_TIMEOUTR_TIMEOUTB_Msk
 
#define I2C_TIMEOUTR_TEXTEN_Pos   (31U)
 
#define I2C_TIMEOUTR_TEXTEN_Msk   (0x1UL << I2C_TIMEOUTR_TEXTEN_Pos)
 
#define I2C_TIMEOUTR_TEXTEN   I2C_TIMEOUTR_TEXTEN_Msk
 
#define I2C_ISR_TXE_Pos   (0U)
 
#define I2C_ISR_TXE_Msk   (0x1UL << I2C_ISR_TXE_Pos)
 
#define I2C_ISR_TXE   I2C_ISR_TXE_Msk
 
#define I2C_ISR_TXIS_Pos   (1U)
 
#define I2C_ISR_TXIS_Msk   (0x1UL << I2C_ISR_TXIS_Pos)
 
#define I2C_ISR_TXIS   I2C_ISR_TXIS_Msk
 
#define I2C_ISR_RXNE_Pos   (2U)
 
#define I2C_ISR_RXNE_Msk   (0x1UL << I2C_ISR_RXNE_Pos)
 
#define I2C_ISR_RXNE   I2C_ISR_RXNE_Msk
 
#define I2C_ISR_ADDR_Pos   (3U)
 
#define I2C_ISR_ADDR_Msk   (0x1UL << I2C_ISR_ADDR_Pos)
 
#define I2C_ISR_ADDR   I2C_ISR_ADDR_Msk
 
#define I2C_ISR_NACKF_Pos   (4U)
 
#define I2C_ISR_NACKF_Msk   (0x1UL << I2C_ISR_NACKF_Pos)
 
#define I2C_ISR_NACKF   I2C_ISR_NACKF_Msk
 
#define I2C_ISR_STOPF_Pos   (5U)
 
#define I2C_ISR_STOPF_Msk   (0x1UL << I2C_ISR_STOPF_Pos)
 
#define I2C_ISR_STOPF   I2C_ISR_STOPF_Msk
 
#define I2C_ISR_TC_Pos   (6U)
 
#define I2C_ISR_TC_Msk   (0x1UL << I2C_ISR_TC_Pos)
 
#define I2C_ISR_TC   I2C_ISR_TC_Msk
 
#define I2C_ISR_TCR_Pos   (7U)
 
#define I2C_ISR_TCR_Msk   (0x1UL << I2C_ISR_TCR_Pos)
 
#define I2C_ISR_TCR   I2C_ISR_TCR_Msk
 
#define I2C_ISR_BERR_Pos   (8U)
 
#define I2C_ISR_BERR_Msk   (0x1UL << I2C_ISR_BERR_Pos)
 
#define I2C_ISR_BERR   I2C_ISR_BERR_Msk
 
#define I2C_ISR_ARLO_Pos   (9U)
 
#define I2C_ISR_ARLO_Msk   (0x1UL << I2C_ISR_ARLO_Pos)
 
#define I2C_ISR_ARLO   I2C_ISR_ARLO_Msk
 
#define I2C_ISR_OVR_Pos   (10U)
 
#define I2C_ISR_OVR_Msk   (0x1UL << I2C_ISR_OVR_Pos)
 
#define I2C_ISR_OVR   I2C_ISR_OVR_Msk
 
#define I2C_ISR_PECERR_Pos   (11U)
 
#define I2C_ISR_PECERR_Msk   (0x1UL << I2C_ISR_PECERR_Pos)
 
#define I2C_ISR_PECERR   I2C_ISR_PECERR_Msk
 
#define I2C_ISR_TIMEOUT_Pos   (12U)
 
#define I2C_ISR_TIMEOUT_Msk   (0x1UL << I2C_ISR_TIMEOUT_Pos)
 
#define I2C_ISR_TIMEOUT   I2C_ISR_TIMEOUT_Msk
 
#define I2C_ISR_ALERT_Pos   (13U)
 
#define I2C_ISR_ALERT_Msk   (0x1UL << I2C_ISR_ALERT_Pos)
 
#define I2C_ISR_ALERT   I2C_ISR_ALERT_Msk
 
#define I2C_ISR_BUSY_Pos   (15U)
 
#define I2C_ISR_BUSY_Msk   (0x1UL << I2C_ISR_BUSY_Pos)
 
#define I2C_ISR_BUSY   I2C_ISR_BUSY_Msk
 
#define I2C_ISR_DIR_Pos   (16U)
 
#define I2C_ISR_DIR_Msk   (0x1UL << I2C_ISR_DIR_Pos)
 
#define I2C_ISR_DIR   I2C_ISR_DIR_Msk
 
#define I2C_ISR_ADDCODE_Pos   (17U)
 
#define I2C_ISR_ADDCODE_Msk   (0x7FUL << I2C_ISR_ADDCODE_Pos)
 
#define I2C_ISR_ADDCODE   I2C_ISR_ADDCODE_Msk
 
#define I2C_ICR_ADDRCF_Pos   (3U)
 
#define I2C_ICR_ADDRCF_Msk   (0x1UL << I2C_ICR_ADDRCF_Pos)
 
#define I2C_ICR_ADDRCF   I2C_ICR_ADDRCF_Msk
 
#define I2C_ICR_NACKCF_Pos   (4U)
 
#define I2C_ICR_NACKCF_Msk   (0x1UL << I2C_ICR_NACKCF_Pos)
 
#define I2C_ICR_NACKCF   I2C_ICR_NACKCF_Msk
 
#define I2C_ICR_STOPCF_Pos   (5U)
 
#define I2C_ICR_STOPCF_Msk   (0x1UL << I2C_ICR_STOPCF_Pos)
 
#define I2C_ICR_STOPCF   I2C_ICR_STOPCF_Msk
 
#define I2C_ICR_BERRCF_Pos   (8U)
 
#define I2C_ICR_BERRCF_Msk   (0x1UL << I2C_ICR_BERRCF_Pos)
 
#define I2C_ICR_BERRCF   I2C_ICR_BERRCF_Msk
 
#define I2C_ICR_ARLOCF_Pos   (9U)
 
#define I2C_ICR_ARLOCF_Msk   (0x1UL << I2C_ICR_ARLOCF_Pos)
 
#define I2C_ICR_ARLOCF   I2C_ICR_ARLOCF_Msk
 
#define I2C_ICR_OVRCF_Pos   (10U)
 
#define I2C_ICR_OVRCF_Msk   (0x1UL << I2C_ICR_OVRCF_Pos)
 
#define I2C_ICR_OVRCF   I2C_ICR_OVRCF_Msk
 
#define I2C_ICR_PECCF_Pos   (11U)
 
#define I2C_ICR_PECCF_Msk   (0x1UL << I2C_ICR_PECCF_Pos)
 
#define I2C_ICR_PECCF   I2C_ICR_PECCF_Msk
 
#define I2C_ICR_TIMOUTCF_Pos   (12U)
 
#define I2C_ICR_TIMOUTCF_Msk   (0x1UL << I2C_ICR_TIMOUTCF_Pos)
 
#define I2C_ICR_TIMOUTCF   I2C_ICR_TIMOUTCF_Msk
 
#define I2C_ICR_ALERTCF_Pos   (13U)
 
#define I2C_ICR_ALERTCF_Msk   (0x1UL << I2C_ICR_ALERTCF_Pos)
 
#define I2C_ICR_ALERTCF   I2C_ICR_ALERTCF_Msk
 
#define I2C_PECR_PEC_Pos   (0U)
 
#define I2C_PECR_PEC_Msk   (0xFFUL << I2C_PECR_PEC_Pos)
 
#define I2C_PECR_PEC   I2C_PECR_PEC_Msk
 
#define I2C_RXDR_RXDATA_Pos   (0U)
 
#define I2C_RXDR_RXDATA_Msk   (0xFFUL << I2C_RXDR_RXDATA_Pos)
 
#define I2C_RXDR_RXDATA   I2C_RXDR_RXDATA_Msk
 
#define I2C_TXDR_TXDATA_Pos   (0U)
 
#define I2C_TXDR_TXDATA_Msk   (0xFFUL << I2C_TXDR_TXDATA_Pos)
 
#define I2C_TXDR_TXDATA   I2C_TXDR_TXDATA_Msk
 
#define IWDG_KR_KEY_Pos   (0U)
 
#define IWDG_KR_KEY_Msk   (0xFFFFUL << IWDG_KR_KEY_Pos)
 
#define IWDG_KR_KEY   IWDG_KR_KEY_Msk
 
#define IWDG_PR_PR_Pos   (0U)
 
#define IWDG_PR_PR_Msk   (0x7UL << IWDG_PR_PR_Pos)
 
#define IWDG_PR_PR   IWDG_PR_PR_Msk
 
#define IWDG_PR_PR_0   (0x1UL << IWDG_PR_PR_Pos)
 
#define IWDG_PR_PR_1   (0x2UL << IWDG_PR_PR_Pos)
 
#define IWDG_PR_PR_2   (0x4UL << IWDG_PR_PR_Pos)
 
#define IWDG_RLR_RL_Pos   (0U)
 
#define IWDG_RLR_RL_Msk   (0xFFFUL << IWDG_RLR_RL_Pos)
 
#define IWDG_RLR_RL   IWDG_RLR_RL_Msk
 
#define IWDG_SR_PVU_Pos   (0U)
 
#define IWDG_SR_PVU_Msk   (0x1UL << IWDG_SR_PVU_Pos)
 
#define IWDG_SR_PVU   IWDG_SR_PVU_Msk
 
#define IWDG_SR_RVU_Pos   (1U)
 
#define IWDG_SR_RVU_Msk   (0x1UL << IWDG_SR_RVU_Pos)
 
#define IWDG_SR_RVU   IWDG_SR_RVU_Msk
 
#define IWDG_SR_WVU_Pos   (2U)
 
#define IWDG_SR_WVU_Msk   (0x1UL << IWDG_SR_WVU_Pos)
 
#define IWDG_SR_WVU   IWDG_SR_WVU_Msk
 
#define IWDG_WINR_WIN_Pos   (0U)
 
#define IWDG_WINR_WIN_Msk   (0xFFFUL << IWDG_WINR_WIN_Pos)
 
#define IWDG_WINR_WIN   IWDG_WINR_WIN_Msk
 
#define PWR_PVD_SUPPORT
 
#define PWR_CR_LPDS_Pos   (0U)
 
#define PWR_CR_LPDS_Msk   (0x1UL << PWR_CR_LPDS_Pos)
 
#define PWR_CR_LPDS   PWR_CR_LPDS_Msk
 
#define PWR_CR_PDDS_Pos   (1U)
 
#define PWR_CR_PDDS_Msk   (0x1UL << PWR_CR_PDDS_Pos)
 
#define PWR_CR_PDDS   PWR_CR_PDDS_Msk
 
#define PWR_CR_CWUF_Pos   (2U)
 
#define PWR_CR_CWUF_Msk   (0x1UL << PWR_CR_CWUF_Pos)
 
#define PWR_CR_CWUF   PWR_CR_CWUF_Msk
 
#define PWR_CR_CSBF_Pos   (3U)
 
#define PWR_CR_CSBF_Msk   (0x1UL << PWR_CR_CSBF_Pos)
 
#define PWR_CR_CSBF   PWR_CR_CSBF_Msk
 
#define PWR_CR_PVDE_Pos   (4U)
 
#define PWR_CR_PVDE_Msk   (0x1UL << PWR_CR_PVDE_Pos)
 
#define PWR_CR_PVDE   PWR_CR_PVDE_Msk
 
#define PWR_CR_PLS_Pos   (5U)
 
#define PWR_CR_PLS_Msk   (0x7UL << PWR_CR_PLS_Pos)
 
#define PWR_CR_PLS   PWR_CR_PLS_Msk
 
#define PWR_CR_PLS_0   (0x1UL << PWR_CR_PLS_Pos)
 
#define PWR_CR_PLS_1   (0x2UL << PWR_CR_PLS_Pos)
 
#define PWR_CR_PLS_2   (0x4UL << PWR_CR_PLS_Pos)
 
#define PWR_CR_PLS_LEV0   (0x00000000U)
 
#define PWR_CR_PLS_LEV1   (0x00000020U)
 
#define PWR_CR_PLS_LEV2   (0x00000040U)
 
#define PWR_CR_PLS_LEV3   (0x00000060U)
 
#define PWR_CR_PLS_LEV4   (0x00000080U)
 
#define PWR_CR_PLS_LEV5   (0x000000A0U)
 
#define PWR_CR_PLS_LEV6   (0x000000C0U)
 
#define PWR_CR_PLS_LEV7   (0x000000E0U)
 
#define PWR_CR_DBP_Pos   (8U)
 
#define PWR_CR_DBP_Msk   (0x1UL << PWR_CR_DBP_Pos)
 
#define PWR_CR_DBP   PWR_CR_DBP_Msk
 
#define PWR_CSR_WUF_Pos   (0U)
 
#define PWR_CSR_WUF_Msk   (0x1UL << PWR_CSR_WUF_Pos)
 
#define PWR_CSR_WUF   PWR_CSR_WUF_Msk
 
#define PWR_CSR_SBF_Pos   (1U)
 
#define PWR_CSR_SBF_Msk   (0x1UL << PWR_CSR_SBF_Pos)
 
#define PWR_CSR_SBF   PWR_CSR_SBF_Msk
 
#define PWR_CSR_PVDO_Pos   (2U)
 
#define PWR_CSR_PVDO_Msk   (0x1UL << PWR_CSR_PVDO_Pos)
 
#define PWR_CSR_PVDO   PWR_CSR_PVDO_Msk
 
#define PWR_CSR_VREFINTRDYF_Pos   (3U)
 
#define PWR_CSR_VREFINTRDYF_Msk   (0x1UL << PWR_CSR_VREFINTRDYF_Pos)
 
#define PWR_CSR_VREFINTRDYF   PWR_CSR_VREFINTRDYF_Msk
 
#define PWR_CSR_EWUP1_Pos   (8U)
 
#define PWR_CSR_EWUP1_Msk   (0x1UL << PWR_CSR_EWUP1_Pos)
 
#define PWR_CSR_EWUP1   PWR_CSR_EWUP1_Msk
 
#define PWR_CSR_EWUP2_Pos   (9U)
 
#define PWR_CSR_EWUP2_Msk   (0x1UL << PWR_CSR_EWUP2_Pos)
 
#define PWR_CSR_EWUP2   PWR_CSR_EWUP2_Msk
 
#define PWR_CSR_EWUP3_Pos   (10U)
 
#define PWR_CSR_EWUP3_Msk   (0x1UL << PWR_CSR_EWUP3_Pos)
 
#define PWR_CSR_EWUP3   PWR_CSR_EWUP3_Msk
 
#define RCC_PLLSRC_PREDIV1_SUPPORT
 
#define RCC_CR_HSION_Pos   (0U)
 
#define RCC_CR_HSION_Msk   (0x1UL << RCC_CR_HSION_Pos)
 
#define RCC_CR_HSION   RCC_CR_HSION_Msk
 
#define RCC_CR_HSIRDY_Pos   (1U)
 
#define RCC_CR_HSIRDY_Msk   (0x1UL << RCC_CR_HSIRDY_Pos)
 
#define RCC_CR_HSIRDY   RCC_CR_HSIRDY_Msk
 
#define RCC_CR_HSITRIM_Pos   (3U)
 
#define RCC_CR_HSITRIM_Msk   (0x1FUL << RCC_CR_HSITRIM_Pos)
 
#define RCC_CR_HSITRIM   RCC_CR_HSITRIM_Msk
 
#define RCC_CR_HSITRIM_0   (0x01UL << RCC_CR_HSITRIM_Pos)
 
#define RCC_CR_HSITRIM_1   (0x02UL << RCC_CR_HSITRIM_Pos)
 
#define RCC_CR_HSITRIM_2   (0x04UL << RCC_CR_HSITRIM_Pos)
 
#define RCC_CR_HSITRIM_3   (0x08UL << RCC_CR_HSITRIM_Pos)
 
#define RCC_CR_HSITRIM_4   (0x10UL << RCC_CR_HSITRIM_Pos)
 
#define RCC_CR_HSICAL_Pos   (8U)
 
#define RCC_CR_HSICAL_Msk   (0xFFUL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSICAL   RCC_CR_HSICAL_Msk
 
#define RCC_CR_HSICAL_0   (0x01UL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSICAL_1   (0x02UL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSICAL_2   (0x04UL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSICAL_3   (0x08UL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSICAL_4   (0x10UL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSICAL_5   (0x20UL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSICAL_6   (0x40UL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSICAL_7   (0x80UL << RCC_CR_HSICAL_Pos)
 
#define RCC_CR_HSEON_Pos   (16U)
 
#define RCC_CR_HSEON_Msk   (0x1UL << RCC_CR_HSEON_Pos)
 
#define RCC_CR_HSEON   RCC_CR_HSEON_Msk
 
#define RCC_CR_HSERDY_Pos   (17U)
 
#define RCC_CR_HSERDY_Msk   (0x1UL << RCC_CR_HSERDY_Pos)
 
#define RCC_CR_HSERDY   RCC_CR_HSERDY_Msk
 
#define RCC_CR_HSEBYP_Pos   (18U)
 
#define RCC_CR_HSEBYP_Msk   (0x1UL << RCC_CR_HSEBYP_Pos)
 
#define RCC_CR_HSEBYP   RCC_CR_HSEBYP_Msk
 
#define RCC_CR_CSSON_Pos   (19U)
 
#define RCC_CR_CSSON_Msk   (0x1UL << RCC_CR_CSSON_Pos)
 
#define RCC_CR_CSSON   RCC_CR_CSSON_Msk
 
#define RCC_CR_PLLON_Pos   (24U)
 
#define RCC_CR_PLLON_Msk   (0x1UL << RCC_CR_PLLON_Pos)
 
#define RCC_CR_PLLON   RCC_CR_PLLON_Msk
 
#define RCC_CR_PLLRDY_Pos   (25U)
 
#define RCC_CR_PLLRDY_Msk   (0x1UL << RCC_CR_PLLRDY_Pos)
 
#define RCC_CR_PLLRDY   RCC_CR_PLLRDY_Msk
 
#define RCC_CFGR_SW_Pos   (0U)
 
#define RCC_CFGR_SW_Msk   (0x3UL << RCC_CFGR_SW_Pos)
 
#define RCC_CFGR_SW   RCC_CFGR_SW_Msk
 
#define RCC_CFGR_SW_0   (0x1UL << RCC_CFGR_SW_Pos)
 
#define RCC_CFGR_SW_1   (0x2UL << RCC_CFGR_SW_Pos)
 
#define RCC_CFGR_SW_HSI   (0x00000000U)
 
#define RCC_CFGR_SW_HSE   (0x00000001U)
 
#define RCC_CFGR_SW_PLL   (0x00000002U)
 
#define RCC_CFGR_SWS_Pos   (2U)
 
#define RCC_CFGR_SWS_Msk   (0x3UL << RCC_CFGR_SWS_Pos)
 
#define RCC_CFGR_SWS   RCC_CFGR_SWS_Msk
 
#define RCC_CFGR_SWS_0   (0x1UL << RCC_CFGR_SWS_Pos)
 
#define RCC_CFGR_SWS_1   (0x2UL << RCC_CFGR_SWS_Pos)
 
#define RCC_CFGR_SWS_HSI   (0x00000000U)
 
#define RCC_CFGR_SWS_HSE   (0x00000004U)
 
#define RCC_CFGR_SWS_PLL   (0x00000008U)
 
#define RCC_CFGR_HPRE_Pos   (4U)
 
#define RCC_CFGR_HPRE_Msk   (0xFUL << RCC_CFGR_HPRE_Pos)
 
#define RCC_CFGR_HPRE   RCC_CFGR_HPRE_Msk
 
#define RCC_CFGR_HPRE_0   (0x1UL << RCC_CFGR_HPRE_Pos)
 
#define RCC_CFGR_HPRE_1   (0x2UL << RCC_CFGR_HPRE_Pos)
 
#define RCC_CFGR_HPRE_2   (0x4UL << RCC_CFGR_HPRE_Pos)
 
#define RCC_CFGR_HPRE_3   (0x8UL << RCC_CFGR_HPRE_Pos)
 
#define RCC_CFGR_HPRE_DIV1   (0x00000000U)
 
#define RCC_CFGR_HPRE_DIV2   (0x00000080U)
 
#define RCC_CFGR_HPRE_DIV4   (0x00000090U)
 
#define RCC_CFGR_HPRE_DIV8   (0x000000A0U)
 
#define RCC_CFGR_HPRE_DIV16   (0x000000B0U)
 
#define RCC_CFGR_HPRE_DIV64   (0x000000C0U)
 
#define RCC_CFGR_HPRE_DIV128   (0x000000D0U)
 
#define RCC_CFGR_HPRE_DIV256   (0x000000E0U)
 
#define RCC_CFGR_HPRE_DIV512   (0x000000F0U)
 
#define RCC_CFGR_PPRE1_Pos   (8U)
 
#define RCC_CFGR_PPRE1_Msk   (0x7UL << RCC_CFGR_PPRE1_Pos)
 
#define RCC_CFGR_PPRE1   RCC_CFGR_PPRE1_Msk
 
#define RCC_CFGR_PPRE1_0   (0x1UL << RCC_CFGR_PPRE1_Pos)
 
#define RCC_CFGR_PPRE1_1   (0x2UL << RCC_CFGR_PPRE1_Pos)
 
#define RCC_CFGR_PPRE1_2   (0x4UL << RCC_CFGR_PPRE1_Pos)
 
#define RCC_CFGR_PPRE1_DIV1   (0x00000000U)
 
#define RCC_CFGR_PPRE1_DIV2   (0x00000400U)
 
#define RCC_CFGR_PPRE1_DIV4   (0x00000500U)
 
#define RCC_CFGR_PPRE1_DIV8   (0x00000600U)
 
#define RCC_CFGR_PPRE1_DIV16   (0x00000700U)
 
#define RCC_CFGR_PPRE2_Pos   (11U)
 
#define RCC_CFGR_PPRE2_Msk   (0x7UL << RCC_CFGR_PPRE2_Pos)
 
#define RCC_CFGR_PPRE2   RCC_CFGR_PPRE2_Msk
 
#define RCC_CFGR_PPRE2_0   (0x1UL << RCC_CFGR_PPRE2_Pos)
 
#define RCC_CFGR_PPRE2_1   (0x2UL << RCC_CFGR_PPRE2_Pos)
 
#define RCC_CFGR_PPRE2_2   (0x4UL << RCC_CFGR_PPRE2_Pos)
 
#define RCC_CFGR_PPRE2_DIV1   (0x00000000U)
 
#define RCC_CFGR_PPRE2_DIV2   (0x00002000U)
 
#define RCC_CFGR_PPRE2_DIV4   (0x00002800U)
 
#define RCC_CFGR_PPRE2_DIV8   (0x00003000U)
 
#define RCC_CFGR_PPRE2_DIV16   (0x00003800U)
 
#define RCC_CFGR_PLLSRC_Pos   (15U)
 
#define RCC_CFGR_PLLSRC_Msk   (0x3UL << RCC_CFGR_PLLSRC_Pos)
 
#define RCC_CFGR_PLLSRC   RCC_CFGR_PLLSRC_Msk
 
#define RCC_CFGR_PLLSRC_HSI_PREDIV   (0x00008000U)
 
#define RCC_CFGR_PLLSRC_HSE_PREDIV   (0x00010000U)
 
#define RCC_CFGR_PLLXTPRE_Pos   (17U)
 
#define RCC_CFGR_PLLXTPRE_Msk   (0x1UL << RCC_CFGR_PLLXTPRE_Pos)
 
#define RCC_CFGR_PLLXTPRE   RCC_CFGR_PLLXTPRE_Msk
 
#define RCC_CFGR_PLLXTPRE_HSE_PREDIV_DIV1   (0x00000000U)
 
#define RCC_CFGR_PLLXTPRE_HSE_PREDIV_DIV2   (0x00020000U)
 
#define RCC_CFGR_PLLMUL_Pos   (18U)
 
#define RCC_CFGR_PLLMUL_Msk   (0xFUL << RCC_CFGR_PLLMUL_Pos)
 
#define RCC_CFGR_PLLMUL   RCC_CFGR_PLLMUL_Msk
 
#define RCC_CFGR_PLLMUL_0   (0x1UL << RCC_CFGR_PLLMUL_Pos)
 
#define RCC_CFGR_PLLMUL_1   (0x2UL << RCC_CFGR_PLLMUL_Pos)
 
#define RCC_CFGR_PLLMUL_2   (0x4UL << RCC_CFGR_PLLMUL_Pos)
 
#define RCC_CFGR_PLLMUL_3   (0x8UL << RCC_CFGR_PLLMUL_Pos)
 
#define RCC_CFGR_PLLMUL2   (0x00000000U)
 
#define RCC_CFGR_PLLMUL3   (0x00040000U)
 
#define RCC_CFGR_PLLMUL4   (0x00080000U)
 
#define RCC_CFGR_PLLMUL5   (0x000C0000U)
 
#define RCC_CFGR_PLLMUL6   (0x00100000U)
 
#define RCC_CFGR_PLLMUL7   (0x00140000U)
 
#define RCC_CFGR_PLLMUL8   (0x00180000U)
 
#define RCC_CFGR_PLLMUL9   (0x001C0000U)
 
#define RCC_CFGR_PLLMUL10   (0x00200000U)
 
#define RCC_CFGR_PLLMUL11   (0x00240000U)
 
#define RCC_CFGR_PLLMUL12   (0x00280000U)
 
#define RCC_CFGR_PLLMUL13   (0x002C0000U)
 
#define RCC_CFGR_PLLMUL14   (0x00300000U)
 
#define RCC_CFGR_PLLMUL15   (0x00340000U)
 
#define RCC_CFGR_PLLMUL16   (0x00380000U)
 
#define RCC_CFGR_USBPRE_Pos   (22U)
 
#define RCC_CFGR_USBPRE_Msk   (0x1UL << RCC_CFGR_USBPRE_Pos)
 
#define RCC_CFGR_USBPRE   RCC_CFGR_USBPRE_Msk
 
#define RCC_CFGR_USBPRE_DIV1_5   (0x00000000U)
 
#define RCC_CFGR_USBPRE_DIV1   (0x00400000U)
 
#define RCC_CFGR_I2SSRC_Pos   (23U)
 
#define RCC_CFGR_I2SSRC_Msk   (0x1UL << RCC_CFGR_I2SSRC_Pos)
 
#define RCC_CFGR_I2SSRC   RCC_CFGR_I2SSRC_Msk
 
#define RCC_CFGR_I2SSRC_SYSCLK   (0x00000000U)
 
#define RCC_CFGR_I2SSRC_EXT   (0x00800000U)
 
#define RCC_CFGR_MCO_Pos   (24U)
 
#define RCC_CFGR_MCO_Msk   (0x7UL << RCC_CFGR_MCO_Pos)
 
#define RCC_CFGR_MCO   RCC_CFGR_MCO_Msk
 
#define RCC_CFGR_MCO_0   (0x1UL << RCC_CFGR_MCO_Pos)
 
#define RCC_CFGR_MCO_1   (0x2UL << RCC_CFGR_MCO_Pos)
 
#define RCC_CFGR_MCO_2   (0x4UL << RCC_CFGR_MCO_Pos)
 
#define RCC_CFGR_MCO_NOCLOCK   (0x00000000U)
 
#define RCC_CFGR_MCO_LSI   (0x02000000U)
 
#define RCC_CFGR_MCO_LSE   (0x03000000U)
 
#define RCC_CFGR_MCO_SYSCLK   (0x04000000U)
 
#define RCC_CFGR_MCO_HSI   (0x05000000U)
 
#define RCC_CFGR_MCO_HSE   (0x06000000U)
 
#define RCC_CFGR_MCO_PLL   (0x07000000U)
 
#define RCC_CFGR_MCOPRE_Pos   (28U)
 
#define RCC_CFGR_MCOPRE_Msk   (0x7UL << RCC_CFGR_MCOPRE_Pos)
 
#define RCC_CFGR_MCOPRE   RCC_CFGR_MCOPRE_Msk
 
#define RCC_CFGR_MCOPRE_0   (0x1UL << RCC_CFGR_MCOPRE_Pos)
 
#define RCC_CFGR_MCOPRE_1   (0x2UL << RCC_CFGR_MCOPRE_Pos)
 
#define RCC_CFGR_MCOPRE_2   (0x4UL << RCC_CFGR_MCOPRE_Pos)
 
#define RCC_CFGR_MCOPRE_DIV1   (0x00000000U)
 
#define RCC_CFGR_MCOPRE_DIV2   (0x10000000U)
 
#define RCC_CFGR_MCOPRE_DIV4   (0x20000000U)
 
#define RCC_CFGR_MCOPRE_DIV8   (0x30000000U)
 
#define RCC_CFGR_MCOPRE_DIV16   (0x40000000U)
 
#define RCC_CFGR_MCOPRE_DIV32   (0x50000000U)
 
#define RCC_CFGR_MCOPRE_DIV64   (0x60000000U)
 
#define RCC_CFGR_MCOPRE_DIV128   (0x70000000U)
 
#define RCC_CFGR_PLLNODIV_Pos   (31U)
 
#define RCC_CFGR_PLLNODIV_Msk   (0x1UL << RCC_CFGR_PLLNODIV_Pos)
 
#define RCC_CFGR_PLLNODIV   RCC_CFGR_PLLNODIV_Msk
 
#define RCC_CFGR_MCOSEL   RCC_CFGR_MCO
 
#define RCC_CFGR_MCOSEL_0   RCC_CFGR_MCO_0
 
#define RCC_CFGR_MCOSEL_1   RCC_CFGR_MCO_1
 
#define RCC_CFGR_MCOSEL_2   RCC_CFGR_MCO_2
 
#define RCC_CFGR_MCOSEL_NOCLOCK   RCC_CFGR_MCO_NOCLOCK
 
#define RCC_CFGR_MCOSEL_LSI   RCC_CFGR_MCO_LSI
 
#define RCC_CFGR_MCOSEL_LSE   RCC_CFGR_MCO_LSE
 
#define RCC_CFGR_MCOSEL_SYSCLK   RCC_CFGR_MCO_SYSCLK
 
#define RCC_CFGR_MCOSEL_HSI   RCC_CFGR_MCO_HSI
 
#define RCC_CFGR_MCOSEL_HSE   RCC_CFGR_MCO_HSE
 
#define RCC_CFGR_MCOSEL_PLL_DIV2   RCC_CFGR_MCO_PLL
 
#define RCC_CIR_LSIRDYF_Pos   (0U)
 
#define RCC_CIR_LSIRDYF_Msk   (0x1UL << RCC_CIR_LSIRDYF_Pos)
 
#define RCC_CIR_LSIRDYF   RCC_CIR_LSIRDYF_Msk
 
#define RCC_CIR_LSERDYF_Pos   (1U)
 
#define RCC_CIR_LSERDYF_Msk   (0x1UL << RCC_CIR_LSERDYF_Pos)
 
#define RCC_CIR_LSERDYF   RCC_CIR_LSERDYF_Msk
 
#define RCC_CIR_HSIRDYF_Pos   (2U)
 
#define RCC_CIR_HSIRDYF_Msk   (0x1UL << RCC_CIR_HSIRDYF_Pos)
 
#define RCC_CIR_HSIRDYF   RCC_CIR_HSIRDYF_Msk
 
#define RCC_CIR_HSERDYF_Pos   (3U)
 
#define RCC_CIR_HSERDYF_Msk   (0x1UL << RCC_CIR_HSERDYF_Pos)
 
#define RCC_CIR_HSERDYF   RCC_CIR_HSERDYF_Msk
 
#define RCC_CIR_PLLRDYF_Pos   (4U)
 
#define RCC_CIR_PLLRDYF_Msk   (0x1UL << RCC_CIR_PLLRDYF_Pos)
 
#define RCC_CIR_PLLRDYF   RCC_CIR_PLLRDYF_Msk
 
#define RCC_CIR_CSSF_Pos   (7U)
 
#define RCC_CIR_CSSF_Msk   (0x1UL << RCC_CIR_CSSF_Pos)
 
#define RCC_CIR_CSSF   RCC_CIR_CSSF_Msk
 
#define RCC_CIR_LSIRDYIE_Pos   (8U)
 
#define RCC_CIR_LSIRDYIE_Msk   (0x1UL << RCC_CIR_LSIRDYIE_Pos)
 
#define RCC_CIR_LSIRDYIE   RCC_CIR_LSIRDYIE_Msk
 
#define RCC_CIR_LSERDYIE_Pos   (9U)
 
#define RCC_CIR_LSERDYIE_Msk   (0x1UL << RCC_CIR_LSERDYIE_Pos)
 
#define RCC_CIR_LSERDYIE   RCC_CIR_LSERDYIE_Msk
 
#define RCC_CIR_HSIRDYIE_Pos   (10U)
 
#define RCC_CIR_HSIRDYIE_Msk   (0x1UL << RCC_CIR_HSIRDYIE_Pos)
 
#define RCC_CIR_HSIRDYIE   RCC_CIR_HSIRDYIE_Msk
 
#define RCC_CIR_HSERDYIE_Pos   (11U)
 
#define RCC_CIR_HSERDYIE_Msk   (0x1UL << RCC_CIR_HSERDYIE_Pos)
 
#define RCC_CIR_HSERDYIE   RCC_CIR_HSERDYIE_Msk
 
#define RCC_CIR_PLLRDYIE_Pos   (12U)
 
#define RCC_CIR_PLLRDYIE_Msk   (0x1UL << RCC_CIR_PLLRDYIE_Pos)
 
#define RCC_CIR_PLLRDYIE   RCC_CIR_PLLRDYIE_Msk
 
#define RCC_CIR_LSIRDYC_Pos   (16U)
 
#define RCC_CIR_LSIRDYC_Msk   (0x1UL << RCC_CIR_LSIRDYC_Pos)
 
#define RCC_CIR_LSIRDYC   RCC_CIR_LSIRDYC_Msk
 
#define RCC_CIR_LSERDYC_Pos   (17U)
 
#define RCC_CIR_LSERDYC_Msk   (0x1UL << RCC_CIR_LSERDYC_Pos)
 
#define RCC_CIR_LSERDYC   RCC_CIR_LSERDYC_Msk
 
#define RCC_CIR_HSIRDYC_Pos   (18U)
 
#define RCC_CIR_HSIRDYC_Msk   (0x1UL << RCC_CIR_HSIRDYC_Pos)
 
#define RCC_CIR_HSIRDYC   RCC_CIR_HSIRDYC_Msk
 
#define RCC_CIR_HSERDYC_Pos   (19U)
 
#define RCC_CIR_HSERDYC_Msk   (0x1UL << RCC_CIR_HSERDYC_Pos)
 
#define RCC_CIR_HSERDYC   RCC_CIR_HSERDYC_Msk
 
#define RCC_CIR_PLLRDYC_Pos   (20U)
 
#define RCC_CIR_PLLRDYC_Msk   (0x1UL << RCC_CIR_PLLRDYC_Pos)
 
#define RCC_CIR_PLLRDYC   RCC_CIR_PLLRDYC_Msk
 
#define RCC_CIR_CSSC_Pos   (23U)
 
#define RCC_CIR_CSSC_Msk   (0x1UL << RCC_CIR_CSSC_Pos)
 
#define RCC_CIR_CSSC   RCC_CIR_CSSC_Msk
 
#define RCC_APB2RSTR_SYSCFGRST_Pos   (0U)
 
#define RCC_APB2RSTR_SYSCFGRST_Msk   (0x1UL << RCC_APB2RSTR_SYSCFGRST_Pos)
 
#define RCC_APB2RSTR_SYSCFGRST   RCC_APB2RSTR_SYSCFGRST_Msk
 
#define RCC_APB2RSTR_TIM1RST_Pos   (11U)
 
#define RCC_APB2RSTR_TIM1RST_Msk   (0x1UL << RCC_APB2RSTR_TIM1RST_Pos)
 
#define RCC_APB2RSTR_TIM1RST   RCC_APB2RSTR_TIM1RST_Msk
 
#define RCC_APB2RSTR_SPI1RST_Pos   (12U)
 
#define RCC_APB2RSTR_SPI1RST_Msk   (0x1UL << RCC_APB2RSTR_SPI1RST_Pos)
 
#define RCC_APB2RSTR_SPI1RST   RCC_APB2RSTR_SPI1RST_Msk
 
#define RCC_APB2RSTR_TIM8RST_Pos   (13U)
 
#define RCC_APB2RSTR_TIM8RST_Msk   (0x1UL << RCC_APB2RSTR_TIM8RST_Pos)
 
#define RCC_APB2RSTR_TIM8RST   RCC_APB2RSTR_TIM8RST_Msk
 
#define RCC_APB2RSTR_USART1RST_Pos   (14U)
 
#define RCC_APB2RSTR_USART1RST_Msk   (0x1UL << RCC_APB2RSTR_USART1RST_Pos)
 
#define RCC_APB2RSTR_USART1RST   RCC_APB2RSTR_USART1RST_Msk
 
#define RCC_APB2RSTR_SPI4RST_Pos   (15U)
 
#define RCC_APB2RSTR_SPI4RST_Msk   (0x1UL << RCC_APB2RSTR_SPI4RST_Pos)
 
#define RCC_APB2RSTR_SPI4RST   RCC_APB2RSTR_SPI4RST_Msk
 
#define RCC_APB2RSTR_TIM15RST_Pos   (16U)
 
#define RCC_APB2RSTR_TIM15RST_Msk   (0x1UL << RCC_APB2RSTR_TIM15RST_Pos)
 
#define RCC_APB2RSTR_TIM15RST   RCC_APB2RSTR_TIM15RST_Msk
 
#define RCC_APB2RSTR_TIM16RST_Pos   (17U)
 
#define RCC_APB2RSTR_TIM16RST_Msk   (0x1UL << RCC_APB2RSTR_TIM16RST_Pos)
 
#define RCC_APB2RSTR_TIM16RST   RCC_APB2RSTR_TIM16RST_Msk
 
#define RCC_APB2RSTR_TIM17RST_Pos   (18U)
 
#define RCC_APB2RSTR_TIM17RST_Msk   (0x1UL << RCC_APB2RSTR_TIM17RST_Pos)
 
#define RCC_APB2RSTR_TIM17RST   RCC_APB2RSTR_TIM17RST_Msk
 
#define RCC_APB2RSTR_TIM20RST_Pos   (20U)
 
#define RCC_APB2RSTR_TIM20RST_Msk   (0x1UL << RCC_APB2RSTR_TIM20RST_Pos)
 
#define RCC_APB2RSTR_TIM20RST   RCC_APB2RSTR_TIM20RST_Msk
 
#define RCC_APB1RSTR_TIM2RST_Pos   (0U)
 
#define RCC_APB1RSTR_TIM2RST_Msk   (0x1UL << RCC_APB1RSTR_TIM2RST_Pos)
 
#define RCC_APB1RSTR_TIM2RST   RCC_APB1RSTR_TIM2RST_Msk
 
#define RCC_APB1RSTR_TIM3RST_Pos   (1U)
 
#define RCC_APB1RSTR_TIM3RST_Msk   (0x1UL << RCC_APB1RSTR_TIM3RST_Pos)
 
#define RCC_APB1RSTR_TIM3RST   RCC_APB1RSTR_TIM3RST_Msk
 
#define RCC_APB1RSTR_TIM4RST_Pos   (2U)
 
#define RCC_APB1RSTR_TIM4RST_Msk   (0x1UL << RCC_APB1RSTR_TIM4RST_Pos)
 
#define RCC_APB1RSTR_TIM4RST   RCC_APB1RSTR_TIM4RST_Msk
 
#define RCC_APB1RSTR_TIM6RST_Pos   (4U)
 
#define RCC_APB1RSTR_TIM6RST_Msk   (0x1UL << RCC_APB1RSTR_TIM6RST_Pos)
 
#define RCC_APB1RSTR_TIM6RST   RCC_APB1RSTR_TIM6RST_Msk
 
#define RCC_APB1RSTR_TIM7RST_Pos   (5U)
 
#define RCC_APB1RSTR_TIM7RST_Msk   (0x1UL << RCC_APB1RSTR_TIM7RST_Pos)
 
#define RCC_APB1RSTR_TIM7RST   RCC_APB1RSTR_TIM7RST_Msk
 
#define RCC_APB1RSTR_WWDGRST_Pos   (11U)
 
#define RCC_APB1RSTR_WWDGRST_Msk   (0x1UL << RCC_APB1RSTR_WWDGRST_Pos)
 
#define RCC_APB1RSTR_WWDGRST   RCC_APB1RSTR_WWDGRST_Msk
 
#define RCC_APB1RSTR_SPI2RST_Pos   (14U)
 
#define RCC_APB1RSTR_SPI2RST_Msk   (0x1UL << RCC_APB1RSTR_SPI2RST_Pos)
 
#define RCC_APB1RSTR_SPI2RST   RCC_APB1RSTR_SPI2RST_Msk
 
#define RCC_APB1RSTR_SPI3RST_Pos   (15U)
 
#define RCC_APB1RSTR_SPI3RST_Msk   (0x1UL << RCC_APB1RSTR_SPI3RST_Pos)
 
#define RCC_APB1RSTR_SPI3RST   RCC_APB1RSTR_SPI3RST_Msk
 
#define RCC_APB1RSTR_USART2RST_Pos   (17U)
 
#define RCC_APB1RSTR_USART2RST_Msk   (0x1UL << RCC_APB1RSTR_USART2RST_Pos)
 
#define RCC_APB1RSTR_USART2RST   RCC_APB1RSTR_USART2RST_Msk
 
#define RCC_APB1RSTR_USART3RST_Pos   (18U)
 
#define RCC_APB1RSTR_USART3RST_Msk   (0x1UL << RCC_APB1RSTR_USART3RST_Pos)
 
#define RCC_APB1RSTR_USART3RST   RCC_APB1RSTR_USART3RST_Msk
 
#define RCC_APB1RSTR_UART4RST_Pos   (19U)
 
#define RCC_APB1RSTR_UART4RST_Msk   (0x1UL << RCC_APB1RSTR_UART4RST_Pos)
 
#define RCC_APB1RSTR_UART4RST   RCC_APB1RSTR_UART4RST_Msk
 
#define RCC_APB1RSTR_UART5RST_Pos   (20U)
 
#define RCC_APB1RSTR_UART5RST_Msk   (0x1UL << RCC_APB1RSTR_UART5RST_Pos)
 
#define RCC_APB1RSTR_UART5RST   RCC_APB1RSTR_UART5RST_Msk
 
#define RCC_APB1RSTR_I2C1RST_Pos   (21U)
 
#define RCC_APB1RSTR_I2C1RST_Msk   (0x1UL << RCC_APB1RSTR_I2C1RST_Pos)
 
#define RCC_APB1RSTR_I2C1RST   RCC_APB1RSTR_I2C1RST_Msk
 
#define RCC_APB1RSTR_I2C2RST_Pos   (22U)
 
#define RCC_APB1RSTR_I2C2RST_Msk   (0x1UL << RCC_APB1RSTR_I2C2RST_Pos)
 
#define RCC_APB1RSTR_I2C2RST   RCC_APB1RSTR_I2C2RST_Msk
 
#define RCC_APB1RSTR_USBRST_Pos   (23U)
 
#define RCC_APB1RSTR_USBRST_Msk   (0x1UL << RCC_APB1RSTR_USBRST_Pos)
 
#define RCC_APB1RSTR_USBRST   RCC_APB1RSTR_USBRST_Msk
 
#define RCC_APB1RSTR_CANRST_Pos   (25U)
 
#define RCC_APB1RSTR_CANRST_Msk   (0x1UL << RCC_APB1RSTR_CANRST_Pos)
 
#define RCC_APB1RSTR_CANRST   RCC_APB1RSTR_CANRST_Msk
 
#define RCC_APB1RSTR_PWRRST_Pos   (28U)
 
#define RCC_APB1RSTR_PWRRST_Msk   (0x1UL << RCC_APB1RSTR_PWRRST_Pos)
 
#define RCC_APB1RSTR_PWRRST   RCC_APB1RSTR_PWRRST_Msk
 
#define RCC_APB1RSTR_DAC1RST_Pos   (29U)
 
#define RCC_APB1RSTR_DAC1RST_Msk   (0x1UL << RCC_APB1RSTR_DAC1RST_Pos)
 
#define RCC_APB1RSTR_DAC1RST   RCC_APB1RSTR_DAC1RST_Msk
 
#define RCC_APB1RSTR_I2C3RST_Pos   (30U)
 
#define RCC_APB1RSTR_I2C3RST_Msk   (0x1UL << RCC_APB1RSTR_I2C3RST_Pos)
 
#define RCC_APB1RSTR_I2C3RST   RCC_APB1RSTR_I2C3RST_Msk
 
#define RCC_AHBENR_DMA1EN_Pos   (0U)
 
#define RCC_AHBENR_DMA1EN_Msk   (0x1UL << RCC_AHBENR_DMA1EN_Pos)
 
#define RCC_AHBENR_DMA1EN   RCC_AHBENR_DMA1EN_Msk
 
#define RCC_AHBENR_DMA2EN_Pos   (1U)
 
#define RCC_AHBENR_DMA2EN_Msk   (0x1UL << RCC_AHBENR_DMA2EN_Pos)
 
#define RCC_AHBENR_DMA2EN   RCC_AHBENR_DMA2EN_Msk
 
#define RCC_AHBENR_SRAMEN_Pos   (2U)
 
#define RCC_AHBENR_SRAMEN_Msk   (0x1UL << RCC_AHBENR_SRAMEN_Pos)
 
#define RCC_AHBENR_SRAMEN   RCC_AHBENR_SRAMEN_Msk
 
#define RCC_AHBENR_FLITFEN_Pos   (4U)
 
#define RCC_AHBENR_FLITFEN_Msk   (0x1UL << RCC_AHBENR_FLITFEN_Pos)
 
#define RCC_AHBENR_FLITFEN   RCC_AHBENR_FLITFEN_Msk
 
#define RCC_AHBENR_FMCEN_Pos   (5U)
 
#define RCC_AHBENR_FMCEN_Msk   (0x1UL << RCC_AHBENR_FMCEN_Pos)
 
#define RCC_AHBENR_FMCEN   RCC_AHBENR_FMCEN_Msk
 
#define RCC_AHBENR_CRCEN_Pos   (6U)
 
#define RCC_AHBENR_CRCEN_Msk   (0x1UL << RCC_AHBENR_CRCEN_Pos)
 
#define RCC_AHBENR_CRCEN   RCC_AHBENR_CRCEN_Msk
 
#define RCC_AHBENR_GPIOHEN_Pos   (16U)
 
#define RCC_AHBENR_GPIOHEN_Msk   (0x1UL << RCC_AHBENR_GPIOHEN_Pos)
 
#define RCC_AHBENR_GPIOHEN   RCC_AHBENR_GPIOHEN_Msk
 
#define RCC_AHBENR_GPIOAEN_Pos   (17U)
 
#define RCC_AHBENR_GPIOAEN_Msk   (0x1UL << RCC_AHBENR_GPIOAEN_Pos)
 
#define RCC_AHBENR_GPIOAEN   RCC_AHBENR_GPIOAEN_Msk
 
#define RCC_AHBENR_GPIOBEN_Pos   (18U)
 
#define RCC_AHBENR_GPIOBEN_Msk   (0x1UL << RCC_AHBENR_GPIOBEN_Pos)
 
#define RCC_AHBENR_GPIOBEN   RCC_AHBENR_GPIOBEN_Msk
 
#define RCC_AHBENR_GPIOCEN_Pos   (19U)
 
#define RCC_AHBENR_GPIOCEN_Msk   (0x1UL << RCC_AHBENR_GPIOCEN_Pos)
 
#define RCC_AHBENR_GPIOCEN   RCC_AHBENR_GPIOCEN_Msk
 
#define RCC_AHBENR_GPIODEN_Pos   (20U)
 
#define RCC_AHBENR_GPIODEN_Msk   (0x1UL << RCC_AHBENR_GPIODEN_Pos)
 
#define RCC_AHBENR_GPIODEN   RCC_AHBENR_GPIODEN_Msk
 
#define RCC_AHBENR_GPIOEEN_Pos   (21U)
 
#define RCC_AHBENR_GPIOEEN_Msk   (0x1UL << RCC_AHBENR_GPIOEEN_Pos)
 
#define RCC_AHBENR_GPIOEEN   RCC_AHBENR_GPIOEEN_Msk
 
#define RCC_AHBENR_GPIOFEN_Pos   (22U)
 
#define RCC_AHBENR_GPIOFEN_Msk   (0x1UL << RCC_AHBENR_GPIOFEN_Pos)
 
#define RCC_AHBENR_GPIOFEN   RCC_AHBENR_GPIOFEN_Msk
 
#define RCC_AHBENR_GPIOGEN_Pos   (23U)
 
#define RCC_AHBENR_GPIOGEN_Msk   (0x1UL << RCC_AHBENR_GPIOGEN_Pos)
 
#define RCC_AHBENR_GPIOGEN   RCC_AHBENR_GPIOGEN_Msk
 
#define RCC_AHBENR_TSCEN_Pos   (24U)
 
#define RCC_AHBENR_TSCEN_Msk   (0x1UL << RCC_AHBENR_TSCEN_Pos)
 
#define RCC_AHBENR_TSCEN   RCC_AHBENR_TSCEN_Msk
 
#define RCC_AHBENR_ADC12EN_Pos   (28U)
 
#define RCC_AHBENR_ADC12EN_Msk   (0x1UL << RCC_AHBENR_ADC12EN_Pos)
 
#define RCC_AHBENR_ADC12EN   RCC_AHBENR_ADC12EN_Msk
 
#define RCC_AHBENR_ADC34EN_Pos   (29U)
 
#define RCC_AHBENR_ADC34EN_Msk   (0x1UL << RCC_AHBENR_ADC34EN_Pos)
 
#define RCC_AHBENR_ADC34EN   RCC_AHBENR_ADC34EN_Msk
 
#define RCC_APB2ENR_SYSCFGEN_Pos   (0U)
 
#define RCC_APB2ENR_SYSCFGEN_Msk   (0x1UL << RCC_APB2ENR_SYSCFGEN_Pos)
 
#define RCC_APB2ENR_SYSCFGEN   RCC_APB2ENR_SYSCFGEN_Msk
 
#define RCC_APB2ENR_TIM1EN_Pos   (11U)
 
#define RCC_APB2ENR_TIM1EN_Msk   (0x1UL << RCC_APB2ENR_TIM1EN_Pos)
 
#define RCC_APB2ENR_TIM1EN   RCC_APB2ENR_TIM1EN_Msk
 
#define RCC_APB2ENR_SPI1EN_Pos   (12U)
 
#define RCC_APB2ENR_SPI1EN_Msk   (0x1UL << RCC_APB2ENR_SPI1EN_Pos)
 
#define RCC_APB2ENR_SPI1EN   RCC_APB2ENR_SPI1EN_Msk
 
#define RCC_APB2ENR_TIM8EN_Pos   (13U)
 
#define RCC_APB2ENR_TIM8EN_Msk   (0x1UL << RCC_APB2ENR_TIM8EN_Pos)
 
#define RCC_APB2ENR_TIM8EN   RCC_APB2ENR_TIM8EN_Msk
 
#define RCC_APB2ENR_USART1EN_Pos   (14U)
 
#define RCC_APB2ENR_USART1EN_Msk   (0x1UL << RCC_APB2ENR_USART1EN_Pos)
 
#define RCC_APB2ENR_USART1EN   RCC_APB2ENR_USART1EN_Msk
 
#define RCC_APB2ENR_SPI4EN_Pos   (15U)
 
#define RCC_APB2ENR_SPI4EN_Msk   (0x1UL << RCC_APB2ENR_SPI4EN_Pos)
 
#define RCC_APB2ENR_SPI4EN   RCC_APB2ENR_SPI4EN_Msk
 
#define RCC_APB2ENR_TIM15EN_Pos   (16U)
 
#define RCC_APB2ENR_TIM15EN_Msk   (0x1UL << RCC_APB2ENR_TIM15EN_Pos)
 
#define RCC_APB2ENR_TIM15EN   RCC_APB2ENR_TIM15EN_Msk
 
#define RCC_APB2ENR_TIM16EN_Pos   (17U)
 
#define RCC_APB2ENR_TIM16EN_Msk   (0x1UL << RCC_APB2ENR_TIM16EN_Pos)
 
#define RCC_APB2ENR_TIM16EN   RCC_APB2ENR_TIM16EN_Msk
 
#define RCC_APB2ENR_TIM17EN_Pos   (18U)
 
#define RCC_APB2ENR_TIM17EN_Msk   (0x1UL << RCC_APB2ENR_TIM17EN_Pos)
 
#define RCC_APB2ENR_TIM17EN   RCC_APB2ENR_TIM17EN_Msk
 
#define RCC_APB2ENR_TIM20EN_Pos   (20U)
 
#define RCC_APB2ENR_TIM20EN_Msk   (0x1UL << RCC_APB2ENR_TIM20EN_Pos)
 
#define RCC_APB2ENR_TIM20EN   RCC_APB2ENR_TIM20EN_Msk
 
#define RCC_APB1ENR_TIM2EN_Pos   (0U)
 
#define RCC_APB1ENR_TIM2EN_Msk   (0x1UL << RCC_APB1ENR_TIM2EN_Pos)
 
#define RCC_APB1ENR_TIM2EN   RCC_APB1ENR_TIM2EN_Msk
 
#define RCC_APB1ENR_TIM3EN_Pos   (1U)
 
#define RCC_APB1ENR_TIM3EN_Msk   (0x1UL << RCC_APB1ENR_TIM3EN_Pos)
 
#define RCC_APB1ENR_TIM3EN   RCC_APB1ENR_TIM3EN_Msk
 
#define RCC_APB1ENR_TIM4EN_Pos   (2U)
 
#define RCC_APB1ENR_TIM4EN_Msk   (0x1UL << RCC_APB1ENR_TIM4EN_Pos)
 
#define RCC_APB1ENR_TIM4EN   RCC_APB1ENR_TIM4EN_Msk
 
#define RCC_APB1ENR_TIM6EN_Pos   (4U)
 
#define RCC_APB1ENR_TIM6EN_Msk   (0x1UL << RCC_APB1ENR_TIM6EN_Pos)
 
#define RCC_APB1ENR_TIM6EN   RCC_APB1ENR_TIM6EN_Msk
 
#define RCC_APB1ENR_TIM7EN_Pos   (5U)
 
#define RCC_APB1ENR_TIM7EN_Msk   (0x1UL << RCC_APB1ENR_TIM7EN_Pos)
 
#define RCC_APB1ENR_TIM7EN   RCC_APB1ENR_TIM7EN_Msk
 
#define RCC_APB1ENR_WWDGEN_Pos   (11U)
 
#define RCC_APB1ENR_WWDGEN_Msk   (0x1UL << RCC_APB1ENR_WWDGEN_Pos)
 
#define RCC_APB1ENR_WWDGEN   RCC_APB1ENR_WWDGEN_Msk
 
#define RCC_APB1ENR_SPI2EN_Pos   (14U)
 
#define RCC_APB1ENR_SPI2EN_Msk   (0x1UL << RCC_APB1ENR_SPI2EN_Pos)
 
#define RCC_APB1ENR_SPI2EN   RCC_APB1ENR_SPI2EN_Msk
 
#define RCC_APB1ENR_SPI3EN_Pos   (15U)
 
#define RCC_APB1ENR_SPI3EN_Msk   (0x1UL << RCC_APB1ENR_SPI3EN_Pos)
 
#define RCC_APB1ENR_SPI3EN   RCC_APB1ENR_SPI3EN_Msk
 
#define RCC_APB1ENR_USART2EN_Pos   (17U)
 
#define RCC_APB1ENR_USART2EN_Msk   (0x1UL << RCC_APB1ENR_USART2EN_Pos)
 
#define RCC_APB1ENR_USART2EN   RCC_APB1ENR_USART2EN_Msk
 
#define RCC_APB1ENR_USART3EN_Pos   (18U)
 
#define RCC_APB1ENR_USART3EN_Msk   (0x1UL << RCC_APB1ENR_USART3EN_Pos)
 
#define RCC_APB1ENR_USART3EN   RCC_APB1ENR_USART3EN_Msk
 
#define RCC_APB1ENR_UART4EN_Pos   (19U)
 
#define RCC_APB1ENR_UART4EN_Msk   (0x1UL << RCC_APB1ENR_UART4EN_Pos)
 
#define RCC_APB1ENR_UART4EN   RCC_APB1ENR_UART4EN_Msk
 
#define RCC_APB1ENR_UART5EN_Pos   (20U)
 
#define RCC_APB1ENR_UART5EN_Msk   (0x1UL << RCC_APB1ENR_UART5EN_Pos)
 
#define RCC_APB1ENR_UART5EN   RCC_APB1ENR_UART5EN_Msk
 
#define RCC_APB1ENR_I2C1EN_Pos   (21U)
 
#define RCC_APB1ENR_I2C1EN_Msk   (0x1UL << RCC_APB1ENR_I2C1EN_Pos)
 
#define RCC_APB1ENR_I2C1EN   RCC_APB1ENR_I2C1EN_Msk
 
#define RCC_APB1ENR_I2C2EN_Pos   (22U)
 
#define RCC_APB1ENR_I2C2EN_Msk   (0x1UL << RCC_APB1ENR_I2C2EN_Pos)
 
#define RCC_APB1ENR_I2C2EN   RCC_APB1ENR_I2C2EN_Msk
 
#define RCC_APB1ENR_USBEN_Pos   (23U)
 
#define RCC_APB1ENR_USBEN_Msk   (0x1UL << RCC_APB1ENR_USBEN_Pos)
 
#define RCC_APB1ENR_USBEN   RCC_APB1ENR_USBEN_Msk
 
#define RCC_APB1ENR_CANEN_Pos   (25U)
 
#define RCC_APB1ENR_CANEN_Msk   (0x1UL << RCC_APB1ENR_CANEN_Pos)
 
#define RCC_APB1ENR_CANEN   RCC_APB1ENR_CANEN_Msk
 
#define RCC_APB1ENR_PWREN_Pos   (28U)
 
#define RCC_APB1ENR_PWREN_Msk   (0x1UL << RCC_APB1ENR_PWREN_Pos)
 
#define RCC_APB1ENR_PWREN   RCC_APB1ENR_PWREN_Msk
 
#define RCC_APB1ENR_DAC1EN_Pos   (29U)
 
#define RCC_APB1ENR_DAC1EN_Msk   (0x1UL << RCC_APB1ENR_DAC1EN_Pos)
 
#define RCC_APB1ENR_DAC1EN   RCC_APB1ENR_DAC1EN_Msk
 
#define RCC_APB1ENR_I2C3EN_Pos   (30U)
 
#define RCC_APB1ENR_I2C3EN_Msk   (0x1UL << RCC_APB1ENR_I2C3EN_Pos)
 
#define RCC_APB1ENR_I2C3EN   RCC_APB1ENR_I2C3EN_Msk
 
#define RCC_BDCR_LSE_Pos   (0U)
 
#define RCC_BDCR_LSE_Msk   (0x7UL << RCC_BDCR_LSE_Pos)
 
#define RCC_BDCR_LSE   RCC_BDCR_LSE_Msk
 
#define RCC_BDCR_LSEON_Pos   (0U)
 
#define RCC_BDCR_LSEON_Msk   (0x1UL << RCC_BDCR_LSEON_Pos)
 
#define RCC_BDCR_LSEON   RCC_BDCR_LSEON_Msk
 
#define RCC_BDCR_LSERDY_Pos   (1U)
 
#define RCC_BDCR_LSERDY_Msk   (0x1UL << RCC_BDCR_LSERDY_Pos)
 
#define RCC_BDCR_LSERDY   RCC_BDCR_LSERDY_Msk
 
#define RCC_BDCR_LSEBYP_Pos   (2U)
 
#define RCC_BDCR_LSEBYP_Msk   (0x1UL << RCC_BDCR_LSEBYP_Pos)
 
#define RCC_BDCR_LSEBYP   RCC_BDCR_LSEBYP_Msk
 
#define RCC_BDCR_LSEDRV_Pos   (3U)
 
#define RCC_BDCR_LSEDRV_Msk   (0x3UL << RCC_BDCR_LSEDRV_Pos)
 
#define RCC_BDCR_LSEDRV   RCC_BDCR_LSEDRV_Msk
 
#define RCC_BDCR_LSEDRV_0   (0x1UL << RCC_BDCR_LSEDRV_Pos)
 
#define RCC_BDCR_LSEDRV_1   (0x2UL << RCC_BDCR_LSEDRV_Pos)
 
#define RCC_BDCR_RTCSEL_Pos   (8U)
 
#define RCC_BDCR_RTCSEL_Msk   (0x3UL << RCC_BDCR_RTCSEL_Pos)
 
#define RCC_BDCR_RTCSEL   RCC_BDCR_RTCSEL_Msk
 
#define RCC_BDCR_RTCSEL_0   (0x1UL << RCC_BDCR_RTCSEL_Pos)
 
#define RCC_BDCR_RTCSEL_1   (0x2UL << RCC_BDCR_RTCSEL_Pos)
 
#define RCC_BDCR_RTCSEL_NOCLOCK   (0x00000000U)
 
#define RCC_BDCR_RTCSEL_LSE   (0x00000100U)
 
#define RCC_BDCR_RTCSEL_LSI   (0x00000200U)
 
#define RCC_BDCR_RTCSEL_HSE   (0x00000300U)
 
#define RCC_BDCR_RTCEN_Pos   (15U)
 
#define RCC_BDCR_RTCEN_Msk   (0x1UL << RCC_BDCR_RTCEN_Pos)
 
#define RCC_BDCR_RTCEN   RCC_BDCR_RTCEN_Msk
 
#define RCC_BDCR_BDRST_Pos   (16U)
 
#define RCC_BDCR_BDRST_Msk   (0x1UL << RCC_BDCR_BDRST_Pos)
 
#define RCC_BDCR_BDRST   RCC_BDCR_BDRST_Msk
 
#define RCC_CSR_LSION_Pos   (0U)
 
#define RCC_CSR_LSION_Msk   (0x1UL << RCC_CSR_LSION_Pos)
 
#define RCC_CSR_LSION   RCC_CSR_LSION_Msk
 
#define RCC_CSR_LSIRDY_Pos   (1U)
 
#define RCC_CSR_LSIRDY_Msk   (0x1UL << RCC_CSR_LSIRDY_Pos)
 
#define RCC_CSR_LSIRDY   RCC_CSR_LSIRDY_Msk
 
#define RCC_CSR_V18PWRRSTF_Pos   (23U)
 
#define RCC_CSR_V18PWRRSTF_Msk   (0x1UL << RCC_CSR_V18PWRRSTF_Pos)
 
#define RCC_CSR_V18PWRRSTF   RCC_CSR_V18PWRRSTF_Msk
 
#define RCC_CSR_RMVF_Pos   (24U)
 
#define RCC_CSR_RMVF_Msk   (0x1UL << RCC_CSR_RMVF_Pos)
 
#define RCC_CSR_RMVF   RCC_CSR_RMVF_Msk
 
#define RCC_CSR_OBLRSTF_Pos   (25U)
 
#define RCC_CSR_OBLRSTF_Msk   (0x1UL << RCC_CSR_OBLRSTF_Pos)
 
#define RCC_CSR_OBLRSTF   RCC_CSR_OBLRSTF_Msk
 
#define RCC_CSR_PINRSTF_Pos   (26U)
 
#define RCC_CSR_PINRSTF_Msk   (0x1UL << RCC_CSR_PINRSTF_Pos)
 
#define RCC_CSR_PINRSTF   RCC_CSR_PINRSTF_Msk
 
#define RCC_CSR_PORRSTF_Pos   (27U)
 
#define RCC_CSR_PORRSTF_Msk   (0x1UL << RCC_CSR_PORRSTF_Pos)
 
#define RCC_CSR_PORRSTF   RCC_CSR_PORRSTF_Msk
 
#define RCC_CSR_SFTRSTF_Pos   (28U)
 
#define RCC_CSR_SFTRSTF_Msk   (0x1UL << RCC_CSR_SFTRSTF_Pos)
 
#define RCC_CSR_SFTRSTF   RCC_CSR_SFTRSTF_Msk
 
#define RCC_CSR_IWDGRSTF_Pos   (29U)
 
#define RCC_CSR_IWDGRSTF_Msk   (0x1UL << RCC_CSR_IWDGRSTF_Pos)
 
#define RCC_CSR_IWDGRSTF   RCC_CSR_IWDGRSTF_Msk
 
#define RCC_CSR_WWDGRSTF_Pos   (30U)
 
#define RCC_CSR_WWDGRSTF_Msk   (0x1UL << RCC_CSR_WWDGRSTF_Pos)
 
#define RCC_CSR_WWDGRSTF   RCC_CSR_WWDGRSTF_Msk
 
#define RCC_CSR_LPWRRSTF_Pos   (31U)
 
#define RCC_CSR_LPWRRSTF_Msk   (0x1UL << RCC_CSR_LPWRRSTF_Pos)
 
#define RCC_CSR_LPWRRSTF   RCC_CSR_LPWRRSTF_Msk
 
#define RCC_CSR_VREGRSTF   RCC_CSR_V18PWRRSTF
 
#define RCC_AHBRSTR_FMCRST_Pos   (5U)
 
#define RCC_AHBRSTR_FMCRST_Msk   (0x1UL << RCC_AHBRSTR_FMCRST_Pos)
 
#define RCC_AHBRSTR_FMCRST   RCC_AHBRSTR_FMCRST_Msk
 
#define RCC_AHBRSTR_GPIOHRST_Pos   (16U)
 
#define RCC_AHBRSTR_GPIOHRST_Msk   (0x1UL << RCC_AHBRSTR_GPIOHRST_Pos)
 
#define RCC_AHBRSTR_GPIOHRST   RCC_AHBRSTR_GPIOHRST_Msk
 
#define RCC_AHBRSTR_GPIOARST_Pos   (17U)
 
#define RCC_AHBRSTR_GPIOARST_Msk   (0x1UL << RCC_AHBRSTR_GPIOARST_Pos)
 
#define RCC_AHBRSTR_GPIOARST   RCC_AHBRSTR_GPIOARST_Msk
 
#define RCC_AHBRSTR_GPIOBRST_Pos   (18U)
 
#define RCC_AHBRSTR_GPIOBRST_Msk   (0x1UL << RCC_AHBRSTR_GPIOBRST_Pos)
 
#define RCC_AHBRSTR_GPIOBRST   RCC_AHBRSTR_GPIOBRST_Msk
 
#define RCC_AHBRSTR_GPIOCRST_Pos   (19U)
 
#define RCC_AHBRSTR_GPIOCRST_Msk   (0x1UL << RCC_AHBRSTR_GPIOCRST_Pos)
 
#define RCC_AHBRSTR_GPIOCRST   RCC_AHBRSTR_GPIOCRST_Msk
 
#define RCC_AHBRSTR_GPIODRST_Pos   (20U)
 
#define RCC_AHBRSTR_GPIODRST_Msk   (0x1UL << RCC_AHBRSTR_GPIODRST_Pos)
 
#define RCC_AHBRSTR_GPIODRST   RCC_AHBRSTR_GPIODRST_Msk
 
#define RCC_AHBRSTR_GPIOERST_Pos   (21U)
 
#define RCC_AHBRSTR_GPIOERST_Msk   (0x1UL << RCC_AHBRSTR_GPIOERST_Pos)
 
#define RCC_AHBRSTR_GPIOERST   RCC_AHBRSTR_GPIOERST_Msk
 
#define RCC_AHBRSTR_GPIOFRST_Pos   (22U)
 
#define RCC_AHBRSTR_GPIOFRST_Msk   (0x1UL << RCC_AHBRSTR_GPIOFRST_Pos)
 
#define RCC_AHBRSTR_GPIOFRST   RCC_AHBRSTR_GPIOFRST_Msk
 
#define RCC_AHBRSTR_GPIOGRST_Pos   (23U)
 
#define RCC_AHBRSTR_GPIOGRST_Msk   (0x1UL << RCC_AHBRSTR_GPIOGRST_Pos)
 
#define RCC_AHBRSTR_GPIOGRST   RCC_AHBRSTR_GPIOGRST_Msk
 
#define RCC_AHBRSTR_TSCRST_Pos   (24U)
 
#define RCC_AHBRSTR_TSCRST_Msk   (0x1UL << RCC_AHBRSTR_TSCRST_Pos)
 
#define RCC_AHBRSTR_TSCRST   RCC_AHBRSTR_TSCRST_Msk
 
#define RCC_AHBRSTR_ADC12RST_Pos   (28U)
 
#define RCC_AHBRSTR_ADC12RST_Msk   (0x1UL << RCC_AHBRSTR_ADC12RST_Pos)
 
#define RCC_AHBRSTR_ADC12RST   RCC_AHBRSTR_ADC12RST_Msk
 
#define RCC_AHBRSTR_ADC34RST_Pos   (29U)
 
#define RCC_AHBRSTR_ADC34RST_Msk   (0x1UL << RCC_AHBRSTR_ADC34RST_Pos)
 
#define RCC_AHBRSTR_ADC34RST   RCC_AHBRSTR_ADC34RST_Msk
 
#define RCC_CFGR2_PREDIV_Pos   (0U)
 
#define RCC_CFGR2_PREDIV_Msk   (0xFUL << RCC_CFGR2_PREDIV_Pos)
 
#define RCC_CFGR2_PREDIV   RCC_CFGR2_PREDIV_Msk
 
#define RCC_CFGR2_PREDIV_0   (0x1UL << RCC_CFGR2_PREDIV_Pos)
 
#define RCC_CFGR2_PREDIV_1   (0x2UL << RCC_CFGR2_PREDIV_Pos)
 
#define RCC_CFGR2_PREDIV_2   (0x4UL << RCC_CFGR2_PREDIV_Pos)
 
#define RCC_CFGR2_PREDIV_3   (0x8UL << RCC_CFGR2_PREDIV_Pos)
 
#define RCC_CFGR2_PREDIV_DIV1   (0x00000000U)
 
#define RCC_CFGR2_PREDIV_DIV2   (0x00000001U)
 
#define RCC_CFGR2_PREDIV_DIV3   (0x00000002U)
 
#define RCC_CFGR2_PREDIV_DIV4   (0x00000003U)
 
#define RCC_CFGR2_PREDIV_DIV5   (0x00000004U)
 
#define RCC_CFGR2_PREDIV_DIV6   (0x00000005U)
 
#define RCC_CFGR2_PREDIV_DIV7   (0x00000006U)
 
#define RCC_CFGR2_PREDIV_DIV8   (0x00000007U)
 
#define RCC_CFGR2_PREDIV_DIV9   (0x00000008U)
 
#define RCC_CFGR2_PREDIV_DIV10   (0x00000009U)
 
#define RCC_CFGR2_PREDIV_DIV11   (0x0000000AU)
 
#define RCC_CFGR2_PREDIV_DIV12   (0x0000000BU)
 
#define RCC_CFGR2_PREDIV_DIV13   (0x0000000CU)
 
#define RCC_CFGR2_PREDIV_DIV14   (0x0000000DU)
 
#define RCC_CFGR2_PREDIV_DIV15   (0x0000000EU)
 
#define RCC_CFGR2_PREDIV_DIV16   (0x0000000FU)
 
#define RCC_CFGR2_ADCPRE12_Pos   (4U)
 
#define RCC_CFGR2_ADCPRE12_Msk   (0x1FUL << RCC_CFGR2_ADCPRE12_Pos)
 
#define RCC_CFGR2_ADCPRE12   RCC_CFGR2_ADCPRE12_Msk
 
#define RCC_CFGR2_ADCPRE12_0   (0x01UL << RCC_CFGR2_ADCPRE12_Pos)
 
#define RCC_CFGR2_ADCPRE12_1   (0x02UL << RCC_CFGR2_ADCPRE12_Pos)
 
#define RCC_CFGR2_ADCPRE12_2   (0x04UL << RCC_CFGR2_ADCPRE12_Pos)
 
#define RCC_CFGR2_ADCPRE12_3   (0x08UL << RCC_CFGR2_ADCPRE12_Pos)
 
#define RCC_CFGR2_ADCPRE12_4   (0x10UL << RCC_CFGR2_ADCPRE12_Pos)
 
#define RCC_CFGR2_ADCPRE12_NO   (0x00000000U)
 
#define RCC_CFGR2_ADCPRE12_DIV1   (0x00000100U)
 
#define RCC_CFGR2_ADCPRE12_DIV2   (0x00000110U)
 
#define RCC_CFGR2_ADCPRE12_DIV4   (0x00000120U)
 
#define RCC_CFGR2_ADCPRE12_DIV6   (0x00000130U)
 
#define RCC_CFGR2_ADCPRE12_DIV8   (0x00000140U)
 
#define RCC_CFGR2_ADCPRE12_DIV10   (0x00000150U)
 
#define RCC_CFGR2_ADCPRE12_DIV12   (0x00000160U)
 
#define RCC_CFGR2_ADCPRE12_DIV16   (0x00000170U)
 
#define RCC_CFGR2_ADCPRE12_DIV32   (0x00000180U)
 
#define RCC_CFGR2_ADCPRE12_DIV64   (0x00000190U)
 
#define RCC_CFGR2_ADCPRE12_DIV128   (0x000001A0U)
 
#define RCC_CFGR2_ADCPRE12_DIV256   (0x000001B0U)
 
#define RCC_CFGR2_ADCPRE34_Pos   (9U)
 
#define RCC_CFGR2_ADCPRE34_Msk   (0x1FUL << RCC_CFGR2_ADCPRE34_Pos)
 
#define RCC_CFGR2_ADCPRE34   RCC_CFGR2_ADCPRE34_Msk
 
#define RCC_CFGR2_ADCPRE34_0   (0x01UL << RCC_CFGR2_ADCPRE34_Pos)
 
#define RCC_CFGR2_ADCPRE34_1   (0x02UL << RCC_CFGR2_ADCPRE34_Pos)
 
#define RCC_CFGR2_ADCPRE34_2   (0x04UL << RCC_CFGR2_ADCPRE34_Pos)
 
#define RCC_CFGR2_ADCPRE34_3   (0x08UL << RCC_CFGR2_ADCPRE34_Pos)
 
#define RCC_CFGR2_ADCPRE34_4   (0x10UL << RCC_CFGR2_ADCPRE34_Pos)
 
#define RCC_CFGR2_ADCPRE34_NO   (0x00000000U)
 
#define RCC_CFGR2_ADCPRE34_DIV1   (0x00002000U)
 
#define RCC_CFGR2_ADCPRE34_DIV2   (0x00002200U)
 
#define RCC_CFGR2_ADCPRE34_DIV4   (0x00002400U)
 
#define RCC_CFGR2_ADCPRE34_DIV6   (0x00002600U)
 
#define RCC_CFGR2_ADCPRE34_DIV8   (0x00002800U)
 
#define RCC_CFGR2_ADCPRE34_DIV10   (0x00002A00U)
 
#define RCC_CFGR2_ADCPRE34_DIV12   (0x00002C00U)
 
#define RCC_CFGR2_ADCPRE34_DIV16   (0x00002E00U)
 
#define RCC_CFGR2_ADCPRE34_DIV32   (0x00003000U)
 
#define RCC_CFGR2_ADCPRE34_DIV64   (0x00003200U)
 
#define RCC_CFGR2_ADCPRE34_DIV128   (0x00003400U)
 
#define RCC_CFGR2_ADCPRE34_DIV256   (0x00003600U)
 
#define RCC_CFGR3_USART1SW_Pos   (0U)
 
#define RCC_CFGR3_USART1SW_Msk   (0x3UL << RCC_CFGR3_USART1SW_Pos)
 
#define RCC_CFGR3_USART1SW   RCC_CFGR3_USART1SW_Msk
 
#define RCC_CFGR3_USART1SW_0   (0x1UL << RCC_CFGR3_USART1SW_Pos)
 
#define RCC_CFGR3_USART1SW_1   (0x2UL << RCC_CFGR3_USART1SW_Pos)
 
#define RCC_CFGR3_USART1SW_PCLK2   (0x00000000U)
 
#define RCC_CFGR3_USART1SW_SYSCLK   (0x00000001U)
 
#define RCC_CFGR3_USART1SW_LSE   (0x00000002U)
 
#define RCC_CFGR3_USART1SW_HSI   (0x00000003U)
 
#define RCC_CFGR3_USART1SW_PCLK   RCC_CFGR3_USART1SW_PCLK2
 
#define RCC_CFGR3_I2CSW_Pos   (4U)
 
#define RCC_CFGR3_I2CSW_Msk   (0x7UL << RCC_CFGR3_I2CSW_Pos)
 
#define RCC_CFGR3_I2CSW   RCC_CFGR3_I2CSW_Msk
 
#define RCC_CFGR3_I2C1SW_Pos   (4U)
 
#define RCC_CFGR3_I2C1SW_Msk   (0x1UL << RCC_CFGR3_I2C1SW_Pos)
 
#define RCC_CFGR3_I2C1SW   RCC_CFGR3_I2C1SW_Msk
 
#define RCC_CFGR3_I2C2SW_Pos   (5U)
 
#define RCC_CFGR3_I2C2SW_Msk   (0x1UL << RCC_CFGR3_I2C2SW_Pos)
 
#define RCC_CFGR3_I2C2SW   RCC_CFGR3_I2C2SW_Msk
 
#define RCC_CFGR3_I2C3SW_Pos   (6U)
 
#define RCC_CFGR3_I2C3SW_Msk   (0x1UL << RCC_CFGR3_I2C3SW_Pos)
 
#define RCC_CFGR3_I2C3SW   RCC_CFGR3_I2C3SW_Msk
 
#define RCC_CFGR3_I2C1SW_HSI   (0x00000000U)
 
#define RCC_CFGR3_I2C1SW_SYSCLK_Pos   (4U)
 
#define RCC_CFGR3_I2C1SW_SYSCLK_Msk   (0x1UL << RCC_CFGR3_I2C1SW_SYSCLK_Pos)
 
#define RCC_CFGR3_I2C1SW_SYSCLK   RCC_CFGR3_I2C1SW_SYSCLK_Msk
 
#define RCC_CFGR3_I2C2SW_HSI   (0x00000000U)
 
#define RCC_CFGR3_I2C2SW_SYSCLK_Pos   (5U)
 
#define RCC_CFGR3_I2C2SW_SYSCLK_Msk   (0x1UL << RCC_CFGR3_I2C2SW_SYSCLK_Pos)
 
#define RCC_CFGR3_I2C2SW_SYSCLK   RCC_CFGR3_I2C2SW_SYSCLK_Msk
 
#define RCC_CFGR3_I2C3SW_HSI   (0x00000000U)
 
#define RCC_CFGR3_I2C3SW_SYSCLK_Pos   (6U)
 
#define RCC_CFGR3_I2C3SW_SYSCLK_Msk   (0x1UL << RCC_CFGR3_I2C3SW_SYSCLK_Pos)
 
#define RCC_CFGR3_I2C3SW_SYSCLK   RCC_CFGR3_I2C3SW_SYSCLK_Msk
 
#define RCC_CFGR3_TIMSW_Pos   (8U)
 
#define RCC_CFGR3_TIMSW_Msk   (0xAFUL << RCC_CFGR3_TIMSW_Pos)
 
#define RCC_CFGR3_TIMSW   RCC_CFGR3_TIMSW_Msk
 
#define RCC_CFGR3_TIM1SW_Pos   (8U)
 
#define RCC_CFGR3_TIM1SW_Msk   (0x1UL << RCC_CFGR3_TIM1SW_Pos)
 
#define RCC_CFGR3_TIM1SW   RCC_CFGR3_TIM1SW_Msk
 
#define RCC_CFGR3_TIM8SW_Pos   (9U)
 
#define RCC_CFGR3_TIM8SW_Msk   (0x1UL << RCC_CFGR3_TIM8SW_Pos)
 
#define RCC_CFGR3_TIM8SW   RCC_CFGR3_TIM8SW_Msk
 
#define RCC_CFGR3_TIM15SW_Pos   (10U)
 
#define RCC_CFGR3_TIM15SW_Msk   (0x1UL << RCC_CFGR3_TIM15SW_Pos)
 
#define RCC_CFGR3_TIM15SW   RCC_CFGR3_TIM15SW_Msk
 
#define RCC_CFGR3_TIM16SW_Pos   (11U)
 
#define RCC_CFGR3_TIM16SW_Msk   (0x1UL << RCC_CFGR3_TIM16SW_Pos)
 
#define RCC_CFGR3_TIM16SW   RCC_CFGR3_TIM16SW_Msk
 
#define RCC_CFGR3_TIM17SW_Pos   (13U)
 
#define RCC_CFGR3_TIM17SW_Msk   (0x1UL << RCC_CFGR3_TIM17SW_Pos)
 
#define RCC_CFGR3_TIM17SW   RCC_CFGR3_TIM17SW_Msk
 
#define RCC_CFGR3_TIM20SW_Pos   (15U)
 
#define RCC_CFGR3_TIM20SW_Msk   (0x1UL << RCC_CFGR3_TIM20SW_Pos)
 
#define RCC_CFGR3_TIM20SW   RCC_CFGR3_TIM20SW_Msk
 
#define RCC_CFGR3_TIM2SW_Pos   (24U)
 
#define RCC_CFGR3_TIM2SW_Msk   (0x1UL << RCC_CFGR3_TIM2SW_Pos)
 
#define RCC_CFGR3_TIM2SW   RCC_CFGR3_TIM2SW_Msk
 
#define RCC_CFGR3_TIM34SW_Pos   (25U)
 
#define RCC_CFGR3_TIM34SW_Msk   (0x1UL << RCC_CFGR3_TIM34SW_Pos)
 
#define RCC_CFGR3_TIM34SW   RCC_CFGR3_TIM34SW_Msk
 
#define RCC_CFGR3_TIM1SW_PCLK2   (0x00000000U)
 
#define RCC_CFGR3_TIM1SW_PLL_Pos   (8U)
 
#define RCC_CFGR3_TIM1SW_PLL_Msk   (0x1UL << RCC_CFGR3_TIM1SW_PLL_Pos)
 
#define RCC_CFGR3_TIM1SW_PLL   RCC_CFGR3_TIM1SW_PLL_Msk
 
#define RCC_CFGR3_TIM8SW_PCLK2   (0x00000000U)
 
#define RCC_CFGR3_TIM8SW_PLL_Pos   (9U)
 
#define RCC_CFGR3_TIM8SW_PLL_Msk   (0x1UL << RCC_CFGR3_TIM8SW_PLL_Pos)
 
#define RCC_CFGR3_TIM8SW_PLL   RCC_CFGR3_TIM8SW_PLL_Msk
 
#define RCC_CFGR3_TIM15SW_PCLK2   (0x00000000U)
 
#define RCC_CFGR3_TIM15SW_PLL_Pos   (10U)
 
#define RCC_CFGR3_TIM15SW_PLL_Msk   (0x1UL << RCC_CFGR3_TIM15SW_PLL_Pos)
 
#define RCC_CFGR3_TIM15SW_PLL   RCC_CFGR3_TIM15SW_PLL_Msk
 
#define RCC_CFGR3_TIM16SW_PCLK2   (0x00000000U)
 
#define RCC_CFGR3_TIM16SW_PLL_Pos   (11U)
 
#define RCC_CFGR3_TIM16SW_PLL_Msk   (0x1UL << RCC_CFGR3_TIM16SW_PLL_Pos)
 
#define RCC_CFGR3_TIM16SW_PLL   RCC_CFGR3_TIM16SW_PLL_Msk
 
#define RCC_CFGR3_TIM17SW_PCLK2   (0x00000000U)
 
#define RCC_CFGR3_TIM17SW_PLL_Pos   (13U)
 
#define RCC_CFGR3_TIM17SW_PLL_Msk   (0x1UL << RCC_CFGR3_TIM17SW_PLL_Pos)
 
#define RCC_CFGR3_TIM17SW_PLL   RCC_CFGR3_TIM17SW_PLL_Msk
 
#define RCC_CFGR3_TIM20SW_PCLK2   (0x00000000U)
 
#define RCC_CFGR3_TIM20SW_PLL_Pos   (15U)
 
#define RCC_CFGR3_TIM20SW_PLL_Msk   (0x1UL << RCC_CFGR3_TIM20SW_PLL_Pos)
 
#define RCC_CFGR3_TIM20SW_PLL   RCC_CFGR3_TIM20SW_PLL_Msk
 
#define RCC_CFGR3_USART2SW_Pos   (16U)
 
#define RCC_CFGR3_USART2SW_Msk   (0x3UL << RCC_CFGR3_USART2SW_Pos)
 
#define RCC_CFGR3_USART2SW   RCC_CFGR3_USART2SW_Msk
 
#define RCC_CFGR3_USART2SW_0   (0x1UL << RCC_CFGR3_USART2SW_Pos)
 
#define RCC_CFGR3_USART2SW_1   (0x2UL << RCC_CFGR3_USART2SW_Pos)
 
#define RCC_CFGR3_USART2SW_PCLK   (0x00000000U)
 
#define RCC_CFGR3_USART2SW_SYSCLK   (0x00010000U)
 
#define RCC_CFGR3_USART2SW_LSE   (0x00020000U)
 
#define RCC_CFGR3_USART2SW_HSI   (0x00030000U)
 
#define RCC_CFGR3_USART3SW_Pos   (18U)
 
#define RCC_CFGR3_USART3SW_Msk   (0x3UL << RCC_CFGR3_USART3SW_Pos)
 
#define RCC_CFGR3_USART3SW   RCC_CFGR3_USART3SW_Msk
 
#define RCC_CFGR3_USART3SW_0   (0x1UL << RCC_CFGR3_USART3SW_Pos)
 
#define RCC_CFGR3_USART3SW_1   (0x2UL << RCC_CFGR3_USART3SW_Pos)
 
#define RCC_CFGR3_USART3SW_PCLK   (0x00000000U)
 
#define RCC_CFGR3_USART3SW_SYSCLK   (0x00040000U)
 
#define RCC_CFGR3_USART3SW_LSE   (0x00080000U)
 
#define RCC_CFGR3_USART3SW_HSI   (0x000C0000U)
 
#define RCC_CFGR3_UART4SW_Pos   (20U)
 
#define RCC_CFGR3_UART4SW_Msk   (0x3UL << RCC_CFGR3_UART4SW_Pos)
 
#define RCC_CFGR3_UART4SW   RCC_CFGR3_UART4SW_Msk
 
#define RCC_CFGR3_UART4SW_0   (0x1UL << RCC_CFGR3_UART4SW_Pos)
 
#define RCC_CFGR3_UART4SW_1   (0x2UL << RCC_CFGR3_UART4SW_Pos)
 
#define RCC_CFGR3_UART4SW_PCLK   (0x00000000U)
 
#define RCC_CFGR3_UART4SW_SYSCLK   (0x00100000U)
 
#define RCC_CFGR3_UART4SW_LSE   (0x00200000U)
 
#define RCC_CFGR3_UART4SW_HSI   (0x00300000U)
 
#define RCC_CFGR3_UART5SW_Pos   (22U)
 
#define RCC_CFGR3_UART5SW_Msk   (0x3UL << RCC_CFGR3_UART5SW_Pos)
 
#define RCC_CFGR3_UART5SW   RCC_CFGR3_UART5SW_Msk
 
#define RCC_CFGR3_UART5SW_0   (0x1UL << RCC_CFGR3_UART5SW_Pos)
 
#define RCC_CFGR3_UART5SW_1   (0x2UL << RCC_CFGR3_UART5SW_Pos)
 
#define RCC_CFGR3_UART5SW_PCLK   (0x00000000U)
 
#define RCC_CFGR3_UART5SW_SYSCLK   (0x00400000U)
 
#define RCC_CFGR3_UART5SW_LSE   (0x00800000U)
 
#define RCC_CFGR3_UART5SW_HSI   (0x00C00000U)
 
#define RCC_CFGR3_TIM2SW_PCLK1   (0x00000000U)
 
#define RCC_CFGR3_TIM2SW_PLL_Pos   (24U)
 
#define RCC_CFGR3_TIM2SW_PLL_Msk   (0x1UL << RCC_CFGR3_TIM2SW_PLL_Pos)
 
#define RCC_CFGR3_TIM2SW_PLL   RCC_CFGR3_TIM2SW_PLL_Msk
 
#define RCC_CFGR3_TIM34SW_PCLK1   (0x00000000U)
 
#define RCC_CFGR3_TIM34SW_PLL_Pos   (25U)
 
#define RCC_CFGR3_TIM34SW_PLL_Msk   (0x1UL << RCC_CFGR3_TIM34SW_PLL_Pos)
 
#define RCC_CFGR3_TIM34SW_PLL   RCC_CFGR3_TIM34SW_PLL_Msk
 
#define RCC_CFGR3_TIM1SW_HCLK   RCC_CFGR3_TIM1SW_PCLK2
 
#define RCC_CFGR3_TIM8SW_HCLK   RCC_CFGR3_TIM8SW_PCLK2
 
#define RCC_CFGR3_TIM15SW_HCLK   RCC_CFGR3_TIM15SW_PCLK2
 
#define RCC_CFGR3_TIM16SW_HCLK   RCC_CFGR3_TIM16SW_PCLK2
 
#define RCC_CFGR3_TIM17SW_HCLK   RCC_CFGR3_TIM17SW_PCLK2
 
#define RCC_CFGR3_TIM20SW_HCLK   RCC_CFGR3_TIM20SW_PCLK2
 
#define RCC_CFGR3_TIM2SW_HCLK   RCC_CFGR3_TIM2SW_PCLK1
 
#define RCC_CFGR3_TIM34SW_HCLK   RCC_CFGR3_TIM34SW_PCLK1
 
#define RTC_TAMPER1_SUPPORT
 
#define RTC_TAMPER2_SUPPORT
 
#define RTC_TAMPER3_SUPPORT
 
#define RTC_BACKUP_SUPPORT
 
#define RTC_WAKEUP_SUPPORT
 
#define RTC_TR_PM_Pos   (22U)
 
#define RTC_TR_PM_Msk   (0x1UL << RTC_TR_PM_Pos)
 
#define RTC_TR_PM   RTC_TR_PM_Msk
 
#define RTC_TR_HT_Pos   (20U)
 
#define RTC_TR_HT_Msk   (0x3UL << RTC_TR_HT_Pos)
 
#define RTC_TR_HT   RTC_TR_HT_Msk
 
#define RTC_TR_HT_0   (0x1UL << RTC_TR_HT_Pos)
 
#define RTC_TR_HT_1   (0x2UL << RTC_TR_HT_Pos)
 
#define RTC_TR_HU_Pos   (16U)
 
#define RTC_TR_HU_Msk   (0xFUL << RTC_TR_HU_Pos)
 
#define RTC_TR_HU   RTC_TR_HU_Msk
 
#define RTC_TR_HU_0   (0x1UL << RTC_TR_HU_Pos)
 
#define RTC_TR_HU_1   (0x2UL << RTC_TR_HU_Pos)
 
#define RTC_TR_HU_2   (0x4UL << RTC_TR_HU_Pos)
 
#define RTC_TR_HU_3   (0x8UL << RTC_TR_HU_Pos)
 
#define RTC_TR_MNT_Pos   (12U)
 
#define RTC_TR_MNT_Msk   (0x7UL << RTC_TR_MNT_Pos)
 
#define RTC_TR_MNT   RTC_TR_MNT_Msk
 
#define RTC_TR_MNT_0   (0x1UL << RTC_TR_MNT_Pos)
 
#define RTC_TR_MNT_1   (0x2UL << RTC_TR_MNT_Pos)
 
#define RTC_TR_MNT_2   (0x4UL << RTC_TR_MNT_Pos)
 
#define RTC_TR_MNU_Pos   (8U)
 
#define RTC_TR_MNU_Msk   (0xFUL << RTC_TR_MNU_Pos)
 
#define RTC_TR_MNU   RTC_TR_MNU_Msk
 
#define RTC_TR_MNU_0   (0x1UL << RTC_TR_MNU_Pos)
 
#define RTC_TR_MNU_1   (0x2UL << RTC_TR_MNU_Pos)
 
#define RTC_TR_MNU_2   (0x4UL << RTC_TR_MNU_Pos)
 
#define RTC_TR_MNU_3   (0x8UL << RTC_TR_MNU_Pos)
 
#define RTC_TR_ST_Pos   (4U)
 
#define RTC_TR_ST_Msk   (0x7UL << RTC_TR_ST_Pos)
 
#define RTC_TR_ST   RTC_TR_ST_Msk
 
#define RTC_TR_ST_0   (0x1UL << RTC_TR_ST_Pos)
 
#define RTC_TR_ST_1   (0x2UL << RTC_TR_ST_Pos)
 
#define RTC_TR_ST_2   (0x4UL << RTC_TR_ST_Pos)
 
#define RTC_TR_SU_Pos   (0U)
 
#define RTC_TR_SU_Msk   (0xFUL << RTC_TR_SU_Pos)
 
#define RTC_TR_SU   RTC_TR_SU_Msk
 
#define RTC_TR_SU_0   (0x1UL << RTC_TR_SU_Pos)
 
#define RTC_TR_SU_1   (0x2UL << RTC_TR_SU_Pos)
 
#define RTC_TR_SU_2   (0x4UL << RTC_TR_SU_Pos)
 
#define RTC_TR_SU_3   (0x8UL << RTC_TR_SU_Pos)
 
#define RTC_DR_YT_Pos   (20U)
 
#define RTC_DR_YT_Msk   (0xFUL << RTC_DR_YT_Pos)
 
#define RTC_DR_YT   RTC_DR_YT_Msk
 
#define RTC_DR_YT_0   (0x1UL << RTC_DR_YT_Pos)
 
#define RTC_DR_YT_1   (0x2UL << RTC_DR_YT_Pos)
 
#define RTC_DR_YT_2   (0x4UL << RTC_DR_YT_Pos)
 
#define RTC_DR_YT_3   (0x8UL << RTC_DR_YT_Pos)
 
#define RTC_DR_YU_Pos   (16U)
 
#define RTC_DR_YU_Msk   (0xFUL << RTC_DR_YU_Pos)
 
#define RTC_DR_YU   RTC_DR_YU_Msk
 
#define RTC_DR_YU_0   (0x1UL << RTC_DR_YU_Pos)
 
#define RTC_DR_YU_1   (0x2UL << RTC_DR_YU_Pos)
 
#define RTC_DR_YU_2   (0x4UL << RTC_DR_YU_Pos)
 
#define RTC_DR_YU_3   (0x8UL << RTC_DR_YU_Pos)
 
#define RTC_DR_WDU_Pos   (13U)
 
#define RTC_DR_WDU_Msk   (0x7UL << RTC_DR_WDU_Pos)
 
#define RTC_DR_WDU   RTC_DR_WDU_Msk
 
#define RTC_DR_WDU_0   (0x1UL << RTC_DR_WDU_Pos)
 
#define RTC_DR_WDU_1   (0x2UL << RTC_DR_WDU_Pos)
 
#define RTC_DR_WDU_2   (0x4UL << RTC_DR_WDU_Pos)
 
#define RTC_DR_MT_Pos   (12U)
 
#define RTC_DR_MT_Msk   (0x1UL << RTC_DR_MT_Pos)
 
#define RTC_DR_MT   RTC_DR_MT_Msk
 
#define RTC_DR_MU_Pos   (8U)
 
#define RTC_DR_MU_Msk   (0xFUL << RTC_DR_MU_Pos)
 
#define RTC_DR_MU   RTC_DR_MU_Msk
 
#define RTC_DR_MU_0   (0x1UL << RTC_DR_MU_Pos)
 
#define RTC_DR_MU_1   (0x2UL << RTC_DR_MU_Pos)
 
#define RTC_DR_MU_2   (0x4UL << RTC_DR_MU_Pos)
 
#define RTC_DR_MU_3   (0x8UL << RTC_DR_MU_Pos)
 
#define RTC_DR_DT_Pos   (4U)
 
#define RTC_DR_DT_Msk   (0x3UL << RTC_DR_DT_Pos)
 
#define RTC_DR_DT   RTC_DR_DT_Msk
 
#define RTC_DR_DT_0   (0x1UL << RTC_DR_DT_Pos)
 
#define RTC_DR_DT_1   (0x2UL << RTC_DR_DT_Pos)
 
#define RTC_DR_DU_Pos   (0U)
 
#define RTC_DR_DU_Msk   (0xFUL << RTC_DR_DU_Pos)
 
#define RTC_DR_DU   RTC_DR_DU_Msk
 
#define RTC_DR_DU_0   (0x1UL << RTC_DR_DU_Pos)
 
#define RTC_DR_DU_1   (0x2UL << RTC_DR_DU_Pos)
 
#define RTC_DR_DU_2   (0x4UL << RTC_DR_DU_Pos)
 
#define RTC_DR_DU_3   (0x8UL << RTC_DR_DU_Pos)
 
#define RTC_CR_COE_Pos   (23U)
 
#define RTC_CR_COE_Msk   (0x1UL << RTC_CR_COE_Pos)
 
#define RTC_CR_COE   RTC_CR_COE_Msk
 
#define RTC_CR_OSEL_Pos   (21U)
 
#define RTC_CR_OSEL_Msk   (0x3UL << RTC_CR_OSEL_Pos)
 
#define RTC_CR_OSEL   RTC_CR_OSEL_Msk
 
#define RTC_CR_OSEL_0   (0x1UL << RTC_CR_OSEL_Pos)
 
#define RTC_CR_OSEL_1   (0x2UL << RTC_CR_OSEL_Pos)
 
#define RTC_CR_POL_Pos   (20U)
 
#define RTC_CR_POL_Msk   (0x1UL << RTC_CR_POL_Pos)
 
#define RTC_CR_POL   RTC_CR_POL_Msk
 
#define RTC_CR_COSEL_Pos   (19U)
 
#define RTC_CR_COSEL_Msk   (0x1UL << RTC_CR_COSEL_Pos)
 
#define RTC_CR_COSEL   RTC_CR_COSEL_Msk
 
#define RTC_CR_BKP_Pos   (18U)
 
#define RTC_CR_BKP_Msk   (0x1UL << RTC_CR_BKP_Pos)
 
#define RTC_CR_BKP   RTC_CR_BKP_Msk
 
#define RTC_CR_SUB1H_Pos   (17U)
 
#define RTC_CR_SUB1H_Msk   (0x1UL << RTC_CR_SUB1H_Pos)
 
#define RTC_CR_SUB1H   RTC_CR_SUB1H_Msk
 
#define RTC_CR_ADD1H_Pos   (16U)
 
#define RTC_CR_ADD1H_Msk   (0x1UL << RTC_CR_ADD1H_Pos)
 
#define RTC_CR_ADD1H   RTC_CR_ADD1H_Msk
 
#define RTC_CR_TSIE_Pos   (15U)
 
#define RTC_CR_TSIE_Msk   (0x1UL << RTC_CR_TSIE_Pos)
 
#define RTC_CR_TSIE   RTC_CR_TSIE_Msk
 
#define RTC_CR_WUTIE_Pos   (14U)
 
#define RTC_CR_WUTIE_Msk   (0x1UL << RTC_CR_WUTIE_Pos)
 
#define RTC_CR_WUTIE   RTC_CR_WUTIE_Msk
 
#define RTC_CR_ALRBIE_Pos   (13U)
 
#define RTC_CR_ALRBIE_Msk   (0x1UL << RTC_CR_ALRBIE_Pos)
 
#define RTC_CR_ALRBIE   RTC_CR_ALRBIE_Msk
 
#define RTC_CR_ALRAIE_Pos   (12U)
 
#define RTC_CR_ALRAIE_Msk   (0x1UL << RTC_CR_ALRAIE_Pos)
 
#define RTC_CR_ALRAIE   RTC_CR_ALRAIE_Msk
 
#define RTC_CR_TSE_Pos   (11U)
 
#define RTC_CR_TSE_Msk   (0x1UL << RTC_CR_TSE_Pos)
 
#define RTC_CR_TSE   RTC_CR_TSE_Msk
 
#define RTC_CR_WUTE_Pos   (10U)
 
#define RTC_CR_WUTE_Msk   (0x1UL << RTC_CR_WUTE_Pos)
 
#define RTC_CR_WUTE   RTC_CR_WUTE_Msk
 
#define RTC_CR_ALRBE_Pos   (9U)
 
#define RTC_CR_ALRBE_Msk   (0x1UL << RTC_CR_ALRBE_Pos)
 
#define RTC_CR_ALRBE   RTC_CR_ALRBE_Msk
 
#define RTC_CR_ALRAE_Pos   (8U)
 
#define RTC_CR_ALRAE_Msk   (0x1UL << RTC_CR_ALRAE_Pos)
 
#define RTC_CR_ALRAE   RTC_CR_ALRAE_Msk
 
#define RTC_CR_FMT_Pos   (6U)
 
#define RTC_CR_FMT_Msk   (0x1UL << RTC_CR_FMT_Pos)
 
#define RTC_CR_FMT   RTC_CR_FMT_Msk
 
#define RTC_CR_BYPSHAD_Pos   (5U)
 
#define RTC_CR_BYPSHAD_Msk   (0x1UL << RTC_CR_BYPSHAD_Pos)
 
#define RTC_CR_BYPSHAD   RTC_CR_BYPSHAD_Msk
 
#define RTC_CR_REFCKON_Pos   (4U)
 
#define RTC_CR_REFCKON_Msk   (0x1UL << RTC_CR_REFCKON_Pos)
 
#define RTC_CR_REFCKON   RTC_CR_REFCKON_Msk
 
#define RTC_CR_TSEDGE_Pos   (3U)
 
#define RTC_CR_TSEDGE_Msk   (0x1UL << RTC_CR_TSEDGE_Pos)
 
#define RTC_CR_TSEDGE   RTC_CR_TSEDGE_Msk
 
#define RTC_CR_WUCKSEL_Pos   (0U)
 
#define RTC_CR_WUCKSEL_Msk   (0x7UL << RTC_CR_WUCKSEL_Pos)
 
#define RTC_CR_WUCKSEL   RTC_CR_WUCKSEL_Msk
 
#define RTC_CR_WUCKSEL_0   (0x1UL << RTC_CR_WUCKSEL_Pos)
 
#define RTC_CR_WUCKSEL_1   (0x2UL << RTC_CR_WUCKSEL_Pos)
 
#define RTC_CR_WUCKSEL_2   (0x4UL << RTC_CR_WUCKSEL_Pos)
 
#define RTC_CR_BCK_Pos   RTC_CR_BKP_Pos
 
#define RTC_CR_BCK_Msk   RTC_CR_BKP_Msk
 
#define RTC_CR_BCK   RTC_CR_BKP
 
#define RTC_ISR_RECALPF_Pos   (16U)
 
#define RTC_ISR_RECALPF_Msk   (0x1UL << RTC_ISR_RECALPF_Pos)
 
#define RTC_ISR_RECALPF   RTC_ISR_RECALPF_Msk
 
#define RTC_ISR_TAMP3F_Pos   (15U)
 
#define RTC_ISR_TAMP3F_Msk   (0x1UL << RTC_ISR_TAMP3F_Pos)
 
#define RTC_ISR_TAMP3F   RTC_ISR_TAMP3F_Msk
 
#define RTC_ISR_TAMP2F_Pos   (14U)
 
#define RTC_ISR_TAMP2F_Msk   (0x1UL << RTC_ISR_TAMP2F_Pos)
 
#define RTC_ISR_TAMP2F   RTC_ISR_TAMP2F_Msk
 
#define RTC_ISR_TAMP1F_Pos   (13U)
 
#define RTC_ISR_TAMP1F_Msk   (0x1UL << RTC_ISR_TAMP1F_Pos)
 
#define RTC_ISR_TAMP1F   RTC_ISR_TAMP1F_Msk
 
#define RTC_ISR_TSOVF_Pos   (12U)
 
#define RTC_ISR_TSOVF_Msk   (0x1UL << RTC_ISR_TSOVF_Pos)
 
#define RTC_ISR_TSOVF   RTC_ISR_TSOVF_Msk
 
#define RTC_ISR_TSF_Pos   (11U)
 
#define RTC_ISR_TSF_Msk   (0x1UL << RTC_ISR_TSF_Pos)
 
#define RTC_ISR_TSF   RTC_ISR_TSF_Msk
 
#define RTC_ISR_WUTF_Pos   (10U)
 
#define RTC_ISR_WUTF_Msk   (0x1UL << RTC_ISR_WUTF_Pos)
 
#define RTC_ISR_WUTF   RTC_ISR_WUTF_Msk
 
#define RTC_ISR_ALRBF_Pos   (9U)
 
#define RTC_ISR_ALRBF_Msk   (0x1UL << RTC_ISR_ALRBF_Pos)
 
#define RTC_ISR_ALRBF   RTC_ISR_ALRBF_Msk
 
#define RTC_ISR_ALRAF_Pos   (8U)
 
#define RTC_ISR_ALRAF_Msk   (0x1UL << RTC_ISR_ALRAF_Pos)
 
#define RTC_ISR_ALRAF   RTC_ISR_ALRAF_Msk
 
#define RTC_ISR_INIT_Pos   (7U)
 
#define RTC_ISR_INIT_Msk   (0x1UL << RTC_ISR_INIT_Pos)
 
#define RTC_ISR_INIT   RTC_ISR_INIT_Msk
 
#define RTC_ISR_INITF_Pos   (6U)
 
#define RTC_ISR_INITF_Msk   (0x1UL << RTC_ISR_INITF_Pos)
 
#define RTC_ISR_INITF   RTC_ISR_INITF_Msk
 
#define RTC_ISR_RSF_Pos   (5U)
 
#define RTC_ISR_RSF_Msk   (0x1UL << RTC_ISR_RSF_Pos)
 
#define RTC_ISR_RSF   RTC_ISR_RSF_Msk
 
#define RTC_ISR_INITS_Pos   (4U)
 
#define RTC_ISR_INITS_Msk   (0x1UL << RTC_ISR_INITS_Pos)
 
#define RTC_ISR_INITS   RTC_ISR_INITS_Msk
 
#define RTC_ISR_SHPF_Pos   (3U)
 
#define RTC_ISR_SHPF_Msk   (0x1UL << RTC_ISR_SHPF_Pos)
 
#define RTC_ISR_SHPF   RTC_ISR_SHPF_Msk
 
#define RTC_ISR_WUTWF_Pos   (2U)
 
#define RTC_ISR_WUTWF_Msk   (0x1UL << RTC_ISR_WUTWF_Pos)
 
#define RTC_ISR_WUTWF   RTC_ISR_WUTWF_Msk
 
#define RTC_ISR_ALRBWF_Pos   (1U)
 
#define RTC_ISR_ALRBWF_Msk   (0x1UL << RTC_ISR_ALRBWF_Pos)
 
#define RTC_ISR_ALRBWF   RTC_ISR_ALRBWF_Msk
 
#define RTC_ISR_ALRAWF_Pos   (0U)
 
#define RTC_ISR_ALRAWF_Msk   (0x1UL << RTC_ISR_ALRAWF_Pos)
 
#define RTC_ISR_ALRAWF   RTC_ISR_ALRAWF_Msk
 
#define RTC_PRER_PREDIV_A_Pos   (16U)
 
#define RTC_PRER_PREDIV_A_Msk   (0x7FUL << RTC_PRER_PREDIV_A_Pos)
 
#define RTC_PRER_PREDIV_A   RTC_PRER_PREDIV_A_Msk
 
#define RTC_PRER_PREDIV_S_Pos   (0U)
 
#define RTC_PRER_PREDIV_S_Msk   (0x7FFFUL << RTC_PRER_PREDIV_S_Pos)
 
#define RTC_PRER_PREDIV_S   RTC_PRER_PREDIV_S_Msk
 
#define RTC_WUTR_WUT_Pos   (0U)
 
#define RTC_WUTR_WUT_Msk   (0xFFFFUL << RTC_WUTR_WUT_Pos)
 
#define RTC_WUTR_WUT   RTC_WUTR_WUT_Msk
 
#define RTC_ALRMAR_MSK4_Pos   (31U)
 
#define RTC_ALRMAR_MSK4_Msk   (0x1UL << RTC_ALRMAR_MSK4_Pos)
 
#define RTC_ALRMAR_MSK4   RTC_ALRMAR_MSK4_Msk
 
#define RTC_ALRMAR_WDSEL_Pos   (30U)
 
#define RTC_ALRMAR_WDSEL_Msk   (0x1UL << RTC_ALRMAR_WDSEL_Pos)
 
#define RTC_ALRMAR_WDSEL   RTC_ALRMAR_WDSEL_Msk
 
#define RTC_ALRMAR_DT_Pos   (28U)
 
#define RTC_ALRMAR_DT_Msk   (0x3UL << RTC_ALRMAR_DT_Pos)
 
#define RTC_ALRMAR_DT   RTC_ALRMAR_DT_Msk
 
#define RTC_ALRMAR_DT_0   (0x1UL << RTC_ALRMAR_DT_Pos)
 
#define RTC_ALRMAR_DT_1   (0x2UL << RTC_ALRMAR_DT_Pos)
 
#define RTC_ALRMAR_DU_Pos   (24U)
 
#define RTC_ALRMAR_DU_Msk   (0xFUL << RTC_ALRMAR_DU_Pos)
 
#define RTC_ALRMAR_DU   RTC_ALRMAR_DU_Msk
 
#define RTC_ALRMAR_DU_0   (0x1UL << RTC_ALRMAR_DU_Pos)
 
#define RTC_ALRMAR_DU_1   (0x2UL << RTC_ALRMAR_DU_Pos)
 
#define RTC_ALRMAR_DU_2   (0x4UL << RTC_ALRMAR_DU_Pos)
 
#define RTC_ALRMAR_DU_3   (0x8UL << RTC_ALRMAR_DU_Pos)
 
#define RTC_ALRMAR_MSK3_Pos   (23U)
 
#define RTC_ALRMAR_MSK3_Msk   (0x1UL << RTC_ALRMAR_MSK3_Pos)
 
#define RTC_ALRMAR_MSK3   RTC_ALRMAR_MSK3_Msk
 
#define RTC_ALRMAR_PM_Pos   (22U)
 
#define RTC_ALRMAR_PM_Msk   (0x1UL << RTC_ALRMAR_PM_Pos)
 
#define RTC_ALRMAR_PM   RTC_ALRMAR_PM_Msk
 
#define RTC_ALRMAR_HT_Pos   (20U)
 
#define RTC_ALRMAR_HT_Msk   (0x3UL << RTC_ALRMAR_HT_Pos)
 
#define RTC_ALRMAR_HT   RTC_ALRMAR_HT_Msk
 
#define RTC_ALRMAR_HT_0   (0x1UL << RTC_ALRMAR_HT_Pos)
 
#define RTC_ALRMAR_HT_1   (0x2UL << RTC_ALRMAR_HT_Pos)
 
#define RTC_ALRMAR_HU_Pos   (16U)
 
#define RTC_ALRMAR_HU_Msk   (0xFUL << RTC_ALRMAR_HU_Pos)
 
#define RTC_ALRMAR_HU   RTC_ALRMAR_HU_Msk
 
#define RTC_ALRMAR_HU_0   (0x1UL << RTC_ALRMAR_HU_Pos)
 
#define RTC_ALRMAR_HU_1   (0x2UL << RTC_ALRMAR_HU_Pos)
 
#define RTC_ALRMAR_HU_2   (0x4UL << RTC_ALRMAR_HU_Pos)
 
#define RTC_ALRMAR_HU_3   (0x8UL << RTC_ALRMAR_HU_Pos)
 
#define RTC_ALRMAR_MSK2_Pos   (15U)
 
#define RTC_ALRMAR_MSK2_Msk   (0x1UL << RTC_ALRMAR_MSK2_Pos)
 
#define RTC_ALRMAR_MSK2   RTC_ALRMAR_MSK2_Msk
 
#define RTC_ALRMAR_MNT_Pos   (12U)
 
#define RTC_ALRMAR_MNT_Msk   (0x7UL << RTC_ALRMAR_MNT_Pos)
 
#define RTC_ALRMAR_MNT   RTC_ALRMAR_MNT_Msk
 
#define RTC_ALRMAR_MNT_0   (0x1UL << RTC_ALRMAR_MNT_Pos)
 
#define RTC_ALRMAR_MNT_1   (0x2UL << RTC_ALRMAR_MNT_Pos)
 
#define RTC_ALRMAR_MNT_2   (0x4UL << RTC_ALRMAR_MNT_Pos)
 
#define RTC_ALRMAR_MNU_Pos   (8U)
 
#define RTC_ALRMAR_MNU_Msk   (0xFUL << RTC_ALRMAR_MNU_Pos)
 
#define RTC_ALRMAR_MNU   RTC_ALRMAR_MNU_Msk
 
#define RTC_ALRMAR_MNU_0   (0x1UL << RTC_ALRMAR_MNU_Pos)
 
#define RTC_ALRMAR_MNU_1   (0x2UL << RTC_ALRMAR_MNU_Pos)
 
#define RTC_ALRMAR_MNU_2   (0x4UL << RTC_ALRMAR_MNU_Pos)
 
#define RTC_ALRMAR_MNU_3   (0x8UL << RTC_ALRMAR_MNU_Pos)
 
#define RTC_ALRMAR_MSK1_Pos   (7U)
 
#define RTC_ALRMAR_MSK1_Msk   (0x1UL << RTC_ALRMAR_MSK1_Pos)
 
#define RTC_ALRMAR_MSK1   RTC_ALRMAR_MSK1_Msk
 
#define RTC_ALRMAR_ST_Pos   (4U)
 
#define RTC_ALRMAR_ST_Msk   (0x7UL << RTC_ALRMAR_ST_Pos)
 
#define RTC_ALRMAR_ST   RTC_ALRMAR_ST_Msk
 
#define RTC_ALRMAR_ST_0   (0x1UL << RTC_ALRMAR_ST_Pos)
 
#define RTC_ALRMAR_ST_1   (0x2UL << RTC_ALRMAR_ST_Pos)
 
#define RTC_ALRMAR_ST_2   (0x4UL << RTC_ALRMAR_ST_Pos)
 
#define RTC_ALRMAR_SU_Pos   (0U)
 
#define RTC_ALRMAR_SU_Msk   (0xFUL << RTC_ALRMAR_SU_Pos)
 
#define RTC_ALRMAR_SU   RTC_ALRMAR_SU_Msk
 
#define RTC_ALRMAR_SU_0   (0x1UL << RTC_ALRMAR_SU_Pos)
 
#define RTC_ALRMAR_SU_1   (0x2UL << RTC_ALRMAR_SU_Pos)
 
#define RTC_ALRMAR_SU_2   (0x4UL << RTC_ALRMAR_SU_Pos)
 
#define RTC_ALRMAR_SU_3   (0x8UL << RTC_ALRMAR_SU_Pos)
 
#define RTC_ALRMBR_MSK4_Pos   (31U)
 
#define RTC_ALRMBR_MSK4_Msk   (0x1UL << RTC_ALRMBR_MSK4_Pos)
 
#define RTC_ALRMBR_MSK4   RTC_ALRMBR_MSK4_Msk
 
#define RTC_ALRMBR_WDSEL_Pos   (30U)
 
#define RTC_ALRMBR_WDSEL_Msk   (0x1UL << RTC_ALRMBR_WDSEL_Pos)
 
#define RTC_ALRMBR_WDSEL   RTC_ALRMBR_WDSEL_Msk
 
#define RTC_ALRMBR_DT_Pos   (28U)
 
#define RTC_ALRMBR_DT_Msk   (0x3UL << RTC_ALRMBR_DT_Pos)
 
#define RTC_ALRMBR_DT   RTC_ALRMBR_DT_Msk
 
#define RTC_ALRMBR_DT_0   (0x1UL << RTC_ALRMBR_DT_Pos)
 
#define RTC_ALRMBR_DT_1   (0x2UL << RTC_ALRMBR_DT_Pos)
 
#define RTC_ALRMBR_DU_Pos   (24U)
 
#define RTC_ALRMBR_DU_Msk   (0xFUL << RTC_ALRMBR_DU_Pos)
 
#define RTC_ALRMBR_DU   RTC_ALRMBR_DU_Msk
 
#define RTC_ALRMBR_DU_0   (0x1UL << RTC_ALRMBR_DU_Pos)
 
#define RTC_ALRMBR_DU_1   (0x2UL << RTC_ALRMBR_DU_Pos)
 
#define RTC_ALRMBR_DU_2   (0x4UL << RTC_ALRMBR_DU_Pos)
 
#define RTC_ALRMBR_DU_3   (0x8UL << RTC_ALRMBR_DU_Pos)
 
#define RTC_ALRMBR_MSK3_Pos   (23U)
 
#define RTC_ALRMBR_MSK3_Msk   (0x1UL << RTC_ALRMBR_MSK3_Pos)
 
#define RTC_ALRMBR_MSK3   RTC_ALRMBR_MSK3_Msk
 
#define RTC_ALRMBR_PM_Pos   (22U)
 
#define RTC_ALRMBR_PM_Msk   (0x1UL << RTC_ALRMBR_PM_Pos)
 
#define RTC_ALRMBR_PM   RTC_ALRMBR_PM_Msk
 
#define RTC_ALRMBR_HT_Pos   (20U)
 
#define RTC_ALRMBR_HT_Msk   (0x3UL << RTC_ALRMBR_HT_Pos)
 
#define RTC_ALRMBR_HT   RTC_ALRMBR_HT_Msk
 
#define RTC_ALRMBR_HT_0   (0x1UL << RTC_ALRMBR_HT_Pos)
 
#define RTC_ALRMBR_HT_1   (0x2UL << RTC_ALRMBR_HT_Pos)
 
#define RTC_ALRMBR_HU_Pos   (16U)
 
#define RTC_ALRMBR_HU_Msk   (0xFUL << RTC_ALRMBR_HU_Pos)
 
#define RTC_ALRMBR_HU   RTC_ALRMBR_HU_Msk
 
#define RTC_ALRMBR_HU_0   (0x1UL << RTC_ALRMBR_HU_Pos)
 
#define RTC_ALRMBR_HU_1   (0x2UL << RTC_ALRMBR_HU_Pos)
 
#define RTC_ALRMBR_HU_2   (0x4UL << RTC_ALRMBR_HU_Pos)
 
#define RTC_ALRMBR_HU_3   (0x8UL << RTC_ALRMBR_HU_Pos)
 
#define RTC_ALRMBR_MSK2_Pos   (15U)
 
#define RTC_ALRMBR_MSK2_Msk   (0x1UL << RTC_ALRMBR_MSK2_Pos)
 
#define RTC_ALRMBR_MSK2   RTC_ALRMBR_MSK2_Msk
 
#define RTC_ALRMBR_MNT_Pos   (12U)
 
#define RTC_ALRMBR_MNT_Msk   (0x7UL << RTC_ALRMBR_MNT_Pos)
 
#define RTC_ALRMBR_MNT   RTC_ALRMBR_MNT_Msk
 
#define RTC_ALRMBR_MNT_0   (0x1UL << RTC_ALRMBR_MNT_Pos)
 
#define RTC_ALRMBR_MNT_1   (0x2UL << RTC_ALRMBR_MNT_Pos)
 
#define RTC_ALRMBR_MNT_2   (0x4UL << RTC_ALRMBR_MNT_Pos)
 
#define RTC_ALRMBR_MNU_Pos   (8U)
 
#define RTC_ALRMBR_MNU_Msk   (0xFUL << RTC_ALRMBR_MNU_Pos)
 
#define RTC_ALRMBR_MNU   RTC_ALRMBR_MNU_Msk
 
#define RTC_ALRMBR_MNU_0   (0x1UL << RTC_ALRMBR_MNU_Pos)
 
#define RTC_ALRMBR_MNU_1   (0x2UL << RTC_ALRMBR_MNU_Pos)
 
#define RTC_ALRMBR_MNU_2   (0x4UL << RTC_ALRMBR_MNU_Pos)
 
#define RTC_ALRMBR_MNU_3   (0x8UL << RTC_ALRMBR_MNU_Pos)
 
#define RTC_ALRMBR_MSK1_Pos   (7U)
 
#define RTC_ALRMBR_MSK1_Msk   (0x1UL << RTC_ALRMBR_MSK1_Pos)
 
#define RTC_ALRMBR_MSK1   RTC_ALRMBR_MSK1_Msk
 
#define RTC_ALRMBR_ST_Pos   (4U)
 
#define RTC_ALRMBR_ST_Msk   (0x7UL << RTC_ALRMBR_ST_Pos)
 
#define RTC_ALRMBR_ST   RTC_ALRMBR_ST_Msk
 
#define RTC_ALRMBR_ST_0   (0x1UL << RTC_ALRMBR_ST_Pos)
 
#define RTC_ALRMBR_ST_1   (0x2UL << RTC_ALRMBR_ST_Pos)
 
#define RTC_ALRMBR_ST_2   (0x4UL << RTC_ALRMBR_ST_Pos)
 
#define RTC_ALRMBR_SU_Pos   (0U)
 
#define RTC_ALRMBR_SU_Msk   (0xFUL << RTC_ALRMBR_SU_Pos)
 
#define RTC_ALRMBR_SU   RTC_ALRMBR_SU_Msk
 
#define RTC_ALRMBR_SU_0   (0x1UL << RTC_ALRMBR_SU_Pos)
 
#define RTC_ALRMBR_SU_1   (0x2UL << RTC_ALRMBR_SU_Pos)
 
#define RTC_ALRMBR_SU_2   (0x4UL << RTC_ALRMBR_SU_Pos)
 
#define RTC_ALRMBR_SU_3   (0x8UL << RTC_ALRMBR_SU_Pos)
 
#define RTC_WPR_KEY_Pos   (0U)
 
#define RTC_WPR_KEY_Msk   (0xFFUL << RTC_WPR_KEY_Pos)
 
#define RTC_WPR_KEY   RTC_WPR_KEY_Msk
 
#define RTC_SSR_SS_Pos   (0U)
 
#define RTC_SSR_SS_Msk   (0xFFFFUL << RTC_SSR_SS_Pos)
 
#define RTC_SSR_SS   RTC_SSR_SS_Msk
 
#define RTC_SHIFTR_SUBFS_Pos   (0U)
 
#define RTC_SHIFTR_SUBFS_Msk   (0x7FFFUL << RTC_SHIFTR_SUBFS_Pos)
 
#define RTC_SHIFTR_SUBFS   RTC_SHIFTR_SUBFS_Msk
 
#define RTC_SHIFTR_ADD1S_Pos   (31U)
 
#define RTC_SHIFTR_ADD1S_Msk   (0x1UL << RTC_SHIFTR_ADD1S_Pos)
 
#define RTC_SHIFTR_ADD1S   RTC_SHIFTR_ADD1S_Msk
 
#define RTC_TSTR_PM_Pos   (22U)
 
#define RTC_TSTR_PM_Msk   (0x1UL << RTC_TSTR_PM_Pos)
 
#define RTC_TSTR_PM   RTC_TSTR_PM_Msk
 
#define RTC_TSTR_HT_Pos   (20U)
 
#define RTC_TSTR_HT_Msk   (0x3UL << RTC_TSTR_HT_Pos)
 
#define RTC_TSTR_HT   RTC_TSTR_HT_Msk
 
#define RTC_TSTR_HT_0   (0x1UL << RTC_TSTR_HT_Pos)
 
#define RTC_TSTR_HT_1   (0x2UL << RTC_TSTR_HT_Pos)
 
#define RTC_TSTR_HU_Pos   (16U)
 
#define RTC_TSTR_HU_Msk   (0xFUL << RTC_TSTR_HU_Pos)
 
#define RTC_TSTR_HU   RTC_TSTR_HU_Msk
 
#define RTC_TSTR_HU_0   (0x1UL << RTC_TSTR_HU_Pos)
 
#define RTC_TSTR_HU_1   (0x2UL << RTC_TSTR_HU_Pos)
 
#define RTC_TSTR_HU_2   (0x4UL << RTC_TSTR_HU_Pos)
 
#define RTC_TSTR_HU_3   (0x8UL << RTC_TSTR_HU_Pos)
 
#define RTC_TSTR_MNT_Pos   (12U)
 
#define RTC_TSTR_MNT_Msk   (0x7UL << RTC_TSTR_MNT_Pos)
 
#define RTC_TSTR_MNT   RTC_TSTR_MNT_Msk
 
#define RTC_TSTR_MNT_0   (0x1UL << RTC_TSTR_MNT_Pos)
 
#define RTC_TSTR_MNT_1   (0x2UL << RTC_TSTR_MNT_Pos)
 
#define RTC_TSTR_MNT_2   (0x4UL << RTC_TSTR_MNT_Pos)
 
#define RTC_TSTR_MNU_Pos   (8U)
 
#define RTC_TSTR_MNU_Msk   (0xFUL << RTC_TSTR_MNU_Pos)
 
#define RTC_TSTR_MNU   RTC_TSTR_MNU_Msk
 
#define RTC_TSTR_MNU_0   (0x1UL << RTC_TSTR_MNU_Pos)
 
#define RTC_TSTR_MNU_1   (0x2UL << RTC_TSTR_MNU_Pos)
 
#define RTC_TSTR_MNU_2   (0x4UL << RTC_TSTR_MNU_Pos)
 
#define RTC_TSTR_MNU_3   (0x8UL << RTC_TSTR_MNU_Pos)
 
#define RTC_TSTR_ST_Pos   (4U)
 
#define RTC_TSTR_ST_Msk   (0x7UL << RTC_TSTR_ST_Pos)
 
#define RTC_TSTR_ST   RTC_TSTR_ST_Msk
 
#define RTC_TSTR_ST_0   (0x1UL << RTC_TSTR_ST_Pos)
 
#define RTC_TSTR_ST_1   (0x2UL << RTC_TSTR_ST_Pos)
 
#define RTC_TSTR_ST_2   (0x4UL << RTC_TSTR_ST_Pos)
 
#define RTC_TSTR_SU_Pos   (0U)
 
#define RTC_TSTR_SU_Msk   (0xFUL << RTC_TSTR_SU_Pos)
 
#define RTC_TSTR_SU   RTC_TSTR_SU_Msk
 
#define RTC_TSTR_SU_0   (0x1UL << RTC_TSTR_SU_Pos)
 
#define RTC_TSTR_SU_1   (0x2UL << RTC_TSTR_SU_Pos)
 
#define RTC_TSTR_SU_2   (0x4UL << RTC_TSTR_SU_Pos)
 
#define RTC_TSTR_SU_3   (0x8UL << RTC_TSTR_SU_Pos)
 
#define RTC_TSDR_WDU_Pos   (13U)
 
#define RTC_TSDR_WDU_Msk   (0x7UL << RTC_TSDR_WDU_Pos)
 
#define RTC_TSDR_WDU   RTC_TSDR_WDU_Msk
 
#define RTC_TSDR_WDU_0   (0x1UL << RTC_TSDR_WDU_Pos)
 
#define RTC_TSDR_WDU_1   (0x2UL << RTC_TSDR_WDU_Pos)
 
#define RTC_TSDR_WDU_2   (0x4UL << RTC_TSDR_WDU_Pos)
 
#define RTC_TSDR_MT_Pos   (12U)
 
#define RTC_TSDR_MT_Msk   (0x1UL << RTC_TSDR_MT_Pos)
 
#define RTC_TSDR_MT   RTC_TSDR_MT_Msk
 
#define RTC_TSDR_MU_Pos   (8U)
 
#define RTC_TSDR_MU_Msk   (0xFUL << RTC_TSDR_MU_Pos)
 
#define RTC_TSDR_MU   RTC_TSDR_MU_Msk
 
#define RTC_TSDR_MU_0   (0x1UL << RTC_TSDR_MU_Pos)
 
#define RTC_TSDR_MU_1   (0x2UL << RTC_TSDR_MU_Pos)
 
#define RTC_TSDR_MU_2   (0x4UL << RTC_TSDR_MU_Pos)
 
#define RTC_TSDR_MU_3   (0x8UL << RTC_TSDR_MU_Pos)
 
#define RTC_TSDR_DT_Pos   (4U)
 
#define RTC_TSDR_DT_Msk   (0x3UL << RTC_TSDR_DT_Pos)
 
#define RTC_TSDR_DT   RTC_TSDR_DT_Msk
 
#define RTC_TSDR_DT_0   (0x1UL << RTC_TSDR_DT_Pos)
 
#define RTC_TSDR_DT_1   (0x2UL << RTC_TSDR_DT_Pos)
 
#define RTC_TSDR_DU_Pos   (0U)
 
#define RTC_TSDR_DU_Msk   (0xFUL << RTC_TSDR_DU_Pos)
 
#define RTC_TSDR_DU   RTC_TSDR_DU_Msk
 
#define RTC_TSDR_DU_0   (0x1UL << RTC_TSDR_DU_Pos)
 
#define RTC_TSDR_DU_1   (0x2UL << RTC_TSDR_DU_Pos)
 
#define RTC_TSDR_DU_2   (0x4UL << RTC_TSDR_DU_Pos)
 
#define RTC_TSDR_DU_3   (0x8UL << RTC_TSDR_DU_Pos)
 
#define RTC_TSSSR_SS_Pos   (0U)
 
#define RTC_TSSSR_SS_Msk   (0xFFFFUL << RTC_TSSSR_SS_Pos)
 
#define RTC_TSSSR_SS   RTC_TSSSR_SS_Msk
 
#define RTC_CALR_CALP_Pos   (15U)
 
#define RTC_CALR_CALP_Msk   (0x1UL << RTC_CALR_CALP_Pos)
 
#define RTC_CALR_CALP   RTC_CALR_CALP_Msk
 
#define RTC_CALR_CALW8_Pos   (14U)
 
#define RTC_CALR_CALW8_Msk   (0x1UL << RTC_CALR_CALW8_Pos)
 
#define RTC_CALR_CALW8   RTC_CALR_CALW8_Msk
 
#define RTC_CALR_CALW16_Pos   (13U)
 
#define RTC_CALR_CALW16_Msk   (0x1UL << RTC_CALR_CALW16_Pos)
 
#define RTC_CALR_CALW16   RTC_CALR_CALW16_Msk
 
#define RTC_CALR_CALM_Pos   (0U)
 
#define RTC_CALR_CALM_Msk   (0x1FFUL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM   RTC_CALR_CALM_Msk
 
#define RTC_CALR_CALM_0   (0x001UL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM_1   (0x002UL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM_2   (0x004UL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM_3   (0x008UL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM_4   (0x010UL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM_5   (0x020UL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM_6   (0x040UL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM_7   (0x080UL << RTC_CALR_CALM_Pos)
 
#define RTC_CALR_CALM_8   (0x100UL << RTC_CALR_CALM_Pos)
 
#define RTC_TAFCR_PC15MODE_Pos   (23U)
 
#define RTC_TAFCR_PC15MODE_Msk   (0x1UL << RTC_TAFCR_PC15MODE_Pos)
 
#define RTC_TAFCR_PC15MODE   RTC_TAFCR_PC15MODE_Msk
 
#define RTC_TAFCR_PC15VALUE_Pos   (22U)
 
#define RTC_TAFCR_PC15VALUE_Msk   (0x1UL << RTC_TAFCR_PC15VALUE_Pos)
 
#define RTC_TAFCR_PC15VALUE   RTC_TAFCR_PC15VALUE_Msk
 
#define RTC_TAFCR_PC14MODE_Pos   (21U)
 
#define RTC_TAFCR_PC14MODE_Msk   (0x1UL << RTC_TAFCR_PC14MODE_Pos)
 
#define RTC_TAFCR_PC14MODE   RTC_TAFCR_PC14MODE_Msk
 
#define RTC_TAFCR_PC14VALUE_Pos   (20U)
 
#define RTC_TAFCR_PC14VALUE_Msk   (0x1UL << RTC_TAFCR_PC14VALUE_Pos)
 
#define RTC_TAFCR_PC14VALUE   RTC_TAFCR_PC14VALUE_Msk
 
#define RTC_TAFCR_PC13MODE_Pos   (19U)
 
#define RTC_TAFCR_PC13MODE_Msk   (0x1UL << RTC_TAFCR_PC13MODE_Pos)
 
#define RTC_TAFCR_PC13MODE   RTC_TAFCR_PC13MODE_Msk
 
#define RTC_TAFCR_PC13VALUE_Pos   (18U)
 
#define RTC_TAFCR_PC13VALUE_Msk   (0x1UL << RTC_TAFCR_PC13VALUE_Pos)
 
#define RTC_TAFCR_PC13VALUE   RTC_TAFCR_PC13VALUE_Msk
 
#define RTC_TAFCR_TAMPPUDIS_Pos   (15U)
 
#define RTC_TAFCR_TAMPPUDIS_Msk   (0x1UL << RTC_TAFCR_TAMPPUDIS_Pos)
 
#define RTC_TAFCR_TAMPPUDIS   RTC_TAFCR_TAMPPUDIS_Msk
 
#define RTC_TAFCR_TAMPPRCH_Pos   (13U)
 
#define RTC_TAFCR_TAMPPRCH_Msk   (0x3UL << RTC_TAFCR_TAMPPRCH_Pos)
 
#define RTC_TAFCR_TAMPPRCH   RTC_TAFCR_TAMPPRCH_Msk
 
#define RTC_TAFCR_TAMPPRCH_0   (0x1UL << RTC_TAFCR_TAMPPRCH_Pos)
 
#define RTC_TAFCR_TAMPPRCH_1   (0x2UL << RTC_TAFCR_TAMPPRCH_Pos)
 
#define RTC_TAFCR_TAMPFLT_Pos   (11U)
 
#define RTC_TAFCR_TAMPFLT_Msk   (0x3UL << RTC_TAFCR_TAMPFLT_Pos)
 
#define RTC_TAFCR_TAMPFLT   RTC_TAFCR_TAMPFLT_Msk
 
#define RTC_TAFCR_TAMPFLT_0   (0x1UL << RTC_TAFCR_TAMPFLT_Pos)
 
#define RTC_TAFCR_TAMPFLT_1   (0x2UL << RTC_TAFCR_TAMPFLT_Pos)
 
#define RTC_TAFCR_TAMPFREQ_Pos   (8U)
 
#define RTC_TAFCR_TAMPFREQ_Msk   (0x7UL << RTC_TAFCR_TAMPFREQ_Pos)
 
#define RTC_TAFCR_TAMPFREQ   RTC_TAFCR_TAMPFREQ_Msk
 
#define RTC_TAFCR_TAMPFREQ_0   (0x1UL << RTC_TAFCR_TAMPFREQ_Pos)
 
#define RTC_TAFCR_TAMPFREQ_1   (0x2UL << RTC_TAFCR_TAMPFREQ_Pos)
 
#define RTC_TAFCR_TAMPFREQ_2   (0x4UL << RTC_TAFCR_TAMPFREQ_Pos)
 
#define RTC_TAFCR_TAMPTS_Pos   (7U)
 
#define RTC_TAFCR_TAMPTS_Msk   (0x1UL << RTC_TAFCR_TAMPTS_Pos)
 
#define RTC_TAFCR_TAMPTS   RTC_TAFCR_TAMPTS_Msk
 
#define RTC_TAFCR_TAMP3TRG_Pos   (6U)
 
#define RTC_TAFCR_TAMP3TRG_Msk   (0x1UL << RTC_TAFCR_TAMP3TRG_Pos)
 
#define RTC_TAFCR_TAMP3TRG   RTC_TAFCR_TAMP3TRG_Msk
 
#define RTC_TAFCR_TAMP3E_Pos   (5U)
 
#define RTC_TAFCR_TAMP3E_Msk   (0x1UL << RTC_TAFCR_TAMP3E_Pos)
 
#define RTC_TAFCR_TAMP3E   RTC_TAFCR_TAMP3E_Msk
 
#define RTC_TAFCR_TAMP2TRG_Pos   (4U)
 
#define RTC_TAFCR_TAMP2TRG_Msk   (0x1UL << RTC_TAFCR_TAMP2TRG_Pos)
 
#define RTC_TAFCR_TAMP2TRG   RTC_TAFCR_TAMP2TRG_Msk
 
#define RTC_TAFCR_TAMP2E_Pos   (3U)
 
#define RTC_TAFCR_TAMP2E_Msk   (0x1UL << RTC_TAFCR_TAMP2E_Pos)
 
#define RTC_TAFCR_TAMP2E   RTC_TAFCR_TAMP2E_Msk
 
#define RTC_TAFCR_TAMPIE_Pos   (2U)
 
#define RTC_TAFCR_TAMPIE_Msk   (0x1UL << RTC_TAFCR_TAMPIE_Pos)
 
#define RTC_TAFCR_TAMPIE   RTC_TAFCR_TAMPIE_Msk
 
#define RTC_TAFCR_TAMP1TRG_Pos   (1U)
 
#define RTC_TAFCR_TAMP1TRG_Msk   (0x1UL << RTC_TAFCR_TAMP1TRG_Pos)
 
#define RTC_TAFCR_TAMP1TRG   RTC_TAFCR_TAMP1TRG_Msk
 
#define RTC_TAFCR_TAMP1E_Pos   (0U)
 
#define RTC_TAFCR_TAMP1E_Msk   (0x1UL << RTC_TAFCR_TAMP1E_Pos)
 
#define RTC_TAFCR_TAMP1E   RTC_TAFCR_TAMP1E_Msk
 
#define RTC_TAFCR_ALARMOUTTYPE   RTC_TAFCR_PC13VALUE
 
#define RTC_ALRMASSR_MASKSS_Pos   (24U)
 
#define RTC_ALRMASSR_MASKSS_Msk   (0xFUL << RTC_ALRMASSR_MASKSS_Pos)
 
#define RTC_ALRMASSR_MASKSS   RTC_ALRMASSR_MASKSS_Msk
 
#define RTC_ALRMASSR_MASKSS_0   (0x1UL << RTC_ALRMASSR_MASKSS_Pos)
 
#define RTC_ALRMASSR_MASKSS_1   (0x2UL << RTC_ALRMASSR_MASKSS_Pos)
 
#define RTC_ALRMASSR_MASKSS_2   (0x4UL << RTC_ALRMASSR_MASKSS_Pos)
 
#define RTC_ALRMASSR_MASKSS_3   (0x8UL << RTC_ALRMASSR_MASKSS_Pos)
 
#define RTC_ALRMASSR_SS_Pos   (0U)
 
#define RTC_ALRMASSR_SS_Msk   (0x7FFFUL << RTC_ALRMASSR_SS_Pos)
 
#define RTC_ALRMASSR_SS   RTC_ALRMASSR_SS_Msk
 
#define RTC_ALRMBSSR_MASKSS_Pos   (24U)
 
#define RTC_ALRMBSSR_MASKSS_Msk   (0xFUL << RTC_ALRMBSSR_MASKSS_Pos)
 
#define RTC_ALRMBSSR_MASKSS   RTC_ALRMBSSR_MASKSS_Msk
 
#define RTC_ALRMBSSR_MASKSS_0   (0x1UL << RTC_ALRMBSSR_MASKSS_Pos)
 
#define RTC_ALRMBSSR_MASKSS_1   (0x2UL << RTC_ALRMBSSR_MASKSS_Pos)
 
#define RTC_ALRMBSSR_MASKSS_2   (0x4UL << RTC_ALRMBSSR_MASKSS_Pos)
 
#define RTC_ALRMBSSR_MASKSS_3   (0x8UL << RTC_ALRMBSSR_MASKSS_Pos)
 
#define RTC_ALRMBSSR_SS_Pos   (0U)
 
#define RTC_ALRMBSSR_SS_Msk   (0x7FFFUL << RTC_ALRMBSSR_SS_Pos)
 
#define RTC_ALRMBSSR_SS   RTC_ALRMBSSR_SS_Msk
 
#define RTC_BKP0R_Pos   (0U)
 
#define RTC_BKP0R_Msk   (0xFFFFFFFFUL << RTC_BKP0R_Pos)
 
#define RTC_BKP0R   RTC_BKP0R_Msk
 
#define RTC_BKP1R_Pos   (0U)
 
#define RTC_BKP1R_Msk   (0xFFFFFFFFUL << RTC_BKP1R_Pos)
 
#define RTC_BKP1R   RTC_BKP1R_Msk
 
#define RTC_BKP2R_Pos   (0U)
 
#define RTC_BKP2R_Msk   (0xFFFFFFFFUL << RTC_BKP2R_Pos)
 
#define RTC_BKP2R   RTC_BKP2R_Msk
 
#define RTC_BKP3R_Pos   (0U)
 
#define RTC_BKP3R_Msk   (0xFFFFFFFFUL << RTC_BKP3R_Pos)
 
#define RTC_BKP3R   RTC_BKP3R_Msk
 
#define RTC_BKP4R_Pos   (0U)
 
#define RTC_BKP4R_Msk   (0xFFFFFFFFUL << RTC_BKP4R_Pos)
 
#define RTC_BKP4R   RTC_BKP4R_Msk
 
#define RTC_BKP5R_Pos   (0U)
 
#define RTC_BKP5R_Msk   (0xFFFFFFFFUL << RTC_BKP5R_Pos)
 
#define RTC_BKP5R   RTC_BKP5R_Msk
 
#define RTC_BKP6R_Pos   (0U)
 
#define RTC_BKP6R_Msk   (0xFFFFFFFFUL << RTC_BKP6R_Pos)
 
#define RTC_BKP6R   RTC_BKP6R_Msk
 
#define RTC_BKP7R_Pos   (0U)
 
#define RTC_BKP7R_Msk   (0xFFFFFFFFUL << RTC_BKP7R_Pos)
 
#define RTC_BKP7R   RTC_BKP7R_Msk
 
#define RTC_BKP8R_Pos   (0U)
 
#define RTC_BKP8R_Msk   (0xFFFFFFFFUL << RTC_BKP8R_Pos)
 
#define RTC_BKP8R   RTC_BKP8R_Msk
 
#define RTC_BKP9R_Pos   (0U)
 
#define RTC_BKP9R_Msk   (0xFFFFFFFFUL << RTC_BKP9R_Pos)
 
#define RTC_BKP9R   RTC_BKP9R_Msk
 
#define RTC_BKP10R_Pos   (0U)
 
#define RTC_BKP10R_Msk   (0xFFFFFFFFUL << RTC_BKP10R_Pos)
 
#define RTC_BKP10R   RTC_BKP10R_Msk
 
#define RTC_BKP11R_Pos   (0U)
 
#define RTC_BKP11R_Msk   (0xFFFFFFFFUL << RTC_BKP11R_Pos)
 
#define RTC_BKP11R   RTC_BKP11R_Msk
 
#define RTC_BKP12R_Pos   (0U)
 
#define RTC_BKP12R_Msk   (0xFFFFFFFFUL << RTC_BKP12R_Pos)
 
#define RTC_BKP12R   RTC_BKP12R_Msk
 
#define RTC_BKP13R_Pos   (0U)
 
#define RTC_BKP13R_Msk   (0xFFFFFFFFUL << RTC_BKP13R_Pos)
 
#define RTC_BKP13R   RTC_BKP13R_Msk
 
#define RTC_BKP14R_Pos   (0U)
 
#define RTC_BKP14R_Msk   (0xFFFFFFFFUL << RTC_BKP14R_Pos)
 
#define RTC_BKP14R   RTC_BKP14R_Msk
 
#define RTC_BKP15R_Pos   (0U)
 
#define RTC_BKP15R_Msk   (0xFFFFFFFFUL << RTC_BKP15R_Pos)
 
#define RTC_BKP15R   RTC_BKP15R_Msk
 
#define RTC_BKP_NUMBER   16
 
#define SPI_I2S_SUPPORT
 
#define SPI_I2S_FULLDUPLEX_SUPPORT
 
#define SPI_CR1_CPHA_Pos   (0U)
 
#define SPI_CR1_CPHA_Msk   (0x1UL << SPI_CR1_CPHA_Pos)
 
#define SPI_CR1_CPHA   SPI_CR1_CPHA_Msk
 
#define SPI_CR1_CPOL_Pos   (1U)
 
#define SPI_CR1_CPOL_Msk   (0x1UL << SPI_CR1_CPOL_Pos)
 
#define SPI_CR1_CPOL   SPI_CR1_CPOL_Msk
 
#define SPI_CR1_MSTR_Pos   (2U)
 
#define SPI_CR1_MSTR_Msk   (0x1UL << SPI_CR1_MSTR_Pos)
 
#define SPI_CR1_MSTR   SPI_CR1_MSTR_Msk
 
#define SPI_CR1_BR_Pos   (3U)
 
#define SPI_CR1_BR_Msk   (0x7UL << SPI_CR1_BR_Pos)
 
#define SPI_CR1_BR   SPI_CR1_BR_Msk
 
#define SPI_CR1_BR_0   (0x1UL << SPI_CR1_BR_Pos)
 
#define SPI_CR1_BR_1   (0x2UL << SPI_CR1_BR_Pos)
 
#define SPI_CR1_BR_2   (0x4UL << SPI_CR1_BR_Pos)
 
#define SPI_CR1_SPE_Pos   (6U)
 
#define SPI_CR1_SPE_Msk   (0x1UL << SPI_CR1_SPE_Pos)
 
#define SPI_CR1_SPE   SPI_CR1_SPE_Msk
 
#define SPI_CR1_LSBFIRST_Pos   (7U)
 
#define SPI_CR1_LSBFIRST_Msk   (0x1UL << SPI_CR1_LSBFIRST_Pos)
 
#define SPI_CR1_LSBFIRST   SPI_CR1_LSBFIRST_Msk
 
#define SPI_CR1_SSI_Pos   (8U)
 
#define SPI_CR1_SSI_Msk   (0x1UL << SPI_CR1_SSI_Pos)
 
#define SPI_CR1_SSI   SPI_CR1_SSI_Msk
 
#define SPI_CR1_SSM_Pos   (9U)
 
#define SPI_CR1_SSM_Msk   (0x1UL << SPI_CR1_SSM_Pos)
 
#define SPI_CR1_SSM   SPI_CR1_SSM_Msk
 
#define SPI_CR1_RXONLY_Pos   (10U)
 
#define SPI_CR1_RXONLY_Msk   (0x1UL << SPI_CR1_RXONLY_Pos)
 
#define SPI_CR1_RXONLY   SPI_CR1_RXONLY_Msk
 
#define SPI_CR1_CRCL_Pos   (11U)
 
#define SPI_CR1_CRCL_Msk   (0x1UL << SPI_CR1_CRCL_Pos)
 
#define SPI_CR1_CRCL   SPI_CR1_CRCL_Msk
 
#define SPI_CR1_CRCNEXT_Pos   (12U)
 
#define SPI_CR1_CRCNEXT_Msk   (0x1UL << SPI_CR1_CRCNEXT_Pos)
 
#define SPI_CR1_CRCNEXT   SPI_CR1_CRCNEXT_Msk
 
#define SPI_CR1_CRCEN_Pos   (13U)
 
#define SPI_CR1_CRCEN_Msk   (0x1UL << SPI_CR1_CRCEN_Pos)
 
#define SPI_CR1_CRCEN   SPI_CR1_CRCEN_Msk
 
#define SPI_CR1_BIDIOE_Pos   (14U)
 
#define SPI_CR1_BIDIOE_Msk   (0x1UL << SPI_CR1_BIDIOE_Pos)
 
#define SPI_CR1_BIDIOE   SPI_CR1_BIDIOE_Msk
 
#define SPI_CR1_BIDIMODE_Pos   (15U)
 
#define SPI_CR1_BIDIMODE_Msk   (0x1UL << SPI_CR1_BIDIMODE_Pos)
 
#define SPI_CR1_BIDIMODE   SPI_CR1_BIDIMODE_Msk
 
#define SPI_CR2_RXDMAEN_Pos   (0U)
 
#define SPI_CR2_RXDMAEN_Msk   (0x1UL << SPI_CR2_RXDMAEN_Pos)
 
#define SPI_CR2_RXDMAEN   SPI_CR2_RXDMAEN_Msk
 
#define SPI_CR2_TXDMAEN_Pos   (1U)
 
#define SPI_CR2_TXDMAEN_Msk   (0x1UL << SPI_CR2_TXDMAEN_Pos)
 
#define SPI_CR2_TXDMAEN   SPI_CR2_TXDMAEN_Msk
 
#define SPI_CR2_SSOE_Pos   (2U)
 
#define SPI_CR2_SSOE_Msk   (0x1UL << SPI_CR2_SSOE_Pos)
 
#define SPI_CR2_SSOE   SPI_CR2_SSOE_Msk
 
#define SPI_CR2_NSSP_Pos   (3U)
 
#define SPI_CR2_NSSP_Msk   (0x1UL << SPI_CR2_NSSP_Pos)
 
#define SPI_CR2_NSSP   SPI_CR2_NSSP_Msk
 
#define SPI_CR2_FRF_Pos   (4U)
 
#define SPI_CR2_FRF_Msk   (0x1UL << SPI_CR2_FRF_Pos)
 
#define SPI_CR2_FRF   SPI_CR2_FRF_Msk
 
#define SPI_CR2_ERRIE_Pos   (5U)
 
#define SPI_CR2_ERRIE_Msk   (0x1UL << SPI_CR2_ERRIE_Pos)
 
#define SPI_CR2_ERRIE   SPI_CR2_ERRIE_Msk
 
#define SPI_CR2_RXNEIE_Pos   (6U)
 
#define SPI_CR2_RXNEIE_Msk   (0x1UL << SPI_CR2_RXNEIE_Pos)
 
#define SPI_CR2_RXNEIE   SPI_CR2_RXNEIE_Msk
 
#define SPI_CR2_TXEIE_Pos   (7U)
 
#define SPI_CR2_TXEIE_Msk   (0x1UL << SPI_CR2_TXEIE_Pos)
 
#define SPI_CR2_TXEIE   SPI_CR2_TXEIE_Msk
 
#define SPI_CR2_DS_Pos   (8U)
 
#define SPI_CR2_DS_Msk   (0xFUL << SPI_CR2_DS_Pos)
 
#define SPI_CR2_DS   SPI_CR2_DS_Msk
 
#define SPI_CR2_DS_0   (0x1UL << SPI_CR2_DS_Pos)
 
#define SPI_CR2_DS_1   (0x2UL << SPI_CR2_DS_Pos)
 
#define SPI_CR2_DS_2   (0x4UL << SPI_CR2_DS_Pos)
 
#define SPI_CR2_DS_3   (0x8UL << SPI_CR2_DS_Pos)
 
#define SPI_CR2_FRXTH_Pos   (12U)
 
#define SPI_CR2_FRXTH_Msk   (0x1UL << SPI_CR2_FRXTH_Pos)
 
#define SPI_CR2_FRXTH   SPI_CR2_FRXTH_Msk
 
#define SPI_CR2_LDMARX_Pos   (13U)
 
#define SPI_CR2_LDMARX_Msk   (0x1UL << SPI_CR2_LDMARX_Pos)
 
#define SPI_CR2_LDMARX   SPI_CR2_LDMARX_Msk
 
#define SPI_CR2_LDMATX_Pos   (14U)
 
#define SPI_CR2_LDMATX_Msk   (0x1UL << SPI_CR2_LDMATX_Pos)
 
#define SPI_CR2_LDMATX   SPI_CR2_LDMATX_Msk
 
#define SPI_SR_RXNE_Pos   (0U)
 
#define SPI_SR_RXNE_Msk   (0x1UL << SPI_SR_RXNE_Pos)
 
#define SPI_SR_RXNE   SPI_SR_RXNE_Msk
 
#define SPI_SR_TXE_Pos   (1U)
 
#define SPI_SR_TXE_Msk   (0x1UL << SPI_SR_TXE_Pos)
 
#define SPI_SR_TXE   SPI_SR_TXE_Msk
 
#define SPI_SR_CHSIDE_Pos   (2U)
 
#define SPI_SR_CHSIDE_Msk   (0x1UL << SPI_SR_CHSIDE_Pos)
 
#define SPI_SR_CHSIDE   SPI_SR_CHSIDE_Msk
 
#define SPI_SR_UDR_Pos   (3U)
 
#define SPI_SR_UDR_Msk   (0x1UL << SPI_SR_UDR_Pos)
 
#define SPI_SR_UDR   SPI_SR_UDR_Msk
 
#define SPI_SR_CRCERR_Pos   (4U)
 
#define SPI_SR_CRCERR_Msk   (0x1UL << SPI_SR_CRCERR_Pos)
 
#define SPI_SR_CRCERR   SPI_SR_CRCERR_Msk
 
#define SPI_SR_MODF_Pos   (5U)
 
#define SPI_SR_MODF_Msk   (0x1UL << SPI_SR_MODF_Pos)
 
#define SPI_SR_MODF   SPI_SR_MODF_Msk
 
#define SPI_SR_OVR_Pos   (6U)
 
#define SPI_SR_OVR_Msk   (0x1UL << SPI_SR_OVR_Pos)
 
#define SPI_SR_OVR   SPI_SR_OVR_Msk
 
#define SPI_SR_BSY_Pos   (7U)
 
#define SPI_SR_BSY_Msk   (0x1UL << SPI_SR_BSY_Pos)
 
#define SPI_SR_BSY   SPI_SR_BSY_Msk
 
#define SPI_SR_FRE_Pos   (8U)
 
#define SPI_SR_FRE_Msk   (0x1UL << SPI_SR_FRE_Pos)
 
#define SPI_SR_FRE   SPI_SR_FRE_Msk
 
#define SPI_SR_FRLVL_Pos   (9U)
 
#define SPI_SR_FRLVL_Msk   (0x3UL << SPI_SR_FRLVL_Pos)
 
#define SPI_SR_FRLVL   SPI_SR_FRLVL_Msk
 
#define SPI_SR_FRLVL_0   (0x1UL << SPI_SR_FRLVL_Pos)
 
#define SPI_SR_FRLVL_1   (0x2UL << SPI_SR_FRLVL_Pos)
 
#define SPI_SR_FTLVL_Pos   (11U)
 
#define SPI_SR_FTLVL_Msk   (0x3UL << SPI_SR_FTLVL_Pos)
 
#define SPI_SR_FTLVL   SPI_SR_FTLVL_Msk
 
#define SPI_SR_FTLVL_0   (0x1UL << SPI_SR_FTLVL_Pos)
 
#define SPI_SR_FTLVL_1   (0x2UL << SPI_SR_FTLVL_Pos)
 
#define SPI_DR_DR_Pos   (0U)
 
#define SPI_DR_DR_Msk   (0xFFFFUL << SPI_DR_DR_Pos)
 
#define SPI_DR_DR   SPI_DR_DR_Msk
 
#define SPI_CRCPR_CRCPOLY_Pos   (0U)
 
#define SPI_CRCPR_CRCPOLY_Msk   (0xFFFFUL << SPI_CRCPR_CRCPOLY_Pos)
 
#define SPI_CRCPR_CRCPOLY   SPI_CRCPR_CRCPOLY_Msk
 
#define SPI_RXCRCR_RXCRC_Pos   (0U)
 
#define SPI_RXCRCR_RXCRC_Msk   (0xFFFFUL << SPI_RXCRCR_RXCRC_Pos)
 
#define SPI_RXCRCR_RXCRC   SPI_RXCRCR_RXCRC_Msk
 
#define SPI_TXCRCR_TXCRC_Pos   (0U)
 
#define SPI_TXCRCR_TXCRC_Msk   (0xFFFFUL << SPI_TXCRCR_TXCRC_Pos)
 
#define SPI_TXCRCR_TXCRC   SPI_TXCRCR_TXCRC_Msk
 
#define SPI_I2SCFGR_CHLEN_Pos   (0U)
 
#define SPI_I2SCFGR_CHLEN_Msk   (0x1UL << SPI_I2SCFGR_CHLEN_Pos)
 
#define SPI_I2SCFGR_CHLEN   SPI_I2SCFGR_CHLEN_Msk
 
#define SPI_I2SCFGR_DATLEN_Pos   (1U)
 
#define SPI_I2SCFGR_DATLEN_Msk   (0x3UL << SPI_I2SCFGR_DATLEN_Pos)
 
#define SPI_I2SCFGR_DATLEN   SPI_I2SCFGR_DATLEN_Msk
 
#define SPI_I2SCFGR_DATLEN_0   (0x1UL << SPI_I2SCFGR_DATLEN_Pos)
 
#define SPI_I2SCFGR_DATLEN_1   (0x2UL << SPI_I2SCFGR_DATLEN_Pos)
 
#define SPI_I2SCFGR_CKPOL_Pos   (3U)
 
#define SPI_I2SCFGR_CKPOL_Msk   (0x1UL << SPI_I2SCFGR_CKPOL_Pos)
 
#define SPI_I2SCFGR_CKPOL   SPI_I2SCFGR_CKPOL_Msk
 
#define SPI_I2SCFGR_I2SSTD_Pos   (4U)
 
#define SPI_I2SCFGR_I2SSTD_Msk   (0x3UL << SPI_I2SCFGR_I2SSTD_Pos)
 
#define SPI_I2SCFGR_I2SSTD   SPI_I2SCFGR_I2SSTD_Msk
 
#define SPI_I2SCFGR_I2SSTD_0   (0x1UL << SPI_I2SCFGR_I2SSTD_Pos)
 
#define SPI_I2SCFGR_I2SSTD_1   (0x2UL << SPI_I2SCFGR_I2SSTD_Pos)
 
#define SPI_I2SCFGR_PCMSYNC_Pos   (7U)
 
#define SPI_I2SCFGR_PCMSYNC_Msk   (0x1UL << SPI_I2SCFGR_PCMSYNC_Pos)
 
#define SPI_I2SCFGR_PCMSYNC   SPI_I2SCFGR_PCMSYNC_Msk
 
#define SPI_I2SCFGR_I2SCFG_Pos   (8U)
 
#define SPI_I2SCFGR_I2SCFG_Msk   (0x3UL << SPI_I2SCFGR_I2SCFG_Pos)
 
#define SPI_I2SCFGR_I2SCFG   SPI_I2SCFGR_I2SCFG_Msk
 
#define SPI_I2SCFGR_I2SCFG_0   (0x1UL << SPI_I2SCFGR_I2SCFG_Pos)
 
#define SPI_I2SCFGR_I2SCFG_1   (0x2UL << SPI_I2SCFGR_I2SCFG_Pos)
 
#define SPI_I2SCFGR_I2SE_Pos   (10U)
 
#define SPI_I2SCFGR_I2SE_Msk   (0x1UL << SPI_I2SCFGR_I2SE_Pos)
 
#define SPI_I2SCFGR_I2SE   SPI_I2SCFGR_I2SE_Msk
 
#define SPI_I2SCFGR_I2SMOD_Pos   (11U)
 
#define SPI_I2SCFGR_I2SMOD_Msk   (0x1UL << SPI_I2SCFGR_I2SMOD_Pos)
 
#define SPI_I2SCFGR_I2SMOD   SPI_I2SCFGR_I2SMOD_Msk
 
#define SPI_I2SPR_I2SDIV_Pos   (0U)
 
#define SPI_I2SPR_I2SDIV_Msk   (0xFFUL << SPI_I2SPR_I2SDIV_Pos)
 
#define SPI_I2SPR_I2SDIV   SPI_I2SPR_I2SDIV_Msk
 
#define SPI_I2SPR_ODD_Pos   (8U)
 
#define SPI_I2SPR_ODD_Msk   (0x1UL << SPI_I2SPR_ODD_Pos)
 
#define SPI_I2SPR_ODD   SPI_I2SPR_ODD_Msk
 
#define SPI_I2SPR_MCKOE_Pos   (9U)
 
#define SPI_I2SPR_MCKOE_Msk   (0x1UL << SPI_I2SPR_MCKOE_Pos)
 
#define SPI_I2SPR_MCKOE   SPI_I2SPR_MCKOE_Msk
 
#define SYSCFG_CFGR1_MEM_MODE_Pos   (0U)
 
#define SYSCFG_CFGR1_MEM_MODE_Msk   (0x7UL << SYSCFG_CFGR1_MEM_MODE_Pos)
 
#define SYSCFG_CFGR1_MEM_MODE   SYSCFG_CFGR1_MEM_MODE_Msk
 
#define SYSCFG_CFGR1_MEM_MODE_0   (0x00000001U)
 
#define SYSCFG_CFGR1_MEM_MODE_1   (0x00000002U)
 
#define SYSCFG_CFGR1_MEM_MODE_2   (0x00000004U)
 
#define SYSCFG_CFGR1_USB_IT_RMP_Pos   (5U)
 
#define SYSCFG_CFGR1_USB_IT_RMP_Msk   (0x1UL << SYSCFG_CFGR1_USB_IT_RMP_Pos)
 
#define SYSCFG_CFGR1_USB_IT_RMP   SYSCFG_CFGR1_USB_IT_RMP_Msk
 
#define SYSCFG_CFGR1_TIM1_ITR3_RMP_Pos   (6U)
 
#define SYSCFG_CFGR1_TIM1_ITR3_RMP_Msk   (0x1UL << SYSCFG_CFGR1_TIM1_ITR3_RMP_Pos)
 
#define SYSCFG_CFGR1_TIM1_ITR3_RMP   SYSCFG_CFGR1_TIM1_ITR3_RMP_Msk
 
#define SYSCFG_CFGR1_DAC1_TRIG1_RMP_Pos   (7U)
 
#define SYSCFG_CFGR1_DAC1_TRIG1_RMP_Msk   (0x1UL << SYSCFG_CFGR1_DAC1_TRIG1_RMP_Pos)
 
#define SYSCFG_CFGR1_DAC1_TRIG1_RMP   SYSCFG_CFGR1_DAC1_TRIG1_RMP_Msk
 
#define SYSCFG_CFGR1_DMA_RMP_Pos   (8U)
 
#define SYSCFG_CFGR1_DMA_RMP_Msk   (0x79UL << SYSCFG_CFGR1_DMA_RMP_Pos)
 
#define SYSCFG_CFGR1_DMA_RMP   SYSCFG_CFGR1_DMA_RMP_Msk
 
#define SYSCFG_CFGR1_ADC24_DMA_RMP_Pos   (8U)
 
#define SYSCFG_CFGR1_ADC24_DMA_RMP_Msk   (0x1UL << SYSCFG_CFGR1_ADC24_DMA_RMP_Pos)
 
#define SYSCFG_CFGR1_ADC24_DMA_RMP   SYSCFG_CFGR1_ADC24_DMA_RMP_Msk
 
#define SYSCFG_CFGR1_TIM16_DMA_RMP_Pos   (11U)
 
#define SYSCFG_CFGR1_TIM16_DMA_RMP_Msk   (0x1UL << SYSCFG_CFGR1_TIM16_DMA_RMP_Pos)
 
#define SYSCFG_CFGR1_TIM16_DMA_RMP   SYSCFG_CFGR1_TIM16_DMA_RMP_Msk
 
#define SYSCFG_CFGR1_TIM17_DMA_RMP_Pos   (12U)
 
#define SYSCFG_CFGR1_TIM17_DMA_RMP_Msk   (0x1UL << SYSCFG_CFGR1_TIM17_DMA_RMP_Pos)
 
#define SYSCFG_CFGR1_TIM17_DMA_RMP   SYSCFG_CFGR1_TIM17_DMA_RMP_Msk
 
#define SYSCFG_CFGR1_TIM6DAC1Ch1_DMA_RMP_Pos   (13U)
 
#define SYSCFG_CFGR1_TIM6DAC1Ch1_DMA_RMP_Msk   (0x1UL << SYSCFG_CFGR1_TIM6DAC1Ch1_DMA_RMP_Pos)
 
#define SYSCFG_CFGR1_TIM6DAC1Ch1_DMA_RMP   SYSCFG_CFGR1_TIM6DAC1Ch1_DMA_RMP_Msk
 
#define SYSCFG_CFGR1_TIM7DAC1Ch2_DMA_RMP_Pos   (14U)
 
#define SYSCFG_CFGR1_TIM7DAC1Ch2_DMA_RMP_Msk   (0x1UL << SYSCFG_CFGR1_TIM7DAC1Ch2_DMA_RMP_Pos)
 
#define SYSCFG_CFGR1_TIM7DAC1Ch2_DMA_RMP   SYSCFG_CFGR1_TIM7DAC1Ch2_DMA_RMP_Msk
 
#define SYSCFG_CFGR1_I2C_PB6_FMP_Pos   (16U)
 
#define SYSCFG_CFGR1_I2C_PB6_FMP_Msk   (0x1UL << SYSCFG_CFGR1_I2C_PB6_FMP_Pos)
 
#define SYSCFG_CFGR1_I2C_PB6_FMP   SYSCFG_CFGR1_I2C_PB6_FMP_Msk
 
#define SYSCFG_CFGR1_I2C_PB7_FMP_Pos   (17U)
 
#define SYSCFG_CFGR1_I2C_PB7_FMP_Msk   (0x1UL << SYSCFG_CFGR1_I2C_PB7_FMP_Pos)
 
#define SYSCFG_CFGR1_I2C_PB7_FMP   SYSCFG_CFGR1_I2C_PB7_FMP_Msk
 
#define SYSCFG_CFGR1_I2C_PB8_FMP_Pos   (18U)
 
#define SYSCFG_CFGR1_I2C_PB8_FMP_Msk   (0x1UL << SYSCFG_CFGR1_I2C_PB8_FMP_Pos)
 
#define SYSCFG_CFGR1_I2C_PB8_FMP   SYSCFG_CFGR1_I2C_PB8_FMP_Msk
 
#define SYSCFG_CFGR1_I2C_PB9_FMP_Pos   (19U)
 
#define SYSCFG_CFGR1_I2C_PB9_FMP_Msk   (0x1UL << SYSCFG_CFGR1_I2C_PB9_FMP_Pos)
 
#define SYSCFG_CFGR1_I2C_PB9_FMP   SYSCFG_CFGR1_I2C_PB9_FMP_Msk
 
#define SYSCFG_CFGR1_I2C1_FMP_Pos   (20U)
 
#define SYSCFG_CFGR1_I2C1_FMP_Msk   (0x1UL << SYSCFG_CFGR1_I2C1_FMP_Pos)
 
#define SYSCFG_CFGR1_I2C1_FMP   SYSCFG_CFGR1_I2C1_FMP_Msk
 
#define SYSCFG_CFGR1_I2C2_FMP_Pos   (21U)
 
#define SYSCFG_CFGR1_I2C2_FMP_Msk   (0x1UL << SYSCFG_CFGR1_I2C2_FMP_Pos)
 
#define SYSCFG_CFGR1_I2C2_FMP   SYSCFG_CFGR1_I2C2_FMP_Msk
 
#define SYSCFG_CFGR1_ENCODER_MODE_Pos   (22U)
 
#define SYSCFG_CFGR1_ENCODER_MODE_Msk   (0x3UL << SYSCFG_CFGR1_ENCODER_MODE_Pos)
 
#define SYSCFG_CFGR1_ENCODER_MODE   SYSCFG_CFGR1_ENCODER_MODE_Msk
 
#define SYSCFG_CFGR1_ENCODER_MODE_0   (0x1UL << SYSCFG_CFGR1_ENCODER_MODE_Pos)
 
#define SYSCFG_CFGR1_ENCODER_MODE_1   (0x2UL << SYSCFG_CFGR1_ENCODER_MODE_Pos)
 
#define SYSCFG_CFGR1_ENCODER_MODE_TIM2_Pos   (22U)
 
#define SYSCFG_CFGR1_ENCODER_MODE_TIM2_Msk   (0x1UL << SYSCFG_CFGR1_ENCODER_MODE_TIM2_Pos)
 
#define SYSCFG_CFGR1_ENCODER_MODE_TIM2   SYSCFG_CFGR1_ENCODER_MODE_TIM2_Msk
 
#define SYSCFG_CFGR1_ENCODER_MODE_TIM3_Pos   (23U)
 
#define SYSCFG_CFGR1_ENCODER_MODE_TIM3_Msk   (0x1UL << SYSCFG_CFGR1_ENCODER_MODE_TIM3_Pos)
 
#define SYSCFG_CFGR1_ENCODER_MODE_TIM3   SYSCFG_CFGR1_ENCODER_MODE_TIM3_Msk
 
#define SYSCFG_CFGR1_I2C3_FMP_Pos   (24U)
 
#define SYSCFG_CFGR1_I2C3_FMP_Msk   (0x1UL << SYSCFG_CFGR1_I2C3_FMP_Pos)
 
#define SYSCFG_CFGR1_I2C3_FMP   SYSCFG_CFGR1_I2C3_FMP_Msk
 
#define SYSCFG_CFGR1_FPU_IE_Pos   (26U)
 
#define SYSCFG_CFGR1_FPU_IE_Msk   (0x3FUL << SYSCFG_CFGR1_FPU_IE_Pos)
 
#define SYSCFG_CFGR1_FPU_IE   SYSCFG_CFGR1_FPU_IE_Msk
 
#define SYSCFG_CFGR1_FPU_IE_0   (0x01UL << SYSCFG_CFGR1_FPU_IE_Pos)
 
#define SYSCFG_CFGR1_FPU_IE_1   (0x02UL << SYSCFG_CFGR1_FPU_IE_Pos)
 
#define SYSCFG_CFGR1_FPU_IE_2   (0x04UL << SYSCFG_CFGR1_FPU_IE_Pos)
 
#define SYSCFG_CFGR1_FPU_IE_3   (0x08UL << SYSCFG_CFGR1_FPU_IE_Pos)
 
#define SYSCFG_CFGR1_FPU_IE_4   (0x10UL << SYSCFG_CFGR1_FPU_IE_Pos)
 
#define SYSCFG_CFGR1_FPU_IE_5   (0x20UL << SYSCFG_CFGR1_FPU_IE_Pos)
 
#define SYSCFG_RCR_PAGE0_Pos   (0U)
 
#define SYSCFG_RCR_PAGE0_Msk   (0x1UL << SYSCFG_RCR_PAGE0_Pos)
 
#define SYSCFG_RCR_PAGE0   SYSCFG_RCR_PAGE0_Msk
 
#define SYSCFG_RCR_PAGE1_Pos   (1U)
 
#define SYSCFG_RCR_PAGE1_Msk   (0x1UL << SYSCFG_RCR_PAGE1_Pos)
 
#define SYSCFG_RCR_PAGE1   SYSCFG_RCR_PAGE1_Msk
 
#define SYSCFG_RCR_PAGE2_Pos   (2U)
 
#define SYSCFG_RCR_PAGE2_Msk   (0x1UL << SYSCFG_RCR_PAGE2_Pos)
 
#define SYSCFG_RCR_PAGE2   SYSCFG_RCR_PAGE2_Msk
 
#define SYSCFG_RCR_PAGE3_Pos   (3U)
 
#define SYSCFG_RCR_PAGE3_Msk   (0x1UL << SYSCFG_RCR_PAGE3_Pos)
 
#define SYSCFG_RCR_PAGE3   SYSCFG_RCR_PAGE3_Msk
 
#define SYSCFG_RCR_PAGE4_Pos   (4U)
 
#define SYSCFG_RCR_PAGE4_Msk   (0x1UL << SYSCFG_RCR_PAGE4_Pos)
 
#define SYSCFG_RCR_PAGE4   SYSCFG_RCR_PAGE4_Msk
 
#define SYSCFG_RCR_PAGE5_Pos   (5U)
 
#define SYSCFG_RCR_PAGE5_Msk   (0x1UL << SYSCFG_RCR_PAGE5_Pos)
 
#define SYSCFG_RCR_PAGE5   SYSCFG_RCR_PAGE5_Msk
 
#define SYSCFG_RCR_PAGE6_Pos   (6U)
 
#define SYSCFG_RCR_PAGE6_Msk   (0x1UL << SYSCFG_RCR_PAGE6_Pos)
 
#define SYSCFG_RCR_PAGE6   SYSCFG_RCR_PAGE6_Msk
 
#define SYSCFG_RCR_PAGE7_Pos   (7U)
 
#define SYSCFG_RCR_PAGE7_Msk   (0x1UL << SYSCFG_RCR_PAGE7_Pos)
 
#define SYSCFG_RCR_PAGE7   SYSCFG_RCR_PAGE7_Msk
 
#define SYSCFG_RCR_PAGE8_Pos   (8U)
 
#define SYSCFG_RCR_PAGE8_Msk   (0x1UL << SYSCFG_RCR_PAGE8_Pos)
 
#define SYSCFG_RCR_PAGE8   SYSCFG_RCR_PAGE8_Msk
 
#define SYSCFG_RCR_PAGE9_Pos   (9U)
 
#define SYSCFG_RCR_PAGE9_Msk   (0x1UL << SYSCFG_RCR_PAGE9_Pos)
 
#define SYSCFG_RCR_PAGE9   SYSCFG_RCR_PAGE9_Msk
 
#define SYSCFG_RCR_PAGE10_Pos   (10U)
 
#define SYSCFG_RCR_PAGE10_Msk   (0x1UL << SYSCFG_RCR_PAGE10_Pos)
 
#define SYSCFG_RCR_PAGE10   SYSCFG_RCR_PAGE10_Msk
 
#define SYSCFG_RCR_PAGE11_Pos   (11U)
 
#define SYSCFG_RCR_PAGE11_Msk   (0x1UL << SYSCFG_RCR_PAGE11_Pos)
 
#define SYSCFG_RCR_PAGE11   SYSCFG_RCR_PAGE11_Msk
 
#define SYSCFG_RCR_PAGE12_Pos   (12U)
 
#define SYSCFG_RCR_PAGE12_Msk   (0x1UL << SYSCFG_RCR_PAGE12_Pos)
 
#define SYSCFG_RCR_PAGE12   SYSCFG_RCR_PAGE12_Msk
 
#define SYSCFG_RCR_PAGE13_Pos   (13U)
 
#define SYSCFG_RCR_PAGE13_Msk   (0x1UL << SYSCFG_RCR_PAGE13_Pos)
 
#define SYSCFG_RCR_PAGE13   SYSCFG_RCR_PAGE13_Msk
 
#define SYSCFG_RCR_PAGE14_Pos   (14U)
 
#define SYSCFG_RCR_PAGE14_Msk   (0x1UL << SYSCFG_RCR_PAGE14_Pos)
 
#define SYSCFG_RCR_PAGE14   SYSCFG_RCR_PAGE14_Msk
 
#define SYSCFG_RCR_PAGE15_Pos   (15U)
 
#define SYSCFG_RCR_PAGE15_Msk   (0x1UL << SYSCFG_RCR_PAGE15_Pos)
 
#define SYSCFG_RCR_PAGE15   SYSCFG_RCR_PAGE15_Msk
 
#define SYSCFG_EXTICR1_EXTI0_Pos   (0U)
 
#define SYSCFG_EXTICR1_EXTI0_Msk   (0xFUL << SYSCFG_EXTICR1_EXTI0_Pos)
 
#define SYSCFG_EXTICR1_EXTI0   SYSCFG_EXTICR1_EXTI0_Msk
 
#define SYSCFG_EXTICR1_EXTI1_Pos   (4U)
 
#define SYSCFG_EXTICR1_EXTI1_Msk   (0xFUL << SYSCFG_EXTICR1_EXTI1_Pos)
 
#define SYSCFG_EXTICR1_EXTI1   SYSCFG_EXTICR1_EXTI1_Msk
 
#define SYSCFG_EXTICR1_EXTI2_Pos   (8U)
 
#define SYSCFG_EXTICR1_EXTI2_Msk   (0xFUL << SYSCFG_EXTICR1_EXTI2_Pos)
 
#define SYSCFG_EXTICR1_EXTI2   SYSCFG_EXTICR1_EXTI2_Msk
 
#define SYSCFG_EXTICR1_EXTI3_Pos   (12U)
 
#define SYSCFG_EXTICR1_EXTI3_Msk   (0xFUL << SYSCFG_EXTICR1_EXTI3_Pos)
 
#define SYSCFG_EXTICR1_EXTI3   SYSCFG_EXTICR1_EXTI3_Msk
 EXTI0 configuration.
 
#define SYSCFG_EXTICR1_EXTI0_PA   (0x00000000U)
 
#define SYSCFG_EXTICR1_EXTI0_PB   (0x00000001U)
 
#define SYSCFG_EXTICR1_EXTI0_PC   (0x00000002U)
 
#define SYSCFG_EXTICR1_EXTI0_PD   (0x00000003U)
 
#define SYSCFG_EXTICR1_EXTI0_PE   (0x00000004U)
 
#define SYSCFG_EXTICR1_EXTI0_PF   (0x00000005U)
 
#define SYSCFG_EXTICR1_EXTI0_PG   (0x00000006U)
 
#define SYSCFG_EXTICR1_EXTI0_PH   (0x00000007U)
 EXTI1 configuration.
 
#define SYSCFG_EXTICR1_EXTI1_PA   (0x00000000U)
 
#define SYSCFG_EXTICR1_EXTI1_PB   (0x00000010U)
 
#define SYSCFG_EXTICR1_EXTI1_PC   (0x00000020U)
 
#define SYSCFG_EXTICR1_EXTI1_PD   (0x00000030U)
 
#define SYSCFG_EXTICR1_EXTI1_PE   (0x00000040U)
 
#define SYSCFG_EXTICR1_EXTI1_PF   (0x00000050U)
 
#define SYSCFG_EXTICR1_EXTI1_PG   (0x00000060U)
 
#define SYSCFG_EXTICR1_EXTI1_PH   (0x00000070U)
 EXTI2 configuration.
 
#define SYSCFG_EXTICR1_EXTI2_PA   (0x00000000U)
 
#define SYSCFG_EXTICR1_EXTI2_PB   (0x00000100U)
 
#define SYSCFG_EXTICR1_EXTI2_PC   (0x00000200U)
 
#define SYSCFG_EXTICR1_EXTI2_PD   (0x00000300U)
 
#define SYSCFG_EXTICR1_EXTI2_PE   (0x00000400U)
 
#define SYSCFG_EXTICR1_EXTI2_PF   (0x00000500U)
 
#define SYSCFG_EXTICR1_EXTI2_PG   (0x00000600U)
 EXTI3 configuration.
 
#define SYSCFG_EXTICR1_EXTI3_PA   (0x00000000U)
 
#define SYSCFG_EXTICR1_EXTI3_PB   (0x00001000U)
 
#define SYSCFG_EXTICR1_EXTI3_PC   (0x00002000U)
 
#define SYSCFG_EXTICR1_EXTI3_PD   (0x00003000U)
 
#define SYSCFG_EXTICR1_EXTI3_PE   (0x00004000U)
 
#define SYSCFG_EXTICR1_EXTI3_PF   (0x00005000U)
 
#define SYSCFG_EXTICR1_EXTI3_PG   (0x00006000U)
 
#define SYSCFG_EXTICR2_EXTI4_Pos   (0U)
 
#define SYSCFG_EXTICR2_EXTI4_Msk   (0xFUL << SYSCFG_EXTICR2_EXTI4_Pos)
 
#define SYSCFG_EXTICR2_EXTI4   SYSCFG_EXTICR2_EXTI4_Msk
 
#define SYSCFG_EXTICR2_EXTI5_Pos   (4U)
 
#define SYSCFG_EXTICR2_EXTI5_Msk   (0xFUL << SYSCFG_EXTICR2_EXTI5_Pos)
 
#define SYSCFG_EXTICR2_EXTI5   SYSCFG_EXTICR2_EXTI5_Msk
 
#define SYSCFG_EXTICR2_EXTI6_Pos   (8U)
 
#define SYSCFG_EXTICR2_EXTI6_Msk   (0xFUL << SYSCFG_EXTICR2_EXTI6_Pos)
 
#define SYSCFG_EXTICR2_EXTI6   SYSCFG_EXTICR2_EXTI6_Msk
 
#define SYSCFG_EXTICR2_EXTI7_Pos   (12U)
 
#define SYSCFG_EXTICR2_EXTI7_Msk   (0xFUL << SYSCFG_EXTICR2_EXTI7_Pos)
 
#define SYSCFG_EXTICR2_EXTI7   SYSCFG_EXTICR2_EXTI7_Msk
 EXTI4 configuration.
 
#define SYSCFG_EXTICR2_EXTI4_PA   (0x00000000U)
 
#define SYSCFG_EXTICR2_EXTI4_PB   (0x00000001U)
 
#define SYSCFG_EXTICR2_EXTI4_PC   (0x00000002U)
 
#define SYSCFG_EXTICR2_EXTI4_PD   (0x00000003U)
 
#define SYSCFG_EXTICR2_EXTI4_PE   (0x00000004U)
 
#define SYSCFG_EXTICR2_EXTI4_PF   (0x00000005U)
 
#define SYSCFG_EXTICR2_EXTI4_PG   (0x00000006U)
 
#define SYSCFG_EXTICR2_EXTI4_PH   (0x00000007U)
 EXTI5 configuration.
 
#define SYSCFG_EXTICR2_EXTI5_PA   (0x00000000U)
 
#define SYSCFG_EXTICR2_EXTI5_PB   (0x00000010U)
 
#define SYSCFG_EXTICR2_EXTI5_PC   (0x00000020U)
 
#define SYSCFG_EXTICR2_EXTI5_PD   (0x00000030U)
 
#define SYSCFG_EXTICR2_EXTI5_PE   (0x00000040U)
 
#define SYSCFG_EXTICR2_EXTI5_PF   (0x00000050U)
 
#define SYSCFG_EXTICR2_EXTI5_PG   (0x00000060U)
 EXTI6 configuration.
 
#define SYSCFG_EXTICR2_EXTI6_PA   (0x00000000U)
 
#define SYSCFG_EXTICR2_EXTI6_PB   (0x00000100U)
 
#define SYSCFG_EXTICR2_EXTI6_PC   (0x00000200U)
 
#define SYSCFG_EXTICR2_EXTI6_PD   (0x00000300U)
 
#define SYSCFG_EXTICR2_EXTI6_PE   (0x00000400U)
 
#define SYSCFG_EXTICR2_EXTI6_PF   (0x00000500U)
 
#define SYSCFG_EXTICR2_EXTI6_PG   (0x00000600U)
 EXTI7 configuration.
 
#define SYSCFG_EXTICR2_EXTI7_PA   (0x00000000U)
 
#define SYSCFG_EXTICR2_EXTI7_PB   (0x00001000U)
 
#define SYSCFG_EXTICR2_EXTI7_PC   (0x00002000U)
 
#define SYSCFG_EXTICR2_EXTI7_PD   (0x00003000U)
 
#define SYSCFG_EXTICR2_EXTI7_PE   (0x00004000U)
 
#define SYSCFG_EXTICR2_EXTI7_PF   (0x00005000U)
 
#define SYSCFG_EXTICR2_EXTI7_PG   (0x00006000U)
 
#define SYSCFG_EXTICR3_EXTI8_Pos   (0U)
 
#define SYSCFG_EXTICR3_EXTI8_Msk   (0xFUL << SYSCFG_EXTICR3_EXTI8_Pos)
 
#define SYSCFG_EXTICR3_EXTI8   SYSCFG_EXTICR3_EXTI8_Msk
 
#define SYSCFG_EXTICR3_EXTI9_Pos   (4U)
 
#define SYSCFG_EXTICR3_EXTI9_Msk   (0xFUL << SYSCFG_EXTICR3_EXTI9_Pos)
 
#define SYSCFG_EXTICR3_EXTI9   SYSCFG_EXTICR3_EXTI9_Msk
 
#define SYSCFG_EXTICR3_EXTI10_Pos   (8U)
 
#define SYSCFG_EXTICR3_EXTI10_Msk   (0xFUL << SYSCFG_EXTICR3_EXTI10_Pos)
 
#define SYSCFG_EXTICR3_EXTI10   SYSCFG_EXTICR3_EXTI10_Msk
 
#define SYSCFG_EXTICR3_EXTI11_Pos   (12U)
 
#define SYSCFG_EXTICR3_EXTI11_Msk   (0xFUL << SYSCFG_EXTICR3_EXTI11_Pos)
 
#define SYSCFG_EXTICR3_EXTI11   SYSCFG_EXTICR3_EXTI11_Msk
 EXTI8 configuration.
 
#define SYSCFG_EXTICR3_EXTI8_PA   (0x00000000U)
 
#define SYSCFG_EXTICR3_EXTI8_PB   (0x00000001U)
 
#define SYSCFG_EXTICR3_EXTI8_PC   (0x00000002U)
 
#define SYSCFG_EXTICR3_EXTI8_PD   (0x00000003U)
 
#define SYSCFG_EXTICR3_EXTI8_PE   (0x00000004U)
 
#define SYSCFG_EXTICR3_EXTI8_PF   (0x00000005U)
 
#define SYSCFG_EXTICR3_EXTI8_PG   (0x00000006U)
 EXTI9 configuration.
 
#define SYSCFG_EXTICR3_EXTI9_PA   (0x00000000U)
 
#define SYSCFG_EXTICR3_EXTI9_PB   (0x00000010U)
 
#define SYSCFG_EXTICR3_EXTI9_PC   (0x00000020U)
 
#define SYSCFG_EXTICR3_EXTI9_PD   (0x00000030U)
 
#define SYSCFG_EXTICR3_EXTI9_PE   (0x00000040U)
 
#define SYSCFG_EXTICR3_EXTI9_PF   (0x00000050U)
 
#define SYSCFG_EXTICR3_EXTI9_PG   (0x00000060U)
 EXTI10 configuration.
 
#define SYSCFG_EXTICR3_EXTI10_PA   (0x00000000U)
 
#define SYSCFG_EXTICR3_EXTI10_PB   (0x00000100U)
 
#define SYSCFG_EXTICR3_EXTI10_PC   (0x00000200U)
 
#define SYSCFG_EXTICR3_EXTI10_PD   (0x00000300U)
 
#define SYSCFG_EXTICR3_EXTI10_PE   (0x00000400U)
 
#define SYSCFG_EXTICR3_EXTI10_PF   (0x00000500U)
 
#define SYSCFG_EXTICR3_EXTI10_PG   (0x00000600U)
 EXTI11 configuration.
 
#define SYSCFG_EXTICR3_EXTI11_PA   (0x00000000U)
 
#define SYSCFG_EXTICR3_EXTI11_PB   (0x00001000U)
 
#define SYSCFG_EXTICR3_EXTI11_PC   (0x00002000U)
 
#define SYSCFG_EXTICR3_EXTI11_PD   (0x00003000U)
 
#define SYSCFG_EXTICR3_EXTI11_PE   (0x00004000U)
 
#define SYSCFG_EXTICR3_EXTI11_PF   (0x00005000U)
 
#define SYSCFG_EXTICR3_EXTI11_PG   (0x00006000U)
 
#define SYSCFG_EXTICR4_EXTI12_Pos   (0U)
 
#define SYSCFG_EXTICR4_EXTI12_Msk   (0xFUL << SYSCFG_EXTICR4_EXTI12_Pos)
 
#define SYSCFG_EXTICR4_EXTI12   SYSCFG_EXTICR4_EXTI12_Msk
 
#define SYSCFG_EXTICR4_EXTI13_Pos   (4U)
 
#define SYSCFG_EXTICR4_EXTI13_Msk   (0xFUL << SYSCFG_EXTICR4_EXTI13_Pos)
 
#define SYSCFG_EXTICR4_EXTI13   SYSCFG_EXTICR4_EXTI13_Msk
 
#define SYSCFG_EXTICR4_EXTI14_Pos   (8U)
 
#define SYSCFG_EXTICR4_EXTI14_Msk   (0xFUL << SYSCFG_EXTICR4_EXTI14_Pos)
 
#define SYSCFG_EXTICR4_EXTI14   SYSCFG_EXTICR4_EXTI14_Msk
 
#define SYSCFG_EXTICR4_EXTI15_Pos   (12U)
 
#define SYSCFG_EXTICR4_EXTI15_Msk   (0xFUL << SYSCFG_EXTICR4_EXTI15_Pos)
 
#define SYSCFG_EXTICR4_EXTI15   SYSCFG_EXTICR4_EXTI15_Msk
 EXTI12 configuration.
 
#define SYSCFG_EXTICR4_EXTI12_PA   (0x00000000U)
 
#define SYSCFG_EXTICR4_EXTI12_PB   (0x00000001U)
 
#define SYSCFG_EXTICR4_EXTI12_PC   (0x00000002U)
 
#define SYSCFG_EXTICR4_EXTI12_PD   (0x00000003U)
 
#define SYSCFG_EXTICR4_EXTI12_PE   (0x00000004U)
 
#define SYSCFG_EXTICR4_EXTI12_PF   (0x00000005U)
 
#define SYSCFG_EXTICR4_EXTI12_PG   (0x00000006U)
 EXTI13 configuration.
 
#define SYSCFG_EXTICR4_EXTI13_PA   (0x00000000U)
 
#define SYSCFG_EXTICR4_EXTI13_PB   (0x00000010U)
 
#define SYSCFG_EXTICR4_EXTI13_PC   (0x00000020U)
 
#define SYSCFG_EXTICR4_EXTI13_PD   (0x00000030U)
 
#define SYSCFG_EXTICR4_EXTI13_PE   (0x00000040U)
 
#define SYSCFG_EXTICR4_EXTI13_PF   (0x00000050U)
 
#define SYSCFG_EXTICR4_EXTI13_PG   (0x00000060U)
 EXTI14 configuration.
 
#define SYSCFG_EXTICR4_EXTI14_PA   (0x00000000U)
 
#define SYSCFG_EXTICR4_EXTI14_PB   (0x00000100U)
 
#define SYSCFG_EXTICR4_EXTI14_PC   (0x00000200U)
 
#define SYSCFG_EXTICR4_EXTI14_PD   (0x00000300U)
 
#define SYSCFG_EXTICR4_EXTI14_PE   (0x00000400U)
 
#define SYSCFG_EXTICR4_EXTI14_PF   (0x00000500U)
 
#define SYSCFG_EXTICR4_EXTI14_PG   (0x00000600U)
 EXTI15 configuration.
 
#define SYSCFG_EXTICR4_EXTI15_PA   (0x00000000U)
 
#define SYSCFG_EXTICR4_EXTI15_PB   (0x00001000U)
 
#define SYSCFG_EXTICR4_EXTI15_PC   (0x00002000U)
 
#define SYSCFG_EXTICR4_EXTI15_PD   (0x00003000U)
 
#define SYSCFG_EXTICR4_EXTI15_PE   (0x00004000U)
 
#define SYSCFG_EXTICR4_EXTI15_PF   (0x00005000U)
 
#define SYSCFG_EXTICR4_EXTI15_PG   (0x00006000U)
 
#define SYSCFG_CFGR2_LOCKUP_LOCK_Pos   (0U)
 
#define SYSCFG_CFGR2_LOCKUP_LOCK_Msk   (0x1UL << SYSCFG_CFGR2_LOCKUP_LOCK_Pos)
 
#define SYSCFG_CFGR2_LOCKUP_LOCK   SYSCFG_CFGR2_LOCKUP_LOCK_Msk
 
#define SYSCFG_CFGR2_SRAM_PARITY_LOCK_Pos   (1U)
 
#define SYSCFG_CFGR2_SRAM_PARITY_LOCK_Msk   (0x1UL << SYSCFG_CFGR2_SRAM_PARITY_LOCK_Pos)
 
#define SYSCFG_CFGR2_SRAM_PARITY_LOCK   SYSCFG_CFGR2_SRAM_PARITY_LOCK_Msk
 
#define SYSCFG_CFGR2_PVD_LOCK_Pos   (2U)
 
#define SYSCFG_CFGR2_PVD_LOCK_Msk   (0x1UL << SYSCFG_CFGR2_PVD_LOCK_Pos)
 
#define SYSCFG_CFGR2_PVD_LOCK   SYSCFG_CFGR2_PVD_LOCK_Msk
 
#define SYSCFG_CFGR2_BYP_ADDR_PAR_Pos   (4U)
 
#define SYSCFG_CFGR2_BYP_ADDR_PAR_Msk   (0x1UL << SYSCFG_CFGR2_BYP_ADDR_PAR_Pos)
 
#define SYSCFG_CFGR2_BYP_ADDR_PAR   SYSCFG_CFGR2_BYP_ADDR_PAR_Msk
 
#define SYSCFG_CFGR2_SRAM_PE_Pos   (8U)
 
#define SYSCFG_CFGR2_SRAM_PE_Msk   (0x1UL << SYSCFG_CFGR2_SRAM_PE_Pos)
 
#define SYSCFG_CFGR2_SRAM_PE   SYSCFG_CFGR2_SRAM_PE_Msk
 
#define SYSCFG_CFGR4_ADC12_EXT2_RMP_Pos   (0U)
 
#define SYSCFG_CFGR4_ADC12_EXT2_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC12_EXT2_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC12_EXT2_RMP   SYSCFG_CFGR4_ADC12_EXT2_RMP_Msk
 
#define SYSCFG_CFGR4_ADC12_EXT3_RMP_Pos   (1U)
 
#define SYSCFG_CFGR4_ADC12_EXT3_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC12_EXT3_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC12_EXT3_RMP   SYSCFG_CFGR4_ADC12_EXT3_RMP_Msk
 
#define SYSCFG_CFGR4_ADC12_EXT5_RMP_Pos   (2U)
 
#define SYSCFG_CFGR4_ADC12_EXT5_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC12_EXT5_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC12_EXT5_RMP   SYSCFG_CFGR4_ADC12_EXT5_RMP_Msk
 
#define SYSCFG_CFGR4_ADC12_EXT13_RMP_Pos   (3U)
 
#define SYSCFG_CFGR4_ADC12_EXT13_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC12_EXT13_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC12_EXT13_RMP   SYSCFG_CFGR4_ADC12_EXT13_RMP_Msk
 
#define SYSCFG_CFGR4_ADC12_EXT15_RMP_Pos   (4U)
 
#define SYSCFG_CFGR4_ADC12_EXT15_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC12_EXT15_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC12_EXT15_RMP   SYSCFG_CFGR4_ADC12_EXT15_RMP_Msk
 
#define SYSCFG_CFGR4_ADC12_JEXT3_RMP_Pos   (5U)
 
#define SYSCFG_CFGR4_ADC12_JEXT3_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC12_JEXT3_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC12_JEXT3_RMP   SYSCFG_CFGR4_ADC12_JEXT3_RMP_Msk
 
#define SYSCFG_CFGR4_ADC12_JEXT6_RMP_Pos   (6U)
 
#define SYSCFG_CFGR4_ADC12_JEXT6_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC12_JEXT6_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC12_JEXT6_RMP   SYSCFG_CFGR4_ADC12_JEXT6_RMP_Msk
 
#define SYSCFG_CFGR4_ADC12_JEXT13_RMP_Pos   (7U)
 
#define SYSCFG_CFGR4_ADC12_JEXT13_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC12_JEXT13_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC12_JEXT13_RMP   SYSCFG_CFGR4_ADC12_JEXT13_RMP_Msk
 
#define SYSCFG_CFGR4_ADC34_EXT5_RMP_Pos   (8U)
 
#define SYSCFG_CFGR4_ADC34_EXT5_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC34_EXT5_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC34_EXT5_RMP   SYSCFG_CFGR4_ADC34_EXT5_RMP_Msk
 
#define SYSCFG_CFGR4_ADC34_EXT6_RMP_Pos   (9U)
 
#define SYSCFG_CFGR4_ADC34_EXT6_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC34_EXT6_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC34_EXT6_RMP   SYSCFG_CFGR4_ADC34_EXT6_RMP_Msk
 
#define SYSCFG_CFGR4_ADC34_EXT15_RMP_Pos   (10U)
 
#define SYSCFG_CFGR4_ADC34_EXT15_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC34_EXT15_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC34_EXT15_RMP   SYSCFG_CFGR4_ADC34_EXT15_RMP_Msk
 
#define SYSCFG_CFGR4_ADC34_JEXT5_RMP_Pos   (11U)
 
#define SYSCFG_CFGR4_ADC34_JEXT5_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC34_JEXT5_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC34_JEXT5_RMP   SYSCFG_CFGR4_ADC34_JEXT5_RMP_Msk
 
#define SYSCFG_CFGR4_ADC34_JEXT11_RMP_Pos   (12U)
 
#define SYSCFG_CFGR4_ADC34_JEXT11_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC34_JEXT11_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC34_JEXT11_RMP   SYSCFG_CFGR4_ADC34_JEXT11_RMP_Msk
 
#define SYSCFG_CFGR4_ADC34_JEXT14_RMP_Pos   (13U)
 
#define SYSCFG_CFGR4_ADC34_JEXT14_RMP_Msk   (0x1UL << SYSCFG_CFGR4_ADC34_JEXT14_RMP_Pos)
 
#define SYSCFG_CFGR4_ADC34_JEXT14_RMP   SYSCFG_CFGR4_ADC34_JEXT14_RMP_Msk
 
#define TIM_CR1_CEN_Pos   (0U)
 
#define TIM_CR1_CEN_Msk   (0x1UL << TIM_CR1_CEN_Pos)
 
#define TIM_CR1_CEN   TIM_CR1_CEN_Msk
 
#define TIM_CR1_UDIS_Pos   (1U)
 
#define TIM_CR1_UDIS_Msk   (0x1UL << TIM_CR1_UDIS_Pos)
 
#define TIM_CR1_UDIS   TIM_CR1_UDIS_Msk
 
#define TIM_CR1_URS_Pos   (2U)
 
#define TIM_CR1_URS_Msk   (0x1UL << TIM_CR1_URS_Pos)
 
#define TIM_CR1_URS   TIM_CR1_URS_Msk
 
#define TIM_CR1_OPM_Pos   (3U)
 
#define TIM_CR1_OPM_Msk   (0x1UL << TIM_CR1_OPM_Pos)
 
#define TIM_CR1_OPM   TIM_CR1_OPM_Msk
 
#define TIM_CR1_DIR_Pos   (4U)
 
#define TIM_CR1_DIR_Msk   (0x1UL << TIM_CR1_DIR_Pos)
 
#define TIM_CR1_DIR   TIM_CR1_DIR_Msk
 
#define TIM_CR1_CMS_Pos   (5U)
 
#define TIM_CR1_CMS_Msk   (0x3UL << TIM_CR1_CMS_Pos)
 
#define TIM_CR1_CMS   TIM_CR1_CMS_Msk
 
#define TIM_CR1_CMS_0   (0x1UL << TIM_CR1_CMS_Pos)
 
#define TIM_CR1_CMS_1   (0x2UL << TIM_CR1_CMS_Pos)
 
#define TIM_CR1_ARPE_Pos   (7U)
 
#define TIM_CR1_ARPE_Msk   (0x1UL << TIM_CR1_ARPE_Pos)
 
#define TIM_CR1_ARPE   TIM_CR1_ARPE_Msk
 
#define TIM_CR1_CKD_Pos   (8U)
 
#define TIM_CR1_CKD_Msk   (0x3UL << TIM_CR1_CKD_Pos)
 
#define TIM_CR1_CKD   TIM_CR1_CKD_Msk
 
#define TIM_CR1_CKD_0   (0x1UL << TIM_CR1_CKD_Pos)
 
#define TIM_CR1_CKD_1   (0x2UL << TIM_CR1_CKD_Pos)
 
#define TIM_CR1_UIFREMAP_Pos   (11U)
 
#define TIM_CR1_UIFREMAP_Msk   (0x1UL << TIM_CR1_UIFREMAP_Pos)
 
#define TIM_CR1_UIFREMAP   TIM_CR1_UIFREMAP_Msk
 
#define TIM_CR2_CCPC_Pos   (0U)
 
#define TIM_CR2_CCPC_Msk   (0x1UL << TIM_CR2_CCPC_Pos)
 
#define TIM_CR2_CCPC   TIM_CR2_CCPC_Msk
 
#define TIM_CR2_CCUS_Pos   (2U)
 
#define TIM_CR2_CCUS_Msk   (0x1UL << TIM_CR2_CCUS_Pos)
 
#define TIM_CR2_CCUS   TIM_CR2_CCUS_Msk
 
#define TIM_CR2_CCDS_Pos   (3U)
 
#define TIM_CR2_CCDS_Msk   (0x1UL << TIM_CR2_CCDS_Pos)
 
#define TIM_CR2_CCDS   TIM_CR2_CCDS_Msk
 
#define TIM_CR2_MMS_Pos   (4U)
 
#define TIM_CR2_MMS_Msk   (0x7UL << TIM_CR2_MMS_Pos)
 
#define TIM_CR2_MMS   TIM_CR2_MMS_Msk
 
#define TIM_CR2_MMS_0   (0x1UL << TIM_CR2_MMS_Pos)
 
#define TIM_CR2_MMS_1   (0x2UL << TIM_CR2_MMS_Pos)
 
#define TIM_CR2_MMS_2   (0x4UL << TIM_CR2_MMS_Pos)
 
#define TIM_CR2_TI1S_Pos   (7U)
 
#define TIM_CR2_TI1S_Msk   (0x1UL << TIM_CR2_TI1S_Pos)
 
#define TIM_CR2_TI1S   TIM_CR2_TI1S_Msk
 
#define TIM_CR2_OIS1_Pos   (8U)
 
#define TIM_CR2_OIS1_Msk   (0x1UL << TIM_CR2_OIS1_Pos)
 
#define TIM_CR2_OIS1   TIM_CR2_OIS1_Msk
 
#define TIM_CR2_OIS1N_Pos   (9U)
 
#define TIM_CR2_OIS1N_Msk   (0x1UL << TIM_CR2_OIS1N_Pos)
 
#define TIM_CR2_OIS1N   TIM_CR2_OIS1N_Msk
 
#define TIM_CR2_OIS2_Pos   (10U)
 
#define TIM_CR2_OIS2_Msk   (0x1UL << TIM_CR2_OIS2_Pos)
 
#define TIM_CR2_OIS2   TIM_CR2_OIS2_Msk
 
#define TIM_CR2_OIS2N_Pos   (11U)
 
#define TIM_CR2_OIS2N_Msk   (0x1UL << TIM_CR2_OIS2N_Pos)
 
#define TIM_CR2_OIS2N   TIM_CR2_OIS2N_Msk
 
#define TIM_CR2_OIS3_Pos   (12U)
 
#define TIM_CR2_OIS3_Msk   (0x1UL << TIM_CR2_OIS3_Pos)
 
#define TIM_CR2_OIS3   TIM_CR2_OIS3_Msk
 
#define TIM_CR2_OIS3N_Pos   (13U)
 
#define TIM_CR2_OIS3N_Msk   (0x1UL << TIM_CR2_OIS3N_Pos)
 
#define TIM_CR2_OIS3N   TIM_CR2_OIS3N_Msk
 
#define TIM_CR2_OIS4_Pos   (14U)
 
#define TIM_CR2_OIS4_Msk   (0x1UL << TIM_CR2_OIS4_Pos)
 
#define TIM_CR2_OIS4   TIM_CR2_OIS4_Msk
 
#define TIM_CR2_OIS5_Pos   (16U)
 
#define TIM_CR2_OIS5_Msk   (0x1UL << TIM_CR2_OIS5_Pos)
 
#define TIM_CR2_OIS5   TIM_CR2_OIS5_Msk
 
#define TIM_CR2_OIS6_Pos   (18U)
 
#define TIM_CR2_OIS6_Msk   (0x1UL << TIM_CR2_OIS6_Pos)
 
#define TIM_CR2_OIS6   TIM_CR2_OIS6_Msk
 
#define TIM_CR2_MMS2_Pos   (20U)
 
#define TIM_CR2_MMS2_Msk   (0xFUL << TIM_CR2_MMS2_Pos)
 
#define TIM_CR2_MMS2   TIM_CR2_MMS2_Msk
 
#define TIM_CR2_MMS2_0   (0x1UL << TIM_CR2_MMS2_Pos)
 
#define TIM_CR2_MMS2_1   (0x2UL << TIM_CR2_MMS2_Pos)
 
#define TIM_CR2_MMS2_2   (0x4UL << TIM_CR2_MMS2_Pos)
 
#define TIM_CR2_MMS2_3   (0x8UL << TIM_CR2_MMS2_Pos)
 
#define TIM_SMCR_SMS_Pos   (0U)
 
#define TIM_SMCR_SMS_Msk   (0x10007UL << TIM_SMCR_SMS_Pos)
 
#define TIM_SMCR_SMS   TIM_SMCR_SMS_Msk
 
#define TIM_SMCR_SMS_0   (0x00000001U)
 
#define TIM_SMCR_SMS_1   (0x00000002U)
 
#define TIM_SMCR_SMS_2   (0x00000004U)
 
#define TIM_SMCR_SMS_3   (0x00010000U)
 
#define TIM_SMCR_OCCS_Pos   (3U)
 
#define TIM_SMCR_OCCS_Msk   (0x1UL << TIM_SMCR_OCCS_Pos)
 
#define TIM_SMCR_OCCS   TIM_SMCR_OCCS_Msk
 
#define TIM_SMCR_TS_Pos   (4U)
 
#define TIM_SMCR_TS_Msk   (0x7UL << TIM_SMCR_TS_Pos)
 
#define TIM_SMCR_TS   TIM_SMCR_TS_Msk
 
#define TIM_SMCR_TS_0   (0x1UL << TIM_SMCR_TS_Pos)
 
#define TIM_SMCR_TS_1   (0x2UL << TIM_SMCR_TS_Pos)
 
#define TIM_SMCR_TS_2   (0x4UL << TIM_SMCR_TS_Pos)
 
#define TIM_SMCR_MSM_Pos   (7U)
 
#define TIM_SMCR_MSM_Msk   (0x1UL << TIM_SMCR_MSM_Pos)
 
#define TIM_SMCR_MSM   TIM_SMCR_MSM_Msk
 
#define TIM_SMCR_ETF_Pos   (8U)
 
#define TIM_SMCR_ETF_Msk   (0xFUL << TIM_SMCR_ETF_Pos)
 
#define TIM_SMCR_ETF   TIM_SMCR_ETF_Msk
 
#define TIM_SMCR_ETF_0   (0x1UL << TIM_SMCR_ETF_Pos)
 
#define TIM_SMCR_ETF_1   (0x2UL << TIM_SMCR_ETF_Pos)
 
#define TIM_SMCR_ETF_2   (0x4UL << TIM_SMCR_ETF_Pos)
 
#define TIM_SMCR_ETF_3   (0x8UL << TIM_SMCR_ETF_Pos)
 
#define TIM_SMCR_ETPS_Pos   (12U)
 
#define TIM_SMCR_ETPS_Msk   (0x3UL << TIM_SMCR_ETPS_Pos)
 
#define TIM_SMCR_ETPS   TIM_SMCR_ETPS_Msk
 
#define TIM_SMCR_ETPS_0   (0x1UL << TIM_SMCR_ETPS_Pos)
 
#define TIM_SMCR_ETPS_1   (0x2UL << TIM_SMCR_ETPS_Pos)
 
#define TIM_SMCR_ECE_Pos   (14U)
 
#define TIM_SMCR_ECE_Msk   (0x1UL << TIM_SMCR_ECE_Pos)
 
#define TIM_SMCR_ECE   TIM_SMCR_ECE_Msk
 
#define TIM_SMCR_ETP_Pos   (15U)
 
#define TIM_SMCR_ETP_Msk   (0x1UL << TIM_SMCR_ETP_Pos)
 
#define TIM_SMCR_ETP   TIM_SMCR_ETP_Msk
 
#define TIM_DIER_UIE_Pos   (0U)
 
#define TIM_DIER_UIE_Msk   (0x1UL << TIM_DIER_UIE_Pos)
 
#define TIM_DIER_UIE   TIM_DIER_UIE_Msk
 
#define TIM_DIER_CC1IE_Pos   (1U)
 
#define TIM_DIER_CC1IE_Msk   (0x1UL << TIM_DIER_CC1IE_Pos)
 
#define TIM_DIER_CC1IE   TIM_DIER_CC1IE_Msk
 
#define TIM_DIER_CC2IE_Pos   (2U)
 
#define TIM_DIER_CC2IE_Msk   (0x1UL << TIM_DIER_CC2IE_Pos)
 
#define TIM_DIER_CC2IE   TIM_DIER_CC2IE_Msk
 
#define TIM_DIER_CC3IE_Pos   (3U)
 
#define TIM_DIER_CC3IE_Msk   (0x1UL << TIM_DIER_CC3IE_Pos)
 
#define TIM_DIER_CC3IE   TIM_DIER_CC3IE_Msk
 
#define TIM_DIER_CC4IE_Pos   (4U)
 
#define TIM_DIER_CC4IE_Msk   (0x1UL << TIM_DIER_CC4IE_Pos)
 
#define TIM_DIER_CC4IE   TIM_DIER_CC4IE_Msk
 
#define TIM_DIER_COMIE_Pos   (5U)
 
#define TIM_DIER_COMIE_Msk   (0x1UL << TIM_DIER_COMIE_Pos)
 
#define TIM_DIER_COMIE   TIM_DIER_COMIE_Msk
 
#define TIM_DIER_TIE_Pos   (6U)
 
#define TIM_DIER_TIE_Msk   (0x1UL << TIM_DIER_TIE_Pos)
 
#define TIM_DIER_TIE   TIM_DIER_TIE_Msk
 
#define TIM_DIER_BIE_Pos   (7U)
 
#define TIM_DIER_BIE_Msk   (0x1UL << TIM_DIER_BIE_Pos)
 
#define TIM_DIER_BIE   TIM_DIER_BIE_Msk
 
#define TIM_DIER_UDE_Pos   (8U)
 
#define TIM_DIER_UDE_Msk   (0x1UL << TIM_DIER_UDE_Pos)
 
#define TIM_DIER_UDE   TIM_DIER_UDE_Msk
 
#define TIM_DIER_CC1DE_Pos   (9U)
 
#define TIM_DIER_CC1DE_Msk   (0x1UL << TIM_DIER_CC1DE_Pos)
 
#define TIM_DIER_CC1DE   TIM_DIER_CC1DE_Msk
 
#define TIM_DIER_CC2DE_Pos   (10U)
 
#define TIM_DIER_CC2DE_Msk   (0x1UL << TIM_DIER_CC2DE_Pos)
 
#define TIM_DIER_CC2DE   TIM_DIER_CC2DE_Msk
 
#define TIM_DIER_CC3DE_Pos   (11U)
 
#define TIM_DIER_CC3DE_Msk   (0x1UL << TIM_DIER_CC3DE_Pos)
 
#define TIM_DIER_CC3DE   TIM_DIER_CC3DE_Msk
 
#define TIM_DIER_CC4DE_Pos   (12U)
 
#define TIM_DIER_CC4DE_Msk   (0x1UL << TIM_DIER_CC4DE_Pos)
 
#define TIM_DIER_CC4DE   TIM_DIER_CC4DE_Msk
 
#define TIM_DIER_COMDE_Pos   (13U)
 
#define TIM_DIER_COMDE_Msk   (0x1UL << TIM_DIER_COMDE_Pos)
 
#define TIM_DIER_COMDE   TIM_DIER_COMDE_Msk
 
#define TIM_DIER_TDE_Pos   (14U)
 
#define TIM_DIER_TDE_Msk   (0x1UL << TIM_DIER_TDE_Pos)
 
#define TIM_DIER_TDE   TIM_DIER_TDE_Msk
 
#define TIM_SR_UIF_Pos   (0U)
 
#define TIM_SR_UIF_Msk   (0x1UL << TIM_SR_UIF_Pos)
 
#define TIM_SR_UIF   TIM_SR_UIF_Msk
 
#define TIM_SR_CC1IF_Pos   (1U)
 
#define TIM_SR_CC1IF_Msk   (0x1UL << TIM_SR_CC1IF_Pos)
 
#define TIM_SR_CC1IF   TIM_SR_CC1IF_Msk
 
#define TIM_SR_CC2IF_Pos   (2U)
 
#define TIM_SR_CC2IF_Msk   (0x1UL << TIM_SR_CC2IF_Pos)
 
#define TIM_SR_CC2IF   TIM_SR_CC2IF_Msk
 
#define TIM_SR_CC3IF_Pos   (3U)
 
#define TIM_SR_CC3IF_Msk   (0x1UL << TIM_SR_CC3IF_Pos)
 
#define TIM_SR_CC3IF   TIM_SR_CC3IF_Msk
 
#define TIM_SR_CC4IF_Pos   (4U)
 
#define TIM_SR_CC4IF_Msk   (0x1UL << TIM_SR_CC4IF_Pos)
 
#define TIM_SR_CC4IF   TIM_SR_CC4IF_Msk
 
#define TIM_SR_COMIF_Pos   (5U)
 
#define TIM_SR_COMIF_Msk   (0x1UL << TIM_SR_COMIF_Pos)
 
#define TIM_SR_COMIF   TIM_SR_COMIF_Msk
 
#define TIM_SR_TIF_Pos   (6U)
 
#define TIM_SR_TIF_Msk   (0x1UL << TIM_SR_TIF_Pos)
 
#define TIM_SR_TIF   TIM_SR_TIF_Msk
 
#define TIM_SR_BIF_Pos   (7U)
 
#define TIM_SR_BIF_Msk   (0x1UL << TIM_SR_BIF_Pos)
 
#define TIM_SR_BIF   TIM_SR_BIF_Msk
 
#define TIM_SR_B2IF_Pos   (8U)
 
#define TIM_SR_B2IF_Msk   (0x1UL << TIM_SR_B2IF_Pos)
 
#define TIM_SR_B2IF   TIM_SR_B2IF_Msk
 
#define TIM_SR_CC1OF_Pos   (9U)
 
#define TIM_SR_CC1OF_Msk   (0x1UL << TIM_SR_CC1OF_Pos)
 
#define TIM_SR_CC1OF   TIM_SR_CC1OF_Msk
 
#define TIM_SR_CC2OF_Pos   (10U)
 
#define TIM_SR_CC2OF_Msk   (0x1UL << TIM_SR_CC2OF_Pos)
 
#define TIM_SR_CC2OF   TIM_SR_CC2OF_Msk
 
#define TIM_SR_CC3OF_Pos   (11U)
 
#define TIM_SR_CC3OF_Msk   (0x1UL << TIM_SR_CC3OF_Pos)
 
#define TIM_SR_CC3OF   TIM_SR_CC3OF_Msk
 
#define TIM_SR_CC4OF_Pos   (12U)
 
#define TIM_SR_CC4OF_Msk   (0x1UL << TIM_SR_CC4OF_Pos)
 
#define TIM_SR_CC4OF   TIM_SR_CC4OF_Msk
 
#define TIM_SR_CC5IF_Pos   (16U)
 
#define TIM_SR_CC5IF_Msk   (0x1UL << TIM_SR_CC5IF_Pos)
 
#define TIM_SR_CC5IF   TIM_SR_CC5IF_Msk
 
#define TIM_SR_CC6IF_Pos   (17U)
 
#define TIM_SR_CC6IF_Msk   (0x1UL << TIM_SR_CC6IF_Pos)
 
#define TIM_SR_CC6IF   TIM_SR_CC6IF_Msk
 
#define TIM_EGR_UG_Pos   (0U)
 
#define TIM_EGR_UG_Msk   (0x1UL << TIM_EGR_UG_Pos)
 
#define TIM_EGR_UG   TIM_EGR_UG_Msk
 
#define TIM_EGR_CC1G_Pos   (1U)
 
#define TIM_EGR_CC1G_Msk   (0x1UL << TIM_EGR_CC1G_Pos)
 
#define TIM_EGR_CC1G   TIM_EGR_CC1G_Msk
 
#define TIM_EGR_CC2G_Pos   (2U)
 
#define TIM_EGR_CC2G_Msk   (0x1UL << TIM_EGR_CC2G_Pos)
 
#define TIM_EGR_CC2G   TIM_EGR_CC2G_Msk
 
#define TIM_EGR_CC3G_Pos   (3U)
 
#define TIM_EGR_CC3G_Msk   (0x1UL << TIM_EGR_CC3G_Pos)
 
#define TIM_EGR_CC3G   TIM_EGR_CC3G_Msk
 
#define TIM_EGR_CC4G_Pos   (4U)
 
#define TIM_EGR_CC4G_Msk   (0x1UL << TIM_EGR_CC4G_Pos)
 
#define TIM_EGR_CC4G   TIM_EGR_CC4G_Msk
 
#define TIM_EGR_COMG_Pos   (5U)
 
#define TIM_EGR_COMG_Msk   (0x1UL << TIM_EGR_COMG_Pos)
 
#define TIM_EGR_COMG   TIM_EGR_COMG_Msk
 
#define TIM_EGR_TG_Pos   (6U)
 
#define TIM_EGR_TG_Msk   (0x1UL << TIM_EGR_TG_Pos)
 
#define TIM_EGR_TG   TIM_EGR_TG_Msk
 
#define TIM_EGR_BG_Pos   (7U)
 
#define TIM_EGR_BG_Msk   (0x1UL << TIM_EGR_BG_Pos)
 
#define TIM_EGR_BG   TIM_EGR_BG_Msk
 
#define TIM_EGR_B2G_Pos   (8U)
 
#define TIM_EGR_B2G_Msk   (0x1UL << TIM_EGR_B2G_Pos)
 
#define TIM_EGR_B2G   TIM_EGR_B2G_Msk
 
#define TIM_CCMR1_CC1S_Pos   (0U)
 
#define TIM_CCMR1_CC1S_Msk   (0x3UL << TIM_CCMR1_CC1S_Pos)
 
#define TIM_CCMR1_CC1S   TIM_CCMR1_CC1S_Msk
 
#define TIM_CCMR1_CC1S_0   (0x1UL << TIM_CCMR1_CC1S_Pos)
 
#define TIM_CCMR1_CC1S_1   (0x2UL << TIM_CCMR1_CC1S_Pos)
 
#define TIM_CCMR1_OC1FE_Pos   (2U)
 
#define TIM_CCMR1_OC1FE_Msk   (0x1UL << TIM_CCMR1_OC1FE_Pos)
 
#define TIM_CCMR1_OC1FE   TIM_CCMR1_OC1FE_Msk
 
#define TIM_CCMR1_OC1PE_Pos   (3U)
 
#define TIM_CCMR1_OC1PE_Msk   (0x1UL << TIM_CCMR1_OC1PE_Pos)
 
#define TIM_CCMR1_OC1PE   TIM_CCMR1_OC1PE_Msk
 
#define TIM_CCMR1_OC1M_Pos   (4U)
 
#define TIM_CCMR1_OC1M_Msk   (0x1007UL << TIM_CCMR1_OC1M_Pos)
 
#define TIM_CCMR1_OC1M   TIM_CCMR1_OC1M_Msk
 
#define TIM_CCMR1_OC1M_0   (0x00000010U)
 
#define TIM_CCMR1_OC1M_1   (0x00000020U)
 
#define TIM_CCMR1_OC1M_2   (0x00000040U)
 
#define TIM_CCMR1_OC1M_3   (0x00010000U)
 
#define TIM_CCMR1_OC1CE_Pos   (7U)
 
#define TIM_CCMR1_OC1CE_Msk   (0x1UL << TIM_CCMR1_OC1CE_Pos)
 
#define TIM_CCMR1_OC1CE   TIM_CCMR1_OC1CE_Msk
 
#define TIM_CCMR1_CC2S_Pos   (8U)
 
#define TIM_CCMR1_CC2S_Msk   (0x3UL << TIM_CCMR1_CC2S_Pos)
 
#define TIM_CCMR1_CC2S   TIM_CCMR1_CC2S_Msk
 
#define TIM_CCMR1_CC2S_0   (0x1UL << TIM_CCMR1_CC2S_Pos)
 
#define TIM_CCMR1_CC2S_1   (0x2UL << TIM_CCMR1_CC2S_Pos)
 
#define TIM_CCMR1_OC2FE_Pos   (10U)
 
#define TIM_CCMR1_OC2FE_Msk   (0x1UL << TIM_CCMR1_OC2FE_Pos)
 
#define TIM_CCMR1_OC2FE   TIM_CCMR1_OC2FE_Msk
 
#define TIM_CCMR1_OC2PE_Pos   (11U)
 
#define TIM_CCMR1_OC2PE_Msk   (0x1UL << TIM_CCMR1_OC2PE_Pos)
 
#define TIM_CCMR1_OC2PE   TIM_CCMR1_OC2PE_Msk
 
#define TIM_CCMR1_OC2M_Pos   (12U)
 
#define TIM_CCMR1_OC2M_Msk   (0x1007UL << TIM_CCMR1_OC2M_Pos)
 
#define TIM_CCMR1_OC2M   TIM_CCMR1_OC2M_Msk
 
#define TIM_CCMR1_OC2M_0   (0x00001000U)
 
#define TIM_CCMR1_OC2M_1   (0x00002000U)
 
#define TIM_CCMR1_OC2M_2   (0x00004000U)
 
#define TIM_CCMR1_OC2M_3   (0x01000000U)
 
#define TIM_CCMR1_OC2CE_Pos   (15U)
 
#define TIM_CCMR1_OC2CE_Msk   (0x1UL << TIM_CCMR1_OC2CE_Pos)
 
#define TIM_CCMR1_OC2CE   TIM_CCMR1_OC2CE_Msk
 
#define TIM_CCMR1_IC1PSC_Pos   (2U)
 
#define TIM_CCMR1_IC1PSC_Msk   (0x3UL << TIM_CCMR1_IC1PSC_Pos)
 
#define TIM_CCMR1_IC1PSC   TIM_CCMR1_IC1PSC_Msk
 
#define TIM_CCMR1_IC1PSC_0   (0x1UL << TIM_CCMR1_IC1PSC_Pos)
 
#define TIM_CCMR1_IC1PSC_1   (0x2UL << TIM_CCMR1_IC1PSC_Pos)
 
#define TIM_CCMR1_IC1F_Pos   (4U)
 
#define TIM_CCMR1_IC1F_Msk   (0xFUL << TIM_CCMR1_IC1F_Pos)
 
#define TIM_CCMR1_IC1F   TIM_CCMR1_IC1F_Msk
 
#define TIM_CCMR1_IC1F_0   (0x1UL << TIM_CCMR1_IC1F_Pos)
 
#define TIM_CCMR1_IC1F_1   (0x2UL << TIM_CCMR1_IC1F_Pos)
 
#define TIM_CCMR1_IC1F_2   (0x4UL << TIM_CCMR1_IC1F_Pos)
 
#define TIM_CCMR1_IC1F_3   (0x8UL << TIM_CCMR1_IC1F_Pos)
 
#define TIM_CCMR1_IC2PSC_Pos   (10U)
 
#define TIM_CCMR1_IC2PSC_Msk   (0x3UL << TIM_CCMR1_IC2PSC_Pos)
 
#define TIM_CCMR1_IC2PSC   TIM_CCMR1_IC2PSC_Msk
 
#define TIM_CCMR1_IC2PSC_0   (0x1UL << TIM_CCMR1_IC2PSC_Pos)
 
#define TIM_CCMR1_IC2PSC_1   (0x2UL << TIM_CCMR1_IC2PSC_Pos)
 
#define TIM_CCMR1_IC2F_Pos   (12U)
 
#define TIM_CCMR1_IC2F_Msk   (0xFUL << TIM_CCMR1_IC2F_Pos)
 
#define TIM_CCMR1_IC2F   TIM_CCMR1_IC2F_Msk
 
#define TIM_CCMR1_IC2F_0   (0x1UL << TIM_CCMR1_IC2F_Pos)
 
#define TIM_CCMR1_IC2F_1   (0x2UL << TIM_CCMR1_IC2F_Pos)
 
#define TIM_CCMR1_IC2F_2   (0x4UL << TIM_CCMR1_IC2F_Pos)
 
#define TIM_CCMR1_IC2F_3   (0x8UL << TIM_CCMR1_IC2F_Pos)
 
#define TIM_CCMR2_CC3S_Pos   (0U)
 
#define TIM_CCMR2_CC3S_Msk   (0x3UL << TIM_CCMR2_CC3S_Pos)
 
#define TIM_CCMR2_CC3S   TIM_CCMR2_CC3S_Msk
 
#define TIM_CCMR2_CC3S_0   (0x1UL << TIM_CCMR2_CC3S_Pos)
 
#define TIM_CCMR2_CC3S_1   (0x2UL << TIM_CCMR2_CC3S_Pos)
 
#define TIM_CCMR2_OC3FE_Pos   (2U)
 
#define TIM_CCMR2_OC3FE_Msk   (0x1UL << TIM_CCMR2_OC3FE_Pos)
 
#define TIM_CCMR2_OC3FE   TIM_CCMR2_OC3FE_Msk
 
#define TIM_CCMR2_OC3PE_Pos   (3U)
 
#define TIM_CCMR2_OC3PE_Msk   (0x1UL << TIM_CCMR2_OC3PE_Pos)
 
#define TIM_CCMR2_OC3PE   TIM_CCMR2_OC3PE_Msk
 
#define TIM_CCMR2_OC3M_Pos   (4U)
 
#define TIM_CCMR2_OC3M_Msk   (0x1007UL << TIM_CCMR2_OC3M_Pos)
 
#define TIM_CCMR2_OC3M   TIM_CCMR2_OC3M_Msk
 
#define TIM_CCMR2_OC3M_0   (0x00000010U)
 
#define TIM_CCMR2_OC3M_1   (0x00000020U)
 
#define TIM_CCMR2_OC3M_2   (0x00000040U)
 
#define TIM_CCMR2_OC3M_3   (0x00010000U)
 
#define TIM_CCMR2_OC3CE_Pos   (7U)
 
#define TIM_CCMR2_OC3CE_Msk   (0x1UL << TIM_CCMR2_OC3CE_Pos)
 
#define TIM_CCMR2_OC3CE   TIM_CCMR2_OC3CE_Msk
 
#define TIM_CCMR2_CC4S_Pos   (8U)
 
#define TIM_CCMR2_CC4S_Msk   (0x3UL << TIM_CCMR2_CC4S_Pos)
 
#define TIM_CCMR2_CC4S   TIM_CCMR2_CC4S_Msk
 
#define TIM_CCMR2_CC4S_0   (0x1UL << TIM_CCMR2_CC4S_Pos)
 
#define TIM_CCMR2_CC4S_1   (0x2UL << TIM_CCMR2_CC4S_Pos)
 
#define TIM_CCMR2_OC4FE_Pos   (10U)
 
#define TIM_CCMR2_OC4FE_Msk   (0x1UL << TIM_CCMR2_OC4FE_Pos)
 
#define TIM_CCMR2_OC4FE   TIM_CCMR2_OC4FE_Msk
 
#define TIM_CCMR2_OC4PE_Pos   (11U)
 
#define TIM_CCMR2_OC4PE_Msk   (0x1UL << TIM_CCMR2_OC4PE_Pos)
 
#define TIM_CCMR2_OC4PE   TIM_CCMR2_OC4PE_Msk
 
#define TIM_CCMR2_OC4M_Pos   (12U)
 
#define TIM_CCMR2_OC4M_Msk   (0x1007UL << TIM_CCMR2_OC4M_Pos)
 
#define TIM_CCMR2_OC4M   TIM_CCMR2_OC4M_Msk
 
#define TIM_CCMR2_OC4M_0   (0x00001000U)
 
#define TIM_CCMR2_OC4M_1   (0x00002000U)
 
#define TIM_CCMR2_OC4M_2   (0x00004000U)
 
#define TIM_CCMR2_OC4M_3   (0x01000000U)
 
#define TIM_CCMR2_OC4CE_Pos   (15U)
 
#define TIM_CCMR2_OC4CE_Msk   (0x1UL << TIM_CCMR2_OC4CE_Pos)
 
#define TIM_CCMR2_OC4CE   TIM_CCMR2_OC4CE_Msk
 
#define TIM_CCMR2_IC3PSC_Pos   (2U)
 
#define TIM_CCMR2_IC3PSC_Msk   (0x3UL << TIM_CCMR2_IC3PSC_Pos)
 
#define TIM_CCMR2_IC3PSC   TIM_CCMR2_IC3PSC_Msk
 
#define TIM_CCMR2_IC3PSC_0   (0x1UL << TIM_CCMR2_IC3PSC_Pos)
 
#define TIM_CCMR2_IC3PSC_1   (0x2UL << TIM_CCMR2_IC3PSC_Pos)
 
#define TIM_CCMR2_IC3F_Pos   (4U)
 
#define TIM_CCMR2_IC3F_Msk   (0xFUL << TIM_CCMR2_IC3F_Pos)
 
#define TIM_CCMR2_IC3F   TIM_CCMR2_IC3F_Msk
 
#define TIM_CCMR2_IC3F_0   (0x1UL << TIM_CCMR2_IC3F_Pos)
 
#define TIM_CCMR2_IC3F_1   (0x2UL << TIM_CCMR2_IC3F_Pos)
 
#define TIM_CCMR2_IC3F_2   (0x4UL << TIM_CCMR2_IC3F_Pos)
 
#define TIM_CCMR2_IC3F_3   (0x8UL << TIM_CCMR2_IC3F_Pos)
 
#define TIM_CCMR2_IC4PSC_Pos   (10U)
 
#define TIM_CCMR2_IC4PSC_Msk   (0x3UL << TIM_CCMR2_IC4PSC_Pos)
 
#define TIM_CCMR2_IC4PSC   TIM_CCMR2_IC4PSC_Msk
 
#define TIM_CCMR2_IC4PSC_0   (0x1UL << TIM_CCMR2_IC4PSC_Pos)
 
#define TIM_CCMR2_IC4PSC_1   (0x2UL << TIM_CCMR2_IC4PSC_Pos)
 
#define TIM_CCMR2_IC4F_Pos   (12U)
 
#define TIM_CCMR2_IC4F_Msk   (0xFUL << TIM_CCMR2_IC4F_Pos)
 
#define TIM_CCMR2_IC4F   TIM_CCMR2_IC4F_Msk
 
#define TIM_CCMR2_IC4F_0   (0x1UL << TIM_CCMR2_IC4F_Pos)
 
#define TIM_CCMR2_IC4F_1   (0x2UL << TIM_CCMR2_IC4F_Pos)
 
#define TIM_CCMR2_IC4F_2   (0x4UL << TIM_CCMR2_IC4F_Pos)
 
#define TIM_CCMR2_IC4F_3   (0x8UL << TIM_CCMR2_IC4F_Pos)
 
#define TIM_CCER_CC1E_Pos   (0U)
 
#define TIM_CCER_CC1E_Msk   (0x1UL << TIM_CCER_CC1E_Pos)
 
#define TIM_CCER_CC1E   TIM_CCER_CC1E_Msk
 
#define TIM_CCER_CC1P_Pos   (1U)
 
#define TIM_CCER_CC1P_Msk   (0x1UL << TIM_CCER_CC1P_Pos)
 
#define TIM_CCER_CC1P   TIM_CCER_CC1P_Msk
 
#define TIM_CCER_CC1NE_Pos   (2U)
 
#define TIM_CCER_CC1NE_Msk   (0x1UL << TIM_CCER_CC1NE_Pos)
 
#define TIM_CCER_CC1NE   TIM_CCER_CC1NE_Msk
 
#define TIM_CCER_CC1NP_Pos   (3U)
 
#define TIM_CCER_CC1NP_Msk   (0x1UL << TIM_CCER_CC1NP_Pos)
 
#define TIM_CCER_CC1NP   TIM_CCER_CC1NP_Msk
 
#define TIM_CCER_CC2E_Pos   (4U)
 
#define TIM_CCER_CC2E_Msk   (0x1UL << TIM_CCER_CC2E_Pos)
 
#define TIM_CCER_CC2E   TIM_CCER_CC2E_Msk
 
#define TIM_CCER_CC2P_Pos   (5U)
 
#define TIM_CCER_CC2P_Msk   (0x1UL << TIM_CCER_CC2P_Pos)
 
#define TIM_CCER_CC2P   TIM_CCER_CC2P_Msk
 
#define TIM_CCER_CC2NE_Pos   (6U)
 
#define TIM_CCER_CC2NE_Msk   (0x1UL << TIM_CCER_CC2NE_Pos)
 
#define TIM_CCER_CC2NE   TIM_CCER_CC2NE_Msk
 
#define TIM_CCER_CC2NP_Pos   (7U)
 
#define TIM_CCER_CC2NP_Msk   (0x1UL << TIM_CCER_CC2NP_Pos)
 
#define TIM_CCER_CC2NP   TIM_CCER_CC2NP_Msk
 
#define TIM_CCER_CC3E_Pos   (8U)
 
#define TIM_CCER_CC3E_Msk   (0x1UL << TIM_CCER_CC3E_Pos)
 
#define TIM_CCER_CC3E   TIM_CCER_CC3E_Msk
 
#define TIM_CCER_CC3P_Pos   (9U)
 
#define TIM_CCER_CC3P_Msk   (0x1UL << TIM_CCER_CC3P_Pos)
 
#define TIM_CCER_CC3P   TIM_CCER_CC3P_Msk
 
#define TIM_CCER_CC3NE_Pos   (10U)
 
#define TIM_CCER_CC3NE_Msk   (0x1UL << TIM_CCER_CC3NE_Pos)
 
#define TIM_CCER_CC3NE   TIM_CCER_CC3NE_Msk
 
#define TIM_CCER_CC3NP_Pos   (11U)
 
#define TIM_CCER_CC3NP_Msk   (0x1UL << TIM_CCER_CC3NP_Pos)
 
#define TIM_CCER_CC3NP   TIM_CCER_CC3NP_Msk
 
#define TIM_CCER_CC4E_Pos   (12U)
 
#define TIM_CCER_CC4E_Msk   (0x1UL << TIM_CCER_CC4E_Pos)
 
#define TIM_CCER_CC4E   TIM_CCER_CC4E_Msk
 
#define TIM_CCER_CC4P_Pos   (13U)
 
#define TIM_CCER_CC4P_Msk   (0x1UL << TIM_CCER_CC4P_Pos)
 
#define TIM_CCER_CC4P   TIM_CCER_CC4P_Msk
 
#define TIM_CCER_CC4NP_Pos   (15U)
 
#define TIM_CCER_CC4NP_Msk   (0x1UL << TIM_CCER_CC4NP_Pos)
 
#define TIM_CCER_CC4NP   TIM_CCER_CC4NP_Msk
 
#define TIM_CCER_CC5E_Pos   (16U)
 
#define TIM_CCER_CC5E_Msk   (0x1UL << TIM_CCER_CC5E_Pos)
 
#define TIM_CCER_CC5E   TIM_CCER_CC5E_Msk
 
#define TIM_CCER_CC5P_Pos   (17U)
 
#define TIM_CCER_CC5P_Msk   (0x1UL << TIM_CCER_CC5P_Pos)
 
#define TIM_CCER_CC5P   TIM_CCER_CC5P_Msk
 
#define TIM_CCER_CC6E_Pos   (20U)
 
#define TIM_CCER_CC6E_Msk   (0x1UL << TIM_CCER_CC6E_Pos)
 
#define TIM_CCER_CC6E   TIM_CCER_CC6E_Msk
 
#define TIM_CCER_CC6P_Pos   (21U)
 
#define TIM_CCER_CC6P_Msk   (0x1UL << TIM_CCER_CC6P_Pos)
 
#define TIM_CCER_CC6P   TIM_CCER_CC6P_Msk
 
#define TIM_CNT_CNT_Pos   (0U)
 
#define TIM_CNT_CNT_Msk   (0xFFFFFFFFUL << TIM_CNT_CNT_Pos)
 
#define TIM_CNT_CNT   TIM_CNT_CNT_Msk
 
#define TIM_CNT_UIFCPY_Pos   (31U)
 
#define TIM_CNT_UIFCPY_Msk   (0x1UL << TIM_CNT_UIFCPY_Pos)
 
#define TIM_CNT_UIFCPY   TIM_CNT_UIFCPY_Msk
 
#define TIM_PSC_PSC_Pos   (0U)
 
#define TIM_PSC_PSC_Msk   (0xFFFFUL << TIM_PSC_PSC_Pos)
 
#define TIM_PSC_PSC   TIM_PSC_PSC_Msk
 
#define TIM_ARR_ARR_Pos   (0U)
 
#define TIM_ARR_ARR_Msk   (0xFFFFFFFFUL << TIM_ARR_ARR_Pos)
 
#define TIM_ARR_ARR   TIM_ARR_ARR_Msk
 
#define TIM_RCR_REP_Pos   (0U)
 
#define TIM_RCR_REP_Msk   (0xFFFFUL << TIM_RCR_REP_Pos)
 
#define TIM_RCR_REP   TIM_RCR_REP_Msk
 
#define TIM_CCR1_CCR1_Pos   (0U)
 
#define TIM_CCR1_CCR1_Msk   (0xFFFFUL << TIM_CCR1_CCR1_Pos)
 
#define TIM_CCR1_CCR1   TIM_CCR1_CCR1_Msk
 
#define TIM_CCR2_CCR2_Pos   (0U)
 
#define TIM_CCR2_CCR2_Msk   (0xFFFFUL << TIM_CCR2_CCR2_Pos)
 
#define TIM_CCR2_CCR2   TIM_CCR2_CCR2_Msk
 
#define TIM_CCR3_CCR3_Pos   (0U)
 
#define TIM_CCR3_CCR3_Msk   (0xFFFFUL << TIM_CCR3_CCR3_Pos)
 
#define TIM_CCR3_CCR3   TIM_CCR3_CCR3_Msk
 
#define TIM_CCR4_CCR4_Pos   (0U)
 
#define TIM_CCR4_CCR4_Msk   (0xFFFFUL << TIM_CCR4_CCR4_Pos)
 
#define TIM_CCR4_CCR4   TIM_CCR4_CCR4_Msk
 
#define TIM_CCR5_CCR5_Pos   (0U)
 
#define TIM_CCR5_CCR5_Msk   (0xFFFFFFFFUL << TIM_CCR5_CCR5_Pos)
 
#define TIM_CCR5_CCR5   TIM_CCR5_CCR5_Msk
 
#define TIM_CCR5_GC5C1_Pos   (29U)
 
#define TIM_CCR5_GC5C1_Msk   (0x1UL << TIM_CCR5_GC5C1_Pos)
 
#define TIM_CCR5_GC5C1   TIM_CCR5_GC5C1_Msk
 
#define TIM_CCR5_GC5C2_Pos   (30U)
 
#define TIM_CCR5_GC5C2_Msk   (0x1UL << TIM_CCR5_GC5C2_Pos)
 
#define TIM_CCR5_GC5C2   TIM_CCR5_GC5C2_Msk
 
#define TIM_CCR5_GC5C3_Pos   (31U)
 
#define TIM_CCR5_GC5C3_Msk   (0x1UL << TIM_CCR5_GC5C3_Pos)
 
#define TIM_CCR5_GC5C3   TIM_CCR5_GC5C3_Msk
 
#define TIM_CCR6_CCR6_Pos   (0U)
 
#define TIM_CCR6_CCR6_Msk   (0xFFFFUL << TIM_CCR6_CCR6_Pos)
 
#define TIM_CCR6_CCR6   TIM_CCR6_CCR6_Msk
 
#define TIM_BDTR_DTG_Pos   (0U)
 
#define TIM_BDTR_DTG_Msk   (0xFFUL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_DTG   TIM_BDTR_DTG_Msk
 
#define TIM_BDTR_DTG_0   (0x01UL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_DTG_1   (0x02UL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_DTG_2   (0x04UL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_DTG_3   (0x08UL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_DTG_4   (0x10UL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_DTG_5   (0x20UL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_DTG_6   (0x40UL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_DTG_7   (0x80UL << TIM_BDTR_DTG_Pos)
 
#define TIM_BDTR_LOCK_Pos   (8U)
 
#define TIM_BDTR_LOCK_Msk   (0x3UL << TIM_BDTR_LOCK_Pos)
 
#define TIM_BDTR_LOCK   TIM_BDTR_LOCK_Msk
 
#define TIM_BDTR_LOCK_0   (0x1UL << TIM_BDTR_LOCK_Pos)
 
#define TIM_BDTR_LOCK_1   (0x2UL << TIM_BDTR_LOCK_Pos)
 
#define TIM_BDTR_OSSI_Pos   (10U)
 
#define TIM_BDTR_OSSI_Msk   (0x1UL << TIM_BDTR_OSSI_Pos)
 
#define TIM_BDTR_OSSI   TIM_BDTR_OSSI_Msk
 
#define TIM_BDTR_OSSR_Pos   (11U)
 
#define TIM_BDTR_OSSR_Msk   (0x1UL << TIM_BDTR_OSSR_Pos)
 
#define TIM_BDTR_OSSR   TIM_BDTR_OSSR_Msk
 
#define TIM_BDTR_BKE_Pos   (12U)
 
#define TIM_BDTR_BKE_Msk   (0x1UL << TIM_BDTR_BKE_Pos)
 
#define TIM_BDTR_BKE   TIM_BDTR_BKE_Msk
 
#define TIM_BDTR_BKP_Pos   (13U)
 
#define TIM_BDTR_BKP_Msk   (0x1UL << TIM_BDTR_BKP_Pos)
 
#define TIM_BDTR_BKP   TIM_BDTR_BKP_Msk
 
#define TIM_BDTR_AOE_Pos   (14U)
 
#define TIM_BDTR_AOE_Msk   (0x1UL << TIM_BDTR_AOE_Pos)
 
#define TIM_BDTR_AOE   TIM_BDTR_AOE_Msk
 
#define TIM_BDTR_MOE_Pos   (15U)
 
#define TIM_BDTR_MOE_Msk   (0x1UL << TIM_BDTR_MOE_Pos)
 
#define TIM_BDTR_MOE   TIM_BDTR_MOE_Msk
 
#define TIM_BDTR_BKF_Pos   (16U)
 
#define TIM_BDTR_BKF_Msk   (0xFUL << TIM_BDTR_BKF_Pos)
 
#define TIM_BDTR_BKF   TIM_BDTR_BKF_Msk
 
#define TIM_BDTR_BK2F_Pos   (20U)
 
#define TIM_BDTR_BK2F_Msk   (0xFUL << TIM_BDTR_BK2F_Pos)
 
#define TIM_BDTR_BK2F   TIM_BDTR_BK2F_Msk
 
#define TIM_BDTR_BK2E_Pos   (24U)
 
#define TIM_BDTR_BK2E_Msk   (0x1UL << TIM_BDTR_BK2E_Pos)
 
#define TIM_BDTR_BK2E   TIM_BDTR_BK2E_Msk
 
#define TIM_BDTR_BK2P_Pos   (25U)
 
#define TIM_BDTR_BK2P_Msk   (0x1UL << TIM_BDTR_BK2P_Pos)
 
#define TIM_BDTR_BK2P   TIM_BDTR_BK2P_Msk
 
#define TIM_DCR_DBA_Pos   (0U)
 
#define TIM_DCR_DBA_Msk   (0x1FUL << TIM_DCR_DBA_Pos)
 
#define TIM_DCR_DBA   TIM_DCR_DBA_Msk
 
#define TIM_DCR_DBA_0   (0x01UL << TIM_DCR_DBA_Pos)
 
#define TIM_DCR_DBA_1   (0x02UL << TIM_DCR_DBA_Pos)
 
#define TIM_DCR_DBA_2   (0x04UL << TIM_DCR_DBA_Pos)
 
#define TIM_DCR_DBA_3   (0x08UL << TIM_DCR_DBA_Pos)
 
#define TIM_DCR_DBA_4   (0x10UL << TIM_DCR_DBA_Pos)
 
#define TIM_DCR_DBL_Pos   (8U)
 
#define TIM_DCR_DBL_Msk   (0x1FUL << TIM_DCR_DBL_Pos)
 
#define TIM_DCR_DBL   TIM_DCR_DBL_Msk
 
#define TIM_DCR_DBL_0   (0x01UL << TIM_DCR_DBL_Pos)
 
#define TIM_DCR_DBL_1   (0x02UL << TIM_DCR_DBL_Pos)
 
#define TIM_DCR_DBL_2   (0x04UL << TIM_DCR_DBL_Pos)
 
#define TIM_DCR_DBL_3   (0x08UL << TIM_DCR_DBL_Pos)
 
#define TIM_DCR_DBL_4   (0x10UL << TIM_DCR_DBL_Pos)
 
#define TIM_DMAR_DMAB_Pos   (0U)
 
#define TIM_DMAR_DMAB_Msk   (0xFFFFUL << TIM_DMAR_DMAB_Pos)
 
#define TIM_DMAR_DMAB   TIM_DMAR_DMAB_Msk
 
#define TIM16_OR_TI1_RMP_Pos   (0U)
 
#define TIM16_OR_TI1_RMP_Msk   (0x3UL << TIM16_OR_TI1_RMP_Pos)
 
#define TIM16_OR_TI1_RMP   TIM16_OR_TI1_RMP_Msk
 
#define TIM16_OR_TI1_RMP_0   (0x1UL << TIM16_OR_TI1_RMP_Pos)
 
#define TIM16_OR_TI1_RMP_1   (0x2UL << TIM16_OR_TI1_RMP_Pos)
 
#define TIM1_OR_ETR_RMP_Pos   (0U)
 
#define TIM1_OR_ETR_RMP_Msk   (0xFUL << TIM1_OR_ETR_RMP_Pos)
 
#define TIM1_OR_ETR_RMP   TIM1_OR_ETR_RMP_Msk
 
#define TIM1_OR_ETR_RMP_0   (0x1UL << TIM1_OR_ETR_RMP_Pos)
 
#define TIM1_OR_ETR_RMP_1   (0x2UL << TIM1_OR_ETR_RMP_Pos)
 
#define TIM1_OR_ETR_RMP_2   (0x4UL << TIM1_OR_ETR_RMP_Pos)
 
#define TIM1_OR_ETR_RMP_3   (0x8UL << TIM1_OR_ETR_RMP_Pos)
 
#define TIM8_OR_ETR_RMP_Pos   (0U)
 
#define TIM8_OR_ETR_RMP_Msk   (0xFUL << TIM8_OR_ETR_RMP_Pos)
 
#define TIM8_OR_ETR_RMP   TIM8_OR_ETR_RMP_Msk
 
#define TIM8_OR_ETR_RMP_0   (0x1UL << TIM8_OR_ETR_RMP_Pos)
 
#define TIM8_OR_ETR_RMP_1   (0x2UL << TIM8_OR_ETR_RMP_Pos)
 
#define TIM8_OR_ETR_RMP_2   (0x4UL << TIM8_OR_ETR_RMP_Pos)
 
#define TIM8_OR_ETR_RMP_3   (0x8UL << TIM8_OR_ETR_RMP_Pos)
 
#define TIM20_OR_ETR_RMP_Pos   (0U)
 
#define TIM20_OR_ETR_RMP_Msk   (0xFUL << TIM20_OR_ETR_RMP_Pos)
 
#define TIM20_OR_ETR_RMP   TIM20_OR_ETR_RMP_Msk
 
#define TIM20_OR_ETR_RMP_0   (0x1UL << TIM20_OR_ETR_RMP_Pos)
 
#define TIM20_OR_ETR_RMP_1   (0x2UL << TIM20_OR_ETR_RMP_Pos)
 
#define TIM20_OR_ETR_RMP_2   (0x4UL << TIM20_OR_ETR_RMP_Pos)
 
#define TIM20_OR_ETR_RMP_3   (0x8UL << TIM20_OR_ETR_RMP_Pos)
 
#define TIM_CCMR3_OC5FE_Pos   (2U)
 
#define TIM_CCMR3_OC5FE_Msk   (0x1UL << TIM_CCMR3_OC5FE_Pos)
 
#define TIM_CCMR3_OC5FE   TIM_CCMR3_OC5FE_Msk
 
#define TIM_CCMR3_OC5PE_Pos   (3U)
 
#define TIM_CCMR3_OC5PE_Msk   (0x1UL << TIM_CCMR3_OC5PE_Pos)
 
#define TIM_CCMR3_OC5PE   TIM_CCMR3_OC5PE_Msk
 
#define TIM_CCMR3_OC5M_Pos   (4U)
 
#define TIM_CCMR3_OC5M_Msk   (0x1007UL << TIM_CCMR3_OC5M_Pos)
 
#define TIM_CCMR3_OC5M   TIM_CCMR3_OC5M_Msk
 
#define TIM_CCMR3_OC5M_0   (0x0001UL << TIM_CCMR3_OC5M_Pos)
 
#define TIM_CCMR3_OC5M_1   (0x0002UL << TIM_CCMR3_OC5M_Pos)
 
#define TIM_CCMR3_OC5M_2   (0x0004UL << TIM_CCMR3_OC5M_Pos)
 
#define TIM_CCMR3_OC5M_3   (0x1000UL << TIM_CCMR3_OC5M_Pos)
 
#define TIM_CCMR3_OC5CE_Pos   (7U)
 
#define TIM_CCMR3_OC5CE_Msk   (0x1UL << TIM_CCMR3_OC5CE_Pos)
 
#define TIM_CCMR3_OC5CE   TIM_CCMR3_OC5CE_Msk
 
#define TIM_CCMR3_OC6FE_Pos   (10U)
 
#define TIM_CCMR3_OC6FE_Msk   (0x1UL << TIM_CCMR3_OC6FE_Pos)
 
#define TIM_CCMR3_OC6FE   TIM_CCMR3_OC6FE_Msk
 
#define TIM_CCMR3_OC6PE_Pos   (11U)
 
#define TIM_CCMR3_OC6PE_Msk   (0x1UL << TIM_CCMR3_OC6PE_Pos)
 
#define TIM_CCMR3_OC6PE   TIM_CCMR3_OC6PE_Msk
 
#define TIM_CCMR3_OC6M_Pos   (12U)
 
#define TIM_CCMR3_OC6M_Msk   (0x1007UL << TIM_CCMR3_OC6M_Pos)
 
#define TIM_CCMR3_OC6M   TIM_CCMR3_OC6M_Msk
 
#define TIM_CCMR3_OC6M_0   (0x0001UL << TIM_CCMR3_OC6M_Pos)
 
#define TIM_CCMR3_OC6M_1   (0x0002UL << TIM_CCMR3_OC6M_Pos)
 
#define TIM_CCMR3_OC6M_2   (0x0004UL << TIM_CCMR3_OC6M_Pos)
 
#define TIM_CCMR3_OC6M_3   (0x1000UL << TIM_CCMR3_OC6M_Pos)
 
#define TIM_CCMR3_OC6CE_Pos   (15U)
 
#define TIM_CCMR3_OC6CE_Msk   (0x1UL << TIM_CCMR3_OC6CE_Pos)
 
#define TIM_CCMR3_OC6CE   TIM_CCMR3_OC6CE_Msk
 
#define TSC_CR_TSCE_Pos   (0U)
 
#define TSC_CR_TSCE_Msk   (0x1UL << TSC_CR_TSCE_Pos)
 
#define TSC_CR_TSCE   TSC_CR_TSCE_Msk
 
#define TSC_CR_START_Pos   (1U)
 
#define TSC_CR_START_Msk   (0x1UL << TSC_CR_START_Pos)
 
#define TSC_CR_START   TSC_CR_START_Msk
 
#define TSC_CR_AM_Pos   (2U)
 
#define TSC_CR_AM_Msk   (0x1UL << TSC_CR_AM_Pos)
 
#define TSC_CR_AM   TSC_CR_AM_Msk
 
#define TSC_CR_SYNCPOL_Pos   (3U)
 
#define TSC_CR_SYNCPOL_Msk   (0x1UL << TSC_CR_SYNCPOL_Pos)
 
#define TSC_CR_SYNCPOL   TSC_CR_SYNCPOL_Msk
 
#define TSC_CR_IODEF_Pos   (4U)
 
#define TSC_CR_IODEF_Msk   (0x1UL << TSC_CR_IODEF_Pos)
 
#define TSC_CR_IODEF   TSC_CR_IODEF_Msk
 
#define TSC_CR_MCV_Pos   (5U)
 
#define TSC_CR_MCV_Msk   (0x7UL << TSC_CR_MCV_Pos)
 
#define TSC_CR_MCV   TSC_CR_MCV_Msk
 
#define TSC_CR_MCV_0   (0x1UL << TSC_CR_MCV_Pos)
 
#define TSC_CR_MCV_1   (0x2UL << TSC_CR_MCV_Pos)
 
#define TSC_CR_MCV_2   (0x4UL << TSC_CR_MCV_Pos)
 
#define TSC_CR_PGPSC_Pos   (12U)
 
#define TSC_CR_PGPSC_Msk   (0x7UL << TSC_CR_PGPSC_Pos)
 
#define TSC_CR_PGPSC   TSC_CR_PGPSC_Msk
 
#define TSC_CR_PGPSC_0   (0x1UL << TSC_CR_PGPSC_Pos)
 
#define TSC_CR_PGPSC_1   (0x2UL << TSC_CR_PGPSC_Pos)
 
#define TSC_CR_PGPSC_2   (0x4UL << TSC_CR_PGPSC_Pos)
 
#define TSC_CR_SSPSC_Pos   (15U)
 
#define TSC_CR_SSPSC_Msk   (0x1UL << TSC_CR_SSPSC_Pos)
 
#define TSC_CR_SSPSC   TSC_CR_SSPSC_Msk
 
#define TSC_CR_SSE_Pos   (16U)
 
#define TSC_CR_SSE_Msk   (0x1UL << TSC_CR_SSE_Pos)
 
#define TSC_CR_SSE   TSC_CR_SSE_Msk
 
#define TSC_CR_SSD_Pos   (17U)
 
#define TSC_CR_SSD_Msk   (0x7FUL << TSC_CR_SSD_Pos)
 
#define TSC_CR_SSD   TSC_CR_SSD_Msk
 
#define TSC_CR_SSD_0   (0x01UL << TSC_CR_SSD_Pos)
 
#define TSC_CR_SSD_1   (0x02UL << TSC_CR_SSD_Pos)
 
#define TSC_CR_SSD_2   (0x04UL << TSC_CR_SSD_Pos)
 
#define TSC_CR_SSD_3   (0x08UL << TSC_CR_SSD_Pos)
 
#define TSC_CR_SSD_4   (0x10UL << TSC_CR_SSD_Pos)
 
#define TSC_CR_SSD_5   (0x20UL << TSC_CR_SSD_Pos)
 
#define TSC_CR_SSD_6   (0x40UL << TSC_CR_SSD_Pos)
 
#define TSC_CR_CTPL_Pos   (24U)
 
#define TSC_CR_CTPL_Msk   (0xFUL << TSC_CR_CTPL_Pos)
 
#define TSC_CR_CTPL   TSC_CR_CTPL_Msk
 
#define TSC_CR_CTPL_0   (0x1UL << TSC_CR_CTPL_Pos)
 
#define TSC_CR_CTPL_1   (0x2UL << TSC_CR_CTPL_Pos)
 
#define TSC_CR_CTPL_2   (0x4UL << TSC_CR_CTPL_Pos)
 
#define TSC_CR_CTPL_3   (0x8UL << TSC_CR_CTPL_Pos)
 
#define TSC_CR_CTPH_Pos   (28U)
 
#define TSC_CR_CTPH_Msk   (0xFUL << TSC_CR_CTPH_Pos)
 
#define TSC_CR_CTPH   TSC_CR_CTPH_Msk
 
#define TSC_CR_CTPH_0   (0x1UL << TSC_CR_CTPH_Pos)
 
#define TSC_CR_CTPH_1   (0x2UL << TSC_CR_CTPH_Pos)
 
#define TSC_CR_CTPH_2   (0x4UL << TSC_CR_CTPH_Pos)
 
#define TSC_CR_CTPH_3   (0x8UL << TSC_CR_CTPH_Pos)
 
#define TSC_IER_EOAIE_Pos   (0U)
 
#define TSC_IER_EOAIE_Msk   (0x1UL << TSC_IER_EOAIE_Pos)
 
#define TSC_IER_EOAIE   TSC_IER_EOAIE_Msk
 
#define TSC_IER_MCEIE_Pos   (1U)
 
#define TSC_IER_MCEIE_Msk   (0x1UL << TSC_IER_MCEIE_Pos)
 
#define TSC_IER_MCEIE   TSC_IER_MCEIE_Msk
 
#define TSC_ICR_EOAIC_Pos   (0U)
 
#define TSC_ICR_EOAIC_Msk   (0x1UL << TSC_ICR_EOAIC_Pos)
 
#define TSC_ICR_EOAIC   TSC_ICR_EOAIC_Msk
 
#define TSC_ICR_MCEIC_Pos   (1U)
 
#define TSC_ICR_MCEIC_Msk   (0x1UL << TSC_ICR_MCEIC_Pos)
 
#define TSC_ICR_MCEIC   TSC_ICR_MCEIC_Msk
 
#define TSC_ISR_EOAF_Pos   (0U)
 
#define TSC_ISR_EOAF_Msk   (0x1UL << TSC_ISR_EOAF_Pos)
 
#define TSC_ISR_EOAF   TSC_ISR_EOAF_Msk
 
#define TSC_ISR_MCEF_Pos   (1U)
 
#define TSC_ISR_MCEF_Msk   (0x1UL << TSC_ISR_MCEF_Pos)
 
#define TSC_ISR_MCEF   TSC_ISR_MCEF_Msk
 
#define TSC_IOHCR_G1_IO1_Pos   (0U)
 
#define TSC_IOHCR_G1_IO1_Msk   (0x1UL << TSC_IOHCR_G1_IO1_Pos)
 
#define TSC_IOHCR_G1_IO1   TSC_IOHCR_G1_IO1_Msk
 
#define TSC_IOHCR_G1_IO2_Pos   (1U)
 
#define TSC_IOHCR_G1_IO2_Msk   (0x1UL << TSC_IOHCR_G1_IO2_Pos)
 
#define TSC_IOHCR_G1_IO2   TSC_IOHCR_G1_IO2_Msk
 
#define TSC_IOHCR_G1_IO3_Pos   (2U)
 
#define TSC_IOHCR_G1_IO3_Msk   (0x1UL << TSC_IOHCR_G1_IO3_Pos)
 
#define TSC_IOHCR_G1_IO3   TSC_IOHCR_G1_IO3_Msk
 
#define TSC_IOHCR_G1_IO4_Pos   (3U)
 
#define TSC_IOHCR_G1_IO4_Msk   (0x1UL << TSC_IOHCR_G1_IO4_Pos)
 
#define TSC_IOHCR_G1_IO4   TSC_IOHCR_G1_IO4_Msk
 
#define TSC_IOHCR_G2_IO1_Pos   (4U)
 
#define TSC_IOHCR_G2_IO1_Msk   (0x1UL << TSC_IOHCR_G2_IO1_Pos)
 
#define TSC_IOHCR_G2_IO1   TSC_IOHCR_G2_IO1_Msk
 
#define TSC_IOHCR_G2_IO2_Pos   (5U)
 
#define TSC_IOHCR_G2_IO2_Msk   (0x1UL << TSC_IOHCR_G2_IO2_Pos)
 
#define TSC_IOHCR_G2_IO2   TSC_IOHCR_G2_IO2_Msk
 
#define TSC_IOHCR_G2_IO3_Pos   (6U)
 
#define TSC_IOHCR_G2_IO3_Msk   (0x1UL << TSC_IOHCR_G2_IO3_Pos)
 
#define TSC_IOHCR_G2_IO3   TSC_IOHCR_G2_IO3_Msk
 
#define TSC_IOHCR_G2_IO4_Pos   (7U)
 
#define TSC_IOHCR_G2_IO4_Msk   (0x1UL << TSC_IOHCR_G2_IO4_Pos)
 
#define TSC_IOHCR_G2_IO4   TSC_IOHCR_G2_IO4_Msk
 
#define TSC_IOHCR_G3_IO1_Pos   (8U)
 
#define TSC_IOHCR_G3_IO1_Msk   (0x1UL << TSC_IOHCR_G3_IO1_Pos)
 
#define TSC_IOHCR_G3_IO1   TSC_IOHCR_G3_IO1_Msk
 
#define TSC_IOHCR_G3_IO2_Pos   (9U)
 
#define TSC_IOHCR_G3_IO2_Msk   (0x1UL << TSC_IOHCR_G3_IO2_Pos)
 
#define TSC_IOHCR_G3_IO2   TSC_IOHCR_G3_IO2_Msk
 
#define TSC_IOHCR_G3_IO3_Pos   (10U)
 
#define TSC_IOHCR_G3_IO3_Msk   (0x1UL << TSC_IOHCR_G3_IO3_Pos)
 
#define TSC_IOHCR_G3_IO3   TSC_IOHCR_G3_IO3_Msk
 
#define TSC_IOHCR_G3_IO4_Pos   (11U)
 
#define TSC_IOHCR_G3_IO4_Msk   (0x1UL << TSC_IOHCR_G3_IO4_Pos)
 
#define TSC_IOHCR_G3_IO4   TSC_IOHCR_G3_IO4_Msk
 
#define TSC_IOHCR_G4_IO1_Pos   (12U)
 
#define TSC_IOHCR_G4_IO1_Msk   (0x1UL << TSC_IOHCR_G4_IO1_Pos)
 
#define TSC_IOHCR_G4_IO1   TSC_IOHCR_G4_IO1_Msk
 
#define TSC_IOHCR_G4_IO2_Pos   (13U)
 
#define TSC_IOHCR_G4_IO2_Msk   (0x1UL << TSC_IOHCR_G4_IO2_Pos)
 
#define TSC_IOHCR_G4_IO2   TSC_IOHCR_G4_IO2_Msk
 
#define TSC_IOHCR_G4_IO3_Pos   (14U)
 
#define TSC_IOHCR_G4_IO3_Msk   (0x1UL << TSC_IOHCR_G4_IO3_Pos)
 
#define TSC_IOHCR_G4_IO3   TSC_IOHCR_G4_IO3_Msk
 
#define TSC_IOHCR_G4_IO4_Pos   (15U)
 
#define TSC_IOHCR_G4_IO4_Msk   (0x1UL << TSC_IOHCR_G4_IO4_Pos)
 
#define TSC_IOHCR_G4_IO4   TSC_IOHCR_G4_IO4_Msk
 
#define TSC_IOHCR_G5_IO1_Pos   (16U)
 
#define TSC_IOHCR_G5_IO1_Msk   (0x1UL << TSC_IOHCR_G5_IO1_Pos)
 
#define TSC_IOHCR_G5_IO1   TSC_IOHCR_G5_IO1_Msk
 
#define TSC_IOHCR_G5_IO2_Pos   (17U)
 
#define TSC_IOHCR_G5_IO2_Msk   (0x1UL << TSC_IOHCR_G5_IO2_Pos)
 
#define TSC_IOHCR_G5_IO2   TSC_IOHCR_G5_IO2_Msk
 
#define TSC_IOHCR_G5_IO3_Pos   (18U)
 
#define TSC_IOHCR_G5_IO3_Msk   (0x1UL << TSC_IOHCR_G5_IO3_Pos)
 
#define TSC_IOHCR_G5_IO3   TSC_IOHCR_G5_IO3_Msk
 
#define TSC_IOHCR_G5_IO4_Pos   (19U)
 
#define TSC_IOHCR_G5_IO4_Msk   (0x1UL << TSC_IOHCR_G5_IO4_Pos)
 
#define TSC_IOHCR_G5_IO4   TSC_IOHCR_G5_IO4_Msk
 
#define TSC_IOHCR_G6_IO1_Pos   (20U)
 
#define TSC_IOHCR_G6_IO1_Msk   (0x1UL << TSC_IOHCR_G6_IO1_Pos)
 
#define TSC_IOHCR_G6_IO1   TSC_IOHCR_G6_IO1_Msk
 
#define TSC_IOHCR_G6_IO2_Pos   (21U)
 
#define TSC_IOHCR_G6_IO2_Msk   (0x1UL << TSC_IOHCR_G6_IO2_Pos)
 
#define TSC_IOHCR_G6_IO2   TSC_IOHCR_G6_IO2_Msk
 
#define TSC_IOHCR_G6_IO3_Pos   (22U)
 
#define TSC_IOHCR_G6_IO3_Msk   (0x1UL << TSC_IOHCR_G6_IO3_Pos)
 
#define TSC_IOHCR_G6_IO3   TSC_IOHCR_G6_IO3_Msk
 
#define TSC_IOHCR_G6_IO4_Pos   (23U)
 
#define TSC_IOHCR_G6_IO4_Msk   (0x1UL << TSC_IOHCR_G6_IO4_Pos)
 
#define TSC_IOHCR_G6_IO4   TSC_IOHCR_G6_IO4_Msk
 
#define TSC_IOHCR_G7_IO1_Pos   (24U)
 
#define TSC_IOHCR_G7_IO1_Msk   (0x1UL << TSC_IOHCR_G7_IO1_Pos)
 
#define TSC_IOHCR_G7_IO1   TSC_IOHCR_G7_IO1_Msk
 
#define TSC_IOHCR_G7_IO2_Pos   (25U)
 
#define TSC_IOHCR_G7_IO2_Msk   (0x1UL << TSC_IOHCR_G7_IO2_Pos)
 
#define TSC_IOHCR_G7_IO2   TSC_IOHCR_G7_IO2_Msk
 
#define TSC_IOHCR_G7_IO3_Pos   (26U)
 
#define TSC_IOHCR_G7_IO3_Msk   (0x1UL << TSC_IOHCR_G7_IO3_Pos)
 
#define TSC_IOHCR_G7_IO3   TSC_IOHCR_G7_IO3_Msk
 
#define TSC_IOHCR_G7_IO4_Pos   (27U)
 
#define TSC_IOHCR_G7_IO4_Msk   (0x1UL << TSC_IOHCR_G7_IO4_Pos)
 
#define TSC_IOHCR_G7_IO4   TSC_IOHCR_G7_IO4_Msk
 
#define TSC_IOHCR_G8_IO1_Pos   (28U)
 
#define TSC_IOHCR_G8_IO1_Msk   (0x1UL << TSC_IOHCR_G8_IO1_Pos)
 
#define TSC_IOHCR_G8_IO1   TSC_IOHCR_G8_IO1_Msk
 
#define TSC_IOHCR_G8_IO2_Pos   (29U)
 
#define TSC_IOHCR_G8_IO2_Msk   (0x1UL << TSC_IOHCR_G8_IO2_Pos)
 
#define TSC_IOHCR_G8_IO2   TSC_IOHCR_G8_IO2_Msk
 
#define TSC_IOHCR_G8_IO3_Pos   (30U)
 
#define TSC_IOHCR_G8_IO3_Msk   (0x1UL << TSC_IOHCR_G8_IO3_Pos)
 
#define TSC_IOHCR_G8_IO3   TSC_IOHCR_G8_IO3_Msk
 
#define TSC_IOHCR_G8_IO4_Pos   (31U)
 
#define TSC_IOHCR_G8_IO4_Msk   (0x1UL << TSC_IOHCR_G8_IO4_Pos)
 
#define TSC_IOHCR_G8_IO4   TSC_IOHCR_G8_IO4_Msk
 
#define TSC_IOASCR_G1_IO1_Pos   (0U)
 
#define TSC_IOASCR_G1_IO1_Msk   (0x1UL << TSC_IOASCR_G1_IO1_Pos)
 
#define TSC_IOASCR_G1_IO1   TSC_IOASCR_G1_IO1_Msk
 
#define TSC_IOASCR_G1_IO2_Pos   (1U)
 
#define TSC_IOASCR_G1_IO2_Msk   (0x1UL << TSC_IOASCR_G1_IO2_Pos)
 
#define TSC_IOASCR_G1_IO2   TSC_IOASCR_G1_IO2_Msk
 
#define TSC_IOASCR_G1_IO3_Pos   (2U)
 
#define TSC_IOASCR_G1_IO3_Msk   (0x1UL << TSC_IOASCR_G1_IO3_Pos)
 
#define TSC_IOASCR_G1_IO3   TSC_IOASCR_G1_IO3_Msk
 
#define TSC_IOASCR_G1_IO4_Pos   (3U)
 
#define TSC_IOASCR_G1_IO4_Msk   (0x1UL << TSC_IOASCR_G1_IO4_Pos)
 
#define TSC_IOASCR_G1_IO4   TSC_IOASCR_G1_IO4_Msk
 
#define TSC_IOASCR_G2_IO1_Pos   (4U)
 
#define TSC_IOASCR_G2_IO1_Msk   (0x1UL << TSC_IOASCR_G2_IO1_Pos)
 
#define TSC_IOASCR_G2_IO1   TSC_IOASCR_G2_IO1_Msk
 
#define TSC_IOASCR_G2_IO2_Pos   (5U)
 
#define TSC_IOASCR_G2_IO2_Msk   (0x1UL << TSC_IOASCR_G2_IO2_Pos)
 
#define TSC_IOASCR_G2_IO2   TSC_IOASCR_G2_IO2_Msk
 
#define TSC_IOASCR_G2_IO3_Pos   (6U)
 
#define TSC_IOASCR_G2_IO3_Msk   (0x1UL << TSC_IOASCR_G2_IO3_Pos)
 
#define TSC_IOASCR_G2_IO3   TSC_IOASCR_G2_IO3_Msk
 
#define TSC_IOASCR_G2_IO4_Pos   (7U)
 
#define TSC_IOASCR_G2_IO4_Msk   (0x1UL << TSC_IOASCR_G2_IO4_Pos)
 
#define TSC_IOASCR_G2_IO4   TSC_IOASCR_G2_IO4_Msk
 
#define TSC_IOASCR_G3_IO1_Pos   (8U)
 
#define TSC_IOASCR_G3_IO1_Msk   (0x1UL << TSC_IOASCR_G3_IO1_Pos)
 
#define TSC_IOASCR_G3_IO1   TSC_IOASCR_G3_IO1_Msk
 
#define TSC_IOASCR_G3_IO2_Pos   (9U)
 
#define TSC_IOASCR_G3_IO2_Msk   (0x1UL << TSC_IOASCR_G3_IO2_Pos)
 
#define TSC_IOASCR_G3_IO2   TSC_IOASCR_G3_IO2_Msk
 
#define TSC_IOASCR_G3_IO3_Pos   (10U)
 
#define TSC_IOASCR_G3_IO3_Msk   (0x1UL << TSC_IOASCR_G3_IO3_Pos)
 
#define TSC_IOASCR_G3_IO3   TSC_IOASCR_G3_IO3_Msk
 
#define TSC_IOASCR_G3_IO4_Pos   (11U)
 
#define TSC_IOASCR_G3_IO4_Msk   (0x1UL << TSC_IOASCR_G3_IO4_Pos)
 
#define TSC_IOASCR_G3_IO4   TSC_IOASCR_G3_IO4_Msk
 
#define TSC_IOASCR_G4_IO1_Pos   (12U)
 
#define TSC_IOASCR_G4_IO1_Msk   (0x1UL << TSC_IOASCR_G4_IO1_Pos)
 
#define TSC_IOASCR_G4_IO1   TSC_IOASCR_G4_IO1_Msk
 
#define TSC_IOASCR_G4_IO2_Pos   (13U)
 
#define TSC_IOASCR_G4_IO2_Msk   (0x1UL << TSC_IOASCR_G4_IO2_Pos)
 
#define TSC_IOASCR_G4_IO2   TSC_IOASCR_G4_IO2_Msk
 
#define TSC_IOASCR_G4_IO3_Pos   (14U)
 
#define TSC_IOASCR_G4_IO3_Msk   (0x1UL << TSC_IOASCR_G4_IO3_Pos)
 
#define TSC_IOASCR_G4_IO3   TSC_IOASCR_G4_IO3_Msk
 
#define TSC_IOASCR_G4_IO4_Pos   (15U)
 
#define TSC_IOASCR_G4_IO4_Msk   (0x1UL << TSC_IOASCR_G4_IO4_Pos)
 
#define TSC_IOASCR_G4_IO4   TSC_IOASCR_G4_IO4_Msk
 
#define TSC_IOASCR_G5_IO1_Pos   (16U)
 
#define TSC_IOASCR_G5_IO1_Msk   (0x1UL << TSC_IOASCR_G5_IO1_Pos)
 
#define TSC_IOASCR_G5_IO1   TSC_IOASCR_G5_IO1_Msk
 
#define TSC_IOASCR_G5_IO2_Pos   (17U)
 
#define TSC_IOASCR_G5_IO2_Msk   (0x1UL << TSC_IOASCR_G5_IO2_Pos)
 
#define TSC_IOASCR_G5_IO2   TSC_IOASCR_G5_IO2_Msk
 
#define TSC_IOASCR_G5_IO3_Pos   (18U)
 
#define TSC_IOASCR_G5_IO3_Msk   (0x1UL << TSC_IOASCR_G5_IO3_Pos)
 
#define TSC_IOASCR_G5_IO3   TSC_IOASCR_G5_IO3_Msk
 
#define TSC_IOASCR_G5_IO4_Pos   (19U)
 
#define TSC_IOASCR_G5_IO4_Msk   (0x1UL << TSC_IOASCR_G5_IO4_Pos)
 
#define TSC_IOASCR_G5_IO4   TSC_IOASCR_G5_IO4_Msk
 
#define TSC_IOASCR_G6_IO1_Pos   (20U)
 
#define TSC_IOASCR_G6_IO1_Msk   (0x1UL << TSC_IOASCR_G6_IO1_Pos)
 
#define TSC_IOASCR_G6_IO1   TSC_IOASCR_G6_IO1_Msk
 
#define TSC_IOASCR_G6_IO2_Pos   (21U)
 
#define TSC_IOASCR_G6_IO2_Msk   (0x1UL << TSC_IOASCR_G6_IO2_Pos)
 
#define TSC_IOASCR_G6_IO2   TSC_IOASCR_G6_IO2_Msk
 
#define TSC_IOASCR_G6_IO3_Pos   (22U)
 
#define TSC_IOASCR_G6_IO3_Msk   (0x1UL << TSC_IOASCR_G6_IO3_Pos)
 
#define TSC_IOASCR_G6_IO3   TSC_IOASCR_G6_IO3_Msk
 
#define TSC_IOASCR_G6_IO4_Pos   (23U)
 
#define TSC_IOASCR_G6_IO4_Msk   (0x1UL << TSC_IOASCR_G6_IO4_Pos)
 
#define TSC_IOASCR_G6_IO4   TSC_IOASCR_G6_IO4_Msk
 
#define TSC_IOASCR_G7_IO1_Pos   (24U)
 
#define TSC_IOASCR_G7_IO1_Msk   (0x1UL << TSC_IOASCR_G7_IO1_Pos)
 
#define TSC_IOASCR_G7_IO1   TSC_IOASCR_G7_IO1_Msk
 
#define TSC_IOASCR_G7_IO2_Pos   (25U)
 
#define TSC_IOASCR_G7_IO2_Msk   (0x1UL << TSC_IOASCR_G7_IO2_Pos)
 
#define TSC_IOASCR_G7_IO2   TSC_IOASCR_G7_IO2_Msk
 
#define TSC_IOASCR_G7_IO3_Pos   (26U)
 
#define TSC_IOASCR_G7_IO3_Msk   (0x1UL << TSC_IOASCR_G7_IO3_Pos)
 
#define TSC_IOASCR_G7_IO3   TSC_IOASCR_G7_IO3_Msk
 
#define TSC_IOASCR_G7_IO4_Pos   (27U)
 
#define TSC_IOASCR_G7_IO4_Msk   (0x1UL << TSC_IOASCR_G7_IO4_Pos)
 
#define TSC_IOASCR_G7_IO4   TSC_IOASCR_G7_IO4_Msk
 
#define TSC_IOASCR_G8_IO1_Pos   (28U)
 
#define TSC_IOASCR_G8_IO1_Msk   (0x1UL << TSC_IOASCR_G8_IO1_Pos)
 
#define TSC_IOASCR_G8_IO1   TSC_IOASCR_G8_IO1_Msk
 
#define TSC_IOASCR_G8_IO2_Pos   (29U)
 
#define TSC_IOASCR_G8_IO2_Msk   (0x1UL << TSC_IOASCR_G8_IO2_Pos)
 
#define TSC_IOASCR_G8_IO2   TSC_IOASCR_G8_IO2_Msk
 
#define TSC_IOASCR_G8_IO3_Pos   (30U)
 
#define TSC_IOASCR_G8_IO3_Msk   (0x1UL << TSC_IOASCR_G8_IO3_Pos)
 
#define TSC_IOASCR_G8_IO3   TSC_IOASCR_G8_IO3_Msk
 
#define TSC_IOASCR_G8_IO4_Pos   (31U)
 
#define TSC_IOASCR_G8_IO4_Msk   (0x1UL << TSC_IOASCR_G8_IO4_Pos)
 
#define TSC_IOASCR_G8_IO4   TSC_IOASCR_G8_IO4_Msk
 
#define TSC_IOSCR_G1_IO1_Pos   (0U)
 
#define TSC_IOSCR_G1_IO1_Msk   (0x1UL << TSC_IOSCR_G1_IO1_Pos)
 
#define TSC_IOSCR_G1_IO1   TSC_IOSCR_G1_IO1_Msk
 
#define TSC_IOSCR_G1_IO2_Pos   (1U)
 
#define TSC_IOSCR_G1_IO2_Msk   (0x1UL << TSC_IOSCR_G1_IO2_Pos)
 
#define TSC_IOSCR_G1_IO2   TSC_IOSCR_G1_IO2_Msk
 
#define TSC_IOSCR_G1_IO3_Pos   (2U)
 
#define TSC_IOSCR_G1_IO3_Msk   (0x1UL << TSC_IOSCR_G1_IO3_Pos)
 
#define TSC_IOSCR_G1_IO3   TSC_IOSCR_G1_IO3_Msk
 
#define TSC_IOSCR_G1_IO4_Pos   (3U)
 
#define TSC_IOSCR_G1_IO4_Msk   (0x1UL << TSC_IOSCR_G1_IO4_Pos)
 
#define TSC_IOSCR_G1_IO4   TSC_IOSCR_G1_IO4_Msk
 
#define TSC_IOSCR_G2_IO1_Pos   (4U)
 
#define TSC_IOSCR_G2_IO1_Msk   (0x1UL << TSC_IOSCR_G2_IO1_Pos)
 
#define TSC_IOSCR_G2_IO1   TSC_IOSCR_G2_IO1_Msk
 
#define TSC_IOSCR_G2_IO2_Pos   (5U)
 
#define TSC_IOSCR_G2_IO2_Msk   (0x1UL << TSC_IOSCR_G2_IO2_Pos)
 
#define TSC_IOSCR_G2_IO2   TSC_IOSCR_G2_IO2_Msk
 
#define TSC_IOSCR_G2_IO3_Pos   (6U)
 
#define TSC_IOSCR_G2_IO3_Msk   (0x1UL << TSC_IOSCR_G2_IO3_Pos)
 
#define TSC_IOSCR_G2_IO3   TSC_IOSCR_G2_IO3_Msk
 
#define TSC_IOSCR_G2_IO4_Pos   (7U)
 
#define TSC_IOSCR_G2_IO4_Msk   (0x1UL << TSC_IOSCR_G2_IO4_Pos)
 
#define TSC_IOSCR_G2_IO4   TSC_IOSCR_G2_IO4_Msk
 
#define TSC_IOSCR_G3_IO1_Pos   (8U)
 
#define TSC_IOSCR_G3_IO1_Msk   (0x1UL << TSC_IOSCR_G3_IO1_Pos)
 
#define TSC_IOSCR_G3_IO1   TSC_IOSCR_G3_IO1_Msk
 
#define TSC_IOSCR_G3_IO2_Pos   (9U)
 
#define TSC_IOSCR_G3_IO2_Msk   (0x1UL << TSC_IOSCR_G3_IO2_Pos)
 
#define TSC_IOSCR_G3_IO2   TSC_IOSCR_G3_IO2_Msk
 
#define TSC_IOSCR_G3_IO3_Pos   (10U)
 
#define TSC_IOSCR_G3_IO3_Msk   (0x1UL << TSC_IOSCR_G3_IO3_Pos)
 
#define TSC_IOSCR_G3_IO3   TSC_IOSCR_G3_IO3_Msk
 
#define TSC_IOSCR_G3_IO4_Pos   (11U)
 
#define TSC_IOSCR_G3_IO4_Msk   (0x1UL << TSC_IOSCR_G3_IO4_Pos)
 
#define TSC_IOSCR_G3_IO4   TSC_IOSCR_G3_IO4_Msk
 
#define TSC_IOSCR_G4_IO1_Pos   (12U)
 
#define TSC_IOSCR_G4_IO1_Msk   (0x1UL << TSC_IOSCR_G4_IO1_Pos)
 
#define TSC_IOSCR_G4_IO1   TSC_IOSCR_G4_IO1_Msk
 
#define TSC_IOSCR_G4_IO2_Pos   (13U)
 
#define TSC_IOSCR_G4_IO2_Msk   (0x1UL << TSC_IOSCR_G4_IO2_Pos)
 
#define TSC_IOSCR_G4_IO2   TSC_IOSCR_G4_IO2_Msk
 
#define TSC_IOSCR_G4_IO3_Pos   (14U)
 
#define TSC_IOSCR_G4_IO3_Msk   (0x1UL << TSC_IOSCR_G4_IO3_Pos)
 
#define TSC_IOSCR_G4_IO3   TSC_IOSCR_G4_IO3_Msk
 
#define TSC_IOSCR_G4_IO4_Pos   (15U)
 
#define TSC_IOSCR_G4_IO4_Msk   (0x1UL << TSC_IOSCR_G4_IO4_Pos)
 
#define TSC_IOSCR_G4_IO4   TSC_IOSCR_G4_IO4_Msk
 
#define TSC_IOSCR_G5_IO1_Pos   (16U)
 
#define TSC_IOSCR_G5_IO1_Msk   (0x1UL << TSC_IOSCR_G5_IO1_Pos)
 
#define TSC_IOSCR_G5_IO1   TSC_IOSCR_G5_IO1_Msk
 
#define TSC_IOSCR_G5_IO2_Pos   (17U)
 
#define TSC_IOSCR_G5_IO2_Msk   (0x1UL << TSC_IOSCR_G5_IO2_Pos)
 
#define TSC_IOSCR_G5_IO2   TSC_IOSCR_G5_IO2_Msk
 
#define TSC_IOSCR_G5_IO3_Pos   (18U)
 
#define TSC_IOSCR_G5_IO3_Msk   (0x1UL << TSC_IOSCR_G5_IO3_Pos)
 
#define TSC_IOSCR_G5_IO3   TSC_IOSCR_G5_IO3_Msk
 
#define TSC_IOSCR_G5_IO4_Pos   (19U)
 
#define TSC_IOSCR_G5_IO4_Msk   (0x1UL << TSC_IOSCR_G5_IO4_Pos)
 
#define TSC_IOSCR_G5_IO4   TSC_IOSCR_G5_IO4_Msk
 
#define TSC_IOSCR_G6_IO1_Pos   (20U)
 
#define TSC_IOSCR_G6_IO1_Msk   (0x1UL << TSC_IOSCR_G6_IO1_Pos)
 
#define TSC_IOSCR_G6_IO1   TSC_IOSCR_G6_IO1_Msk
 
#define TSC_IOSCR_G6_IO2_Pos   (21U)
 
#define TSC_IOSCR_G6_IO2_Msk   (0x1UL << TSC_IOSCR_G6_IO2_Pos)
 
#define TSC_IOSCR_G6_IO2   TSC_IOSCR_G6_IO2_Msk
 
#define TSC_IOSCR_G6_IO3_Pos   (22U)
 
#define TSC_IOSCR_G6_IO3_Msk   (0x1UL << TSC_IOSCR_G6_IO3_Pos)
 
#define TSC_IOSCR_G6_IO3   TSC_IOSCR_G6_IO3_Msk
 
#define TSC_IOSCR_G6_IO4_Pos   (23U)
 
#define TSC_IOSCR_G6_IO4_Msk   (0x1UL << TSC_IOSCR_G6_IO4_Pos)
 
#define TSC_IOSCR_G6_IO4   TSC_IOSCR_G6_IO4_Msk
 
#define TSC_IOSCR_G7_IO1_Pos   (24U)
 
#define TSC_IOSCR_G7_IO1_Msk   (0x1UL << TSC_IOSCR_G7_IO1_Pos)
 
#define TSC_IOSCR_G7_IO1   TSC_IOSCR_G7_IO1_Msk
 
#define TSC_IOSCR_G7_IO2_Pos   (25U)
 
#define TSC_IOSCR_G7_IO2_Msk   (0x1UL << TSC_IOSCR_G7_IO2_Pos)
 
#define TSC_IOSCR_G7_IO2   TSC_IOSCR_G7_IO2_Msk
 
#define TSC_IOSCR_G7_IO3_Pos   (26U)
 
#define TSC_IOSCR_G7_IO3_Msk   (0x1UL << TSC_IOSCR_G7_IO3_Pos)
 
#define TSC_IOSCR_G7_IO3   TSC_IOSCR_G7_IO3_Msk
 
#define TSC_IOSCR_G7_IO4_Pos   (27U)
 
#define TSC_IOSCR_G7_IO4_Msk   (0x1UL << TSC_IOSCR_G7_IO4_Pos)
 
#define TSC_IOSCR_G7_IO4   TSC_IOSCR_G7_IO4_Msk
 
#define TSC_IOSCR_G8_IO1_Pos   (28U)
 
#define TSC_IOSCR_G8_IO1_Msk   (0x1UL << TSC_IOSCR_G8_IO1_Pos)
 
#define TSC_IOSCR_G8_IO1   TSC_IOSCR_G8_IO1_Msk
 
#define TSC_IOSCR_G8_IO2_Pos   (29U)
 
#define TSC_IOSCR_G8_IO2_Msk   (0x1UL << TSC_IOSCR_G8_IO2_Pos)
 
#define TSC_IOSCR_G8_IO2   TSC_IOSCR_G8_IO2_Msk
 
#define TSC_IOSCR_G8_IO3_Pos   (30U)
 
#define TSC_IOSCR_G8_IO3_Msk   (0x1UL << TSC_IOSCR_G8_IO3_Pos)
 
#define TSC_IOSCR_G8_IO3   TSC_IOSCR_G8_IO3_Msk
 
#define TSC_IOSCR_G8_IO4_Pos   (31U)
 
#define TSC_IOSCR_G8_IO4_Msk   (0x1UL << TSC_IOSCR_G8_IO4_Pos)
 
#define TSC_IOSCR_G8_IO4   TSC_IOSCR_G8_IO4_Msk
 
#define TSC_IOCCR_G1_IO1_Pos   (0U)
 
#define TSC_IOCCR_G1_IO1_Msk   (0x1UL << TSC_IOCCR_G1_IO1_Pos)
 
#define TSC_IOCCR_G1_IO1   TSC_IOCCR_G1_IO1_Msk
 
#define TSC_IOCCR_G1_IO2_Pos   (1U)
 
#define TSC_IOCCR_G1_IO2_Msk   (0x1UL << TSC_IOCCR_G1_IO2_Pos)
 
#define TSC_IOCCR_G1_IO2   TSC_IOCCR_G1_IO2_Msk
 
#define TSC_IOCCR_G1_IO3_Pos   (2U)
 
#define TSC_IOCCR_G1_IO3_Msk   (0x1UL << TSC_IOCCR_G1_IO3_Pos)
 
#define TSC_IOCCR_G1_IO3   TSC_IOCCR_G1_IO3_Msk
 
#define TSC_IOCCR_G1_IO4_Pos   (3U)
 
#define TSC_IOCCR_G1_IO4_Msk   (0x1UL << TSC_IOCCR_G1_IO4_Pos)
 
#define TSC_IOCCR_G1_IO4   TSC_IOCCR_G1_IO4_Msk
 
#define TSC_IOCCR_G2_IO1_Pos   (4U)
 
#define TSC_IOCCR_G2_IO1_Msk   (0x1UL << TSC_IOCCR_G2_IO1_Pos)
 
#define TSC_IOCCR_G2_IO1   TSC_IOCCR_G2_IO1_Msk
 
#define TSC_IOCCR_G2_IO2_Pos   (5U)
 
#define TSC_IOCCR_G2_IO2_Msk   (0x1UL << TSC_IOCCR_G2_IO2_Pos)
 
#define TSC_IOCCR_G2_IO2   TSC_IOCCR_G2_IO2_Msk
 
#define TSC_IOCCR_G2_IO3_Pos   (6U)
 
#define TSC_IOCCR_G2_IO3_Msk   (0x1UL << TSC_IOCCR_G2_IO3_Pos)
 
#define TSC_IOCCR_G2_IO3   TSC_IOCCR_G2_IO3_Msk
 
#define TSC_IOCCR_G2_IO4_Pos   (7U)
 
#define TSC_IOCCR_G2_IO4_Msk   (0x1UL << TSC_IOCCR_G2_IO4_Pos)
 
#define TSC_IOCCR_G2_IO4   TSC_IOCCR_G2_IO4_Msk
 
#define TSC_IOCCR_G3_IO1_Pos   (8U)
 
#define TSC_IOCCR_G3_IO1_Msk   (0x1UL << TSC_IOCCR_G3_IO1_Pos)
 
#define TSC_IOCCR_G3_IO1   TSC_IOCCR_G3_IO1_Msk
 
#define TSC_IOCCR_G3_IO2_Pos   (9U)
 
#define TSC_IOCCR_G3_IO2_Msk   (0x1UL << TSC_IOCCR_G3_IO2_Pos)
 
#define TSC_IOCCR_G3_IO2   TSC_IOCCR_G3_IO2_Msk
 
#define TSC_IOCCR_G3_IO3_Pos   (10U)
 
#define TSC_IOCCR_G3_IO3_Msk   (0x1UL << TSC_IOCCR_G3_IO3_Pos)
 
#define TSC_IOCCR_G3_IO3   TSC_IOCCR_G3_IO3_Msk
 
#define TSC_IOCCR_G3_IO4_Pos   (11U)
 
#define TSC_IOCCR_G3_IO4_Msk   (0x1UL << TSC_IOCCR_G3_IO4_Pos)
 
#define TSC_IOCCR_G3_IO4   TSC_IOCCR_G3_IO4_Msk
 
#define TSC_IOCCR_G4_IO1_Pos   (12U)
 
#define TSC_IOCCR_G4_IO1_Msk   (0x1UL << TSC_IOCCR_G4_IO1_Pos)
 
#define TSC_IOCCR_G4_IO1   TSC_IOCCR_G4_IO1_Msk
 
#define TSC_IOCCR_G4_IO2_Pos   (13U)
 
#define TSC_IOCCR_G4_IO2_Msk   (0x1UL << TSC_IOCCR_G4_IO2_Pos)
 
#define TSC_IOCCR_G4_IO2   TSC_IOCCR_G4_IO2_Msk
 
#define TSC_IOCCR_G4_IO3_Pos   (14U)
 
#define TSC_IOCCR_G4_IO3_Msk   (0x1UL << TSC_IOCCR_G4_IO3_Pos)
 
#define TSC_IOCCR_G4_IO3   TSC_IOCCR_G4_IO3_Msk
 
#define TSC_IOCCR_G4_IO4_Pos   (15U)
 
#define TSC_IOCCR_G4_IO4_Msk   (0x1UL << TSC_IOCCR_G4_IO4_Pos)
 
#define TSC_IOCCR_G4_IO4   TSC_IOCCR_G4_IO4_Msk
 
#define TSC_IOCCR_G5_IO1_Pos   (16U)
 
#define TSC_IOCCR_G5_IO1_Msk   (0x1UL << TSC_IOCCR_G5_IO1_Pos)
 
#define TSC_IOCCR_G5_IO1   TSC_IOCCR_G5_IO1_Msk
 
#define TSC_IOCCR_G5_IO2_Pos   (17U)
 
#define TSC_IOCCR_G5_IO2_Msk   (0x1UL << TSC_IOCCR_G5_IO2_Pos)
 
#define TSC_IOCCR_G5_IO2   TSC_IOCCR_G5_IO2_Msk
 
#define TSC_IOCCR_G5_IO3_Pos   (18U)
 
#define TSC_IOCCR_G5_IO3_Msk   (0x1UL << TSC_IOCCR_G5_IO3_Pos)
 
#define TSC_IOCCR_G5_IO3   TSC_IOCCR_G5_IO3_Msk
 
#define TSC_IOCCR_G5_IO4_Pos   (19U)
 
#define TSC_IOCCR_G5_IO4_Msk   (0x1UL << TSC_IOCCR_G5_IO4_Pos)
 
#define TSC_IOCCR_G5_IO4   TSC_IOCCR_G5_IO4_Msk
 
#define TSC_IOCCR_G6_IO1_Pos   (20U)
 
#define TSC_IOCCR_G6_IO1_Msk   (0x1UL << TSC_IOCCR_G6_IO1_Pos)
 
#define TSC_IOCCR_G6_IO1   TSC_IOCCR_G6_IO1_Msk
 
#define TSC_IOCCR_G6_IO2_Pos   (21U)
 
#define TSC_IOCCR_G6_IO2_Msk   (0x1UL << TSC_IOCCR_G6_IO2_Pos)
 
#define TSC_IOCCR_G6_IO2   TSC_IOCCR_G6_IO2_Msk
 
#define TSC_IOCCR_G6_IO3_Pos   (22U)
 
#define TSC_IOCCR_G6_IO3_Msk   (0x1UL << TSC_IOCCR_G6_IO3_Pos)
 
#define TSC_IOCCR_G6_IO3   TSC_IOCCR_G6_IO3_Msk
 
#define TSC_IOCCR_G6_IO4_Pos   (23U)
 
#define TSC_IOCCR_G6_IO4_Msk   (0x1UL << TSC_IOCCR_G6_IO4_Pos)
 
#define TSC_IOCCR_G6_IO4   TSC_IOCCR_G6_IO4_Msk
 
#define TSC_IOCCR_G7_IO1_Pos   (24U)
 
#define TSC_IOCCR_G7_IO1_Msk   (0x1UL << TSC_IOCCR_G7_IO1_Pos)
 
#define TSC_IOCCR_G7_IO1   TSC_IOCCR_G7_IO1_Msk
 
#define TSC_IOCCR_G7_IO2_Pos   (25U)
 
#define TSC_IOCCR_G7_IO2_Msk   (0x1UL << TSC_IOCCR_G7_IO2_Pos)
 
#define TSC_IOCCR_G7_IO2   TSC_IOCCR_G7_IO2_Msk
 
#define TSC_IOCCR_G7_IO3_Pos   (26U)
 
#define TSC_IOCCR_G7_IO3_Msk   (0x1UL << TSC_IOCCR_G7_IO3_Pos)
 
#define TSC_IOCCR_G7_IO3   TSC_IOCCR_G7_IO3_Msk
 
#define TSC_IOCCR_G7_IO4_Pos   (27U)
 
#define TSC_IOCCR_G7_IO4_Msk   (0x1UL << TSC_IOCCR_G7_IO4_Pos)
 
#define TSC_IOCCR_G7_IO4   TSC_IOCCR_G7_IO4_Msk
 
#define TSC_IOCCR_G8_IO1_Pos   (28U)
 
#define TSC_IOCCR_G8_IO1_Msk   (0x1UL << TSC_IOCCR_G8_IO1_Pos)
 
#define TSC_IOCCR_G8_IO1   TSC_IOCCR_G8_IO1_Msk
 
#define TSC_IOCCR_G8_IO2_Pos   (29U)
 
#define TSC_IOCCR_G8_IO2_Msk   (0x1UL << TSC_IOCCR_G8_IO2_Pos)
 
#define TSC_IOCCR_G8_IO2   TSC_IOCCR_G8_IO2_Msk
 
#define TSC_IOCCR_G8_IO3_Pos   (30U)
 
#define TSC_IOCCR_G8_IO3_Msk   (0x1UL << TSC_IOCCR_G8_IO3_Pos)
 
#define TSC_IOCCR_G8_IO3   TSC_IOCCR_G8_IO3_Msk
 
#define TSC_IOCCR_G8_IO4_Pos   (31U)
 
#define TSC_IOCCR_G8_IO4_Msk   (0x1UL << TSC_IOCCR_G8_IO4_Pos)
 
#define TSC_IOCCR_G8_IO4   TSC_IOCCR_G8_IO4_Msk
 
#define TSC_IOGCSR_G1E_Pos   (0U)
 
#define TSC_IOGCSR_G1E_Msk   (0x1UL << TSC_IOGCSR_G1E_Pos)
 
#define TSC_IOGCSR_G1E   TSC_IOGCSR_G1E_Msk
 
#define TSC_IOGCSR_G2E_Pos   (1U)
 
#define TSC_IOGCSR_G2E_Msk   (0x1UL << TSC_IOGCSR_G2E_Pos)
 
#define TSC_IOGCSR_G2E   TSC_IOGCSR_G2E_Msk
 
#define TSC_IOGCSR_G3E_Pos   (2U)
 
#define TSC_IOGCSR_G3E_Msk   (0x1UL << TSC_IOGCSR_G3E_Pos)
 
#define TSC_IOGCSR_G3E   TSC_IOGCSR_G3E_Msk
 
#define TSC_IOGCSR_G4E_Pos   (3U)
 
#define TSC_IOGCSR_G4E_Msk   (0x1UL << TSC_IOGCSR_G4E_Pos)
 
#define TSC_IOGCSR_G4E   TSC_IOGCSR_G4E_Msk
 
#define TSC_IOGCSR_G5E_Pos   (4U)
 
#define TSC_IOGCSR_G5E_Msk   (0x1UL << TSC_IOGCSR_G5E_Pos)
 
#define TSC_IOGCSR_G5E   TSC_IOGCSR_G5E_Msk
 
#define TSC_IOGCSR_G6E_Pos   (5U)
 
#define TSC_IOGCSR_G6E_Msk   (0x1UL << TSC_IOGCSR_G6E_Pos)
 
#define TSC_IOGCSR_G6E   TSC_IOGCSR_G6E_Msk
 
#define TSC_IOGCSR_G7E_Pos   (6U)
 
#define TSC_IOGCSR_G7E_Msk   (0x1UL << TSC_IOGCSR_G7E_Pos)
 
#define TSC_IOGCSR_G7E   TSC_IOGCSR_G7E_Msk
 
#define TSC_IOGCSR_G8E_Pos   (7U)
 
#define TSC_IOGCSR_G8E_Msk   (0x1UL << TSC_IOGCSR_G8E_Pos)
 
#define TSC_IOGCSR_G8E   TSC_IOGCSR_G8E_Msk
 
#define TSC_IOGCSR_G1S_Pos   (16U)
 
#define TSC_IOGCSR_G1S_Msk   (0x1UL << TSC_IOGCSR_G1S_Pos)
 
#define TSC_IOGCSR_G1S   TSC_IOGCSR_G1S_Msk
 
#define TSC_IOGCSR_G2S_Pos   (17U)
 
#define TSC_IOGCSR_G2S_Msk   (0x1UL << TSC_IOGCSR_G2S_Pos)
 
#define TSC_IOGCSR_G2S   TSC_IOGCSR_G2S_Msk
 
#define TSC_IOGCSR_G3S_Pos   (18U)
 
#define TSC_IOGCSR_G3S_Msk   (0x1UL << TSC_IOGCSR_G3S_Pos)
 
#define TSC_IOGCSR_G3S   TSC_IOGCSR_G3S_Msk
 
#define TSC_IOGCSR_G4S_Pos   (19U)
 
#define TSC_IOGCSR_G4S_Msk   (0x1UL << TSC_IOGCSR_G4S_Pos)
 
#define TSC_IOGCSR_G4S   TSC_IOGCSR_G4S_Msk
 
#define TSC_IOGCSR_G5S_Pos   (20U)
 
#define TSC_IOGCSR_G5S_Msk   (0x1UL << TSC_IOGCSR_G5S_Pos)
 
#define TSC_IOGCSR_G5S   TSC_IOGCSR_G5S_Msk
 
#define TSC_IOGCSR_G6S_Pos   (21U)
 
#define TSC_IOGCSR_G6S_Msk   (0x1UL << TSC_IOGCSR_G6S_Pos)
 
#define TSC_IOGCSR_G6S   TSC_IOGCSR_G6S_Msk
 
#define TSC_IOGCSR_G7S_Pos   (22U)
 
#define TSC_IOGCSR_G7S_Msk   (0x1UL << TSC_IOGCSR_G7S_Pos)
 
#define TSC_IOGCSR_G7S   TSC_IOGCSR_G7S_Msk
 
#define TSC_IOGCSR_G8S_Pos   (23U)
 
#define TSC_IOGCSR_G8S_Msk   (0x1UL << TSC_IOGCSR_G8S_Pos)
 
#define TSC_IOGCSR_G8S   TSC_IOGCSR_G8S_Msk
 
#define TSC_IOGXCR_CNT_Pos   (0U)
 
#define TSC_IOGXCR_CNT_Msk   (0x3FFFUL << TSC_IOGXCR_CNT_Pos)
 
#define TSC_IOGXCR_CNT   TSC_IOGXCR_CNT_Msk
 
#define USART_7BITS_SUPPORT
 
#define USART_CR1_UE_Pos   (0U)
 
#define USART_CR1_UE_Msk   (0x1UL << USART_CR1_UE_Pos)
 
#define USART_CR1_UE   USART_CR1_UE_Msk
 
#define USART_CR1_UESM_Pos   (1U)
 
#define USART_CR1_UESM_Msk   (0x1UL << USART_CR1_UESM_Pos)
 
#define USART_CR1_UESM   USART_CR1_UESM_Msk
 
#define USART_CR1_RE_Pos   (2U)
 
#define USART_CR1_RE_Msk   (0x1UL << USART_CR1_RE_Pos)
 
#define USART_CR1_RE   USART_CR1_RE_Msk
 
#define USART_CR1_TE_Pos   (3U)
 
#define USART_CR1_TE_Msk   (0x1UL << USART_CR1_TE_Pos)
 
#define USART_CR1_TE   USART_CR1_TE_Msk
 
#define USART_CR1_IDLEIE_Pos   (4U)
 
#define USART_CR1_IDLEIE_Msk   (0x1UL << USART_CR1_IDLEIE_Pos)
 
#define USART_CR1_IDLEIE   USART_CR1_IDLEIE_Msk
 
#define USART_CR1_RXNEIE_Pos   (5U)
 
#define USART_CR1_RXNEIE_Msk   (0x1UL << USART_CR1_RXNEIE_Pos)
 
#define USART_CR1_RXNEIE   USART_CR1_RXNEIE_Msk
 
#define USART_CR1_TCIE_Pos   (6U)
 
#define USART_CR1_TCIE_Msk   (0x1UL << USART_CR1_TCIE_Pos)
 
#define USART_CR1_TCIE   USART_CR1_TCIE_Msk
 
#define USART_CR1_TXEIE_Pos   (7U)
 
#define USART_CR1_TXEIE_Msk   (0x1UL << USART_CR1_TXEIE_Pos)
 
#define USART_CR1_TXEIE   USART_CR1_TXEIE_Msk
 
#define USART_CR1_PEIE_Pos   (8U)
 
#define USART_CR1_PEIE_Msk   (0x1UL << USART_CR1_PEIE_Pos)
 
#define USART_CR1_PEIE   USART_CR1_PEIE_Msk
 
#define USART_CR1_PS_Pos   (9U)
 
#define USART_CR1_PS_Msk   (0x1UL << USART_CR1_PS_Pos)
 
#define USART_CR1_PS   USART_CR1_PS_Msk
 
#define USART_CR1_PCE_Pos   (10U)
 
#define USART_CR1_PCE_Msk   (0x1UL << USART_CR1_PCE_Pos)
 
#define USART_CR1_PCE   USART_CR1_PCE_Msk
 
#define USART_CR1_WAKE_Pos   (11U)
 
#define USART_CR1_WAKE_Msk   (0x1UL << USART_CR1_WAKE_Pos)
 
#define USART_CR1_WAKE   USART_CR1_WAKE_Msk
 
#define USART_CR1_M0_Pos   (12U)
 
#define USART_CR1_M0_Msk   (0x1UL << USART_CR1_M0_Pos)
 
#define USART_CR1_M0   USART_CR1_M0_Msk
 
#define USART_CR1_MME_Pos   (13U)
 
#define USART_CR1_MME_Msk   (0x1UL << USART_CR1_MME_Pos)
 
#define USART_CR1_MME   USART_CR1_MME_Msk
 
#define USART_CR1_CMIE_Pos   (14U)
 
#define USART_CR1_CMIE_Msk   (0x1UL << USART_CR1_CMIE_Pos)
 
#define USART_CR1_CMIE   USART_CR1_CMIE_Msk
 
#define USART_CR1_OVER8_Pos   (15U)
 
#define USART_CR1_OVER8_Msk   (0x1UL << USART_CR1_OVER8_Pos)
 
#define USART_CR1_OVER8   USART_CR1_OVER8_Msk
 
#define USART_CR1_DEDT_Pos   (16U)
 
#define USART_CR1_DEDT_Msk   (0x1FUL << USART_CR1_DEDT_Pos)
 
#define USART_CR1_DEDT   USART_CR1_DEDT_Msk
 
#define USART_CR1_DEDT_0   (0x01UL << USART_CR1_DEDT_Pos)
 
#define USART_CR1_DEDT_1   (0x02UL << USART_CR1_DEDT_Pos)
 
#define USART_CR1_DEDT_2   (0x04UL << USART_CR1_DEDT_Pos)
 
#define USART_CR1_DEDT_3   (0x08UL << USART_CR1_DEDT_Pos)
 
#define USART_CR1_DEDT_4   (0x10UL << USART_CR1_DEDT_Pos)
 
#define USART_CR1_DEAT_Pos   (21U)
 
#define USART_CR1_DEAT_Msk   (0x1FUL << USART_CR1_DEAT_Pos)
 
#define USART_CR1_DEAT   USART_CR1_DEAT_Msk
 
#define USART_CR1_DEAT_0   (0x01UL << USART_CR1_DEAT_Pos)
 
#define USART_CR1_DEAT_1   (0x02UL << USART_CR1_DEAT_Pos)
 
#define USART_CR1_DEAT_2   (0x04UL << USART_CR1_DEAT_Pos)
 
#define USART_CR1_DEAT_3   (0x08UL << USART_CR1_DEAT_Pos)
 
#define USART_CR1_DEAT_4   (0x10UL << USART_CR1_DEAT_Pos)
 
#define USART_CR1_RTOIE_Pos   (26U)
 
#define USART_CR1_RTOIE_Msk   (0x1UL << USART_CR1_RTOIE_Pos)
 
#define USART_CR1_RTOIE   USART_CR1_RTOIE_Msk
 
#define USART_CR1_EOBIE_Pos   (27U)
 
#define USART_CR1_EOBIE_Msk   (0x1UL << USART_CR1_EOBIE_Pos)
 
#define USART_CR1_EOBIE   USART_CR1_EOBIE_Msk
 
#define USART_CR1_M1_Pos   (28U)
 
#define USART_CR1_M1_Msk   (0x1UL << USART_CR1_M1_Pos)
 
#define USART_CR1_M1   USART_CR1_M1_Msk
 
#define USART_CR1_M_Pos   (12U)
 
#define USART_CR1_M_Msk   (0x10001UL << USART_CR1_M_Pos)
 
#define USART_CR1_M   USART_CR1_M_Msk
 
#define USART_CR2_ADDM7_Pos   (4U)
 
#define USART_CR2_ADDM7_Msk   (0x1UL << USART_CR2_ADDM7_Pos)
 
#define USART_CR2_ADDM7   USART_CR2_ADDM7_Msk
 
#define USART_CR2_LBDL_Pos   (5U)
 
#define USART_CR2_LBDL_Msk   (0x1UL << USART_CR2_LBDL_Pos)
 
#define USART_CR2_LBDL   USART_CR2_LBDL_Msk
 
#define USART_CR2_LBDIE_Pos   (6U)
 
#define USART_CR2_LBDIE_Msk   (0x1UL << USART_CR2_LBDIE_Pos)
 
#define USART_CR2_LBDIE   USART_CR2_LBDIE_Msk
 
#define USART_CR2_LBCL_Pos   (8U)
 
#define USART_CR2_LBCL_Msk   (0x1UL << USART_CR2_LBCL_Pos)
 
#define USART_CR2_LBCL   USART_CR2_LBCL_Msk
 
#define USART_CR2_CPHA_Pos   (9U)
 
#define USART_CR2_CPHA_Msk   (0x1UL << USART_CR2_CPHA_Pos)
 
#define USART_CR2_CPHA   USART_CR2_CPHA_Msk
 
#define USART_CR2_CPOL_Pos   (10U)
 
#define USART_CR2_CPOL_Msk   (0x1UL << USART_CR2_CPOL_Pos)
 
#define USART_CR2_CPOL   USART_CR2_CPOL_Msk
 
#define USART_CR2_CLKEN_Pos   (11U)
 
#define USART_CR2_CLKEN_Msk   (0x1UL << USART_CR2_CLKEN_Pos)
 
#define USART_CR2_CLKEN   USART_CR2_CLKEN_Msk
 
#define USART_CR2_STOP_Pos   (12U)
 
#define USART_CR2_STOP_Msk   (0x3UL << USART_CR2_STOP_Pos)
 
#define USART_CR2_STOP   USART_CR2_STOP_Msk
 
#define USART_CR2_STOP_0   (0x1UL << USART_CR2_STOP_Pos)
 
#define USART_CR2_STOP_1   (0x2UL << USART_CR2_STOP_Pos)
 
#define USART_CR2_LINEN_Pos   (14U)
 
#define USART_CR2_LINEN_Msk   (0x1UL << USART_CR2_LINEN_Pos)
 
#define USART_CR2_LINEN   USART_CR2_LINEN_Msk
 
#define USART_CR2_SWAP_Pos   (15U)
 
#define USART_CR2_SWAP_Msk   (0x1UL << USART_CR2_SWAP_Pos)
 
#define USART_CR2_SWAP   USART_CR2_SWAP_Msk
 
#define USART_CR2_RXINV_Pos   (16U)
 
#define USART_CR2_RXINV_Msk   (0x1UL << USART_CR2_RXINV_Pos)
 
#define USART_CR2_RXINV   USART_CR2_RXINV_Msk
 
#define USART_CR2_TXINV_Pos   (17U)
 
#define USART_CR2_TXINV_Msk   (0x1UL << USART_CR2_TXINV_Pos)
 
#define USART_CR2_TXINV   USART_CR2_TXINV_Msk
 
#define USART_CR2_DATAINV_Pos   (18U)
 
#define USART_CR2_DATAINV_Msk   (0x1UL << USART_CR2_DATAINV_Pos)
 
#define USART_CR2_DATAINV   USART_CR2_DATAINV_Msk
 
#define USART_CR2_MSBFIRST_Pos   (19U)
 
#define USART_CR2_MSBFIRST_Msk   (0x1UL << USART_CR2_MSBFIRST_Pos)
 
#define USART_CR2_MSBFIRST   USART_CR2_MSBFIRST_Msk
 
#define USART_CR2_ABREN_Pos   (20U)
 
#define USART_CR2_ABREN_Msk   (0x1UL << USART_CR2_ABREN_Pos)
 
#define USART_CR2_ABREN   USART_CR2_ABREN_Msk
 
#define USART_CR2_ABRMODE_Pos   (21U)
 
#define USART_CR2_ABRMODE_Msk   (0x3UL << USART_CR2_ABRMODE_Pos)
 
#define USART_CR2_ABRMODE   USART_CR2_ABRMODE_Msk
 
#define USART_CR2_ABRMODE_0   (0x1UL << USART_CR2_ABRMODE_Pos)
 
#define USART_CR2_ABRMODE_1   (0x2UL << USART_CR2_ABRMODE_Pos)
 
#define USART_CR2_RTOEN_Pos   (23U)
 
#define USART_CR2_RTOEN_Msk   (0x1UL << USART_CR2_RTOEN_Pos)
 
#define USART_CR2_RTOEN   USART_CR2_RTOEN_Msk
 
#define USART_CR2_ADD_Pos   (24U)
 
#define USART_CR2_ADD_Msk   (0xFFUL << USART_CR2_ADD_Pos)
 
#define USART_CR2_ADD   USART_CR2_ADD_Msk
 
#define USART_CR3_EIE_Pos   (0U)
 
#define USART_CR3_EIE_Msk   (0x1UL << USART_CR3_EIE_Pos)
 
#define USART_CR3_EIE   USART_CR3_EIE_Msk
 
#define USART_CR3_IREN_Pos   (1U)
 
#define USART_CR3_IREN_Msk   (0x1UL << USART_CR3_IREN_Pos)
 
#define USART_CR3_IREN   USART_CR3_IREN_Msk
 
#define USART_CR3_IRLP_Pos   (2U)
 
#define USART_CR3_IRLP_Msk   (0x1UL << USART_CR3_IRLP_Pos)
 
#define USART_CR3_IRLP   USART_CR3_IRLP_Msk
 
#define USART_CR3_HDSEL_Pos   (3U)
 
#define USART_CR3_HDSEL_Msk   (0x1UL << USART_CR3_HDSEL_Pos)
 
#define USART_CR3_HDSEL   USART_CR3_HDSEL_Msk
 
#define USART_CR3_NACK_Pos   (4U)
 
#define USART_CR3_NACK_Msk   (0x1UL << USART_CR3_NACK_Pos)
 
#define USART_CR3_NACK   USART_CR3_NACK_Msk
 
#define USART_CR3_SCEN_Pos   (5U)
 
#define USART_CR3_SCEN_Msk   (0x1UL << USART_CR3_SCEN_Pos)
 
#define USART_CR3_SCEN   USART_CR3_SCEN_Msk
 
#define USART_CR3_DMAR_Pos   (6U)
 
#define USART_CR3_DMAR_Msk   (0x1UL << USART_CR3_DMAR_Pos)
 
#define USART_CR3_DMAR   USART_CR3_DMAR_Msk
 
#define USART_CR3_DMAT_Pos   (7U)
 
#define USART_CR3_DMAT_Msk   (0x1UL << USART_CR3_DMAT_Pos)
 
#define USART_CR3_DMAT   USART_CR3_DMAT_Msk
 
#define USART_CR3_RTSE_Pos   (8U)
 
#define USART_CR3_RTSE_Msk   (0x1UL << USART_CR3_RTSE_Pos)
 
#define USART_CR3_RTSE   USART_CR3_RTSE_Msk
 
#define USART_CR3_CTSE_Pos   (9U)
 
#define USART_CR3_CTSE_Msk   (0x1UL << USART_CR3_CTSE_Pos)
 
#define USART_CR3_CTSE   USART_CR3_CTSE_Msk
 
#define USART_CR3_CTSIE_Pos   (10U)
 
#define USART_CR3_CTSIE_Msk   (0x1UL << USART_CR3_CTSIE_Pos)
 
#define USART_CR3_CTSIE   USART_CR3_CTSIE_Msk
 
#define USART_CR3_ONEBIT_Pos   (11U)
 
#define USART_CR3_ONEBIT_Msk   (0x1UL << USART_CR3_ONEBIT_Pos)
 
#define USART_CR3_ONEBIT   USART_CR3_ONEBIT_Msk
 
#define USART_CR3_OVRDIS_Pos   (12U)
 
#define USART_CR3_OVRDIS_Msk   (0x1UL << USART_CR3_OVRDIS_Pos)
 
#define USART_CR3_OVRDIS   USART_CR3_OVRDIS_Msk
 
#define USART_CR3_DDRE_Pos   (13U)
 
#define USART_CR3_DDRE_Msk   (0x1UL << USART_CR3_DDRE_Pos)
 
#define USART_CR3_DDRE   USART_CR3_DDRE_Msk
 
#define USART_CR3_DEM_Pos   (14U)
 
#define USART_CR3_DEM_Msk   (0x1UL << USART_CR3_DEM_Pos)
 
#define USART_CR3_DEM   USART_CR3_DEM_Msk
 
#define USART_CR3_DEP_Pos   (15U)
 
#define USART_CR3_DEP_Msk   (0x1UL << USART_CR3_DEP_Pos)
 
#define USART_CR3_DEP   USART_CR3_DEP_Msk
 
#define USART_CR3_SCARCNT_Pos   (17U)
 
#define USART_CR3_SCARCNT_Msk   (0x7UL << USART_CR3_SCARCNT_Pos)
 
#define USART_CR3_SCARCNT   USART_CR3_SCARCNT_Msk
 
#define USART_CR3_SCARCNT_0   (0x1UL << USART_CR3_SCARCNT_Pos)
 
#define USART_CR3_SCARCNT_1   (0x2UL << USART_CR3_SCARCNT_Pos)
 
#define USART_CR3_SCARCNT_2   (0x4UL << USART_CR3_SCARCNT_Pos)
 
#define USART_CR3_WUS_Pos   (20U)
 
#define USART_CR3_WUS_Msk   (0x3UL << USART_CR3_WUS_Pos)
 
#define USART_CR3_WUS   USART_CR3_WUS_Msk
 
#define USART_CR3_WUS_0   (0x1UL << USART_CR3_WUS_Pos)
 
#define USART_CR3_WUS_1   (0x2UL << USART_CR3_WUS_Pos)
 
#define USART_CR3_WUFIE_Pos   (22U)
 
#define USART_CR3_WUFIE_Msk   (0x1UL << USART_CR3_WUFIE_Pos)
 
#define USART_CR3_WUFIE   USART_CR3_WUFIE_Msk
 
#define USART_BRR_DIV_FRACTION_Pos   (0U)
 
#define USART_BRR_DIV_FRACTION_Msk   (0xFUL << USART_BRR_DIV_FRACTION_Pos)
 
#define USART_BRR_DIV_FRACTION   USART_BRR_DIV_FRACTION_Msk
 
#define USART_BRR_DIV_MANTISSA_Pos   (4U)
 
#define USART_BRR_DIV_MANTISSA_Msk   (0xFFFUL << USART_BRR_DIV_MANTISSA_Pos)
 
#define USART_BRR_DIV_MANTISSA   USART_BRR_DIV_MANTISSA_Msk
 
#define USART_GTPR_PSC_Pos   (0U)
 
#define USART_GTPR_PSC_Msk   (0xFFUL << USART_GTPR_PSC_Pos)
 
#define USART_GTPR_PSC   USART_GTPR_PSC_Msk
 
#define USART_GTPR_GT_Pos   (8U)
 
#define USART_GTPR_GT_Msk   (0xFFUL << USART_GTPR_GT_Pos)
 
#define USART_GTPR_GT   USART_GTPR_GT_Msk
 
#define USART_RTOR_RTO_Pos   (0U)
 
#define USART_RTOR_RTO_Msk   (0xFFFFFFUL << USART_RTOR_RTO_Pos)
 
#define USART_RTOR_RTO   USART_RTOR_RTO_Msk
 
#define USART_RTOR_BLEN_Pos   (24U)
 
#define USART_RTOR_BLEN_Msk   (0xFFUL << USART_RTOR_BLEN_Pos)
 
#define USART_RTOR_BLEN   USART_RTOR_BLEN_Msk
 
#define USART_RQR_ABRRQ_Pos   (0U)
 
#define USART_RQR_ABRRQ_Msk   (0x1UL << USART_RQR_ABRRQ_Pos)
 
#define USART_RQR_ABRRQ   USART_RQR_ABRRQ_Msk
 
#define USART_RQR_SBKRQ_Pos   (1U)
 
#define USART_RQR_SBKRQ_Msk   (0x1UL << USART_RQR_SBKRQ_Pos)
 
#define USART_RQR_SBKRQ   USART_RQR_SBKRQ_Msk
 
#define USART_RQR_MMRQ_Pos   (2U)
 
#define USART_RQR_MMRQ_Msk   (0x1UL << USART_RQR_MMRQ_Pos)
 
#define USART_RQR_MMRQ   USART_RQR_MMRQ_Msk
 
#define USART_RQR_RXFRQ_Pos   (3U)
 
#define USART_RQR_RXFRQ_Msk   (0x1UL << USART_RQR_RXFRQ_Pos)
 
#define USART_RQR_RXFRQ   USART_RQR_RXFRQ_Msk
 
#define USART_RQR_TXFRQ_Pos   (4U)
 
#define USART_RQR_TXFRQ_Msk   (0x1UL << USART_RQR_TXFRQ_Pos)
 
#define USART_RQR_TXFRQ   USART_RQR_TXFRQ_Msk
 
#define USART_ISR_PE_Pos   (0U)
 
#define USART_ISR_PE_Msk   (0x1UL << USART_ISR_PE_Pos)
 
#define USART_ISR_PE   USART_ISR_PE_Msk
 
#define USART_ISR_FE_Pos   (1U)
 
#define USART_ISR_FE_Msk   (0x1UL << USART_ISR_FE_Pos)
 
#define USART_ISR_FE   USART_ISR_FE_Msk
 
#define USART_ISR_NE_Pos   (2U)
 
#define USART_ISR_NE_Msk   (0x1UL << USART_ISR_NE_Pos)
 
#define USART_ISR_NE   USART_ISR_NE_Msk
 
#define USART_ISR_ORE_Pos   (3U)
 
#define USART_ISR_ORE_Msk   (0x1UL << USART_ISR_ORE_Pos)
 
#define USART_ISR_ORE   USART_ISR_ORE_Msk
 
#define USART_ISR_IDLE_Pos   (4U)
 
#define USART_ISR_IDLE_Msk   (0x1UL << USART_ISR_IDLE_Pos)
 
#define USART_ISR_IDLE   USART_ISR_IDLE_Msk
 
#define USART_ISR_RXNE_Pos   (5U)
 
#define USART_ISR_RXNE_Msk   (0x1UL << USART_ISR_RXNE_Pos)
 
#define USART_ISR_RXNE   USART_ISR_RXNE_Msk
 
#define USART_ISR_TC_Pos   (6U)
 
#define USART_ISR_TC_Msk   (0x1UL << USART_ISR_TC_Pos)
 
#define USART_ISR_TC   USART_ISR_TC_Msk
 
#define USART_ISR_TXE_Pos   (7U)
 
#define USART_ISR_TXE_Msk   (0x1UL << USART_ISR_TXE_Pos)
 
#define USART_ISR_TXE   USART_ISR_TXE_Msk
 
#define USART_ISR_LBDF_Pos   (8U)
 
#define USART_ISR_LBDF_Msk   (0x1UL << USART_ISR_LBDF_Pos)
 
#define USART_ISR_LBDF   USART_ISR_LBDF_Msk
 
#define USART_ISR_CTSIF_Pos   (9U)
 
#define USART_ISR_CTSIF_Msk   (0x1UL << USART_ISR_CTSIF_Pos)
 
#define USART_ISR_CTSIF   USART_ISR_CTSIF_Msk
 
#define USART_ISR_CTS_Pos   (10U)
 
#define USART_ISR_CTS_Msk   (0x1UL << USART_ISR_CTS_Pos)
 
#define USART_ISR_CTS   USART_ISR_CTS_Msk
 
#define USART_ISR_RTOF_Pos   (11U)
 
#define USART_ISR_RTOF_Msk   (0x1UL << USART_ISR_RTOF_Pos)
 
#define USART_ISR_RTOF   USART_ISR_RTOF_Msk
 
#define USART_ISR_EOBF_Pos   (12U)
 
#define USART_ISR_EOBF_Msk   (0x1UL << USART_ISR_EOBF_Pos)
 
#define USART_ISR_EOBF   USART_ISR_EOBF_Msk
 
#define USART_ISR_ABRE_Pos   (14U)
 
#define USART_ISR_ABRE_Msk   (0x1UL << USART_ISR_ABRE_Pos)
 
#define USART_ISR_ABRE   USART_ISR_ABRE_Msk
 
#define USART_ISR_ABRF_Pos   (15U)
 
#define USART_ISR_ABRF_Msk   (0x1UL << USART_ISR_ABRF_Pos)
 
#define USART_ISR_ABRF   USART_ISR_ABRF_Msk
 
#define USART_ISR_BUSY_Pos   (16U)
 
#define USART_ISR_BUSY_Msk   (0x1UL << USART_ISR_BUSY_Pos)
 
#define USART_ISR_BUSY   USART_ISR_BUSY_Msk
 
#define USART_ISR_CMF_Pos   (17U)
 
#define USART_ISR_CMF_Msk   (0x1UL << USART_ISR_CMF_Pos)
 
#define USART_ISR_CMF   USART_ISR_CMF_Msk
 
#define USART_ISR_SBKF_Pos   (18U)
 
#define USART_ISR_SBKF_Msk   (0x1UL << USART_ISR_SBKF_Pos)
 
#define USART_ISR_SBKF   USART_ISR_SBKF_Msk
 
#define USART_ISR_RWU_Pos   (19U)
 
#define USART_ISR_RWU_Msk   (0x1UL << USART_ISR_RWU_Pos)
 
#define USART_ISR_RWU   USART_ISR_RWU_Msk
 
#define USART_ISR_WUF_Pos   (20U)
 
#define USART_ISR_WUF_Msk   (0x1UL << USART_ISR_WUF_Pos)
 
#define USART_ISR_WUF   USART_ISR_WUF_Msk
 
#define USART_ISR_TEACK_Pos   (21U)
 
#define USART_ISR_TEACK_Msk   (0x1UL << USART_ISR_TEACK_Pos)
 
#define USART_ISR_TEACK   USART_ISR_TEACK_Msk
 
#define USART_ISR_REACK_Pos   (22U)
 
#define USART_ISR_REACK_Msk   (0x1UL << USART_ISR_REACK_Pos)
 
#define USART_ISR_REACK   USART_ISR_REACK_Msk
 
#define USART_ICR_PECF_Pos   (0U)
 
#define USART_ICR_PECF_Msk   (0x1UL << USART_ICR_PECF_Pos)
 
#define USART_ICR_PECF   USART_ICR_PECF_Msk
 
#define USART_ICR_FECF_Pos   (1U)
 
#define USART_ICR_FECF_Msk   (0x1UL << USART_ICR_FECF_Pos)
 
#define USART_ICR_FECF   USART_ICR_FECF_Msk
 
#define USART_ICR_NCF_Pos   (2U)
 
#define USART_ICR_NCF_Msk   (0x1UL << USART_ICR_NCF_Pos)
 
#define USART_ICR_NCF   USART_ICR_NCF_Msk
 
#define USART_ICR_ORECF_Pos   (3U)
 
#define USART_ICR_ORECF_Msk   (0x1UL << USART_ICR_ORECF_Pos)
 
#define USART_ICR_ORECF   USART_ICR_ORECF_Msk
 
#define USART_ICR_IDLECF_Pos   (4U)
 
#define USART_ICR_IDLECF_Msk   (0x1UL << USART_ICR_IDLECF_Pos)
 
#define USART_ICR_IDLECF   USART_ICR_IDLECF_Msk
 
#define USART_ICR_TCCF_Pos   (6U)
 
#define USART_ICR_TCCF_Msk   (0x1UL << USART_ICR_TCCF_Pos)
 
#define USART_ICR_TCCF   USART_ICR_TCCF_Msk
 
#define USART_ICR_LBDCF_Pos   (8U)
 
#define USART_ICR_LBDCF_Msk   (0x1UL << USART_ICR_LBDCF_Pos)
 
#define USART_ICR_LBDCF   USART_ICR_LBDCF_Msk
 
#define USART_ICR_CTSCF_Pos   (9U)
 
#define USART_ICR_CTSCF_Msk   (0x1UL << USART_ICR_CTSCF_Pos)
 
#define USART_ICR_CTSCF   USART_ICR_CTSCF_Msk
 
#define USART_ICR_RTOCF_Pos   (11U)
 
#define USART_ICR_RTOCF_Msk   (0x1UL << USART_ICR_RTOCF_Pos)
 
#define USART_ICR_RTOCF   USART_ICR_RTOCF_Msk
 
#define USART_ICR_EOBCF_Pos   (12U)
 
#define USART_ICR_EOBCF_Msk   (0x1UL << USART_ICR_EOBCF_Pos)
 
#define USART_ICR_EOBCF   USART_ICR_EOBCF_Msk
 
#define USART_ICR_CMCF_Pos   (17U)
 
#define USART_ICR_CMCF_Msk   (0x1UL << USART_ICR_CMCF_Pos)
 
#define USART_ICR_CMCF   USART_ICR_CMCF_Msk
 
#define USART_ICR_WUCF_Pos   (20U)
 
#define USART_ICR_WUCF_Msk   (0x1UL << USART_ICR_WUCF_Pos)
 
#define USART_ICR_WUCF   USART_ICR_WUCF_Msk
 
#define USART_RDR_RDR_Pos   (0U)
 
#define USART_RDR_RDR_Msk   (0x1FFUL << USART_RDR_RDR_Pos)
 
#define USART_RDR_RDR   USART_RDR_RDR_Msk
 
#define USART_TDR_TDR_Pos   (0U)
 
#define USART_TDR_TDR_Msk   (0x1FFUL << USART_TDR_TDR_Pos)
 
#define USART_TDR_TDR   USART_TDR_TDR_Msk
 
#define USB_CNTR   (USB_BASE + 0x40U)
 
#define USB_ISTR   (USB_BASE + 0x44U)
 
#define USB_FNR   (USB_BASE + 0x48U)
 
#define USB_DADDR   (USB_BASE + 0x4CU)
 
#define USB_BTABLE   (USB_BASE + 0x50U)
 
#define USB_LPMCSR   (USB_BASE + 0x54U)
 
#define USB_ISTR_CTR   ((uint16_t)0x8000U)
 
#define USB_ISTR_PMAOVR   ((uint16_t)0x4000U)
 
#define USB_ISTR_ERR   ((uint16_t)0x2000U)
 
#define USB_ISTR_WKUP   ((uint16_t)0x1000U)
 
#define USB_ISTR_SUSP   ((uint16_t)0x0800U)
 
#define USB_ISTR_RESET   ((uint16_t)0x0400U)
 
#define USB_ISTR_SOF   ((uint16_t)0x0200U)
 
#define USB_ISTR_ESOF   ((uint16_t)0x0100U)
 
#define USB_ISTR_L1REQ   ((uint16_t)0x0080U)
 
#define USB_ISTR_DIR   ((uint16_t)0x0010U)
 
#define USB_ISTR_EP_ID   ((uint16_t)0x000FU)
 
#define USB_ISTR_PMAOVRM   USB_ISTR_PMAOVR
 
#define USB_CLR_CTR   (~USB_ISTR_CTR)
 
#define USB_CLR_PMAOVR   (~USB_ISTR_PMAOVR)
 
#define USB_CLR_ERR   (~USB_ISTR_ERR)
 
#define USB_CLR_WKUP   (~USB_ISTR_WKUP)
 
#define USB_CLR_SUSP   (~USB_ISTR_SUSP)
 
#define USB_CLR_RESET   (~USB_ISTR_RESET)
 
#define USB_CLR_SOF   (~USB_ISTR_SOF)
 
#define USB_CLR_ESOF   (~USB_ISTR_ESOF)
 
#define USB_CLR_L1REQ   (~USB_ISTR_L1REQ)
 
#define USB_CLR_PMAOVRM   USB_CLR_PMAOVR
 
#define USB_CNTR_CTRM   ((uint16_t)0x8000U)
 
#define USB_CNTR_PMAOVR   ((uint16_t)0x4000U)
 
#define USB_CNTR_ERRM   ((uint16_t)0x2000U)
 
#define USB_CNTR_WKUPM   ((uint16_t)0x1000U)
 
#define USB_CNTR_SUSPM   ((uint16_t)0x0800U)
 
#define USB_CNTR_RESETM   ((uint16_t)0x0400U)
 
#define USB_CNTR_SOFM   ((uint16_t)0x0200U)
 
#define USB_CNTR_ESOFM   ((uint16_t)0x0100U)
 
#define USB_CNTR_L1REQM   ((uint16_t)0x0080U)
 
#define USB_CNTR_L1RESUME   ((uint16_t)0x0020U)
 
#define USB_CNTR_RESUME   ((uint16_t)0x0010U)
 
#define USB_CNTR_FSUSP   ((uint16_t)0x0008U)
 
#define USB_CNTR_LPMODE   ((uint16_t)0x0004U)
 
#define USB_CNTR_PDWN   ((uint16_t)0x0002U)
 
#define USB_CNTR_FRES   ((uint16_t)0x0001U)
 
#define USB_CNTR_PMAOVRM   USB_CNTR_PMAOVR
 
#define USB_CNTR_LP_MODE   USB_CNTR_LPMODE
 
#define USB_LPMCSR_BESL   ((uint16_t)0x00F0U)
 
#define USB_LPMCSR_REMWAKE   ((uint16_t)0x0008U)
 
#define USB_LPMCSR_LPMACK   ((uint16_t)0x0002U)
 
#define USB_LPMCSR_LMPEN   ((uint16_t)0x0001U)
 
#define USB_FNR_RXDP   ((uint16_t)0x8000U)
 
#define USB_FNR_RXDM   ((uint16_t)0x4000U)
 
#define USB_FNR_LCK   ((uint16_t)0x2000U)
 
#define USB_FNR_LSOF   ((uint16_t)0x1800U)
 
#define USB_FNR_FN   ((uint16_t)0x07FFU)
 
#define USB_DADDR_EF   ((uint8_t)0x80U)
 
#define USB_DADDR_ADD   ((uint8_t)0x7FU)
 
#define USB_EP0R   USB_BASE
 
#define USB_EP1R   (USB_BASE + 0x04U)
 
#define USB_EP2R   (USB_BASE + 0x08U)
 
#define USB_EP3R   (USB_BASE + 0x0CU)
 
#define USB_EP4R   (USB_BASE + 0x10U)
 
#define USB_EP5R   (USB_BASE + 0x14U)
 
#define USB_EP6R   (USB_BASE + 0x18U)
 
#define USB_EP7R   (USB_BASE + 0x1CU)
 
#define USB_EP_CTR_RX   ((uint16_t)0x8000U)
 
#define USB_EP_DTOG_RX   ((uint16_t)0x4000U)
 
#define USB_EPRX_STAT   ((uint16_t)0x3000U)
 
#define USB_EP_SETUP   ((uint16_t)0x0800U)
 
#define USB_EP_T_FIELD   ((uint16_t)0x0600U)
 
#define USB_EP_KIND   ((uint16_t)0x0100U)
 
#define USB_EP_CTR_TX   ((uint16_t)0x0080U)
 
#define USB_EP_DTOG_TX   ((uint16_t)0x0040U)
 
#define USB_EPTX_STAT   ((uint16_t)0x0030U)
 
#define USB_EPADDR_FIELD   ((uint16_t)0x000FU)
 
#define USB_EPREG_MASK   (USB_EP_CTR_RX|USB_EP_SETUP|USB_EP_T_FIELD|USB_EP_KIND|USB_EP_CTR_TX|USB_EPADDR_FIELD)
 
#define USB_EP_TYPE_MASK   ((uint16_t)0x0600U)
 
#define USB_EP_BULK   ((uint16_t)0x0000U)
 
#define USB_EP_CONTROL   ((uint16_t)0x0200U)
 
#define USB_EP_ISOCHRONOUS   ((uint16_t)0x0400U)
 
#define USB_EP_INTERRUPT   ((uint16_t)0x0600U)
 
#define USB_EP_T_MASK   ((uint16_t) ~USB_EP_T_FIELD & USB_EPREG_MASK)
 
#define USB_EPKIND_MASK   ((uint16_t) ~USB_EP_KIND & USB_EPREG_MASK)
 
#define USB_EP_TX_DIS   ((uint16_t)0x0000U)
 
#define USB_EP_TX_STALL   ((uint16_t)0x0010U)
 
#define USB_EP_TX_NAK   ((uint16_t)0x0020U)
 
#define USB_EP_TX_VALID   ((uint16_t)0x0030U)
 
#define USB_EPTX_DTOG1   ((uint16_t)0x0010U)
 
#define USB_EPTX_DTOG2   ((uint16_t)0x0020U)
 
#define USB_EPTX_DTOGMASK   (USB_EPTX_STAT|USB_EPREG_MASK)
 
#define USB_EP_RX_DIS   ((uint16_t)0x0000U)
 
#define USB_EP_RX_STALL   ((uint16_t)0x1000U)
 
#define USB_EP_RX_NAK   ((uint16_t)0x2000U)
 
#define USB_EP_RX_VALID   ((uint16_t)0x3000U)
 
#define USB_EPRX_DTOG1   ((uint16_t)0x1000U)
 
#define USB_EPRX_DTOG2   ((uint16_t)0x2000U)
 
#define USB_EPRX_DTOGMASK   (USB_EPRX_STAT|USB_EPREG_MASK)
 
#define WWDG_CR_T_Pos   (0U)
 
#define WWDG_CR_T_Msk   (0x7FUL << WWDG_CR_T_Pos)
 
#define WWDG_CR_T   WWDG_CR_T_Msk
 
#define WWDG_CR_T_0   (0x01UL << WWDG_CR_T_Pos)
 
#define WWDG_CR_T_1   (0x02UL << WWDG_CR_T_Pos)
 
#define WWDG_CR_T_2   (0x04UL << WWDG_CR_T_Pos)
 
#define WWDG_CR_T_3   (0x08UL << WWDG_CR_T_Pos)
 
#define WWDG_CR_T_4   (0x10UL << WWDG_CR_T_Pos)
 
#define WWDG_CR_T_5   (0x20UL << WWDG_CR_T_Pos)
 
#define WWDG_CR_T_6   (0x40UL << WWDG_CR_T_Pos)
 
#define WWDG_CR_T0   WWDG_CR_T_0
 
#define WWDG_CR_T1   WWDG_CR_T_1
 
#define WWDG_CR_T2   WWDG_CR_T_2
 
#define WWDG_CR_T3   WWDG_CR_T_3
 
#define WWDG_CR_T4   WWDG_CR_T_4
 
#define WWDG_CR_T5   WWDG_CR_T_5
 
#define WWDG_CR_T6   WWDG_CR_T_6
 
#define WWDG_CR_WDGA_Pos   (7U)
 
#define WWDG_CR_WDGA_Msk   (0x1UL << WWDG_CR_WDGA_Pos)
 
#define WWDG_CR_WDGA   WWDG_CR_WDGA_Msk
 
#define WWDG_CFR_W_Pos   (0U)
 
#define WWDG_CFR_W_Msk   (0x7FUL << WWDG_CFR_W_Pos)
 
#define WWDG_CFR_W   WWDG_CFR_W_Msk
 
#define WWDG_CFR_W_0   (0x01UL << WWDG_CFR_W_Pos)
 
#define WWDG_CFR_W_1   (0x02UL << WWDG_CFR_W_Pos)
 
#define WWDG_CFR_W_2   (0x04UL << WWDG_CFR_W_Pos)
 
#define WWDG_CFR_W_3   (0x08UL << WWDG_CFR_W_Pos)
 
#define WWDG_CFR_W_4   (0x10UL << WWDG_CFR_W_Pos)
 
#define WWDG_CFR_W_5   (0x20UL << WWDG_CFR_W_Pos)
 
#define WWDG_CFR_W_6   (0x40UL << WWDG_CFR_W_Pos)
 
#define WWDG_CFR_W0   WWDG_CFR_W_0
 
#define WWDG_CFR_W1   WWDG_CFR_W_1
 
#define WWDG_CFR_W2   WWDG_CFR_W_2
 
#define WWDG_CFR_W3   WWDG_CFR_W_3
 
#define WWDG_CFR_W4   WWDG_CFR_W_4
 
#define WWDG_CFR_W5   WWDG_CFR_W_5
 
#define WWDG_CFR_W6   WWDG_CFR_W_6
 
#define WWDG_CFR_WDGTB_Pos   (7U)
 
#define WWDG_CFR_WDGTB_Msk   (0x3UL << WWDG_CFR_WDGTB_Pos)
 
#define WWDG_CFR_WDGTB   WWDG_CFR_WDGTB_Msk
 
#define WWDG_CFR_WDGTB_0   (0x1UL << WWDG_CFR_WDGTB_Pos)
 
#define WWDG_CFR_WDGTB_1   (0x2UL << WWDG_CFR_WDGTB_Pos)
 
#define WWDG_CFR_WDGTB0   WWDG_CFR_WDGTB_0
 
#define WWDG_CFR_WDGTB1   WWDG_CFR_WDGTB_1
 
#define WWDG_CFR_EWI_Pos   (9U)
 
#define WWDG_CFR_EWI_Msk   (0x1UL << WWDG_CFR_EWI_Pos)
 
#define WWDG_CFR_EWI   WWDG_CFR_EWI_Msk
 
#define WWDG_SR_EWIF_Pos   (0U)
 
#define WWDG_SR_EWIF_Msk   (0x1UL << WWDG_SR_EWIF_Pos)
 
#define WWDG_SR_EWIF   WWDG_SR_EWIF_Msk
 
#define IS_ADC_ALL_INSTANCE(INSTANCE)
 
#define IS_ADC_MULTIMODE_MASTER_INSTANCE(INSTANCE)
 
#define IS_ADC_COMMON_INSTANCE(INSTANCE)
 
#define IS_CAN_ALL_INSTANCE(INSTANCE)   ((INSTANCE) == CAN)
 
#define IS_COMP_ALL_INSTANCE(INSTANCE)
 
#define IS_COMP_COMMON_INSTANCE(COMMON_INSTANCE)
 
#define IS_COMP_WINDOWMODE_INSTANCE(INSTANCE)
 
#define IS_CRC_ALL_INSTANCE(INSTANCE)   ((INSTANCE) == CRC)
 
#define IS_DAC_ALL_INSTANCE(INSTANCE)   ((INSTANCE) == DAC1)
 
#define IS_DAC_CHANNEL_INSTANCE(INSTANCE, CHANNEL)
 
#define IS_DMA_ALL_INSTANCE(INSTANCE)
 
#define IS_GPIO_ALL_INSTANCE(INSTANCE)
 
#define IS_GPIO_AF_INSTANCE(INSTANCE)
 
#define IS_GPIO_LOCK_INSTANCE(INSTANCE)
 
#define IS_I2C_ALL_INSTANCE(INSTANCE)
 
#define IS_I2C_WAKEUP_FROMSTOP_INSTANCE(INSTANCE)   IS_I2C_ALL_INSTANCE(INSTANCE)
 
#define IS_I2S_ALL_INSTANCE(INSTANCE)
 
#define IS_I2S_EXT_ALL_INSTANCE(INSTANCE)
 
#define IS_OPAMP_ALL_INSTANCE(INSTANCE)
 
#define IS_IWDG_ALL_INSTANCE(INSTANCE)   ((INSTANCE) == IWDG)
 
#define IS_RTC_ALL_INSTANCE(INSTANCE)   ((INSTANCE) == RTC)
 
#define IS_SMBUS_ALL_INSTANCE(INSTANCE)
 
#define IS_SPI_ALL_INSTANCE(INSTANCE)
 
#define IS_TIM_INSTANCE(INSTANCE)
 
#define IS_TIM_CC1_INSTANCE(INSTANCE)
 
#define IS_TIM_CC2_INSTANCE(INSTANCE)
 
#define IS_TIM_CC3_INSTANCE(INSTANCE)
 
#define IS_TIM_CC4_INSTANCE(INSTANCE)
 
#define IS_TIM_CC5_INSTANCE(INSTANCE)
 
#define IS_TIM_CC6_INSTANCE(INSTANCE)
 
#define IS_TIM_ADVANCED_INSTANCE(INSTANCE)
 
#define IS_TIM_CLOCK_SELECT_INSTANCE(INSTANCE)
 
#define IS_TIM_CLOCKSOURCE_ETRMODE1_INSTANCE(INSTANCE)
 
#define IS_TIM_CLOCKSOURCE_ETRMODE2_INSTANCE(INSTANCE)
 
#define IS_TIM_CLOCKSOURCE_TIX_INSTANCE(INSTANCE)
 
#define IS_TIM_CLOCKSOURCE_ITRX_INSTANCE(INSTANCE)
 
#define IS_TIM_OCXREF_CLEAR_INSTANCE(INSTANCE)
 
#define IS_TIM_ENCODER_INTERFACE_INSTANCE(INSTANCE)
 
#define IS_TIM_HALL_SENSOR_INTERFACE_INSTANCE(INSTANCE)
 
#define IS_TIM_ETR_INSTANCE(INSTANCE)
 
#define IS_TIM_XOR_INSTANCE(INSTANCE)
 
#define IS_TIM_MASTER_INSTANCE(INSTANCE)
 
#define IS_TIM_SLAVE_INSTANCE(INSTANCE)
 
#define IS_TIM_32B_COUNTER_INSTANCE(INSTANCE)    ((INSTANCE) == TIM2)
 
#define IS_TIM_DMABURST_INSTANCE(INSTANCE)
 
#define IS_TIM_BREAK_INSTANCE(INSTANCE)
 
#define IS_TIM_CCX_INSTANCE(INSTANCE, CHANNEL)
 
#define IS_TIM_CCXN_INSTANCE(INSTANCE, CHANNEL)
 
#define IS_TIM_COUNTER_MODE_SELECT_INSTANCE(INSTANCE)
 
#define IS_TIM_REPETITION_COUNTER_INSTANCE(INSTANCE)
 
#define IS_TIM_CLOCK_DIVISION_INSTANCE(INSTANCE)
 
#define IS_TIM_BKIN2_INSTANCE(INSTANCE)
 
#define IS_TIM_TRGO2_INSTANCE(INSTANCE)
 
#define IS_TIM_DMA_INSTANCE(INSTANCE)
 
#define IS_TIM_DMA_CC_INSTANCE(INSTANCE)
 
#define IS_TIM_COMMUTATION_EVENT_INSTANCE(INSTANCE)
 
#define IS_TIM_REMAP_INSTANCE(INSTANCE)
 
#define IS_TIM_COMBINED3PHASEPWM_INSTANCE(INSTANCE)
 
#define IS_TSC_ALL_INSTANCE(INSTANCE)   ((INSTANCE) == TSC)
 
#define IS_USART_INSTANCE(INSTANCE)
 
#define IS_USART_AUTOBAUDRATE_DETECTION_INSTANCE(INSTANCE)
 
#define IS_UART_INSTANCE(INSTANCE)
 
#define IS_UART_HALFDUPLEX_INSTANCE(INSTANCE)
 
#define IS_UART_LIN_INSTANCE(INSTANCE)
 
#define IS_UART_WAKEUP_FROMSTOP_INSTANCE(INSTANCE)
 
#define IS_UART_HWFLOW_INSTANCE(INSTANCE)
 
#define IS_UART_AUTOBAUDRATE_DETECTION_INSTANCE(INSTANCE)
 
#define IS_UART_DRIVER_ENABLE_INSTANCE(INSTANCE)
 
#define IS_SMARTCARD_INSTANCE(INSTANCE)
 
#define IS_IRDA_INSTANCE(INSTANCE)
 
#define IS_UART_DMA_INSTANCE(INSTANCE)   (1)
 
#define IS_PCD_ALL_INSTANCE(INSTANCE)   ((INSTANCE) == USB)
 
#define IS_WWDG_ALL_INSTANCE(INSTANCE)   ((INSTANCE) == WWDG)
 
#define ADC1_IRQn   ADC1_2_IRQn
 
#define SDADC1_IRQn   ADC4_IRQn
 
#define COMP_IRQn   COMP1_2_3_IRQn
 
#define COMP2_IRQn   COMP1_2_3_IRQn
 
#define COMP1_2_IRQn   COMP1_2_3_IRQn
 
#define COMP4_6_IRQn   COMP4_5_6_IRQn
 
#define HRTIM1_FLT_IRQn   I2C3_ER_IRQn
 
#define HRTIM1_TIME_IRQn   I2C3_EV_IRQn
 
#define TIM15_IRQn   TIM1_BRK_TIM15_IRQn
 
#define TIM18_DAC2_IRQn   TIM1_CC_IRQn
 
#define TIM17_IRQn   TIM1_TRG_COM_TIM17_IRQn
 
#define TIM16_IRQn   TIM1_UP_TIM16_IRQn
 
#define TIM19_IRQn   TIM20_UP_IRQn
 
#define TIM6_DAC1_IRQn   TIM6_DAC_IRQn
 
#define TIM7_DAC2_IRQn   TIM7_IRQn
 
#define TIM12_IRQn   TIM8_BRK_IRQn
 
#define TIM14_IRQn   TIM8_TRG_COM_IRQn
 
#define TIM13_IRQn   TIM8_UP_IRQn
 
#define CEC_IRQn   USBWakeUp_IRQn
 
#define USBWakeUp_IRQn   USBWakeUp_RMP_IRQn
 
#define CAN_TX_IRQn   USB_HP_CAN_TX_IRQn
 
#define CAN_RX0_IRQn   USB_LP_CAN_RX0_IRQn
 
#define ADC1_IRQHandler   ADC1_2_IRQHandler
 
#define SDADC1_IRQHandler   ADC4_IRQHandler
 
#define COMP_IRQHandler   COMP1_2_3_IRQHandler
 
#define COMP2_IRQHandler   COMP1_2_3_IRQHandler
 
#define COMP1_2_IRQHandler   COMP1_2_3_IRQHandler
 
#define COMP4_6_IRQHandler   COMP4_5_6_IRQHandler
 
#define HRTIM1_FLT_IRQHandler   I2C3_ER_IRQHandler
 
#define HRTIM1_TIME_IRQHandler   I2C3_EV_IRQHandler
 
#define TIM15_IRQHandler   TIM1_BRK_TIM15_IRQHandler
 
#define TIM18_DAC2_IRQHandler   TIM1_CC_IRQHandler
 
#define TIM17_IRQHandler   TIM1_TRG_COM_TIM17_IRQHandler
 
#define TIM16_IRQHandler   TIM1_UP_TIM16_IRQHandler
 
#define TIM19_IRQHandler   TIM20_UP_IRQHandler
 
#define TIM6_DAC1_IRQHandler   TIM6_DAC_IRQHandler
 
#define TIM7_DAC2_IRQHandler   TIM7_IRQHandler
 
#define TIM12_IRQHandler   TIM8_BRK_IRQHandler
 
#define TIM14_IRQHandler   TIM8_TRG_COM_IRQHandler
 
#define TIM13_IRQHandler   TIM8_UP_IRQHandler
 
#define CEC_IRQHandler   USBWakeUp_IRQHandler
 
#define USBWakeUp_IRQHandler   USBWakeUp_RMP_IRQHandler
 
#define CAN_TX_IRQHandler   USB_HP_CAN_TX_IRQHandler
 
#define CAN_RX0_IRQHandler   USB_LP_CAN_RX0_IRQHandler
 

Enumerations

enum  IRQn_Type {
  NonMaskableInt_IRQn = -14 , HardFault_IRQn = -13 , MemoryManagement_IRQn = -12 , BusFault_IRQn = -11 ,
  UsageFault_IRQn = -10 , SVCall_IRQn = -5 , DebugMonitor_IRQn = -4 , PendSV_IRQn = -2 ,
  SysTick_IRQn = -1 , WWDG_IRQn = 0 , PVD_IRQn = 1 , TAMP_STAMP_IRQn = 2 ,
  RTC_WKUP_IRQn = 3 , FLASH_IRQn = 4 , RCC_IRQn = 5 , EXTI0_IRQn = 6 ,
  EXTI1_IRQn = 7 , EXTI2_TSC_IRQn = 8 , EXTI3_IRQn = 9 , EXTI4_IRQn = 10 ,
  DMA1_Channel1_IRQn = 11 , DMA1_Channel2_IRQn = 12 , DMA1_Channel3_IRQn = 13 , DMA1_Channel4_IRQn = 14 ,
  DMA1_Channel5_IRQn = 15 , DMA1_Channel6_IRQn = 16 , DMA1_Channel7_IRQn = 17 , ADC1_2_IRQn = 18 ,
  USB_HP_CAN_TX_IRQn = 19 , USB_LP_CAN_RX0_IRQn = 20 , CAN_RX1_IRQn = 21 , CAN_SCE_IRQn = 22 ,
  EXTI9_5_IRQn = 23 , TIM1_BRK_TIM15_IRQn = 24 , TIM1_UP_TIM16_IRQn = 25 , TIM1_TRG_COM_TIM17_IRQn = 26 ,
  TIM1_CC_IRQn = 27 , TIM2_IRQn = 28 , TIM3_IRQn = 29 , TIM4_IRQn = 30 ,
  I2C1_EV_IRQn = 31 , I2C1_ER_IRQn = 32 , I2C2_EV_IRQn = 33 , I2C2_ER_IRQn = 34 ,
  SPI1_IRQn = 35 , SPI2_IRQn = 36 , USART1_IRQn = 37 , USART2_IRQn = 38 ,
  USART3_IRQn = 39 , EXTI15_10_IRQn = 40 , RTC_Alarm_IRQn = 41 , USBWakeUp_IRQn = 42 ,
  TIM8_BRK_IRQn = 43 , TIM8_UP_IRQn = 44 , TIM8_TRG_COM_IRQn = 45 , TIM8_CC_IRQn = 46 ,
  ADC3_IRQn = 47 , FMC_IRQn = 48 , SPI3_IRQn = 51 , UART4_IRQn = 52 ,
  UART5_IRQn = 53 , TIM6_DAC_IRQn = 54 , TIM7_IRQn = 55 , DMA2_Channel1_IRQn = 56 ,
  DMA2_Channel2_IRQn = 57 , DMA2_Channel3_IRQn = 58 , DMA2_Channel4_IRQn = 59 , DMA2_Channel5_IRQn = 60 ,
  ADC4_IRQn = 61 , COMP1_2_3_IRQn = 64 , COMP4_5_6_IRQn = 65 , COMP7_IRQn = 66 ,
  I2C3_EV_IRQn = 72 , I2C3_ER_IRQn = 73 , USB_HP_IRQn = 74 , USB_LP_IRQn = 75 ,
  USBWakeUp_RMP_IRQn = 76 , TIM20_BRK_IRQn = 77 , TIM20_UP_IRQn = 78 , TIM20_TRG_COM_IRQn = 79 ,
  TIM20_CC_IRQn = 80 , FPU_IRQn = 81 , SPI4_IRQn = 84
}
 STM32F303xE devices Interrupt Number Definition, according to the selected device in Library_configuration_section. More...
 

Detailed Description

CMSIS STM32F303xE Devices Peripheral Access Layer Header File.

Author
MCD Application Team 
     This file contains:
      - Data structures and the address mapping for all peripherals
      - Peripheral's registers declarations and bits definition
      - Macros to access peripheral's registers hardware
Attention

© Copyright (c) 2016 STMicroelectronics. All rights reserved.

This software component is licensed by ST under BSD 3-Clause license, the "License"; You may not use this file except in compliance with the License. You may obtain a copy of the License at: opensource.org/licenses/BSD-3-Clause

Generated by doxygen 1.9.7